JPS63269608A - Differential amplifier - Google Patents
Differential amplifierInfo
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Abstract
Description
【発明の詳細な説明】
[発明の目的]
(産業上の利用分野)
この発明は可聴周波数帯からビデオ周波数帯までの信号
を扱う差動増幅器に係り、特にその出力歪特性の改善に
関する。DETAILED DESCRIPTION OF THE INVENTION [Object of the Invention] (Industrial Application Field) The present invention relates to a differential amplifier that handles signals from an audio frequency band to a video frequency band, and particularly relates to improving its output distortion characteristics.
(従来の技術)
可聴周波数帯からビデオ周波数帯までの信号を扱う差動
増幅器は、基本的に第2図に示すように構成される。(Prior Art) A differential amplifier that handles signals from the audio frequency band to the video frequency band is basically configured as shown in FIG.
すなわち、トランジスタQl、Q2及びエミッタ抵抗R
1,R2からなる差動対回路は定電流源11によってバ
イアスされる。トランジスタQl。That is, transistors Ql, Q2 and emitter resistance R
1 and R2 is biased by a constant current source 11. Transistor Ql.
Q2の各ベースにはそれぞれベース抵抗R3゜R4を介
して定電圧源E1からのバイアス電流が加えられている
。また、トランジスタQ2のベースにはコンデンサCI
を介して入力信号Vinが加えられる。A bias current from a constant voltage source E1 is applied to each base of Q2 via a base resistor R3°R4. Also, a capacitor CI is connected to the base of the transistor Q2.
An input signal Vin is applied via.
トランジスタQ1のコレクタ電流はダイオードD1、抵
抗R5,R7、)ランジスタQ3よりなる第2のカレン
トミラー回路の入力端に入力され、トランジスタQ2の
コレクタ電流はダイオードD2、抵抗Re、R8、)ラ
ンジスタQ4よりなる第2のカレントミラー回路の入力
端に入力される。トランジスタQ3.Q4のエミッタ間
には抵抗R9が接続される。The collector current of transistor Q1 is input to the input terminal of a second current mirror circuit consisting of diode D1, resistors R5, R7, ) transistor Q3, and the collector current of transistor Q2 is input from diode D2, resistors Re, R8, ) transistor Q4. It is input to the input terminal of the second current mirror circuit. Transistor Q3. A resistor R9 is connected between the emitter of Q4.
第1のカレントミラー回路の出力電流はダイオードD3
及びトランジスタQ5よりなる第3のカレントミラー回
路の入力端に入力され、第2のカレントミラー回路の出
力電流は第3のカレントミラー回路の出力電流と加算さ
れて負荷抵抗RIGに入力される。この負荷抵抗RIO
には定電圧源E2によってバイアス電圧v2が加えられ
ている。The output current of the first current mirror circuit is the diode D3.
The output current of the second current mirror circuit is added to the output current of the third current mirror circuit and is input to the load resistor RIG. This load resistance RIO
A bias voltage v2 is applied to by a constant voltage source E2.
上記構成において、入力信号Vinは差動対回路によっ
て電圧・電流変換され、差動電流信号となってトランジ
スタQl、Q2のコレクタに現れる。In the above configuration, the input signal Vin is voltage-to-current converted by the differential pair circuit, and appears as a differential current signal at the collectors of the transistors Ql and Q2.
各コレクタ電流をそれぞれ第1、第2のカレントミラー
回路で逆方向電流に変換し、さらに第3のカレントミラ
ー回路で逆方向電流に変換することにより、差動電流信
号はシングル・エンド化され、変化電流分は2倍になる
。この電流信号は負荷抵抗RIOに流れ、これによって
電流・電圧変換されて出力電圧V outとして出力さ
れる。By converting each collector current into a reverse current in the first and second current mirror circuits, and further converting it into a reverse current in the third current mirror circuit, the differential current signal is made single-ended. The amount of changing current is doubled. This current signal flows through the load resistor RIO, where it is converted into current and voltage and output as an output voltage V out.
ここで、トランジスタQ3.Q4のエミッタ間に接続さ
れた抵抗R9は上記の変化電流を増幅するためのもので
ある。つまり、トランジスタQ3゜Q4のエミッタ電位
は差動的に変化するので、抵抗R9の中点は仮想接地点
となる。このとき、トランジスタQ3のエミッタにかか
る抵抗分はR7とR9/2との並列抵抗分、トランジス
タQ4のエミッタにかかる抵抗分は抵抗R8とR9/2
の並列抵抗分と等価になり、上記変化電流分が増えると
抵抗値が下がる。換言すれば、第1、第2のカレントミ
ラー回路の出力側トランジスタQ3゜Q4のミラー比が
等測的に大きくなったことになり、差動対回路から出力
される信号電流は第1、第2のカレントミラー回路によ
って増幅されたことになる。Here, transistor Q3. A resistor R9 connected between the emitters of Q4 is for amplifying the above changing current. That is, since the emitter potentials of the transistors Q3 and Q4 change differentially, the midpoint of the resistor R9 becomes a virtual ground point. At this time, the resistance applied to the emitter of transistor Q3 is the parallel resistance of R7 and R9/2, and the resistance applied to the emitter of transistor Q4 is the parallel resistance of R8 and R9/2.
It is equivalent to the parallel resistance of , and as the variable current increases, the resistance value decreases. In other words, the mirror ratios of the output side transistors Q3゜Q4 of the first and second current mirror circuits have become isometrically larger, and the signal current output from the differential pair circuits has become larger than the first and second current mirror circuits. This means that the signal is amplified by the current mirror circuit No. 2.
しかしながら、上記のような従来の差動増幅器は以下の
ような問題を有する。すなわち、トランジスタのベース
・エミッタ間電圧VBEは指数関数で表わされ、電流が
増えれば増加する。しかし、第2図において、トランジ
スタQlのコレクタ電流がリニアに増加した場合を考え
ると、トランジスタQ2のコレクタ電流も増加するが、
上記理由によってQ2のコレクタ電位はリニアに変化せ
ず、下がりきらない状態になる。逆にトランジスタQ1
のコレクタ電流が減少した場合にはトランジスタQ2の
コレクタ電位は上がりきらない状態となる。したがって
、電流出力信号は主に奇数次の歪成分を持つことになり
、これが出力電圧v outに影響して歪発生の原因と
なっている。However, the conventional differential amplifier as described above has the following problems. That is, the base-emitter voltage VBE of the transistor is expressed by an exponential function, and increases as the current increases. However, in FIG. 2, if we consider the case where the collector current of transistor Ql increases linearly, the collector current of transistor Q2 also increases.
Due to the above-mentioned reason, the collector potential of Q2 does not change linearly and cannot fall completely. Conversely, transistor Q1
If the collector current of transistor Q2 decreases, the collector potential of transistor Q2 will not be able to rise completely. Therefore, the current output signal mainly has odd-order distortion components, which affect the output voltage v out and cause distortion.
(発明が解決しようとする問題点)
以上述べたように従来の差動増幅器は、差動−5一
対回路の出力電流が入力電圧の変化分に比例しないため
、出力電圧に歪を発生するという問題があった。(Problems to be Solved by the Invention) As stated above, conventional differential amplifiers generate distortion in the output voltage because the output current of the differential -5 pair circuit is not proportional to the change in input voltage. There was a problem.
この発明は上記問題を解決するためになされたもので、
極めて低歪で可聴周波数帯からヒデオ周波数帯までリニ
アに増幅することのできる差動増幅器を提供することを
目的とする。This invention was made to solve the above problem.
It is an object of the present invention to provide a differential amplifier that can linearly amplify from an audio frequency band to a video frequency band with extremely low distortion.
[発明の構成]
(問題点を解決するための手段)
上記目的を達成するためにこの発明に係る差動増幅器は
、定電流を入力電圧に応じて分流出力する差動対回路と
、この差動対回路の一方の出力電流を入力して第1のト
ランジスタにより逆方向の電流を生成し、この逆方向電
流とバイアス電流を加算して第2のトランジスタを制御
し、この第2のトランジスタの一方の非制御電極を第1
の抵抗を介して前記第1のトランジスタの制御電極に接
続してなる第1のカレントミラー回路と、前記差動対回
路の他方の出力電流を入力して第3のトランジスタによ
り逆方向の電流を生成し、この逆方向電流とバイアス電
流を加算して第4のトランジスタを制御し、この第4の
トランジスタの一方の非制御電極を第2の抵抗を介して
前記第3のトランジスタの制御電極に接続してなる第2
のカレントミラー回路と、前記第2及び第4のトランジ
スタの一方の被制御電極間に接続される抵抗と、前記第
2のトランジスタの他方の被制御電極から出力される電
流を入力して逆方向の電流を生成出力する第3のカレン
トミラー回路と、この第3のカレントミラー回路の折返
し電流と前記第4のトランジスタの他方の被制御電極か
ら出力される電流とを加算出力する出力回路とを具備し
て構成される。[Structure of the Invention] (Means for Solving the Problems) In order to achieve the above object, a differential amplifier according to the present invention includes a differential pair circuit that divides and outputs a constant current according to an input voltage, and a differential pair circuit that divides and outputs a constant current according to an input voltage. The output current of one side of the dynamic pair circuit is input, a current in the opposite direction is generated by the first transistor, and this reverse direction current and the bias current are added to control the second transistor. One non-control electrode
A first current mirror circuit connected to the control electrode of the first transistor through a resistor and the other output current of the differential pair circuit are inputted, and a third transistor generates a current in the opposite direction. A fourth transistor is controlled by adding this reverse current and a bias current, and one non-control electrode of the fourth transistor is connected to the control electrode of the third transistor via a second resistor. The second one connected
a current mirror circuit, a resistor connected between one of the controlled electrodes of the second and fourth transistors, and a current output from the other controlled electrode of the second transistor. a third current mirror circuit that generates and outputs a current; and an output circuit that adds and outputs the folded current of the third current mirror circuit and the current output from the other controlled electrode of the fourth transistor. It is equipped with and configured.
(作用)
上記構成による差動増幅器では、第1、第2のカレント
ミラー回路において、第2のトランジスタと第1の抵抗
、第4のトランジスタと第2の抵抗は負帰還回路を構成
しており、それぞれ差動対回路からの電流は第1、第3
のトランジスタで逆方向電流に変換された後、第2、第
4のトランジスタ、第1、第2の抵抗を介して負帰還さ
れる。(Function) In the differential amplifier having the above configuration, in the first and second current mirror circuits, the second transistor and the first resistor, and the fourth transistor and the second resistor constitute a negative feedback circuit. , the current from the differential pair circuit is the first, third
After being converted into a reverse current by the transistor, negative feedback is provided via the second and fourth transistors and the first and second resistors.
このとき、第1、第2の抵抗に流れる電流によって発生
する電圧は第1、第3のトランジスタの制御・被制御量
電圧に依存せず、差動対回路の出力電流に対してリニア
に変化する。そこで、差動電圧が発生する第2、第4の
トランジスタの各一方の被制御電極間に増幅用の第3の
抵抗を接続することにより、リニアに差動電流を増幅す
ることができる。At this time, the voltage generated by the current flowing through the first and second resistors does not depend on the controlled/controlled amount voltage of the first and third transistors, and changes linearly with the output current of the differential pair circuit. do. Therefore, by connecting a third resistor for amplification between the controlled electrodes of each of the second and fourth transistors where the differential voltage is generated, the differential current can be linearly amplified.
(実施例)
以下、第1図を参照してこの発明の一実施例を説明する
。(Embodiment) An embodiment of the present invention will be described below with reference to FIG.
第1図は第2図に示した差動増幅器にこの発明を適用し
た場合の構成を示すものである。第1図において、第2
図と同一部分には同一符号を付して示し、その説明を省
略する。FIG. 1 shows a configuration in which the present invention is applied to the differential amplifier shown in FIG. In Figure 1, the second
Components that are the same as those in the figures are designated by the same reference numerals, and their explanations will be omitted.
この差動増幅器は、前記第1のカレントミラー回路の出
力端であるトランジスタQ3のコレクタを定電流源I2
によってバイアスし、Q3のコレクタ電流をトランジス
タQ6のベースに供給する。This differential amplifier connects the collector of the transistor Q3, which is the output terminal of the first current mirror circuit, to the constant current source I2.
and supplies the collector current of Q3 to the base of transistor Q6.
第2のカレントミラー回路の出力端であるトランジスタ
Q4のコレクタを定電流源I3によりてバイアスし、Q
4のコレクタ電流をトランジスタQ7のベースに供給す
る。トランジスタQ6のエミッタを抵抗RLIを介して
Q3のベースに接続して負帰還路を形成し、コレクタを
第3のカレントミラー回路の出力端であるトランジスタ
Q5のコレクタに接続する。トランジスタQ7のエミッ
タを抵抗R12を介してQ4のベースに接続して負帰還
路を形成し、コレクタを第3のカレントミラー回路の入
力端であるトランジスタQ5のベースに接続する。そし
て、前記抵抗R9をトランジスタQB、Q7のエミッタ
間に接続するようにしたものである。The collector of the transistor Q4, which is the output end of the second current mirror circuit, is biased by the constant current source I3, and the Q
A collector current of 4 is supplied to the base of transistor Q7. The emitter of transistor Q6 is connected to the base of Q3 via resistor RLI to form a negative feedback path, and the collector is connected to the collector of transistor Q5, which is the output end of the third current mirror circuit. The emitter of transistor Q7 is connected to the base of Q4 via resistor R12 to form a negative feedback path, and the collector is connected to the base of transistor Q5, which is the input end of the third current mirror circuit. The resistor R9 is connected between the emitters of the transistors QB and Q7.
すなわち、第1のカレントミラー回路はトランジスタQ
6及び抵抗R11を含めて構成され、第2のカレントミ
ラー回路はトランジスタQ7及び抵抗R12を含めて構
成される。このため、差動対回路の出力電流はトランジ
スタQ6.Q7のコレクタに現れる。しかし、Q6.Q
7のコレクタ電流はQ3.Q4のコレクタ電流に対して
逆相であるので、Q7のコレクタ電流を第3のカレント
ミラー回路の入力端に供給し、Q6のコレクタ電流を第
3のカレントミラー回路の出力電流と加算して負荷抵抗
R10に内力するようにしている。That is, the first current mirror circuit consists of the transistor Q
6 and a resistor R11, and the second current mirror circuit includes a transistor Q7 and a resistor R12. Therefore, the output current of the differential pair circuit is the same as that of transistor Q6. Appears in the collector of Q7. However, Q6. Q
7 collector current is Q3. Since the phase is opposite to the collector current of Q4, the collector current of Q7 is supplied to the input terminal of the third current mirror circuit, and the collector current of Q6 is added to the output current of the third current mirror circuit to generate the load. An internal force is applied to the resistor R10.
ここで、第1のカレントミラー回路についてみると、定
電流源■2の電流のほとんどが抵抗R7とトランジスタ
Q3に流れ、ミラー比が1=1とすればダイオードDi
にも同等の電流が流れる。Now, regarding the first current mirror circuit, most of the current from constant current source 2 flows through resistor R7 and transistor Q3, and if the mirror ratio is 1=1, diode Di
The same current flows through.
ダイオードD1に流れる電流はトランジスタQ1のコレ
クタ電流となるので、抵抗R7及びトランジスタQ3に
は定電流源I2の電流とトランジスタQ1のコレクタ電
流との差電流が流れることになる。Since the current flowing through the diode D1 becomes the collector current of the transistor Q1, a difference current between the current of the constant current source I2 and the collector current of the transistor Q1 flows through the resistor R7 and the transistor Q3.
ここで、各トランジスタの順方向電流増幅率βが充分大
きいとすれば、トランジスタQ3、ダイオードDIに流
れる電流は一定となり、トランジスタQ1のコレクタ電
流の増減に対応してトランジスタQ6に流れる電流も増
減する。その大きさは等しく、位相は逆である。このこ
とは第2のカレントミラー回路についても同じである。Here, if the forward current amplification factor β of each transistor is sufficiently large, the current flowing through transistor Q3 and diode DI will be constant, and the current flowing through transistor Q6 will also increase or decrease in response to an increase or decrease in the collector current of transistor Q1. . Their magnitudes are equal and their phases are opposite. This also applies to the second current mirror circuit.
以上のことから、トランジスタQ3.Q4のベース電位
はトランジスタQl、Q2のコレクタ電流が変化しても
変動せず、トランジスタ。6゜Q7のエミッタ電位が増
減した電流によって変動する。このとき、トランジスタ
Q8.Q7のベース・エミッタ電圧VBF、は増減電流
によって変化するが、抵抗RLI、 R12に発生する
電圧信号に対しては同等影響しない。つまり、トランジ
スタQ6とQ7の各エミッタにはそれぞれ逆相の信号が
発生する。この状態で抵抗R9をトランジスタQB、Q
7のエミッタ間に介在させることによって、変化電流を
増幅する。この場合、差動対回路の出力電流信号を電圧
信号としてリニアに発生させるので、出力電圧V ou
t も従来のものに比して極めて低歪となる。From the above, transistor Q3. The base potential of Q4 does not change even if the collector currents of transistors Ql and Q2 change; The emitter potential of 6°Q7 fluctuates depending on the increased or decreased current. At this time, transistor Q8. Although the base-emitter voltage VBF of Q7 changes depending on the increase or decrease in current, it does not have the same effect on the voltage signal generated across resistors RLI and R12. That is, signals of opposite phases are generated at the emitters of transistors Q6 and Q7, respectively. In this state, resistor R9 is connected to transistors QB, Q
By interposing it between the emitters of 7, the changing current is amplified. In this case, since the output current signal of the differential pair circuit is linearly generated as a voltage signal, the output voltage V ou
t also has extremely low distortion compared to the conventional one.
したがって、上記構成にょる差動増幅器は、差動対回路
の出力電流をリニアに増幅することができるので、出力
電圧の歪を充分低減することができる。Therefore, since the differential amplifier having the above configuration can linearly amplify the output current of the differential pair circuit, distortion of the output voltage can be sufficiently reduced.
ところで、同一負荷抵抗を多数の差動増幅器でドライブ
するような場合、従来では、第2図の回路において抵抗
R9を省略し、カレントミラー比でゲインを上げる方法
がとられる。しかし、このような方法ではミラー比が整
数比の場合にしか入出力電流をリニアにすることができ
ず、差動対回路の電圧・電流変換率が一定ならばとびと
びのゲイン値しかとることができない。また、出力歪が
増大するので、好ましくない。この発明に係る差動増幅
器を用いれば、抵抗R9、RIL、 R12及び定電流
源I2,13の値を適当に設定すれば、ゲインを連続値
として設定でき、ゲインの設定に自由度があるので、あ
る一段の増幅器のゲインを上げるのに極めて有効である
。By the way, when the same load resistance is driven by a large number of differential amplifiers, conventionally, the resistor R9 is omitted from the circuit shown in FIG. 2, and the gain is increased by the current mirror ratio. However, with this method, the input/output current can only be made linear when the mirror ratio is an integer ratio, and if the voltage/current conversion rate of the differential pair circuit is constant, only discrete gain values can be obtained. Can not. Furthermore, output distortion increases, which is not preferable. If the differential amplifier according to the present invention is used, the gain can be set as a continuous value by appropriately setting the values of the resistors R9, RIL, R12 and constant current sources I2, 13, and there is a degree of freedom in setting the gain. , is extremely effective in increasing the gain of a certain single stage amplifier.
尚、上記実施例において、ダイオードD1゜D2を省略
し、抵抗R5,R[fを適当な値に設定するようにして
も、温度一定ならば同等の効果を得ることができる。In the above embodiment, even if the diodes D1 and D2 are omitted and the resistors R5 and R[f are set to appropriate values, the same effect can be obtained as long as the temperature is constant.
[発明の効果コ
以上のようにこの発明によれば、極めて低い歪で可聴周
波数帯からヒデオ周波数帯までリニアに増幅することの
できる差動増幅器を提供することができる。[Effects of the Invention] As described above, according to the present invention, it is possible to provide a differential amplifier capable of linearly amplifying from the audio frequency band to the video frequency band with extremely low distortion.
第1図はこの発明に係る差動増幅器の一実施例を示す回
路図、第2図はこの発明が適用される従来の差動増幅器
の構成を示す回路図である。
Q1〜Q7・・・トランジスタ、R1−R12・・・抵
抗、■1〜■3・・・定電流源、El、E2・・・定電
圧源、Vin・・・入力電圧、V out・・・出力電
圧。FIG. 1 is a circuit diagram showing an embodiment of a differential amplifier according to the present invention, and FIG. 2 is a circuit diagram showing the configuration of a conventional differential amplifier to which the present invention is applied. Q1 to Q7...Transistor, R1-R12...Resistor, ■1 to ■3... Constant current source, El, E2... Constant voltage source, Vin... Input voltage, V out... Output voltage.
Claims (1)
この差動対回路の一方の出力電流を入力して第1のトラ
ンジスタにより逆方向の電流を生成し、この逆方向電流
とバイアス電流を加算して第2のトランジスタを制御し
、この第2のトランジスタの一方の非制御電極を第1の
抵抗を介して前記第1のトランジスタの制御電極に接続
してなる第1のカレントミラー回路と、前記差動対回路
の他方の出力電流を入力して第3のトランジスタにより
逆方向の電流を生成し、この逆方向電流とバイアス電流
を加算して第4のトランジスタを制御し、この第4のト
ランジスタの一方の非制御電極を第2の抵抗を介して前
記第3のトランジスタの制御電極に接続してなる第2の
カレントミラー回路と、前記第2及び第4のトランジス
タの一方の被制御電極間に接続される抵抗と、前記第2
のトランジスタの他方の被制御電極から出力される電流
を入力して逆方向の電流を生成出力する第3のカレント
ミラー回路と、この第3のカレントミラー回路の折返し
電流と前記第4のトランジスタの他方の被制御電極から
出力される電流とを加算出力する出力回路とを具備する
差動増幅器。A differential pair circuit that divides and outputs a constant current according to the input voltage,
One output current of this differential pair circuit is input, a current in the opposite direction is generated by the first transistor, and the second transistor is controlled by adding this reverse direction current and the bias current. a first current mirror circuit formed by connecting one non-control electrode of the transistor to the control electrode of the first transistor through a first resistor, and inputting the output current of the other of the differential pair circuit; A third transistor generates a reverse current, the reverse current and a bias current are added together to control a fourth transistor, and one non-control electrode of the fourth transistor is connected through a second resistor. a second current mirror circuit connected to the control electrode of the third transistor; a resistor connected between the controlled electrodes of one of the second and fourth transistors;
a third current mirror circuit that inputs the current output from the other controlled electrode of the transistor and generates and outputs a current in the opposite direction; A differential amplifier comprising an output circuit that adds and outputs the current output from the other controlled electrode.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62103244A JPS63269608A (en) | 1987-04-28 | 1987-04-28 | Differential amplifier |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62103244A JPS63269608A (en) | 1987-04-28 | 1987-04-28 | Differential amplifier |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63269608A true JPS63269608A (en) | 1988-11-07 |
Family
ID=14349027
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP62103244A Pending JPS63269608A (en) | 1987-04-28 | 1987-04-28 | Differential amplifier |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63269608A (en) |
-
1987
- 1987-04-28 JP JP62103244A patent/JPS63269608A/en active Pending
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