JPS6324706Y2 - - Google Patents
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- JPS6324706Y2 JPS6324706Y2 JP4502679U JP4502679U JPS6324706Y2 JP S6324706 Y2 JPS6324706 Y2 JP S6324706Y2 JP 4502679 U JP4502679 U JP 4502679U JP 4502679 U JP4502679 U JP 4502679U JP S6324706 Y2 JPS6324706 Y2 JP S6324706Y2
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- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 description 6
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- 238000000034 method Methods 0.000 description 1
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Description
【考案の詳細な説明】
本考案はICに外付けされる第1線路群と第2
線路群の各交点にキースイツチを配して前記キー
スイツチにより選択的に前記交点を接続するよう
にした回路装置において、前記ICの動作表示に
関するものである。[Detailed explanation of the invention] This invention is based on the first line group and the second line group externally attached to the IC.
The present invention relates to an operation display of the IC in a circuit device in which a key switch is provided at each intersection of a group of lines, and the key switch selectively connects the intersection.
第1図は前記ICとしてテレビジヨン受像機の
リモートコントロール送信器用のIC1〔該ICは
電源入力用端子18とアース用端子19とを有し
ている〕を例に挙げて従来の回路装置を示すもの
であつて、l1〜l8は前記IC1のキー入力端
子I1〜I8に接続された第1線路群、L1〜L
4はキー出力端子φ1〜φ4に接続された第2線
路群、2は前記第1線路群と第2線路群の各交点
にキースイツチS1〜S32を配したマトリツク
ス・キースイツチ装置である。いずれかのキース
イツチを押すと、キー出力端子φ1〜φ4のハイ
レベル状態が順次転移し、第1線路群l1〜l8
のうち押されているキースイツチによつて接続さ
れた線路が周期的にハイレベルとなり、他の第1
線路群はローレベルの状態のままである。斯るキ
ー入力はIC1内でコード化されキヤリアをパル
ス変調する。そのパルス変調信号が出力端子Oか
ら外付けの駆動トランジスタ3のベースに印加さ
れて、該トランジスタ3をオン・オフし赤外線発
光ダイオード4,5を信号に応じて駆動する。6
はモード切換えスイツチで、スイツチをオンして
端子7をアース状態に保持する場合と、スイツチ
6をオフにして電源電圧(Vcc)に保持する場合
とでキースイツチS1〜S32による情報量をこ
のスイツチ6がない場合に比し2倍に設定可能と
する。8は電源用の電池である。 FIG. 1 shows a conventional circuit device, taking as an example an IC 1 for a remote control transmitter of a television receiver (the IC has a power input terminal 18 and a ground terminal 19). 11 to 18 are first line groups L1 to L connected to the key input terminals I1 to I8 of the IC1.
4 is a second line group connected to the key output terminals φ1 to φ4; 2 is a matrix key switch device in which key switches S1 to S32 are arranged at each intersection of the first line group and the second line group. When any key switch is pressed, the high level state of the key output terminals φ1 to φ4 is sequentially transferred to the first line group l1 to l8.
The line connected by the pressed key switch periodically becomes high level, and the other
The line group remains at a low level. Such key inputs are encoded within IC1 and pulse modulate the carrier. The pulse modulation signal is applied from the output terminal O to the base of an external drive transistor 3, turning on and off the transistor 3 and driving the infrared light emitting diodes 4 and 5 in accordance with the signal. 6
is a mode changeover switch, and the amount of information provided by key switches S1 to S32 is changed depending on whether the switch 6 is turned on and terminal 7 is held in the grounded state or the switch 6 is turned off and held at the power supply voltage (Vcc). It can be set twice as much as when there is no. 8 is a battery for power supply.
このような回路装置において、従来はいずれか
のキースイツチを押した時にキヤリア発生用の発
振器が動作し、その共振子であるセラミツクフイ
ルタ9及びコンデンサ10,11による外付け回
路12〔端子16,17に外付け〕の点イに電圧
が生じるのを利用し、この点の電圧を電流制限抵
抗13を介してトランジスタ14に印加すること
により、そのコレクタと電池8との間に挿入した
発光ダイオード15を駆動してIC1の動作表示
を行なうようにしていた。 In such a circuit device, conventionally, when one of the key switches is pressed, an oscillator for carrier generation operates, and an external circuit 12 (terminals 16, 17) is connected to the ceramic filter 9, which is the resonator, and the capacitors 10, 11. By applying the voltage at this point to the transistor 14 via the current limiting resistor 13, the light-emitting diode 15 inserted between the collector and the battery 8 is activated. It was designed to display the operation of IC1 by driving it.
しかしながら、このように発振回路に生じる電
圧を利用するものにあつては、発振回路の周波数
安定性が損なわれる原因となり、好ましくない。 However, in the case where the voltage generated in the oscillation circuit is used in this way, it is not preferable because it causes the frequency stability of the oscillation circuit to be impaired.
また表示用部品点数も多くコストアツプを招来
する。 Furthermore, the number of display parts is large, leading to an increase in costs.
本考案は表示用発光ダイオードを駆動するため
の専用端子をICに設けることなく上記の欠点を
解消するように工夫した回路装置を提案するもの
であり、以下図面に示した実施例に従つて説明す
る。 The present invention proposes a circuit device devised to eliminate the above drawbacks without providing a dedicated terminal on the IC for driving display light emitting diodes. do.
第2図は本考案の一実施例を示しており、ここ
ではIC1の動作表示用発光ダイオード15はIC
1のキー出力端子φ1に接続されている。即ち発
光ダイオード15のカソードが線路L1を介して
キー出力端子φ1に結合され、アノードは電流制
限抵抗20を介して電池8に接続されている。 FIG. 2 shows an embodiment of the present invention, in which the light emitting diode 15 for indicating the operation of the IC1 is
It is connected to the key output terminal φ1 of No. 1. That is, the cathode of the light emitting diode 15 is coupled to the key output terminal φ1 via the line L1, and the anode is connected to the battery 8 via the current limiting resistor 20.
このように接続した場合の発光ダイオード15
の動作を理解するために第3図ではIC1の内部
の構成も示している。 Light emitting diode 15 when connected like this
In order to understand the operation of IC1, FIG. 3 also shows the internal configuration of IC1.
第3図において、21はキー入力端子I1〜I
8の入力内容に応じて5ビツトのコード化された
出力を生じるキーインエンコーダであり、このエ
ンコーダ21の出力は次段のインストラクシヨ
ン・デコーダ(命令デコーダ)22にレジストさ
れる。このインストラクシヨンデコーダ22がキ
ーインエンコーダ21から信号を受けている間
(従つて、キースイツチが押されている間)、イン
ストラクシヨン・デコーダ22から発振回路25
へ該発振回路25を駆動する信号が与えられる。
発振回路25の出力(周波数455KHz)は次段の
分周器26によつて10分の1の45.5KHzのキヤリ
ア用と、それよりも低周波数のクロツク用に分周
され、そのキヤリアはタイミング発生回路23を
経て変調回路27に加えられ、クロツク信号は前
記タイミング発生回路23を経てインストラクシ
ヨン・デコーダ22とスキヤン信号発生回路24
に供給される。スキヤン信号発生回路24の出力
はクロツク信号が与えられる前はキー出力端子φ
1〜φ4の全てについてハイレベルの状態である
が、最初のクロツク信号部分により一たんローレ
ベルの状態(第4図のt0〜t1)に設定され、
その後出力端子φ1〜φ4についてハイレベルを
順次転移する。変調回路27ではタイミング発生
回路23を通して与えられたキヤリアをインスト
ラクシヨン・デコーダ22からのコード信号によ
つてパルス変調する。このパルス変調波はバツフ
ア回路28を介して出力端子Oに導出される。3
1はモード切換えスイツチ6により端子7のレベ
ル状態がハイレベルかローレベルかを検出し、そ
れに応じてインストラクシヨン・デコーダ22の
コードをかえて扱う情報内容を多くするモードチ
エツク回路である。29はキー出力端子φ1と電
池8との間に表示用発光ダイオード15を接続し
たために発光ダイオード15を流れる電流を流れ
込ませるための電流吸収回路であり、前記発光ダ
イオード15に流れる電流がスキヤン信号発生回
路24側に流れないようにする。尚、完全を期す
るためダイオード30を図示の如くIC1内部で
追加するとよい。前記電流吸収回路29はキー出
力端子φ1がローレベルのときのみオンしてその
入力端子をローレベルとし、それ以外のときはハ
イレベルとするような制御をスキヤン信号発生回
路24から受ける。もし、この電流吸収回路29
の入力端がローレベルのままであれば出力端子φ
1はいつもローレベルになつて情報の誤りの原因
となるからである。第3図において、31はモー
ドチエツク回路であり、端子7を介して外付けの
スイツチ6に接続されている。 In FIG. 3, 21 is a key input terminal I1 to I
The encoder 21 is a key-in encoder that produces a 5-bit coded output according to the input contents of the encoder 21, and the output of this encoder 21 is registered in an instruction decoder 22 at the next stage. While this instruction decoder 22 is receiving a signal from the key-in encoder 21 (therefore, while the key switch is being pressed), the instruction decoder 22 receives a signal from the oscillation circuit 25.
A signal for driving the oscillation circuit 25 is applied to the oscillation circuit 25.
The output of the oscillation circuit 25 (frequency 455KHz) is divided by the next-stage frequency divider 26 into a 1/10 45.5KHz carrier and a lower frequency clock, and the carrier is used for timing generation. The clock signal is applied to the modulation circuit 27 via the circuit 23, and the clock signal is applied to the instruction decoder 22 and the scan signal generation circuit 24 via the timing generation circuit 23.
supplied to The output of the scan signal generation circuit 24 is at the key output terminal φ before the clock signal is applied.
1 to φ4 are all in a high level state, but are temporarily set to a low level state (t0 to t1 in FIG. 4) by the first clock signal portion,
Thereafter, the high level is sequentially transferred to the output terminals φ1 to φ4. The modulation circuit 27 pulse-modulates the carrier supplied through the timing generation circuit 23 using the code signal from the instruction decoder 22. This pulse modulated wave is led out to the output terminal O via the buffer circuit 28. 3
Reference numeral 1 denotes a mode check circuit which detects whether the level state of the terminal 7 is high or low by the mode changeover switch 6, and changes the code of the instruction decoder 22 accordingly to increase the information content handled. 29 is a current absorption circuit for allowing the current flowing through the light emitting diode 15 to flow because the display light emitting diode 15 is connected between the key output terminal φ1 and the battery 8, and the current flowing through the light emitting diode 15 generates a scan signal. Prevent it from flowing to the circuit 24 side. For completeness, it is recommended to add a diode 30 inside the IC 1 as shown in the figure. The current absorbing circuit 29 is controlled by the scan signal generating circuit 24 so that it is turned on only when the key output terminal φ1 is at a low level, and its input terminal is at a low level, and at other times, it is at a high level. If this current absorption circuit 29
If the input terminal of remains low level, the output terminal φ
1 is always at a low level, causing information errors. In FIG. 3, 31 is a mode check circuit, which is connected to an external switch 6 via a terminal 7.
次に第2図、第3図の動作を説明する。いずれ
のキースイツチも押されていない非動作時は、キ
ー出力端子φ1〜φ4は全てハイレベルになつて
いる〔第4図においてt0以前〕ため表示用発光
ダイオード15には順バイアスがかからず、該発
光ダイオード15は消灯している。次に、いずれ
かのキースイツチを押すと、押したキースイツチ
に応じてキー入力端子I1〜I8のうち対応する
キー入力端子にハイレベルの信号が伝送される。
それに従つて、インストラクシヨン・デコーダか
ら発振回路25に動作電圧が送られるので発振回
路25は動作を開始する。その際、タイミング発
生回路23からインストラクシヨン・デコーダ2
2とスキヤン信号発生回路24にクロツクパルス
が与えられ、このスキヤン信号発生回路24の全
ての出力を一たんローレベルになす。第4図にお
いて時間t0〜t1がこれに相当し、約10msec
である。続いてキー出力端子φ1〜φ4には順次
ハイレベル状態が巡回することになり、これに従
つて発光ダイオード15はキー出力端子φ1がハ
イレベルのときt1〜t2,t5〜t6,…消灯
状態で、ローレベルのときt0〜t1,t2〜t
5,…点灯状態となり、キースイツチを押してい
る間中、周期的に消灯と点灯を繰り返す(第4図
から明らかな如く1周期につき点灯時間の方が消
灯時間よりも長い)。 Next, the operations shown in FIGS. 2 and 3 will be explained. When none of the key switches is pressed and is inactive, the key output terminals φ1 to φ4 are all at a high level [before t0 in FIG. 4], so no forward bias is applied to the display light emitting diode 15. The light emitting diode 15 is off. Next, when one of the key switches is pressed, a high level signal is transmitted to the corresponding key input terminal among the key input terminals I1 to I8, depending on the pressed key switch.
Accordingly, an operating voltage is sent from the instruction decoder to the oscillation circuit 25, so that the oscillation circuit 25 starts operating. At this time, the instruction decoder 2 is sent from the timing generation circuit 23.
A clock pulse is applied to the scan signal generating circuit 2 and the scan signal generating circuit 24, and all outputs of the scan signal generating circuit 24 are temporarily brought to a low level. In Fig. 4, the time t0 to t1 corresponds to this, and is approximately 10 msec.
It is. Subsequently, the key output terminals φ1 to φ4 are in a high level state sequentially, and accordingly, when the key output terminal φ1 is at a high level, the light emitting diode 15 is in the off state from t1 to t2, t5 to t6, . . . , t0-t1, t2-t when low level
5. The light is turned on, and the light turns off and on periodically while the key switch is pressed (as is clear from FIG. 4, the light-on time is longer than the light-off time per cycle).
一方、キースイツチによりいずれかのキー出力
端子に接続されたキー入力端子は周期的にハイレ
ベルとなつて、キーインエンコーダ21をそれに
応じたコード化信号が出力されるよう制御する。
インストラクシヨン・デコーダ22はそのコード
信号を記憶保持すると共に変調回路27にそのコ
ード信号の内容を送出する。変調回路27ではタ
イミング信号発生回路23を経由して供給される
キヤリア(45.5KHz)を、そのコード信号でパル
ス変調する。パルス変調された信号はバツフア回
路28及び出力端子Oを通して駆動トランジスタ
3のベースに印加され、そのコレクタと電池8と
の間に接続された赤外線発光ダイオード4,5を
変調信号に応じて駆動する。 On the other hand, the key input terminal connected to one of the key output terminals by the key switch is periodically brought to a high level, and the key-in encoder 21 is controlled to output a corresponding coded signal.
The instruction decoder 22 stores and holds the code signal and sends the contents of the code signal to the modulation circuit 27. The modulation circuit 27 pulse-modulates the carrier (45.5 KHz) supplied via the timing signal generation circuit 23 with the code signal. The pulse-modulated signal is applied to the base of the driving transistor 3 through the buffer circuit 28 and the output terminal O, and drives infrared light emitting diodes 4 and 5 connected between its collector and the battery 8 in accordance with the modulated signal.
スキヤン信号発生回路24はキースイツチを押
している間中、信号を発生するので押しているキ
ースイツチによる入力信号の内容はt1〜t5の
周期に一定の期間キーインエンコーダ21に入力
され、インストラクシヨン・デコーダ22の内容
を入れ替える(勿論、同一内容を入れ替えること
になるが、もし最初のものがノイズ等により誤つ
た内容で記憶保持されている場合には、繰返し入
れ替える方法は、この誤りを解除できるので好ま
しい)。 The scan signal generation circuit 24 generates a signal while the key switch is being pressed, so the content of the input signal from the key switch being pressed is input to the key-in encoder 21 for a certain period of time from t1 to t5, and is input to the instruction decoder 22. Replace the contents (of course, the same contents will be replaced, but if the first one is stored with incorrect contents due to noise etc., the method of repeatedly replacing it is preferable because it can eliminate this error).
第5図は本考案の他の実施例を第3図に準じて
示しており、ここではキー入力端子I1に対し表
示用発光ダイオード15を接続している。従つ
て、発光ダイオード15を流れる電流を吸収する
回路29′はキー入力端子I1側に設けられてい
る。尚、第5図ではキー出力端子φ1〜φ5のハ
イレベルとローレベルの形態が第6図に示す如く
第3図及び第4図の場合とは逆になつている。ま
たキー入力端子I1〜I8はいずれのキースイツ
チも押されていない非動作時はハイレベルである
がキー出力端子I1〜I8からの信号がキースイ
ツチの操作により届いたキー入力端子のみローレ
ベルとなる。今、キースイツチS11が押され
て、キー出力端子φ2とキー入力端子I3が接続
された場合について説明すると、キー入力端子I
3の状態は第6図I3に示す如くt2〜t3及び
t6〜t7の時間にローレベルになる。この信号
がキーインエンコーダ21から電流吸収回路2
9′に送られ該回路29′がt2〜t3,t6〜t
7の期間にオンしてその入力端をローレベルとす
るので表示用発光ダイオード15が点灯するので
ある。このように発光ダイオード15が時間t2
〜t3,t6〜t7において点灯したとき端子I
1もt2〜t3,t6〜t7にローレベルにな
り、情報内容につきI1とI3の間で混同が生じ
るおそれがあるが、これを防止するため入力端子
I1以外の入力端子I2〜I8が選択された場合
は、I1からの信号は情報として取り込まないよ
うにする必要がある。この動作をコントロールす
るのが、入力コントロール回路32である。この
ように第5図の実施例では上述の機能をもつた入
力コントロール回路32を付加する必要がある。 FIG. 5 shows another embodiment of the present invention according to FIG. 3, in which a display light emitting diode 15 is connected to the key input terminal I1. Therefore, the circuit 29' for absorbing the current flowing through the light emitting diode 15 is provided on the key input terminal I1 side. In FIG. 5, the high level and low level forms of the key output terminals φ1 to φ5 are reversed from those in FIGS. 3 and 4, as shown in FIG. 6. Further, the key input terminals I1 to I8 are at a high level when none of the key switches is pressed and are not in operation, but only the key input terminal to which a signal from the key output terminals I1 to I8 is received by the operation of the key switch becomes a low level. Now, to explain the case where the key switch S11 is pressed and the key output terminal φ2 and the key input terminal I3 are connected, the key input terminal I
The state No. 3 becomes low level during times t2 to t3 and t6 to t7 as shown in FIG. 6 I3. This signal is sent from the key-in encoder 21 to the current absorption circuit 2.
9', and the circuit 29' performs t2-t3, t6-t
Since it is turned on during the period 7 and its input terminal is set to a low level, the display light emitting diode 15 lights up. In this way, the light emitting diode 15 lights up at time t2.
Terminal I when lit at ~t3, t6~t7
1 also goes to low level from t2 to t3 and from t6 to t7, and there is a risk of confusion between I1 and I3 regarding the information content, but to prevent this, input terminals I2 to I8 other than input terminal I1 are selected. In this case, it is necessary to prevent the signal from I1 from being taken in as information. The input control circuit 32 controls this operation. Thus, in the embodiment shown in FIG. 5, it is necessary to add an input control circuit 32 having the above-mentioned functions.
本考案によればIC1の端子ピンの数を増加す
ることなく、ICのキー入力端子又は出力端子を
利用することにより最小の外付け部品点数でIC
1の動作表示を行なうことができ、また従来のよ
うに発振回路の安定性を損なうような欠点は生じ
ないという効果がある。 According to the present invention, by using the key input terminal or output terminal of the IC without increasing the number of terminal pins of IC1, the IC can be integrated with a minimum number of external parts.
1 operation display can be performed, and there is an effect that there is no drawback that would impair the stability of the oscillation circuit as in the conventional case.
第1図は従来の回路装置を示す図面である。第
2図は本考案を実施した回路装置の図面であり、
第3図はその一部の詳細図、第4図は説明波形図
である。第5図は本考案の他の実施例の要部詳細
図であり、第6図はその説明波形図である。
l1〜l8……第1線路群、L1〜L4……第
2線路群、1……IC、2……マトリツクスキー
スイツチ装置、S1〜S32……キースイツチ、
3……駆動トランジスタ、4,5……赤外線発光
ダイオード、6……モード切換えスイツチ、8…
…電池、9……セラミツクフイルタ、15……
ICの動作表示用発光ダイオード、I1〜I8…
…キー入力端子、φ1〜φ4……キー出力端子、
21……キーインエンコーダ、22……インスト
ラクシヨン・デコーダ、23……タイミング信号
発生回路、24……スキヤン信号発生回路、25
……発振回路、26……分周器、27……変調回
路、28……バツフア回路、29,29′……電
流吸収回路、32……入力コントロール回路。
FIG. 1 is a drawing showing a conventional circuit device. FIG. 2 is a drawing of a circuit device implementing the present invention,
FIG. 3 is a detailed diagram of a part thereof, and FIG. 4 is an explanatory waveform diagram. FIG. 5 is a detailed diagram of a main part of another embodiment of the present invention, and FIG. 6 is an explanatory waveform diagram thereof. l1-l8...first line group, L1-L4...second line group, 1...IC, 2...matrix key switch device, S1-S32...key switch,
3... Drive transistor, 4, 5... Infrared light emitting diode, 6... Mode changeover switch, 8...
...Battery, 9...Ceramic filter, 15...
Light emitting diodes for indicating IC operation, I1 to I8...
...Key input terminal, φ1 to φ4...Key output terminal,
21... Key-in encoder, 22... Instruction decoder, 23... Timing signal generation circuit, 24... Scan signal generation circuit, 25
... Oscillator circuit, 26 ... Frequency divider, 27 ... Modulation circuit, 28 ... Buffer circuit, 29, 29' ... Current absorption circuit, 32 ... Input control circuit.
Claims (1)
ンサによる外付け回路に発振電圧が生じるIC
に外付けされる第1線路群と第2線路群の各交
点にキースイツチを配して前記キースイツチに
より選択的に前記交点を接続してなる回路配置
において、前記第1線路群の少なくとも1つの
線路又は第2線路群の少なくとも1つの線路に
IC動作表示用の発光ダイオードを接続したこ
とを特徴とする回路装置。 (2) 前記第1、第2線路群の交点部分はマトリツ
クス・キースイツチ装置内に形成されているこ
とを特徴とする実用新案登録請求の範囲第1項
記載の回路装置。[Scope of claim for utility model registration] (1) An IC that generates oscillation voltage in an external circuit using a ceramic filter as a resonator and a capacitor.
In a circuit arrangement in which a key switch is disposed at each intersection of a first line group and a second line group externally connected to the line, and the key switch selectively connects the intersection points, at least one line of the first line group or on at least one track of the second track group.
A circuit device characterized by connecting a light emitting diode for displaying IC operation. (2) The circuit device according to claim 1, wherein the intersection of the first and second line groups is formed within a matrix key switch device.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4502679U JPS6324706Y2 (en) | 1979-04-04 | 1979-04-04 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4502679U JPS6324706Y2 (en) | 1979-04-04 | 1979-04-04 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS55144739U JPS55144739U (en) | 1980-10-17 |
JPS6324706Y2 true JPS6324706Y2 (en) | 1988-07-06 |
Family
ID=28922491
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP4502679U Expired JPS6324706Y2 (en) | 1979-04-04 | 1979-04-04 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6324706Y2 (en) |
-
1979
- 1979-04-04 JP JP4502679U patent/JPS6324706Y2/ja not_active Expired
Also Published As
Publication number | Publication date |
---|---|
JPS55144739U (en) | 1980-10-17 |
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