JPS63141489U - - Google Patents
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- Publication number
- JPS63141489U JPS63141489U JP1987034015U JP3401587U JPS63141489U JP S63141489 U JPS63141489 U JP S63141489U JP 1987034015 U JP1987034015 U JP 1987034015U JP 3401587 U JP3401587 U JP 3401587U JP S63141489 U JPS63141489 U JP S63141489U
- Authority
- JP
- Japan
- Prior art keywords
- circuit board
- chip
- semiconductor non
- memory
- circuit block
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
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Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L2224/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
- H01L2224/161—Disposition
- H01L2224/16151—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/16221—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/16225—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
Landscapes
- Wire Bonding (AREA)
- Non-Volatile Memory (AREA)
- Electric Clocks (AREA)
- Electromechanical Clocks (AREA)
Description
第1図は本考案による電子時計用回路ブロツク
の平面図、第2図は本考案による電子時計用回路
ブロツクの断面図、第3図は本考案による電子時
計用回路ブロツクを組み込んだムーブメントの平
面図、第4図は本考案による電子時計用回路ブロ
ツクを組み込んだムーブメントの断面図である。 1……ICチツプ、2……不輝発性メモリー内
蔵部、3……フレキシブル回路基板、4……銅箔
パターン、5……超小型水晶振動子、6……モー
ルド剤、7……はんだバンプ、8……メモリー消
去用穴、9……地板、10……回路押え板、10
a……回路押え板の穴、11……コイル、12…
…磁心、13……コイルリード基板、14……ス
テータ、15……電池、16……巻真、17……
規正レバー、18……輪列受、19……電池マイ
ナス端子、20……電池絶縁板、21,22,2
3,24,25……ねじ。
の平面図、第2図は本考案による電子時計用回路
ブロツクの断面図、第3図は本考案による電子時
計用回路ブロツクを組み込んだムーブメントの平
面図、第4図は本考案による電子時計用回路ブロ
ツクを組み込んだムーブメントの断面図である。 1……ICチツプ、2……不輝発性メモリー内
蔵部、3……フレキシブル回路基板、4……銅箔
パターン、5……超小型水晶振動子、6……モー
ルド剤、7……はんだバンプ、8……メモリー消
去用穴、9……地板、10……回路押え板、10
a……回路押え板の穴、11……コイル、12…
…磁心、13……コイルリード基板、14……ス
テータ、15……電池、16……巻真、17……
規正レバー、18……輪列受、19……電池マイ
ナス端子、20……電池絶縁板、21,22,2
3,24,25……ねじ。
Claims (1)
- 紫外線消去タイプの半導体不輝発性メモリーを
内蔵するICチツプを回路基板にフエイスダウン
実装する電子時計用回路ブロツクに於いて、前記
回路基板の前記半導体不輝発性メモリー内蔵部に
対応する位置に前記半導体不輝発性メモリーを消
去するための穴を設けるとともに、前記ICチツ
プ及び前記回路基板に前記回路基板の前記ICチ
ツプ装着側からモールド剤等の接着剤を塗布した
ことを特徴とする電子時計用回路ブロツク。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1987034015U JPS63141489U (ja) | 1987-03-09 | 1987-03-09 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1987034015U JPS63141489U (ja) | 1987-03-09 | 1987-03-09 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63141489U true JPS63141489U (ja) | 1988-09-19 |
Family
ID=30842163
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1987034015U Pending JPS63141489U (ja) | 1987-03-09 | 1987-03-09 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63141489U (ja) |
-
1987
- 1987-03-09 JP JP1987034015U patent/JPS63141489U/ja active Pending
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