JPS6310652B2 - - Google Patents
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- JPS6310652B2 JPS6310652B2 JP54015072A JP1507279A JPS6310652B2 JP S6310652 B2 JPS6310652 B2 JP S6310652B2 JP 54015072 A JP54015072 A JP 54015072A JP 1507279 A JP1507279 A JP 1507279A JP S6310652 B2 JPS6310652 B2 JP S6310652B2
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Description
【発明の詳細な説明】
本発明は、例えば直流送電設備における交直変
換装置の起動時もしくは部分的運転から全面的運
転への切換時のバイパススイツチから交直変換装
置への直流電流の切換え方式を改良したサイリス
タ変換装置に関するものである。DETAILED DESCRIPTION OF THE INVENTION The present invention improves a method for switching DC current from a bypass switch to an AC/DC converter in DC power transmission equipment, for example, when starting up the AC/DC converter or switching from partial operation to full operation. This invention relates to a thyristor conversion device.
一般に、直流送電、異周波数系統間直流連系に
おいて、高電圧大容量のサイリスタ式交直変換装
置が採用されている。この種のサイリスタ変換装
置（以下単に変換装置と略記する）は一般に、多
相構成もしくは高電圧化のため、単位変換装置
（通常３相ブリツジ結線）を複数個直列接続され
ている。このような構成において、系統運用上、
全面的運転もしくは部分的運転が繰返し実施され
る。又、単位変換装置が故障した場合に、故障変
換装置を系統より切離し、健全変換装置のみで部
分的に運転することも系統運転信頼性を向上する
上で極めて重要である。このように、全面的運転
部分的運転の切換えを可能にするために、各単
位変換装置の直流側にバイパススイツチを並列に
設置される。バイパススイツチとして、しや断器
等のメカニカルスイツチもしくはサイリスタ等の
半導体スイツチ等を使用することができる。現状
では経済的理由により、メカニカルスイツチが採
用されている。 Generally, high-voltage, large-capacity thyristor-type AC/DC converters are employed in DC power transmission and DC interconnection between systems with different frequencies. This type of thyristor conversion device (hereinafter simply referred to as a conversion device) generally has a plurality of unit conversion devices (usually three-phase bridge connection) connected in series in order to have a multiphase configuration or a high voltage. In such a configuration, in terms of system operation,
Full or partial operations are carried out repeatedly. Furthermore, when a unit converter fails, it is extremely important to disconnect the faulty converter from the system and partially operate with only the healthy converter in order to improve system operation reliability. Thus, to enable switching between full operation and partial operation, a bypass switch is installed in parallel on the DC side of each unit converter. As the bypass switch, a mechanical switch such as a circuit breaker or a semiconductor switch such as a thyristor can be used. Currently, mechanical switches are used for economic reasons.
メカニカルスイツチは原理的に直流しや断が不
可能であり、又開閉に際しアークの発生による接
点摩耗の問題があるため、メカニカルスイツチの
開閉は無電圧で行う必要がある。 In principle, a mechanical switch cannot be turned on or off, and there is a problem of contact wear due to arcing when opening and closing, so it is necessary to open and close a mechanical switch without voltage.
このため、バイパススイツチを開閉するときは
常に、変換装置をバイパスペア（３相ブリツジの
点弧位相が180゜異る２つのバルブを同時に通電す
る。）動作させ、バイパススイツチの極間電圧を
ほぼ零に抑えている。この場合、バイパススイツ
チの動作時間は開閉指令信号の遅れも含めて数十
ms〜数百msである。この間変換装置のバイパス
ペア動作を維持させるために、長時間（バイパス
スイツチ動作時間＋マージン）に亘つて、バイパ
スペアのバルブにゲート信号を与える必要があ
る。これはゲート信号制御装置の容量を大きくす
るので、種々の工夫がなされている。例えば、バ
イパスペア期間信号とバルブに加わる順電圧信号
とのアンド条件が成立したときのみゲート信号を
発生する方式がある。この方式ではバイパスペア
期間でも、バルブに順電圧が加わらない限り、ゲ
ート信号を発生する必要がないため、ゲートパワ
ーは極めて少なくてよい。従つて、ゲート制御装
置を大幅に小型化できる。しかし、バイパススイ
ツチ開閉の際のバイパスペア期間の１部の期間の
みしかバイパスペアバルブにゲート信号を供給し
ない前記のような狭幅ゲート方式において、幾つ
かの欠点がある。これらの欠点を従来の実施例で
説明する。第１図は一般的な直流送電の構成図
で、第２図はバイパススイツチ開閉時のバイパス
ペアバルブの従来のゲート制御方式のタイムチヤ
ートである。第１図において、１1〜１4は単位変
換装置で、この例では２個直列の例で示してい
る。２1〜２4は、各変換装置の交流入力又は出力
用の変圧器、３1〜３4は、各変換装置と並列に接
続されたバイパススイツチ、４は平滑用の直流リ
アクトルである。５1〜５6は変換装置のアームを
構成するサイリスタバルブ（以下バルブと略記す
る。）である。かかる構成の直流送電において、
Ａ系統Ｂ系統間の電力の融通を行う場合、例え
ば定格電力融通の時は全変換装置１1〜１4を運転
する。この時、バイパススイツチ３1〜３4はすべ
て“開”状態にある。一方、部分的運転する場
合、例えば、バイパススイツチ３1及び３3のみを
閉にして、変換装置１2及び１4を運転すれば、定
格の半分の電力融通が可能である。又、変換装置
１1もしくは１3が故障した場合も、前記の部分的
運転と同様の運転が可能である。これら運転の切
換えは当然のことながら、交流入力、交流出力を
解列しないで実行される。 Therefore, whenever the bypass switch is opened or closed, the converter is operated as a bypass pair (two valves whose firing phases of the three-phase bridge differ by 180 degrees are energized at the same time), and the voltage between poles of the bypass switch is approximately reduced. It's kept at zero. In this case, the operating time of the bypass switch is several tens of seconds, including the delay in the opening/closing command signal.
ms to several hundred ms. In order to maintain the bypass pair operation of the converter during this time, it is necessary to apply a gate signal to the valves of the bypass pair over a long period of time (bypass switch operation time + margin). Since this increases the capacity of the gate signal control device, various measures have been taken. For example, there is a method in which a gate signal is generated only when an AND condition between a bypass pair period signal and a forward voltage signal applied to a valve is satisfied. In this method, even during the bypass pair period, there is no need to generate a gate signal unless a forward voltage is applied to the valve, so the gate power may be extremely small. Therefore, the gate control device can be significantly downsized. However, there are several drawbacks in the above-described narrow gate method in which the gate signal is supplied to the bypass pair valve only during a part of the bypass pair period when the bypass switch is opened and closed. These drawbacks will be explained using conventional examples. FIG. 1 is a configuration diagram of a general DC power transmission, and FIG. 2 is a time chart of a conventional gate control method for bypass pair valves when a bypass switch is opened and closed. In FIG. 1, 1 1 to 1 4 are unit conversion devices, and in this example, two units are shown in series. 2 1 to 2 4 are transformers for AC input or output of each conversion device, 3 1 to 3 4 are bypass switches connected in parallel with each conversion device, and 4 is a DC reactor for smoothing. 5 1 to 5 6 are thyristor valves (hereinafter abbreviated as valves) constituting arms of the conversion device. In DC power transmission with this configuration,
When power is exchanged between the A system and the B system, for example, when rated power is exchanged, all converters 1 1 to 1 4 are operated. At this time, all bypass switches 3 1 to 3 4 are in the "open" state. On the other hand, in the case of partial operation, for example, if only the bypass switches 3 1 and 3 3 are closed and the converters 1 2 and 1 4 are operated, half of the rated power can be exchanged. Further, even if the converter 1 1 or 1 3 fails, the same operation as the partial operation described above is possible. Naturally, these operation changes are performed without disconnecting the AC input and AC output.
第２図は第１図に実線、点線で図示の運転モー
ド切換、即ち変換装置１2，１4のみの部分的運転
（従つて、３2，３4は開、３1，３3は閉、１1，１3
は運転停止）から、全面的運転（３1〜３4＝開、
１1〜１4＝運転）に切換え状態のタイムチヤート
を表わしている。第２図において、ａはバイパス
スイツチの開閉指令、ｂはバイパスペア動作指
令、ｃはバイパススイツチの接点の開閉状態、ｄ
はバイパススイツチ、例えば３1の極間電圧（ア
ーク電圧）を示す。この電圧がバルブに印加され
る。ｅはバイパスペアバルブに供給されるゲート
信号で、これはバイパスペア期間であるという条
件とバルブ順電圧が所定の電圧（順電圧信号の検
出レベル＝LV2）以上であるという条件とのアン
ド条件にて発生するゲート信号である。バルブが
点弧すれば、順電圧が消滅するので、ゲート信号
は狭幅のパルスとなる。 FIG. 2 shows the operation mode switching shown in FIG. 1 by solid lines and dotted lines, that is, partial operation of only converters 1 2 and 1 4 (therefore, 3 2 and 3 4 are open, and 3 1 and 3 3 are closed). , 1 1 , 1 3
from full operation (3 1 to 3 4 = open,
1 1 to 1 4 =operation) shows the time chart of the switching state. In Fig. 2, a is a bypass switch open/close command, b is a bypass pair operation command, c is an open/close state of the bypass switch contact, and d
indicates the voltage across the poles (arc voltage) of the bypass switch, for example 3 1 . This voltage is applied to the valve. e is a gate signal supplied to the bypass pair valve, which is an AND condition between the condition that it is a bypass pair period and the condition that the valve forward voltage is higher than a predetermined voltage (forward voltage signal detection level = LV 2 ) This is a gate signal generated at When the valve fires, the forward voltage disappears, so the gate signal becomes a narrow pulse.
ｆはバイパススイツチを流れる電流でバイパス
スイツチ閉時の電流は直流電流Idに等しい。ｇは
バイパスペアに選択されたバルブに流れる電流
で、バイパススイツチから完全にバイパスバルブ
に電流が切換えられれば、直流電流Idに等しい。
ｈは通常運転時のバルブゲート指令で、この指令
が“OFF”→“ON”になるとバイパスペア動作
指令はロツクされると同時にバルブは通常の運転
に移行する。以上の第１図と第２図で、バイパス
スイツチの“閉”→“開”の切換え時における各
部の動作を説明する。 f is the current flowing through the bypass switch, and the current when the bypass switch is closed is equal to the DC current Id. g is the current flowing through the valve selected in the bypass pair, and if the current is completely switched from the bypass switch to the bypass valve, it is equal to the DC current Id.
h is the valve gate command during normal operation, and when this command changes from "OFF" to "ON", the bypass pair operation command is locked and at the same time the valve shifts to normal operation. The operation of each part when the bypass switch is switched from "closed" to "open" will be explained with reference to FIGS. 1 and 2 above.
バイパススイツチの開閉指令ａが“閉”→
“開”になつた時（ｔ＝t1）、同時もしくは所定の
遅れをもつて、バイパスペア動作指令が“OFF”
→“ON”状態になり、バイパスペア動作に入れ
る状態になる。ｔ＝t2でバイパススイツチの接点
が開極し始め、一定の時間後（ｔ＝t4）正規の開
極状態に達する。この過程（ｔ＝t2〜t4）でバイ
パススイツチの極間電圧（アーク電圧）ｄは上昇
する。このアーク電圧はバイパススイツチに流れ
る電流ｆとバイパススイツチの接点間の距離等に
左右される。このバイパススイツチのアーク電圧
はバルブに印加される。バルブに加わる電圧がバ
ルブの順電圧検出レベルを越えると、バイパスペ
アに選択されたバルブにはゲートパルスが与えら
れ、バイパススイツチの電流がバイパスペアのバ
ルブに移行する。その後、ｔ＝t5にて、通常運転
時のバルブゲート指令により、バイパスペア動作
指令はロツクされバルブは通常の運転状態にな
る。即ち変換装置は全面的運転に入る。このよう
なバイパススイツチの開閉時における従来のバル
ブゲート制御方式には次のような欠点がある。 Bypass switch open/close command a is “closed” →
When it becomes “open” (t = t 1 ), the bypass pair operation command is turned “OFF” at the same time or with a predetermined delay.
→The device becomes “ON” and enters bypass pair operation. The contacts of the bypass switch begin to open at t=t 2 and reach the normal open state after a certain period of time (t=t 4 ). During this process (t= t2 to t4 ), the voltage between electrodes (arc voltage) d of the bypass switch increases. This arc voltage depends on the current f flowing through the bypass switch and the distance between the contacts of the bypass switch. The arc voltage of this bypass switch is applied to the bulb. When the voltage applied to the valve exceeds the valve's forward voltage detection level, a gate pulse is applied to the valve selected for the bypass pair, and the current in the bypass switch is transferred to the valve in the bypass pair. Thereafter, at t= t5 , the bypass pair operation command is locked by the valve gate command during normal operation, and the valve returns to the normal operating state. That is, the converter goes into full operation. The conventional valve gate control method for opening and closing such a bypass switch has the following drawbacks.
１ バルブの順電圧検出レベルは数千Ｖ〜数万Ｖ
であるのでバイパススイツチの開極エネルギー
が過大となる。1. The forward voltage detection level of the valve is several thousand V to tens of thousands of V.
Therefore, the opening energy of the bypass switch becomes excessive.
２ 前記１）項の過大な開極エネルギーはバイパ
ススイツチの信頼性に大きく影響を与え、場合
によつてはバイパススイツチを破損させること
がある。2. The excessive opening energy described in item 1) above greatly affects the reliability of the bypass switch, and may even damage the bypass switch in some cases.
３ 前記１）項の過大な開極エネルギーに耐え得
るようにバイパススイツチを製作すると、性能
的にも、経済的にも不利である。3. If a bypass switch is manufactured to withstand the excessive opening energy mentioned in item 1) above, it will be disadvantageous both in terms of performance and economy.
４ バイパススイツチのアーク電圧は開極前のバ
イパススイツチ電流に左右されるので、バイパ
スペアバルブの点弧する時間、ｔ＝t3は直流電
流Idにより大幅に変る。従つて、あらゆる直流
電流の条件を考慮して、バイパスペア時間（ｔ
＝t5−t1）を決定する必要があるが、この場
合、バイパスペア期間は極めて大きくなる。4. Since the arc voltage of the bypass switch depends on the bypass switch current before opening, the firing time of the bypass pair valve, t= t3 , changes significantly depending on the DC current Id. Therefore, considering all DC current conditions, the bypass pair time (t
= t 5 - t 1 ), but in this case the bypass pair period becomes extremely long.
本発明の目的はかかる従来の欠点を除去するた
めになされたもので、最少のアーク電圧でバイパ
ススイツチからバイパスペアバルブに電流を移行
させることが出来るサイリスタ変換装置を提供す
ることにある。 SUMMARY OF THE INVENTION An object of the present invention has been made to eliminate such drawbacks of the prior art, and is to provide a thyristor conversion device that can transfer current from a bypass switch to a bypass pair valve with a minimum arc voltage.
以下、本発明を第３図の一実施例及び第４図の
タイムチヤートを参照して説明する。第３図はバ
イパススイツチ開極時のバルブゲート制御装置の
ブロツク図を第１図における変換器１1とバイパ
ススイツチ３1の例で示している。６3及び６6は
それぞれバルブ５3及び５6を制御するゲート制御
装置で、７はサイリスタ変換装置及びバイパスス
イツチを制御する主制御装置である。ゲート制御
装置６3，６6は主制御装置７からの、バイパスス
イツチ開閉指令ａ、バイパスペア動作指令ｂ及び
通常時のバルブゲート指令ｈとバルブからの順電
圧信号ｊとで動作し、バルブにゲート信号ｅを供
給する。ゲート制御装置６3，６6は、バイパスス
イツチ開閉用のゲート信号発生回路１０とアンド
回路９とゲート信号期間決定回路８及びオア回路
１１よりなる。１２はバイパススイツチの操作回
路で、主制御装置７からのバイパススイツチ開閉
指令ａを受けて、バイパススイツチ用操作信号ｍ
を出力し、バイパススイツチ３1を操作する。第
４図は第３図の動作を示すタイムチヤートであ
る。バイパススイツチ３1が閉じていて、電流ｆ
（＝Id）が流れている状態にて、部分的運転から
全面的運転に移行する際の本発明の作用を説明す
る。ｔ＝t1にて、バイパススイツチ開閉指令ａが
“閉”→“開”状態に変ると、同時もしくは所定
の遅れをもつてバイパスペア動作指令が“OFF”
→“ON”状態になる。ｔ＝t1より所定時間TD遅
れて、バイパススイツチ開閉用のゲート信号発生
回路１０より、所定のパルス幅と所定の休止区間
を有するパルス状のゲート信号ｉを時間TPの間
発生させる。 Hereinafter, the present invention will be explained with reference to an embodiment of FIG. 3 and a time chart of FIG. 4. FIG. 3 shows a block diagram of the valve gate control device when the bypass switch is open, using the converter 11 and bypass switch 31 in FIG. 1 as an example. 6 3 and 6 6 are gate control devices that control the valves 5 3 and 5 6 , respectively, and 7 is a main control device that controls the thyristor conversion device and the bypass switch. The gate control devices 6 3 and 6 6 are operated by the bypass switch opening/closing command a, the bypass pair operation command b, the normal valve gate command h, and the forward voltage signal j from the valve from the main control device 7. A gate signal e is supplied. The gate control devices 6 3 and 6 6 each include a gate signal generation circuit 10 for opening and closing the bypass switch, an AND circuit 9, a gate signal period determining circuit 8, and an OR circuit 11. Reference numeral 12 denotes a bypass switch operation circuit, which receives a bypass switch opening/closing command a from the main controller 7 and outputs a bypass switch operation signal m.
Output and operate bypass switch 31 . FIG. 4 is a time chart showing the operation of FIG. 3. Bypass switch 3 1 is closed and the current f
The operation of the present invention when transitioning from partial operation to full operation while (=Id) is flowing will be explained. At t=t 1 , when the bypass switch open/close command a changes from "closed" to "open", the bypass pair operation command is turned "OFF" at the same time or with a predetermined delay.
→ Goes to “ON” state. After a predetermined time T D delay from t=t 1 , a gate signal generation circuit 10 for opening and closing the bypass switch generates a pulse-like gate signal i having a predetermined pulse width and a predetermined pause interval for a time T P .
一方、バイパススイツチは開極指令より時間
TB遅れたｔ＝t2で開極動作を開始する。開極と同
時に、バイパススイツチのアーク電圧は除々に上
昇する。ｔ＝t2′でアーク電圧はバルブの最少点
弧電圧LV1に達する（LV1≪LV2（順電圧信号検
出レベル））。このとき、バルブにはゲート信号ｅ
が供給されているので、アーク電圧が最少点弧電
圧を越えた直後に、バルブは点弧でき、これによ
りバイパススイツチの電流ｆはバイパスペアに選
択されたバルブに移る（ｇはバイパスペアバルブ
の電流）。ｔ＝t3においては、バルブが既に点弧
しているので、順電圧信号は“OFF”の状態の
ままである従つてこの時点（ｔ＝t3）でゲート信
号ｅは発生しない。その後、ｔ＝t5で通常運転時
のバルブゲート指令ｈが“OFF”→“ON”状態
となり、バイパスペア動作指令がロツクされ通常
の運転に入る。即ち全変換装置１1〜１4による全
面的運転になる。前記の遅れ時間TDはバイパス
スイツチの遅れ時間TBとの関連で設定される。
ゲート信号の継続時間TPは遅れ時間TBのバラツ
キ、アーク電圧の発生バラツキ等を考慮して選定
する。即ち、アーク電圧がバルブの最少点弧電圧
に達する近傍に、ゲート信号ｉが発生するように
TD及びTPを選定すればよい。なおゲート信号ｉ
を休止期間を有するパルス信号としたが、必要に
応じて、休止期間のない、幅がTPの連続的なゲ
ート信号でもよい。 On the other hand, the bypass switch takes more time than the opening command.
The opening operation starts at t= t2 , which is delayed by T B. Simultaneously with opening, the arc voltage of the bypass switch gradually increases. At t=t 2 ', the arc voltage reaches the minimum ignition voltage LV 1 of the bulb (LV 1 <<LV 2 (forward voltage signal detection level)). At this time, the valve receives a gate signal e
is supplied, the valve can fire immediately after the arc voltage exceeds the minimum firing voltage, which transfers the current f in the bypass switch to the valve selected in the bypass pair (g is the value of the bypass pair valve). current). At t= t3 , the forward voltage signal remains in the "OFF" state since the valve has already been fired, so the gate signal e is not generated at this time (t= t3 ). Thereafter, at t= t5 , the valve gate command h during normal operation changes from "OFF" to "ON", the bypass pair operation command is locked, and normal operation begins. In other words, all converters 1 1 to 1 4 are in full operation. The delay time T D is set in relation to the delay time T B of the bypass switch.
The duration time T P of the gate signal is selected in consideration of variations in the delay time T B , variations in arc voltage generation, etc. That is, the gate signal i is generated near the point where the arc voltage reaches the minimum ignition voltage of the bulb.
Just select T D and T P. Note that the gate signal i
is a pulse signal having a pause period, but if necessary, a continuous gate signal having a width T P without a pause period may be used.
以上の構成の本発明によれば、バイパスペアバ
ルブを極めて低い電圧で点弧でき、バイパススイ
ツチのストレスを大幅に低減できる。例えばバル
ブの最少点弧電圧LV1は200〜500Vに対し、従来
方式のバルブ点弧電圧（＝順電圧検出レベル
LV2）は数千Ｖ〜数万Ｖ程度である。 According to the present invention having the above configuration, the bypass pair valve can be ignited at an extremely low voltage, and the stress on the bypass switch can be significantly reduced. For example, the minimum valve firing voltage LV 1 is 200 to 500V, whereas the valve firing voltage of the conventional method (= forward voltage detection level
LV2 ) is approximately several thousand volts to tens of thousands of volts.
又、バイパススイツチの開極とほぼ同時にバイ
パスペア動作に入れるので、従来の方式に比べバ
イパスペア時間（ｔ＝t5−t1）を短かくできる。
更に、バイパススイツチ開極時にゲート信号ｅは
ゲート信号ｉとゲート信号１のオア回路を形成す
るので２重系となり信頼性が向上する。 Furthermore, since the bypass pair operation is started almost simultaneously with the opening of the bypass switch, the bypass pair time (t=t 5 -t 1 ) can be shortened compared to the conventional system.
Further, when the bypass switch is opened, the gate signal e forms an OR circuit of the gate signal i and the gate signal 1, resulting in a double system, which improves reliability.
このように本発明によればバイパススイツチの
動作責務を大幅に低減でき、信頼性の向上に大き
く寄与できる。又部分的運転全面的運転の切換
時間を大幅に短縮できる。 As described above, according to the present invention, the operational responsibility of the bypass switch can be significantly reduced, and it can greatly contribute to improving reliability. Furthermore, the switching time between partial operation and full operation can be significantly reduced.
第１図は通常の直流送電系統の構成図、第２図
は第１図のバイパススイツチとバルブとの切換え
時の従来方式によるゲート制御タイムチヤート
図、第３図は本発明の一実施例を示すブロツク
図、第４図は第３図の動作を説明するためのタイ
ムチヤートである。
１1〜１4…変換器、２1〜２4…変圧器、３1〜３
４…バイパススイツチ、５1〜５6…バルブ、６3，
６5…ゲート制御装置、７…主制御装置、８…ゲ
ート信号区間決定回路、９…アンド回路、１０…
ゲート信号発生回路、１１…オア回路。
Fig. 1 is a configuration diagram of a normal DC power transmission system, Fig. 2 is a gate control time chart according to the conventional method when switching between the bypass switch and valve shown in Fig. 1, and Fig. 3 is an example of an embodiment of the present invention. The block diagram shown in FIG. 4 is a time chart for explaining the operation of FIG. 3. 1 1 to 1 4 ... converter, 2 1 to 2 4 ... transformer, 3 1 to 3
4 ...Bypass switch, 51 to 56 ...Valve, 63 ,
6 5 ...Gate control device, 7...Main control device, 8...Gate signal section determination circuit, 9...AND circuit, 10...
Gate signal generation circuit, 11...OR circuit.
Claims (1)
記単位サイリスタ変換装置の直流端子にバイパス
スイツチを並列に接続してなる交直サイリスタ変
換装置において、前記バイパススイツチの開極指
令を受けてから所定の遅れをもつて、所定の期間
バイパスペアバルブにゲート信号を供給するゲー
ト制御装置を設け、前記バイパススイツチを開極
し前記バイパスペアバルブに前記バイパススイツ
チの電流を切換えるときに前記ゲート制御装置の
出力で、バイパスペアバルブを制御して行うよう
にしたことを特徴とするサイリスタ変換装置。1. In an AC/DC thyristor conversion device in which unit thyristor conversion devices are connected in series and a bypass switch is connected in parallel to the DC terminal of the unit thyristor conversion device, a predetermined delay is caused after receiving the opening command of the bypass switch. A gate control device is provided that supplies a gate signal to the bypass pair valve for a predetermined period, and when the bypass switch is opened and the current of the bypass switch is switched to the bypass pair valve, the output of the gate control device A thyristor conversion device characterized by controlling a bypass pair valve.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1507279A JPS55109139A (en) | 1979-02-14 | 1979-02-14 | Thyristor converter |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1507279A JPS55109139A (en) | 1979-02-14 | 1979-02-14 | Thyristor converter |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS55109139A JPS55109139A (en) | 1980-08-22 |
| JPS6310652B2 true JPS6310652B2 (en) | 1988-03-08 |
Family
ID=11878640
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1507279A Granted JPS55109139A (en) | 1979-02-14 | 1979-02-14 | Thyristor converter |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS55109139A (en) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5072161A (en) * | 1973-10-31 | 1975-06-14 |
-
1979
- 1979-02-14 JP JP1507279A patent/JPS55109139A/en active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5072161A (en) * | 1973-10-31 | 1975-06-14 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS55109139A (en) | 1980-08-22 |
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