JPS6260308A - Schmitt circuit - Google Patents
Schmitt circuitInfo
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- JPS6260308A JPS6260308A JP60200790A JP20079085A JPS6260308A JP S6260308 A JPS6260308 A JP S6260308A JP 60200790 A JP60200790 A JP 60200790A JP 20079085 A JP20079085 A JP 20079085A JP S6260308 A JPS6260308 A JP S6260308A
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- circuit
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Abstract
Description
【発明の詳細な説明】
(産業上の利用分野)
本発明は、バイポーラ集積回路に利用されるシュミット
回路に関する。DETAILED DESCRIPTION OF THE INVENTION (Field of Industrial Application) The present invention relates to a Schmitt circuit used in bipolar integrated circuits.
(従来の技術)
従来、バイポーラ集積回路に用いられているシュミット
回路を第2図に示している。(Prior Art) A Schmitt circuit conventionally used in bipolar integrated circuits is shown in FIG.
このシュミット回路は、差動増幅回路を構成する2つの
トランジスタQ目I C1+zのエミッタ側接読点に
トランジスタQI3. Q10及び抵抗R2からなる定
電流回路(定電流値■。)が接続され、さらにこれらト
ランジスタQ、、、Q、、のコレクタ側にそれぞれカレ
ントミラー回路が接続されたものである。This Schmitt circuit has transistors QI3 . A constant current circuit (constant current value ■.) consisting of Q10 and resistor R2 is connected, and furthermore, current mirror circuits are connected to the collector sides of these transistors Q, , , Q,, respectively.
トランジスタQ11に接続されるカレントミラー回路は
、トランジスタQISといわゆるダイオード接合として
作用するトランジスタQI6と抵抗R1によって構成さ
れ、トランジスタQI2に接続されるカレントミラー回
路はトランジスタQ、7といわゆるダイオード接合とし
て作用するトランジスタQ、8と抵抗R4によって構成
されている。The current mirror circuit connected to the transistor Q11 is composed of the transistor QIS, the transistor QI6 which acts as a so-called diode junction, and the resistor R1, and the current mirror circuit connected to the transistor QI2 acts with the transistors Q and 7 as a so-called diode junction. It is composed of transistors Q and 8 and a resistor R4.
かかるシュミット回路において、トランジスタQz、Q
+□のベース側をそれぞれ入力端子A、 Bとし、こ
のA−B間の電位差を■。とじ、各トランジスタQ7を
流れるコレクタ電流をICnとすると、以下に示す式(
1) 、 (2)が出力(トランジスタQ1□のコレク
タ電位)の状態にかかわらず成立している。In such a Schmitt circuit, transistors Qz, Q
The base sides of +□ are input terminals A and B, respectively, and the potential difference between A and B is ■. When the collector current flowing through each transistor Q7 is ICn, the following equation (
1) and (2) hold regardless of the state of the output (collector potential of transistor Q1□).
q Ic++
I cz + T c+z = I o
−(2)但し、q:電子の電荷
に:ボルツマン定数
T:絶対温度
また、出力がrLJレベルのときには以下の式(3)
、 (4) 、 (5)の関係が成立する。q Ic++ I cz + T c+z = I o
-(2) However, q: Electron charge: Boltzmann constant T: Absolute temperature Also, when the output is at rLJ level, the following equation (3)
, (4), and (5) hold true.
Tc++ = IC16・・・(3)
I c+s = I c+z −(4)I c
+a = I C+? = 0 −(5)一方、出力
が「L」レベルからrHJレベルに切り替わるときには
、上式(1) 、 (2) 、 (3) 、 (4)
、 (5)q I cIh
が成立し、この関係に上式(3) 、 (4)を代入す
ると。Tc++ = IC16...(3) Ic+s = Ic+z - (4) Ic
+a = IC+? = 0 - (5) On the other hand, when the output switches from "L" level to rHJ level, the above equations (1), (2), (3), (4)
, (5) q I cIh holds true, and by substituting the above equations (3) and (4) into this relationship.
q Ic++ が成立する。q Ic++ holds true.
よって、出力がrLJレベルからrHJレベルに切り替
わるときの電位差V All (L−0は式(1) 、
(2) 。Therefore, the potential difference V All when the output switches from the rLJ level to the rHJ level (L-0 is Equation (1),
(2).
(6)によって決定される。(6) is determined.
ところで、出力がrHJレベルに切り替わると。By the way, when the output switches to rHJ level.
ICI□=Ic+a ・・・(7)I C+?
= I c+ I−(8)I cIh = r c+
s = 0 ”・(9)の各式が成立する。ICI□=Ic+a...(7) IC+?
= I c+ I-(8) I cIh = r c+
s = 0'' (9) holds true.
次に、出力がrHJレベルからIllレベルに切り替わ
るときには、上式(1) 、 (2) 、 (7) 、
(8) 、 (9)の他に
し、この関係に上式(7) 、 (8)を代入すると。Next, when the output switches from the rHJ level to the Ill level, the above equations (1), (2), (7),
In addition to (8) and (9), if we substitute the above equations (7) and (8) into this relationship, we get:
q I c+z が成立する。q I c+z holds true.
よって出力が「H」レベルからrLJレベルに切り替わ
るときの電位差V All (M 4 L)は式(1)
、 (2) 。Therefore, the potential difference V All (M 4 L) when the output switches from the "H" level to the rLJ level is expressed by the formula (1)
, (2).
(10)によって決定される。このときヒステリシス幅
は(V□(、−ゎ−VAB(H−L))で定義される。(10). At this time, the hysteresis width is defined as (V□(, -ゎ-VAB(HL)).
(発明が解決しようとする問題点)
しかるに、この種のシュミット回路の特性は上式(1)
、 (2) 、 (6) 、 (10)の関係で規定
されているために、スレシュホー/L/ドレヘ/L’+
VAl (L −14) +VAl (H−L) rヒ
ステリシス幅は前記定電流回路の定電流値I0に依存し
ている。(Problem to be solved by the invention) However, the characteristics of this type of Schmitt circuit are expressed by the above equation (1).
, (2), (6), and (10), Thresho/L/Drehe/L'+
VAl (L −14) +VAl (H−L) rThe hysteresis width depends on the constant current value I0 of the constant current circuit.
この定電流値■。は電源電圧VCCと抵抗R2によって
決定されるので、電源電圧VCCの変化及び抵抗R2の
生産上のばらつきによって変動するために前記スレシュ
ホールドレベル+VA!lよ−、)。This constant current value ■. is determined by the power supply voltage VCC and the resistor R2, so the threshold level +VA! varies due to changes in the power supply voltage VCC and manufacturing variations in the resistor R2. l-,).
vAHiH−Ll + ヒステリシス幅が変動し特性
の統一を図ることができない。vAHiH-Ll + The hysteresis width fluctuates, making it impossible to unify the characteristics.
(問題点を解決するための手段)
本発明は、差動増幅回路を構成する一対のトランジスタ
のエミッタ側接続点に定電流回路が接続され、これらの
トランジスタに流れるコレクタ電流をカレントミラー回
路で比較する回路において。(Means for solving the problem) The present invention has a constant current circuit connected to the emitter side connection point of a pair of transistors constituting a differential amplifier circuit, and compares the collector currents flowing through these transistors using a current mirror circuit. In the circuit that does.
前記定電流回路に流れる定電流値に比例する電流が前記
カレントミラー回路に正帰還されるものである。A current proportional to the constant current value flowing through the constant current circuit is positively fed back to the current mirror circuit.
(作用)
差動増幅回路を構成する一対のトランジスタのコレクタ
側に接続されたカレントミラー回路には。(Function) A current mirror circuit is connected to the collector side of a pair of transistors that make up a differential amplifier circuit.
この差動増幅回路の一エミッタ側に接続された定電流回
路を流れる定電流値(■。)に比例する電流が流され、
スレシュホールドレベル+ V AB (L−旧+VA
B()l + Ll及びヒステリシス幅はこの電流値の
比を基準として決定される。A current proportional to the constant current value (■.) flowing through the constant current circuit connected to one emitter side of this differential amplifier circuit is passed,
Threshold level + V AB (L-old + VA
B()l+Ll and the hysteresis width are determined based on the ratio of this current value.
(実施例)
以下7本発明の実施例について図面を参照して説明する
。(Example) Seven examples of the present invention will be described below with reference to the drawings.
第1図は2本発明に係るシュミット回路をバイポーラト
ランジスタによって構成した集積回路の一例を示してい
る。FIG. 1 shows an example of an integrated circuit in which two Schmitt circuits according to the present invention are constructed using bipolar transistors.
差動増幅器を構成する一対のトランジスタQ1゜Q2の
エミッタ側接続点lにトランジスタQ6 。A transistor Q6 is connected to a connection point l on the emitter side of a pair of transistors Q1 and Q2 that constitute a differential amplifier.
Q7.Q、及び抵抗R1からなる定電流回路が共゛通ベ
ースによって接続されている。これらのトランジスタQ
b 、Q? 、Qaのベース・エミッタ接合の面積比は
、1:IA:1になされ、トランジスタQ6に流れるコ
レクタ電流が一定電流値■。になされ、トランジスタQ
、に流れるコレクタ電流が一定電流値I0/2になされ
ている。Q7. A constant current circuit consisting of a resistor R1 and a resistor R1 are connected by a common base. These transistors Q
b, Q? , Qa have a base-emitter junction area ratio of 1:IA:1, and the collector current flowing through transistor Q6 has a constant current value ■. Transistor Q
, the collector current flowing through is set to a constant current value I0/2.
前記差動増幅回路のコレクタ側にはトランジスタQ、と
いわゆるダイオード接合として作用するトランジスタQ
9によって構成されるカレントミラー回路2が接続され
、さらに前記定電流回路を構成するトランジスタQ、の
コレクタ側と出力端子側(トランジスタQ2のコレクタ
)にトランジスタQ4といわゆるダイオード接合として
作用するトランジスタQ、とからなるカレントミラー回
路3が接続されている。このカレントミラー回路3は、
出力がrHJレベルのときには出力端子側に接続された
トランジスタQI0が導通して2作用しないようになさ
れている。On the collector side of the differential amplifier circuit are a transistor Q and a transistor Q that acts as a so-called diode junction.
A current mirror circuit 2 constituted by 9 is connected to the transistor Q, which acts as a so-called diode junction with a transistor Q4 on the collector side and the output terminal side (collector of the transistor Q2) of the transistor Q constituting the constant current circuit. A current mirror circuit 3 consisting of the following is connected. This current mirror circuit 3 is
When the output is at the rHJ level, the transistor QI0 connected to the output terminal side is conductive and does not function.
次に、前記トランジスタQq 、C3、Qa 、 Qs
のベース・エミッタ接合の面積比を2:3:1:6に設
定した場合の動作について説明する。Next, the transistors Qq, C3, Qa, Qs
The operation when the base-emitter junction area ratio is set to 2:3:1:6 will be described.
トランジスタQl、Qzのベース間の電位差をVAII
とすると。The potential difference between the bases of transistors Ql and Qz is VAII
If so.
q IcI
r c+ + I cz= I o
−(12)が成立し、出力がrLJレベルのときには
。q IcI r c+ + I cz= I o
- (12) holds true and the output is at rLJ level.
I cz= Ic++ IC4・・・(13)I、、−
□ ・・・(14)が成立し、さらに、
出力が「L」レベルから「H」レベルに切り替わるとき
には上式(11)〜(14)の関係に加えて
T c:+ = I c+ −(1
5)従って、出力がrLJレベルからrHJレベルに切
り替わるときのICIをICI(L−1111IC2を
ICZ(L−H)+ VA!lをV All (L
−111とすると。I cz= Ic++ IC4...(13) I,, -
□ ...(14) holds, and furthermore,
When the output switches from the "L" level to the "H" level, in addition to the relationships in equations (11) to (14) above, T c:+ = I c+ - (1
5) Therefore, the ICI when the output switches from rLJ level to rHJ level is ICI (L-1111IC2 is ICZ (L-H) + VA!l is V All (L
-111.
1CI(L、H)= IO−命命(17)I c
z+t−o+ = I o ・=
(1B)となる。1CI (L, H) = IO - Life (17) I c
z+t-o+ = I o ・=
(1B).
しかして、出力がrHJレベルに切り替わるとr 、、
s= r C4= 0 ・(20)の関係が
成立する。Therefore, when the output switches to the rHJ level, r...
The relationship s= r C4= 0 (20) holds true.
一方、 出力がrHJレベルからrLJレベルに切り替
わるときには上式(11) 、 (12) 、 (20
)の関係に加えて、以下に示す式(21) 、 (22
)が成立する。On the other hand, when the output switches from rHJ level to rLJ level, the above equations (11), (12), (20
), as well as the following equations (21) and (22
) holds true.
I C2= I e:+ ・(21)I
C3−ICI ・・−(22)従って、出力が
rHJレベルからrLJレベルに切り替わるときのIc
IをICI(H−9,ICZをIC2(H−Ll、
VAIをV A11 +11− L)とすると。I C2= I e:+ ・(21) I
C3-ICI...-(22) Therefore, Ic when the output switches from rHJ level to rLJ level
I to ICI (H-9, ICZ to IC2 (H-Ll,
Let VAI be V A11 +11- L).
■C目+1−L)= Io ・・争(2
3)I czn+−tr = I O−(24
)となる。■Cth + 1-L) = Io... Conflict (2
3) I czn+-tr = I O-(24
).
よって本例の回路によれば、スレシュホールドレベルl
VAI(L−1,VAIlよ−。及びヒステリシス
幅(vAll(L、、H) VAII(H−Ll)は
上式(19)、 (25)によって決定されるこ・とに
なる。Therefore, according to the circuit of this example, the threshold level l
VAI(L-1, VAIl) and hysteresis width (vAll(L,,H) VAII(H-Ll) are determined by the above equations (19) and (25).
(発明の効果)
以上述べたように本発明によれば、シュミット回路の特
性を決定する各種パラメータが、定電流値そのものに依
存されないために、特性上のばらつきを低減し、安定な
回路動作を行うことができる。(Effects of the Invention) As described above, according to the present invention, various parameters that determine the characteristics of a Schmitt circuit are not dependent on the constant current value itself, so variations in characteristics are reduced and stable circuit operation is achieved. It can be carried out.
第1図は本発明に係るシュミット回路の実施例を示す回
路図、第2図は従来例を示す回路図である。
1・・・エミッタ側接続点
2,3・・・カレントミラー回路
Q1〜Q9・・・トランジスタ
第7図FIG. 1 is a circuit diagram showing an embodiment of a Schmitt circuit according to the present invention, and FIG. 2 is a circuit diagram showing a conventional example. 1... Emitter side connection points 2, 3... Current mirror circuit Q1-Q9... Transistor Fig. 7
Claims (1)
ッタ側接続点に定電流回路が接続され、これらのトラン
ジスタに流れるコレクタ電流をカレントミラー回路で比
較する回路において、前記定電流回路に流れる定電流値
に比例する電流が前記カレントミラー回路に正帰還され
ることを特徴とするシュミット回路。1) In a circuit in which a constant current circuit is connected to the emitter side connection point of a pair of transistors constituting a differential amplifier circuit, and the collector currents flowing in these transistors are compared by a current mirror circuit, the constant current flowing in the constant current circuit A Schmitt circuit characterized in that a current proportional to the value is positively fed back to the current mirror circuit.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60200790A JPS6260308A (en) | 1985-09-10 | 1985-09-10 | Schmitt circuit |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60200790A JPS6260308A (en) | 1985-09-10 | 1985-09-10 | Schmitt circuit |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS6260308A true JPS6260308A (en) | 1987-03-17 |
JPH0377686B2 JPH0377686B2 (en) | 1991-12-11 |
Family
ID=16430232
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP60200790A Granted JPS6260308A (en) | 1985-09-10 | 1985-09-10 | Schmitt circuit |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6260308A (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US9884635B2 (en) | 2013-03-29 | 2018-02-06 | Mitsubishi Heavy Industries, Ltd. | Signaling system and door control method |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS59104817A (en) * | 1982-12-07 | 1984-06-16 | Matsushita Electric Ind Co Ltd | Hysteresis comparator |
-
1985
- 1985-09-10 JP JP60200790A patent/JPS6260308A/en active Granted
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS59104817A (en) * | 1982-12-07 | 1984-06-16 | Matsushita Electric Ind Co Ltd | Hysteresis comparator |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US9884635B2 (en) | 2013-03-29 | 2018-02-06 | Mitsubishi Heavy Industries, Ltd. | Signaling system and door control method |
Also Published As
Publication number | Publication date |
---|---|
JPH0377686B2 (en) | 1991-12-11 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
EXPY | Cancellation because of completion of term |