JPS6249482A - 画像前処理装置 - Google Patents
画像前処理装置Info
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- JPS6249482A JPS6249482A JP60187267A JP18726785A JPS6249482A JP S6249482 A JPS6249482 A JP S6249482A JP 60187267 A JP60187267 A JP 60187267A JP 18726785 A JP18726785 A JP 18726785A JP S6249482 A JPS6249482 A JP S6249482A
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- 238000007781 pre-processing Methods 0.000 title claims description 7
- 238000000034 method Methods 0.000 abstract description 7
- 238000010586 diagram Methods 0.000 description 11
- 238000006243 chemical reaction Methods 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発°明の利用分野〕
本発明は、画像入力装置で画像を読取った後、読取られ
た画像信号を認識処理装置で処理する以前に当該画像信
号を整形する画像前処理装置に関する。
た画像信号を認識処理装置で処理する以前に当該画像信
号を整形する画像前処理装置に関する。
文字、図形、立体像の稜線等を認識する図形認識装置が
一般に用いられている。これを図により説明する。
一般に用いられている。これを図により説明する。
第５図は図形認識装置の系統図である。図で、１は認識
すべき画像を信号として入力する画像入力装置、２は入
力した画像信号を記憶する画像メモリ、３は画像メモリ
に記憶された画像信号に対して各種の認識処理を実行し
、画像内容をデータ化する認識処理装置である。
すべき画像を信号として入力する画像入力装置、２は入
力した画像信号を記憶する画像メモリ、３は画像メモリ
に記憶された画像信号に対して各種の認識処理を実行し
、画像内容をデータ化する認識処理装置である。
画像入力装置は、与えられた図形をフライングスポット
スキャナ、ビジコンチューブ、光電変換素子列などの手
段による走査装置で走査し、得られる電気信号を例えば
白さ、黒さの程度によって量子化（ディジタル化）する
。例えば、白背景領域を走査した場合の電気信号は２進
値で「０」に変換され、又、図形領域を走査した場合の
電気信号は２進値で「１」に変換される。このようにし
て２進値に変換された画像信号は、画像メモリ２内の所
定の記憶部に順次収納をｎてゆ、く。
スキャナ、ビジコンチューブ、光電変換素子列などの手
段による走査装置で走査し、得られる電気信号を例えば
白さ、黒さの程度によって量子化（ディジタル化）する
。例えば、白背景領域を走査した場合の電気信号は２進
値で「０」に変換され、又、図形領域を走査した場合の
電気信号は２進値で「１」に変換される。このようにし
て２進値に変換された画像信号は、画像メモリ２内の所
定の記憶部に順次収納をｎてゆ、く。
ところで、このようにして読取られ、収納された画像信
号は、対象となる画面の品質や画像入力装置の性能によ
シ多くの雑音を含んでいる。例えば、白背景領域のある
個所において値「１」が入力されたり、図形領域のある
個所において値「０」が入力されたりする。そして、こ
のように画像信号に多くの雑音が含まれていると、認識
処理装置における処理に際して誤認識が生じ、極端な場
合は認識不可能となっていた。
号は、対象となる画面の品質や画像入力装置の性能によ
シ多くの雑音を含んでいる。例えば、白背景領域のある
個所において値「１」が入力されたり、図形領域のある
個所において値「０」が入力されたりする。そして、こ
のように画像信号に多くの雑音が含まれていると、認識
処理装置における処理に際して誤認識が生じ、極端な場
合は認識不可能となっていた。
このような事態の発生を防止するため、従来、画像入力
装置１゛により得られた画像信号を予め前処理により処
理しく画像を整形し）、この処理を経た画像信号を画像
メモリ２に収納する手段が採用されていた。しかしなが
ら、上記の前処理はコンピュータにおいてプログラム処
理により実行されるので処理の速度に限界があジ、多く
のデータを扱うことができず、必然的に入力対称となる
画像は簡単な文字、図形に限定されるという欠点があっ
た。又、前処理により整形された画像データが常に原画
像を完全に表現し得るように整形されているとは限らず
、この場合、認識処理装置３においては依然と１で誤認
識や認識不可の事態が発生するという欠点があった。
装置１゛により得られた画像信号を予め前処理により処
理しく画像を整形し）、この処理を経た画像信号を画像
メモリ２に収納する手段が採用されていた。しかしなが
ら、上記の前処理はコンピュータにおいてプログラム処
理により実行されるので処理の速度に限界があジ、多く
のデータを扱うことができず、必然的に入力対称となる
画像は簡単な文字、図形に限定されるという欠点があっ
た。又、前処理により整形された画像データが常に原画
像を完全に表現し得るように整形されているとは限らず
、この場合、認識処理装置３においては依然と１で誤認
識や認識不可の事態が発生するという欠点があった。
本発明は、このような事情に鑑みてなされたものであり
、その目的は、上記従来技術の欠点を除き、大量のデー
タを取扱うことができ、しかも、整形後の認識処理にお
ける誤認識や認識不可の事態を避け、認識率を向上させ
ることができる画像前処理装置を提供するにある。
、その目的は、上記従来技術の欠点を除き、大量のデー
タを取扱うことができ、しかも、整形後の認識処理にお
ける誤認識や認識不可の事態を避け、認識率を向上させ
ることができる画像前処理装置を提供するにある。
上記の目的を達成するため、本発明は、画像入力装置で
読取られた画像信号をそのまま記憶装置の所定の記憶部
に収納し、これら収納された画像信号をとシ出して所定
のノ↓ターンに配列し、この配列されたパターンを予め
定められたパターンと比較することによシ画像信号を修
正し、この修正を経た画像信号を、その画像信号のもと
の画像信号が収納されている前記所定の記憶部に付属す
る記憶部に収納することを特徴とする。
読取られた画像信号をそのまま記憶装置の所定の記憶部
に収納し、これら収納された画像信号をとシ出して所定
のノ↓ターンに配列し、この配列されたパターンを予め
定められたパターンと比較することによシ画像信号を修
正し、この修正を経た画像信号を、その画像信号のもと
の画像信号が収納されている前記所定の記憶部に付属す
る記憶部に収納することを特徴とする。
以下、本発明を図示の実施例に基づいて説明する。
第１図は本発明の実施例に係る画像前処理装置のブロッ
ク図である。図で、５は画像入力装置で読取られた画像
信号を記憶する画像メモリである。
ク図である。図で、５は画像入力装置で読取られた画像
信号を記憶する画像メモリである。
６．７．８はいずれもシフトレジスタであり、各シフト
レジスタ６．７．８は直列に接続されるとともに、各シ
フトレジスタ６．７．８の出力カ個別に取出される。９
は各シフトレジスタ６．７゜８の出力によシ形成される
画像信号パターンと予め記憶されている所定のパターン
とを比較して画像信号を修正するマスクテーブルである
。１ｏはマスクテーブル９における修正を経た画像信号
が順次蓄積されるシフトレジスタ、１１はシフトレジス
タ１０に蓄積された画像信号のそれぞれを画像メモリ５
の所定のアドレスの所定のビットに戻すためのシフトレ
ジスタである。
レジスタ６．７．８は直列に接続されるとともに、各シ
フトレジスタ６．７．８の出力カ個別に取出される。９
は各シフトレジスタ６．７゜８の出力によシ形成される
画像信号パターンと予め記憶されている所定のパターン
とを比較して画像信号を修正するマスクテーブルである
。１ｏはマスクテーブル９における修正を経た画像信号
が順次蓄積されるシフトレジスタ、１１はシフトレジス
タ１０に蓄積された画像信号のそれぞれを画像メモリ５
の所定のアドレスの所定のビットに戻すためのシフトレ
ジスタである。
第２図は第１図に示す画像メモリにおける１っのアドレ
スのビット構成の説明図である。１つのアドレスには、
読取られる画像における１つの絵素に関する情報が記憶
される。Ａ、Ｂ、Ｃは当該絵素に関する情報を示す。即
ち、情報Ａは例えば当該絵素の色彩に関する情報（色コ
ード）であり、２０ビツト〜２５ビツトが使用される。
スのビット構成の説明図である。１つのアドレスには、
読取られる画像における１つの絵素に関する情報が記憶
される。Ａ、Ｂ、Ｃは当該絵素に関する情報を示す。即
ち、情報Ａは例えば当該絵素の色彩に関する情報（色コ
ード）であり、２０ビツト〜２５ビツトが使用される。
情報Ｂは第１図に示すシフトレジスタ１１からの信号で
あシ、したがって、マスクテーブル９における修正を経
た信号である。情報Ｂには２６ビツトが使用される。
あシ、したがって、マスクテーブル９における修正を経
た信号である。情報Ｂには２６ビツトが使用される。
情報Ｃは画像入力装置により読取られた画像信号で６１
）、２７ビツトが使用される。画像メモリ５は、このよ
うなアドレスの多数個によジ構成されている。読取られ
た画像信号（もとになる画像信号）からみた場合、情報
Ａ、Ｂはこれに付属する信号とみることができる。
）、２７ビツトが使用される。画像メモリ５は、このよ
うなアドレスの多数個によジ構成されている。読取られ
た画像信号（もとになる画像信号）からみた場合、情報
Ａ、Ｂはこれに付属する信号とみることができる。
次に、本実施例の動作を第３図（ａ） 、 （ｂ）およ
び第４図（ａ） 、 （ｂ） 、 （ｅ）を参照しなが
ら説明する。画像入力装置により読取られた各絵素毎の
画像信号は画像メモリの所定のアドレスの２７ビツトに
収納される。ところで、前述のように、画像入力装置か
らの画像信号は多くの雑音を含んでいる。これを第３図
（ａ）に示す。第３図（ａ）は文字ｒＥＪを画像入力装
置で読取った場合の画像信号を示す。図中Ｘ印は信号「
】」を示し、空白部は信号「０」を示す。
び第４図（ａ） 、 （ｂ） 、 （ｅ）を参照しなが
ら説明する。画像入力装置により読取られた各絵素毎の
画像信号は画像メモリの所定のアドレスの２７ビツトに
収納される。ところで、前述のように、画像入力装置か
らの画像信号は多くの雑音を含んでいる。これを第３図
（ａ）に示す。第３図（ａ）は文字ｒＥＪを画像入力装
置で読取った場合の画像信号を示す。図中Ｘ印は信号「
】」を示し、空白部は信号「０」を示す。
図から明らかなように、文字ｒＥＪにあっては、信号ｅ
ｘ ｒ ｅ２ ＊ ｅｓは当然「１」であるべきである
が、画像入力装置で読取られた信号は「０」である。又
、これとは逆に、信号８１１ 、 ｅ１２＋ ｅｓ３は
「０」であるべき筈が「１」となっている。これらの信
号ｅｌ＋ ｅ２． ｅ３＋ ｅｌｌ＋ ｅ１２ ＋ ｅ
１３が雑音であｔ））このような誤った信号もそのまま
画像メそり５の相当するアドレスの２７ビツトに収納さ
れる。
ｘ ｒ ｅ２ ＊ ｅｓは当然「１」であるべきである
が、画像入力装置で読取られた信号は「０」である。又
、これとは逆に、信号８１１ 、 ｅ１２＋ ｅｓ３は
「０」であるべき筈が「１」となっている。これらの信
号ｅｌ＋ ｅ２． ｅ３＋ ｅｌｌ＋ ｅ１２ ＋ ｅ
１３が雑音であｔ））このような誤った信号もそのまま
画像メそり５の相当するアドレスの２７ビツトに収納さ
れる。
画像メモリ５に一旦収納された画像信号は所定の順序で
順次シフトレジスタ６に取出されシフトされてゆき、さ
らにシフトレジスタ７、シフトレジスタ８に入力されシ
フトされてゆく。シフトレジスタ６．７．８からは各別
に出力がマスクテーブル９に取出されるので、画像メモ
リ５からシフトレジスタ６へ画像信号を取出すときのア
ドレス順、および谷シフトレジスタ６．７．８のビット
数を適宜選択することにより、マスクテーブル９には画
像信号の任意の配列パターンが得られる。
順次シフトレジスタ６に取出されシフトされてゆき、さ
らにシフトレジスタ７、シフトレジスタ８に入力されシ
フトされてゆく。シフトレジスタ６．７．８からは各別
に出力がマスクテーブル９に取出されるので、画像メモ
リ５からシフトレジスタ６へ画像信号を取出すときのア
ドレス順、および谷シフトレジスタ６．７．８のビット
数を適宜選択することにより、マスクテーブル９には画
像信号の任意の配列パターンが得られる。
例えばこの配列パターンの１つが第３図（ａ）にＰｌで
示−Ｊ ｒしている。本実施例ではこの配列パターンは
。
示−Ｊ ｒしている。本実施例ではこの配列パターンは
。
画像信号（ａＸ３）で構成される。
一方、マスクテーブル９には予め定められた参照パター
ンが多数記憶さ九ており、入力さｎた配列パターンを順
次、記憶され１こ参照パターンと比較して画像信号の修
正が行なわれる。こＡｉｉ ３図（ａ） 、 （ｂ）お
よび第４図（ａ）〜（Ｃ）により説明する。第４図（ａ
）〜（Ｃ）は上記参照パターンのうちの３つの例を示し
た図であり、第４図（ａ）は（３Ｘ３）のパターンのう
ち中央部のみに信号「１」がある参照パターンを示し、
この場合、マスクテーブル９では入力された配列パター
ンがこのようなパターンであるとき、その信号「１」を
消去する処理がなされる。第３図（ａ）で配列パターン
Ｐ２がこれに相当し、信号Ｊｚは消去される。第４図（
ｂ）に示す参照パターンは中央部のみに信号「０」があ
る参照パターンであり、第３図（ａ）に示す配列パター
ンＰ３がこれに相当し、この場合、中央部の信号ｒＯＪ
は信号［ＩＪに変換される。即ち、信号ｅ３は「１」に
修正される。第４図（Ｃ）に示すものは上列および中央
部に信号「１」がある参照パターンであり、第３図（ａ
）に示す配列パターンＰ４がこれに相当し、この場合、
中央部の信号「ｌ」は信号「０」に変換され、したがっ
て、信号ｅ１３はｒＯＪに修正される。
ンが多数記憶さ九ており、入力さｎた配列パターンを順
次、記憶され１こ参照パターンと比較して画像信号の修
正が行なわれる。こＡｉｉ ３図（ａ） 、 （ｂ）お
よび第４図（ａ）〜（Ｃ）により説明する。第４図（ａ
）〜（Ｃ）は上記参照パターンのうちの３つの例を示し
た図であり、第４図（ａ）は（３Ｘ３）のパターンのう
ち中央部のみに信号「１」がある参照パターンを示し、
この場合、マスクテーブル９では入力された配列パター
ンがこのようなパターンであるとき、その信号「１」を
消去する処理がなされる。第３図（ａ）で配列パターン
Ｐ２がこれに相当し、信号Ｊｚは消去される。第４図（
ｂ）に示す参照パターンは中央部のみに信号「０」があ
る参照パターンであり、第３図（ａ）に示す配列パター
ンＰ３がこれに相当し、この場合、中央部の信号ｒＯＪ
は信号［ＩＪに変換される。即ち、信号ｅ３は「１」に
修正される。第４図（Ｃ）に示すものは上列および中央
部に信号「１」がある参照パターンであり、第３図（ａ
）に示す配列パターンＰ４がこれに相当し、この場合、
中央部の信号「ｌ」は信号「０」に変換され、したがっ
て、信号ｅ１３はｒＯＪに修正される。
このように、マスクテーブル９では画像信号の配列パタ
ーンを参照パターンと比較して修正を行う処理がなされ
る。
ーンを参照パターンと比較して修正を行う処理がなされ
る。
マスクテーブル９で修正処理を経た各画像信号は順次シ
フトレジスタｌＯに出力されてシフトされてゆき、さら
にシフトレジスタ１１にシフトされてゆく。シフトレジ
スタ１１では順次入力されてくる画像信号を、今度は画
像メモリ５の対応するアドレスの２６ビツト収納するた
めのタイミングがとられる。この結果、各絵素に対応す
る各アドレスには、２７ビツトに画像入力装置で得られ
た画像信号が記憶され、２６ビツトにマスクテーブル９
で修正処理を経た信号が記憶されることになる。
フトレジスタｌＯに出力されてシフトされてゆき、さら
にシフトレジスタ１１にシフトされてゆく。シフトレジ
スタ１１では順次入力されてくる画像信号を、今度は画
像メモリ５の対応するアドレスの２６ビツト収納するた
めのタイミングがとられる。この結果、各絵素に対応す
る各アドレスには、２７ビツトに画像入力装置で得られ
た画像信号が記憶され、２６ビツトにマスクテーブル９
で修正処理を経た信号が記憶されることになる。
例えば、第３図（ａ）に示す信号ｅ１についてみると、
その該当アドレスの２７ビツトには信号「０」が、又、
２６ビツトには信号「１」が記憶されることになる。こ
のため、各アドレスの２６ビツトには第３図（ｂ）に示
す整形された文字ｒＥＪに対応する信号が記憶される。
その該当アドレスの２７ビツトには信号「０」が、又、
２６ビツトには信号「１」が記憶されることになる。こ
のため、各アドレスの２６ビツトには第３図（ｂ）に示
す整形された文字ｒＥＪに対応する信号が記憶される。
このように、本実施例では、画像入力装置で得られた画
像信号を直ちに画像メモリに収納し、その後修正処理全
行うようにしたので、多くのデ・−タを取扱うことがで
き、このため、複雑な画像も処理することができる。又
、画像メモリの各アドレスの２７ビツトに画像入力装置
で得られた画像信号を記憶し、２６ビツトに修正処理を
経た画像信号を記憶するようにしたので、認識処理装置
で２６ビントから信号を取出して認識を行う場合、認識
が明確にできないときには、２７ビツトから原画像信号
を取出し、これを参照しながら認識を行うことができ、
誤認識や認識不可の事態を避けることができ、ひいては
認識率を向上させることができる。
像信号を直ちに画像メモリに収納し、その後修正処理全
行うようにしたので、多くのデ・−タを取扱うことがで
き、このため、複雑な画像も処理することができる。又
、画像メモリの各アドレスの２７ビツトに画像入力装置
で得られた画像信号を記憶し、２６ビツトに修正処理を
経た画像信号を記憶するようにしたので、認識処理装置
で２６ビントから信号を取出して認識を行う場合、認識
が明確にできないときには、２７ビツトから原画像信号
を取出し、これを参照しながら認識を行うことができ、
誤認識や認識不可の事態を避けることができ、ひいては
認識率を向上させることができる。
なお、上記実施例の説明では、配列パターンおよび参照
パターンをＣ３Ｘ３ ）の構成とした例について説明し
たが、これに限ることはなく、（３×４）、（４Ｘ ４
） 停適宜の構成とすることができる。
パターンをＣ３Ｘ３ ）の構成とした例について説明し
たが、これに限ることはなく、（３×４）、（４Ｘ ４
） 停適宜の構成とすることができる。
以上述べたように、本発明でに、画像人力装置で絖取ら
れた画像信号を記憶装置の所定の記憶部に一旦収納し、
その後画像信号の修正地理を行い、修正処理を経た画像
信号を前記所定の記憶部に付属する付属記憶部に収納す
るようにしたので、大量のデータを取扱うことがでさ、
かつ、認識処理における誤認識や認識不可の事態を避け
ることができ、ひいては認識率を向上させることができ
る。
れた画像信号を記憶装置の所定の記憶部に一旦収納し、
その後画像信号の修正地理を行い、修正処理を経た画像
信号を前記所定の記憶部に付属する付属記憶部に収納す
るようにしたので、大量のデータを取扱うことがでさ、
かつ、認識処理における誤認識や認識不可の事態を避け
ることができ、ひいては認識率を向上させることができ
る。
第１図は本発明の実施例に係る画像前処理装置のブロッ
ク図、第２図は第１図に示す画像メモリのアドレス構成
図、第３図（Ｌ） 、 （ｂ）画像信号の説明図、第４
図（ａ） 、 （ｂ） 、 （Ｃ）は参照パターンの構
成図、第５図は図形認識装置の系統図でおる。 ５・・・画像メモリ、 ６，７，８．１０．１１・・
・シフトレジスタ、 ９・・・マスクテーブル。
ク図、第２図は第１図に示す画像メモリのアドレス構成
図、第３図（Ｌ） 、 （ｂ）画像信号の説明図、第４
図（ａ） 、 （ｂ） 、 （Ｃ）は参照パターンの構
成図、第５図は図形認識装置の系統図でおる。 ５・・・画像メモリ、 ６，７，８．１０．１１・・
・シフトレジスタ、 ９・・・マスクテーブル。
Claims (1)
- 表示された画像を読取る画像入力装置と、この画像入力
装置により読取られた各画像信号を記憶する記憶装置と
を備えたものにおいて、前記記憶装置に設置され前記各
画像信号が記憶される各記憶部にそれぞれ付属する付属
記憶部と、前記記憶装置に記憶された前記各画像信号を
所定のパターンに配列する配列手段と、前記所定のパタ
ーンを予め定められたパターンと比較して前記各画像信
号を修正する修正手段と、この修正手段により修正を経
た前記各画像信号をそれぞれ対応する前記付属記憶部に
収納する収納手段とを設けたことを特徴とする画像前処
理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60187267A JPS6249482A (ja) | 1985-08-28 | 1985-08-28 | 画像前処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60187267A JPS6249482A (ja) | 1985-08-28 | 1985-08-28 | 画像前処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6249482A true JPS6249482A (ja) | 1987-03-04 |
Family
ID=16202991
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60187267A Pending JPS6249482A (ja) | 1985-08-28 | 1985-08-28 | 画像前処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6249482A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01292487A (ja) * | 1988-05-19 | 1989-11-24 | Sony Corp | 文字認識装置 |
| US4941192A (en) * | 1987-04-20 | 1990-07-10 | Hitachi, Ltd. | Method and apparatus for recognizing pattern of gray level image |
-
1985
- 1985-08-28 JP JP60187267A patent/JPS6249482A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4941192A (en) * | 1987-04-20 | 1990-07-10 | Hitachi, Ltd. | Method and apparatus for recognizing pattern of gray level image |
| JPH01292487A (ja) * | 1988-05-19 | 1989-11-24 | Sony Corp | 文字認識装置 |
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