JPS6242485Y2 - - Google Patents

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JPS6242485Y2
JPS6242485Y2 JP5254181U JP5254181U JPS6242485Y2 JP S6242485 Y2 JPS6242485 Y2 JP S6242485Y2 JP 5254181 U JP5254181 U JP 5254181U JP 5254181 U JP5254181 U JP 5254181U JP S6242485 Y2 JPS6242485 Y2 JP S6242485Y2
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varistor
voltage
thermistor
coefficient thermistor
circuit
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Description

【考案の詳細な説明】 本考案はサージ吸収に用いられるセラミツクバ
リスタへの連続過電圧によつて引き起されるバリ
スタの短絡、焼損対策を施し、連続の過電圧が印
加されてもバリスタが短絡することなく、またサ
ージ吸収機能も十分発揮できるサージ吸収器を提
供するものである。
[Detailed description of the invention] This invention takes measures against short circuits and burnouts of ceramic varistors used for surge absorption caused by continuous overvoltage, and prevents the varistors from shorting even when continuous overvoltage is applied. The purpose of the present invention is to provide a surge absorber that can sufficiently exhibit the surge absorption function.

酸化亜鉛を主体としたセラミツクを用いたバリ
スタは電子機器を雷などのサージ電圧から守るた
めに電源電線の線間あるいは大地間に接続され、
近年幅広く用いられるようになつてきた。
Varistors, which are made of ceramic mainly made of zinc oxide, are connected between power lines or the ground to protect electronic equipment from surge voltages such as lightning.
It has become widely used in recent years.

この種のバリスタとしては現在、酸化亜鉛を主
体としたバリスタが主流となつているが、このバ
リスタは電圧非直線指数が極めて大きく(通常30
以上)、ある一定の電圧(以下バリスタ電圧と呼
ぶ)以下においては絶縁物として働き、またそれ
以上の電圧に対して極めて低い抵抗値を呈し、結
果としてその電圧に伴なう電流をバリスタに流し
電圧を低く制限するという特性を有している。そ
のためこの種のバリスタをサージ吸収器として用
いる場合は、通常時においては、絶縁物として動
作させるため、そのバリスタ電圧は通常の回路電
圧の波高値よりもいくらか高いところに設定す
る。例えばAC100Vの線間に用いる場合、そのバ
リスタ電圧は220V程度に設定する。
Currently, the mainstream of this type of varistor is a varistor mainly made of zinc oxide, but this varistor has an extremely large voltage nonlinearity index (usually 30
(above), below a certain voltage (hereinafter referred to as varistor voltage), it acts as an insulator, and exhibits an extremely low resistance value for voltages above that, resulting in the current associated with that voltage flowing through the varistor. It has the characteristic of limiting the voltage to a low level. Therefore, when this type of varistor is used as a surge absorber, the varistor voltage is set to be somewhat higher than the peak value of the normal circuit voltage in order to operate it as an insulator under normal conditions. For example, when using between AC100V lines, the varistor voltage is set to about 220V.

その回路例を示したのが第1図である。1は電
源電線で、この場合AC100Vである。2は線間に
接続されたバリスタである。もしバリスタ2のバ
リスタ電圧が220Vであれば、電源電圧がAC100V
からAC140Vにまで上昇しても何ら問題はなく、
バリスタ2に何ら影響を与えることはない。しか
しながら、負荷の大きな変動、あるいは単相3線
式配電線の中性線の欠相、その他の地絡事故など
によつて、バリスタ2にAC140V以上の過電圧が
印加されることがある。この場合、過電圧の波高
値はバリスタ2のバリスタ電圧を大きく上まわ
り、連続して電源の電流がバリスタ2に流入する
ことになる。そのためバリスタ2は過大な発熱を
生じ短絡破壊を生じることになる。
FIG. 1 shows an example of the circuit. 1 is the power wire, which in this case is AC100V. 2 is a varistor connected between the lines. If the varistor voltage of varistor 2 is 220V, the power supply voltage is AC100V
There is no problem even if the voltage rises from 140V to AC140V.
This does not affect the ballista 2 in any way. However, an overvoltage of 140 VAC or more may be applied to the varistor 2 due to a large change in load, an open phase in the neutral wire of a single-phase three-wire distribution line, or other ground faults. In this case, the peak value of the overvoltage greatly exceeds the varistor voltage of the varistor 2, and the current from the power supply continuously flows into the varistor 2. Therefore, the varistor 2 generates excessive heat, resulting in short-circuit damage.

この対策として、バリスタ電圧をさらに高く設
定する方法が考えられるが、サージ吸収時の制限
電圧が上昇し、電子機器との協調がとれにくいと
いう問題があつた。
A possible solution to this problem is to set the varistor voltage even higher, but this raises the problem of increasing the limit voltage during surge absorption and making it difficult to coordinate with electronic equipment.

本考案は以上の問題点であるサージ吸収時の制
限電圧を大きく上げることなく、また連続過電圧
に対しても短絡破壊を生じることのないサージ吸
収器を提供するものである。
The present invention provides a surge absorber that does not significantly increase the limiting voltage during surge absorption, which is the problem mentioned above, and does not cause short-circuit breakdown even in the case of continuous overvoltage.

第2図は本考案のサージ吸収器の回路を示した
ものである。3は第1のバリスタで前記従来のバ
リスタ2と同様なバリスタ電圧を持つものであ
る。4は第1のバリスタ3に電気的に直列に接続
された正特性サーミスタで、第1のバリスタ3と
正特性サーミスタ4は熱的にも結合されている。
この正特性サーミスタ4はある一定の温度以上に
なれば、急激に抵抗値が増加するもので、本考案
の回路の場合、室温における抵抗値は5オーム程
度に設定している。5は正特性サーミスタ4に電
気的に並列に接続された第2のバリスタで、バリ
スタ電圧は推定過電圧の程度に応じて任意に選定
できるが、この例では220Vとした。
FIG. 2 shows the circuit of the surge absorber of the present invention. Reference numeral 3 denotes a first varistor which has the same varistor voltage as the conventional varistor 2. 4 is a positive temperature coefficient thermistor electrically connected in series with the first varistor 3, and the first varistor 3 and the positive coefficient thermistor 4 are also thermally coupled.
The resistance value of this positive temperature coefficient thermistor 4 increases rapidly when the temperature exceeds a certain level, and in the case of the circuit of the present invention, the resistance value at room temperature is set to about 5 ohms. Reference numeral 5 denotes a second varistor electrically connected in parallel to the positive temperature coefficient thermistor 4, and the varistor voltage can be arbitrarily selected depending on the degree of estimated overvoltage, but in this example, it was set to 220V.

今、この回路にACの過電圧200Vが連続的に印
加された場合を想定する。ACの過電圧に対し正
特性サーミスタ4の温度が上昇していない状態で
は、正特性サーミスタ4の抵抗は第2のバリスタ
5の抵抗に比べて低く、電源電流は、第1のバリ
スタ3ならびに正特性サーミスタ4を通じて流れ
込む。この時、連続した流入電流によつて第1の
バリスタ3、正特性サーミスタ4ともに発熱を生
じる。この時第1のバリスタ3は正特性サーミス
タ4と熱的に結合されているため、正特性サーミ
スタ4の温度上昇は、正特性サーミスタ4のみに
よる温度上昇よりも大きい。この温度上昇によつ
て正特性サーミスタ4の抵抗値は急激に大きくな
り、流入電流を第1のバリスタ3の短絡破壊に至
らない程度に制限する。また、連続過電圧が取り
去られた後は、正特性サーミスタ4の温度はまた
低下し、過電圧印加前の状態に復帰する。一方、
この回路にサージ電圧が印加された時、まずサー
ジ電流は前記と同様、第1のバリスタ3と正特性
サーミスタ4を通じて流れ、もしこの時第2のバ
リスタ5がなければ、その制限電圧は、第4図の
イのようになる。ここで電流の上昇とともに急激
に制限電圧が上昇するのは正特性サーミスタ4に
おける電圧降下が直線的に増加するためである。
この制限電圧上昇を防止するために、第2のバリ
スタ5が用いられているわけである。すなわち、
正特性サーミスタ4における電圧降下が第2のバ
リスタ5のバリスタ電圧220Vを越えた段階か
ら、第2のバリスタ5の動作がはじまり、制限電
圧上昇の抑制を行ない、本考案の回路の制限電圧
は第4図のロのように十分低い上昇特性を有す
る。
Now, assume that an AC overvoltage of 200V is continuously applied to this circuit. When the temperature of the PTC thermistor 4 does not rise in response to AC overvoltage, the resistance of the PTC thermistor 4 is lower than the resistance of the second varistor 5, and the power supply current flows through the first varistor 3 and the PTC thermistor 4. It flows through the thermistor 4. At this time, both the first varistor 3 and the positive temperature coefficient thermistor 4 generate heat due to the continuous inflow current. At this time, since the first varistor 3 is thermally coupled to the PTC thermistor 4, the temperature rise of the PTC thermistor 4 is larger than the temperature rise due to the PTC thermistor 4 alone. Due to this temperature rise, the resistance value of the positive temperature coefficient thermistor 4 increases rapidly, and the inflow current is limited to an extent that does not cause the first varistor 3 to be destroyed by short circuit. Furthermore, after the continuous overvoltage is removed, the temperature of the PTC thermistor 4 decreases again, returning to the state before the overvoltage was applied. on the other hand,
When a surge voltage is applied to this circuit, the surge current first flows through the first varistor 3 and the positive temperature coefficient thermistor 4 as described above, and if the second varistor 5 is not present at this time, the limiting voltage will be It will look like A in Figure 4. The reason why the limit voltage increases rapidly with the increase in current is that the voltage drop across the positive temperature coefficient thermistor 4 increases linearly.
In order to prevent this limit voltage from increasing, the second varistor 5 is used. That is,
When the voltage drop across the positive characteristic thermistor 4 exceeds the varistor voltage of 220V of the second varistor 5, the second varistor 5 starts operating and suppresses the increase in the limit voltage, and the limit voltage of the circuit of the present invention is reduced to 220V. As shown in Figure 4 (b), it has a sufficiently low rise characteristic.

さて、第3図に本考案のサージ吸収器の具体例
の構造を示した。
Now, FIG. 3 shows the structure of a specific example of the surge absorber of the present invention.

6は前記第2のバリスタ、7は前記正特性サー
ミスタ、8は前記第1のバリスタ、9は第2のバ
リスタ6と正特性サーミスタ7を並列接続するた
めのワタリであり、10,11は両電気端子であ
る。
6 is the second varistor, 7 is the positive temperature coefficient thermistor, 8 is the first varistor, 9 is a wafer for connecting the second varistor 6 and the positive coefficient thermistor 7 in parallel, and 10 and 11 are both It is an electrical terminal.

ここで、正特性サーミスタ7と第1のバリスタ
8と第2のバリスタ6とは、第2図に示す回路構
成となるように、ワタリ9と電気端子10,11
により接続されている。また、正特性サーミスタ
7は、第1のバリスタ8の熱が伝わり易くなるよ
うに結合されている。
Here, the positive temperature coefficient thermistor 7, the first varistor 8, and the second varistor 6 are connected to the waving 9 and the electric terminals 10, 11 so as to have the circuit configuration shown in FIG.
connected by. Further, the positive temperature coefficient thermistor 7 is coupled so that the heat of the first varistor 8 is easily transferred.

以上のように本考案のサージ吸収器の回路構成
にすることによつて次の効果が得られる。
By configuring the circuit configuration of the surge absorber of the present invention as described above, the following effects can be obtained.

(1) 第1のバリスタに正特性サーミスタを直列に
接続し、かつ第1のバリスタと正特性サーミス
タを熱的に結合しているため、連続した過電圧
に対しても短絡破壊を生じないサージ吸収器が
得られる。
(1) A positive temperature coefficient thermistor is connected in series to the first varistor, and the first varistor and the positive coefficient thermistor are thermally coupled, so surge absorption does not cause short-circuit damage even in the case of continuous overvoltage. A vessel is obtained.

(2) 正特性サーミスタに第2のバリスタが並列に
接続されているため、サージ電圧に対しても、
十分低い制限電圧が得られる。
(2) Since the second varistor is connected in parallel to the positive temperature coefficient thermistor, it can withstand surge voltages.
A sufficiently low limiting voltage can be obtained.

また第1のバリスタと正特性サーミスタを熱的
に結合することによつて正特性サーミスタの抵抗
変化への応答が早くなり、第1のバリスタの破壊
保護効果が高くなる。
Further, by thermally coupling the first varistor and the positive temperature coefficient thermistor, the response to resistance changes of the positive coefficient thermistor becomes faster, and the effect of protecting the first varistor from destruction becomes higher.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は従来のサージ吸収器の電気的回路図、
第2図は本考案のサージ吸収器の一実施例を示す
電気的回路図、第3図は同サージ吸収器の具体構
成の一例を示す断面図、第4図は同サージ吸収器
の制限電圧特性図である。 3,8……第1バリスタ、4,7……正特性サ
ーミスタ、5,6……第2のバリスタ。
Figure 1 is an electrical circuit diagram of a conventional surge absorber.
Fig. 2 is an electrical circuit diagram showing an embodiment of the surge absorber of the present invention, Fig. 3 is a sectional view showing an example of the specific configuration of the surge absorber, and Fig. 4 is the limiting voltage of the surge absorber. It is a characteristic diagram. 3, 8...First varistor, 4, 7...Positive characteristic thermistor, 5, 6... Second varistor.

Claims (1)

【実用新案登録請求の範囲】[Scope of utility model registration request] 第1、第2のバリスタと正特性サーミスタとか
らなり、第1のバリスタと前記正特性サーミスタ
とを電気的に直列に接続するとともに熱的に結合
し、さらに第2のバリスタを前記正特性サーミス
タに電気的に並列に接続したことを特徴とするサ
ージ吸収器。
The first varistor and the positive thermistor are electrically connected in series and thermally coupled, and the second varistor is connected to the positive thermistor. A surge absorber characterized by being electrically connected in parallel to.
JP5254181U 1981-04-10 1981-04-10 Expired JPS6242485Y2 (en)

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JPS57166303U JPS57166303U (en) 1982-10-20
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