JPS6241450Y2 - - Google Patents
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- JPS6241450Y2 JPS6241450Y2 JP11899879U JP11899879U JPS6241450Y2 JP S6241450 Y2 JPS6241450 Y2 JP S6241450Y2 JP 11899879 U JP11899879 U JP 11899879U JP 11899879 U JP11899879 U JP 11899879U JP S6241450 Y2 JPS6241450 Y2 JP S6241450Y2
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- JP
- Japan
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- voltage
- electronic volume
- output
- circuit
- control voltage
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- 230000008054 signal transmission Effects 0.000 claims description 2
- 238000010586 diagram Methods 0.000 description 4
- 239000003990 capacitor Substances 0.000 description 2
- 230000002238 attenuated effect Effects 0.000 description 1
Description
【考案の詳細な説明】
本考案は、電子ボリウムにおける残留信号を除
去するようにした回路に関する。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a circuit for removing residual signals in an electronic volume.
電子ボリウムは、信号伝送系に接点が介在せ
ず、またリモコン用に適するので、最近多く利用
されているが、最大減衰量は80dB前後であると
ころから一般の可変抵抗器の100dBに比べて少な
く、このため減衰量の不足から伝送信号を完全に
絞ることができなかつた。 Electronic potentiometers have been widely used recently because they do not require any contacts in the signal transmission system and are suitable for remote control applications, but the maximum attenuation is around 80 dB, which is lower than the 100 dB of a general variable resistor. Therefore, it was not possible to completely narrow down the transmitted signal due to insufficient attenuation.
本考案は斯る点に鑑みたもので、電子ボリウム
にミユーテイング回路を接続して、その電子ボリ
ウムの減衰量を最大にしたときの残留信号を聴感
上の不自然さを伴なうことなく打消するようにし
て、前記したような問題点を解決せんとするもの
である。 The present invention was developed in consideration of this point, and is designed to cancel the residual signal when the attenuation amount of the electronic volume is maximized by connecting a muting circuit to the electronic volume without causing any audible unnaturalness. In this way, the above-mentioned problems are attempted to be solved.
以下、図を参照して本考案の一実施例を説明す
る。第1図において、電子ボリウム回路として働
く1はコンデンサC1を介して入力端子1aに加
わる入力信号を、制御端子1bに加わる第1の制
御電圧としての制御直流電圧V1に逆比例させて
減衰させて出力端子1cに取り出すもので、その
制御直流電圧V1は電源電圧VCCを可変抵抗VRで
分圧して得ている。そして、この電子ボリウム1
の出力はコンデンサC2及び入力抵抗R3を介して
ミユーテイング回路としてのアナログスイツチ2
に入力している。 An embodiment of the present invention will be described below with reference to the drawings. In Fig. 1, 1, which acts as an electronic volume circuit, attenuates the input signal applied to the input terminal 1a via the capacitor C1 in inverse proportion to the control DC voltage V1 as the first control voltage applied to the control terminal 1b. The control DC voltage V 1 is obtained by dividing the power supply voltage V CC by a variable resistor VR. And this electronic volume 1
The output of is connected to analog switch 2 as a muting circuit via capacitor C 2 and input resistor R 3 .
is being input.
このアナログスイツチ2はPチヤンネルFET
とNチヤンネルFET及びインバータで成り、制
御端子2aに第2の制御電圧としての高レベルの
制御電圧を印加することにより入出力間が導通
し、零レベルの制御電圧を印加することにより遮
断する。R5は出力抵抗である。 This analog switch 2 is a P channel FET
It consists of an N-channel FET and an inverter, and conduction is established between the input and output by applying a high-level control voltage as a second control voltage to the control terminal 2a, and disconnected by applying a zero-level control voltage. R5 is the output resistance.
3は演算増幅器で成るコンパレータで、反転入
力端子3aには電源電圧VCCを抵抗R1とR2で分
圧した比較のための基準電圧V2が印加されてお
り、非反転入力端子3bには可変抵抗VRで得ら
れる電子ボリウム1のための制御電圧V1が印加
している。従つてこのコンパレータはV1≦V2の
ときに出力を低レベルにするが、単一電源VCCを
使用しているのでその場合でも1V程度の残留電
圧が出るため、この残留電圧をツエナダイオード
ZDによつて打消するようにしている。 Reference numeral 3 denotes a comparator consisting of an operational amplifier, and a reference voltage V 2 for comparison obtained by dividing the power supply voltage V CC by resistors R 1 and R 2 is applied to the inverting input terminal 3 a, and a reference voltage V 2 for comparison, which is obtained by dividing the power supply voltage V CC by resistors R 1 and R 2, is applied to the non-inverting input terminal 3 b. A control voltage V 1 for the electronic volume 1 obtained by the variable resistor VR is applied. Therefore, this comparator outputs a low level when V 1 ≦ V 2 , but since a single power supply V CC is used, a residual voltage of about 1 V is generated even in that case, so this residual voltage is connected to a Zener diode.
I try to cancel it with ZD.
以上において、可変抵抗VRによる制御電圧V1
が大きければ電子ボリウム1の減衰量は小さく、
小さければ大きくなるので、最大減衰量
(80dB)時の制御電圧V1と等しい値に基準電圧V2
を設定する。 In the above, the control voltage V 1 by the variable resistor VR
If is large, the attenuation amount of electronic volume 1 is small,
The smaller the value, the larger it will be, so set the reference voltage V 2 to a value equal to the control voltage V 1 at the maximum attenuation (80 dB).
Set.
そして、V1>V2の時にはコンパレータ3の出
力は高レベルであるので、アナログスイツチ2は
導通しており、電子ボリウム1で減衰した信号が
そのまま出力信号e0として出る。この後可変抵
抗VRによつて制御電圧V1を小さくしてゆき、V1
≦V2となると、コンパレータ3の出力は低レベ
ルとなり、ツエナダイオードZDのツエナ電圧以
下となるので、アナログスイツチ2の制御端子2
aには電圧が加わらなくなり、このためそのアナ
ログスイツチ2は遮断するようになる。従つて、
この時には最大減衰時であるにも拘らず電子ボリ
ウム1から残留信号が出るが、その信号はアナロ
グスイツチ2によつてミユートされるようになる
ので、出力電圧e0は零となる。そして、このよ
うに最大減衰時にミユーテイングされるので、音
声聴取時等においても聴感上の不自然さは伴なわ
ない。 When V 1 >V 2 , the output of the comparator 3 is at a high level, so the analog switch 2 is conductive, and the signal attenuated by the electronic volume 1 is output as is as the output signal e 0 . After that, the control voltage V 1 is reduced by the variable resistor VR, and V 1
When ≦V 2 , the output of comparator 3 becomes low level and becomes lower than the Zener voltage of Zener diode ZD.
No voltage is applied to a, and therefore the analog switch 2 is cut off. Therefore,
At this time, a residual signal is output from the electronic volume 1 even though it is at maximum attenuation, but that signal is muted by the analog switch 2, so the output voltage e 0 becomes zero. Since muting is performed at the time of maximum attenuation in this manner, there is no unnaturalness in the auditory sense when listening to audio.
以上から本考案によれば、電子ボリウムが最大
減衰量になるとミユーテイング回路が働くので理
論的に減衰量を−∞とすることが可能になるの
で、電子ボリウムの残留信号及びノイズを完全に
除去することができ、またそれらの除去を聴感上
の不自然さを伴うことなく行なうことができるよ
うになる。 From the above, according to the present invention, when the electronic volume reaches its maximum attenuation, the muting circuit works, so it is theoretically possible to reduce the attenuation to -∞, thereby completely eliminating the residual signal and noise of the electronic volume. In addition, it becomes possible to remove them without causing any unnatural sound.
第1図は本考案の一実施例の回路図、第2図は
コンパレータ3への入力電圧の特性図、第3図は
アナログスイツチの制御信号特性図、第4図は出
力信号の特性図である。
1……電子ボリウム、2……アナログスイツ
チ、3……コンパレータ。
Fig. 1 is a circuit diagram of an embodiment of the present invention, Fig. 2 is a characteristic diagram of the input voltage to the comparator 3, Fig. 3 is a control signal characteristic diagram of the analog switch, and Fig. 4 is a characteristic diagram of the output signal. be. 1...Electronic volume, 2...Analog switch, 3...Comparator.
Claims (1)
入力信号の減衰量が制御される電子ボリウム回路
と、 この電子ボリウム回路の出力端に接続され前記
電子ボリウム回路からの出力信号を第2の制御電
圧を受けて遮断させるミユーテイング回路と、 前記電子ボリウム回路に与える前記第1の制御
電圧を一方の入力とし、基準電圧を他方の入力と
して前記第1の制御電圧が前記電子ボリウム回路
を最大減衰量に制御する値に設定された場合に出
力を発生するコンパレータとを備え、 前記コンパレータの出力を前記第2の制御電圧
として用いたことを特徴とする電子ボリウムにお
ける残留信号除去回路。[Claims for Utility Model Registration] An electronic volume circuit that is inserted into a signal transmission circuit and whose attenuation amount of an input signal is controlled by a first control voltage; a muting circuit that receives a second control voltage and cuts off the output signal; one input is the first control voltage applied to the electronic volume circuit; the other input is a reference voltage; and a comparator that generates an output when the electronic volume circuit is set to a value that controls the amount of attenuation to a maximum, and the output of the comparator is used as the second control voltage. removal circuit.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP11899879U JPS6241450Y2 (en) | 1979-08-31 | 1979-08-31 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP11899879U JPS6241450Y2 (en) | 1979-08-31 | 1979-08-31 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5639726U JPS5639726U (en) | 1981-04-14 |
JPS6241450Y2 true JPS6241450Y2 (en) | 1987-10-23 |
Family
ID=29351200
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP11899879U Expired JPS6241450Y2 (en) | 1979-08-31 | 1979-08-31 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6241450Y2 (en) |
-
1979
- 1979-08-31 JP JP11899879U patent/JPS6241450Y2/ja not_active Expired
Also Published As
Publication number | Publication date |
---|---|
JPS5639726U (en) | 1981-04-14 |
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