JPS6239242A - Gate pulse generation circuit for extraction of detecting signal - Google Patents
Gate pulse generation circuit for extraction of detecting signalInfo
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- JPS6239242A JPS6239242A JP60177599A JP17759985A JPS6239242A JP S6239242 A JPS6239242 A JP S6239242A JP 60177599 A JP60177599 A JP 60177599A JP 17759985 A JP17759985 A JP 17759985A JP S6239242 A JPS6239242 A JP S6239242A
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- pulse
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- register
- gate pulse
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-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B41—PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
- B41F—PRINTING MACHINES OR PRESSES
- B41F33/00—Indicating, counting, warning, control or safety devices
Landscapes
- Inking, Control Or Cleaning Of Printing Machines (AREA)
Abstract
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は輪転印刷機において生ずる天地方向見当誤差全
検出するため、ロールm停の長尺紙上へ印刷されるレジ
スタマークの検出信号を抽出する際、この抽出用ゲート
回路をオンとするゲートパルスの発生回路に関するもの
である。。[Detailed Description of the Invention] [Industrial Application Field] The present invention extracts the detection signal of a register mark printed on a long sheet of paper with a roll stop of m in order to detect all the vertical registration errors that occur in a rotary printing press. This invention relates to a gate pulse generation circuit that turns on this extraction gate circuit. .
複数の版胴を有する輪転印刷機においては、ロール紙等
の長尺紙上へ各版胴の版によ)順次に印刷を行なってお
シ、各版の長尺紙に対する印刷位置が異なると画伯の不
一致が生ずるため、各版の印刷位置に応する見当誤差を
自動的に修正し、各版による画4iが一致する方向へ制
御する目的上。In a rotary printing press with multiple plate cylinders, printing is performed sequentially (by the plate of each plate cylinder) onto a long sheet of paper such as roll paper. This is for the purpose of automatically correcting the registration error corresponding to the printing position of each plate, and controlling the image 4i of each plate in a direction in which the images 4i match.
本出願人の別途1顧による特開昭58−14751号。Japanese Patent Application Laid-Open No. 14751/1983 by a separate client of the present applicant.
特開昭58−14752号等により、各種の自動見当調
整装#が開示されており、これらにおいては。Japanese Patent Laid-Open No. 58-14752 and other publications disclose various automatic register adjustment devices.
見当誤差検出用として長尺紙ヘレジスタマークを各版毎
に印刷し、この各レジスタマークの検出信号を抽出する
際、印刷機の回転と同期して発生し。Register marks are printed on each plate of long paper to detect registration errors, and when extracting the detection signal of each register mark, this occurs in synchronization with the rotation of the printing press.
たゲートパルスを用いるものとなっている。。It uses a gate pulse with .
しかし、従来におhては、印刷機の回転軸と連結したパ
ルス発注手段からのパルスに応じて単安駕マルチバイブ
レータ等を駆動すると共に、これによって発生するゲー
トパルスのタイミングを人為的に調整のうえ設定してお
り、各種の印すリ条件変化および長尺紙の移送状況変化
に応じて長尺紙か伸縮し、かつ、印刷部位とレジスタマ
ークの検出部位との距離が数lom忙達するため、長尺
紙伸縮の影響が大となシ、これにしたがってゲートパル
スの最適とするタイミングも変化するのに対し、ゲート
パルスのタイミングは設定後固定されておシ、レジスタ
マークの検出信号抽出が不正確となる問題を生じている
3
〔問題点″fr−解決するための手段〕前述の問題を解
決するため、不発シ」はつぎの手段により構成するもの
となっている。However, in the past, in addition to driving a single-yarn multivibrator etc. in response to pulses from a pulse ordering means connected to the rotating shaft of the printing press, the timing of the gate pulses generated thereby was artificially adjusted. In addition, the long paper expands and contracts in response to changes in various printing conditions and transport conditions of the long paper, and the distance between the printing area and the register mark detection area increases by several roms. Therefore, the influence of long paper expansion and contraction is large, and the optimal timing of the gate pulse changes accordingly, whereas the timing of the gate pulse is fixed after setting, and register mark detection signal extraction 3 [Problem "fr-Means for Solving]" In order to solve the above-mentioned problem, the "non-explosion" is constructed by the following means.
すなわち、長尺紙上へ基準マークに続@規定間隔によシ
印刷されたレジスタマークの検出信号をゲート回路によ
シ抽出する際、このゲート回路をオンとするゲートパル
スを発生する回路において57!I!ir!Aマークの
検出信号に基づきこの基準マークの前縁から基準マーク
とレジスタマークとの規定間隔よ#)′Eiい間隔まで
と対応する時間の経過を検出する手段と、この手段の検
出に応じてレジスタマークの検出信号を含むパルス幅の
ゲートパルス全発生する手段とを備えたものである3゜
〔作用〕
したがって、基準マークとレジスタとを規定間隔として
印刷し1時間の経過を検出する手段により、基準マーク
の前線から規定間隔よシ短い間隔までの時間経過を検出
すれば、この時点がレジスタマークの検出信号よシ若干
前の時点となシ、この時点を基準としてゲートパルスの
発生が行なわれるため、確実にレジスタマークの検出信
号をゲー ト回路によシ抽出することができる〔実施例
〕
以下、実施例を示す図によって本発明の詳細な説明する
。1
第2回内は谷マークの印刷状況を示す図、同図(B)は
検出信号の波形を示す図、同図(C)はクロックパルス
のカウント状況を示す図5同図(6)はゲートパルスの
発生状況を示す図であり、(A)においては、ロール紙
等の長尺紙1の側方上へ、矢印により示す送り方向に対
し一定長do として第1の版によシ基準マーク2を
印刷すると共に、これに続き規定間隔Li設け、かつ、
所定間隔りとして第1の版による第1のレジスタマーク
3aおよび第2の版による同マーク3bt−印刷してお
シ、この例では、基準マーク2とレジスタマーク3aが
共に同色、レジスタマーク3bは他の色により印刷され
ている1゜
これらの各マークは、走査線4上へ各マークと対向して
固定された反射光式゛または透過光弐等の光電的検出器
5により電気信号として検出されるものとなっておシ、
走査線4上において検出が行なわれるため、(B)に示
ナパルス状伯号が長尺紙1の移送に応じて得られる、
したがって、各長さおよび間隔do、t、Dと対応する
各パルス幅およびパルス間隔よジ十分に高い周波数のク
ロックパルス(C)を、検出信号の)に基づき基準マー
ク2の前縁2a刀1らカウントし、d。That is, when a gate circuit extracts a detection signal of a register mark printed on a long sheet of paper following a reference mark at regular intervals, a circuit that generates a gate pulse to turn on this gate circuit receives 57! I! ir! means for detecting the passage of time from the front edge of the reference mark to a specified interval between the reference mark and the register mark based on the detection signal of the A mark; 3. [Function] Therefore, by means of printing reference marks and registers at specified intervals and detecting the passage of one hour, If the time elapsed from the front line of the reference mark to an interval shorter than the specified interval is detected, this point will be slightly earlier than the detection signal of the register mark, and the gate pulse will be generated based on this point. [Embodiment] The present invention will be described in detail below with reference to figures showing embodiments. 1 The second figure shows the printing status of the valley mark, the same figure (B) shows the waveform of the detection signal, the same figure (C) shows the clock pulse count situation, and the same figure (6) 2 is a diagram illustrating the generation situation of gate pulses, and in (A), a fixed length do is applied to the side of a long paper 1 such as a roll paper in the feeding direction indicated by an arrow, and the first version is set as a standard. At the same time as printing mark 2, following this, a specified interval Li is provided, and
The first register mark 3a on the first plate and the same mark 3b on the second plate are printed at predetermined intervals. In this example, the reference mark 2 and the register mark 3a are both the same color, and the register mark 3b is the same color. 1゜These marks printed in other colors are detected as electrical signals by a photoelectric detector 5 such as a reflected light type or transmitted light type fixed on the scanning line 4 facing each mark. Become the one who will be treated,
Since the detection is carried out on the scanning line 4, in (B) a signal in the form of a pulse is obtained according to the transport of the long paper 1. Therefore, each pulse corresponding to each length and interval do, t, D Clock pulses (C) having a sufficiently high frequency than the width and pulse interval are counted from the front edge 2a of the reference mark 2 based on the detection signal (), and d.
と対応するカウント値nに加え1間隔りより短い間隔t
のカウント値n1 までカウント”すれは1時点1+
に達し、これからゲートパルス(2)をカウント値n2
まで発生すると、これのパルス幅はレジスタマーク3a
の検出信号を含むものとなシ、更ンこカウント値n3の
後に同様のゲートパルス(D)を発生すれば、今度はレ
ジスタマーク3bの検出信号を含むものとなる。and the corresponding count value n plus an interval t shorter than one interval
Counting up to the count value n1 is 1+ at one point in time.
is reached, and from now on the gate pulse (2) is set to the count value n2
When the pulse width reaches register mark 3a,
However, if a similar gate pulse (D) is generated after the count value n3, this time it will include the detection signal of the register mark 3b.
したがって、ゲートパルス(D)によりレジスタマーク
3a 、 3bの検出信号(B)と確実に抽出すること
ができる。Therefore, the gate pulse (D) can reliably extract the detection signal (B) of the register marks 3a and 3b.
一方、長尺紙1の伸縮率t−1(、各レジスタマーク3
a 、 3bを各個に印刷する各板間の見尚誤差量をΔ
d、基準マーク2の長さdo と対応するパルスの時間
幅をT、各レジスタマーク3a、3bと対応する各パル
ス間の時間をtとし、長尺R1の移送速度を一定とすれ
ば、実際には、基準マーク2の実長doyにkが含まれ
、レジスタマーク3a。On the other hand, the expansion/contraction rate t-1 of the long paper 1 (, each register mark 3
The amount of misalignment between each board on which a and 3b are printed is Δ
d, the length of the reference mark 2 do, the time width of the pulse corresponding to T, the time between each pulse corresponding to each register mark 3a, 3b, t, and if the transport speed of the long length R1 is constant, the actual , k is included in the actual length doy of the reference mark 2, and the register mark 3a.
3bの実間隔DrにはkおよびΔdが含まれるため、次
式が成立する。Since the actual distance Dr of 3b includes k and Δd, the following equation holds true.
(1)式からΔdを求めれば、次式が得られる。If Δd is calculated from equation (1), the following equation is obtained.
したがって、各時間Tとtとの比および既知の長さdo
ならびに間隔DK基づり(2)式の演算によシ見当誤差
量Δdを検出することができると共に。Therefore, for each time the ratio of T and t and the known length do
Furthermore, the amount of misregistration Δd can be detected by calculating the equation (2) based on the distance DK.
時間比を求める際には(1)式のとおり伸縮率kが消去
によシ除去され、これの影響を排除した正確なΔdが得
られる。When determining the time ratio, the expansion/contraction rate k is removed by erasure as shown in equation (1), and an accurate Δd that eliminates the influence of this is obtained.
第3図は以上の原理に基づく見当自動調整用電気回路の
ブロック図であシ、上述の検出器5からの電気信号は、
波形整形回路21により整形されてパルス信号となシ、
後述の抽出回路22において第2図のカウント値nが求
められると共に、レジスタマーク3m、3bに応するパ
ルス信号のみが抽出され、このパルス信号に応じてクリ
ップフロツブ回路等の制御回路23が起動および停止信
号を交互に送出するものとなっている。FIG. 3 is a block diagram of an electric circuit for automatic registration adjustment based on the above principle, and the electric signal from the above-mentioned detector 5 is
It is shaped into a pulse signal by the waveform shaping circuit 21,
In the extraction circuit 22 described later, the count value n shown in FIG. 2 is obtained, and only the pulse signals corresponding to the register marks 3m and 3b are extracted, and a control circuit 23 such as a clip-flop circuit is activated in response to this pulse signal. and a stop signal are sent out alternately.
また、時間T、tに比し十分に高い周vc敬のクロック
パルスを印刷機の回転と同期して発生するクロックパル
ス発生回路24の出力が抽出回路22およびカウンタ2
5へ与えられておυ、カウンタ25が制御回路23から
の起動信号に応じてクロックパルスのカウントを開始し
、同様の停止信号に応じてクリアを行なうため、第2図
(B)の時間tがクロックパルスのカウント値として求
められ。Further, the output of the clock pulse generation circuit 24, which generates clock pulses with a sufficiently high frequency compared to the times T and t in synchronization with the rotation of the printing press, is transmitted to the extraction circuit 22 and the counter 2.
5, the counter 25 starts counting clock pulses in response to a start signal from the control circuit 23, and clears them in response to a similar stop signal. is determined as the clock pulse count value.
これがラッチ回路26によシ逐次保持されたうえ、マイ
クロプロセッサおよびメモリ等からなる演算器27へ抽
出回路220カウント値nと共に与えられ、ここにおい
て(2)式の演算がなされ、Δdに応じた制御出力を演
算器2γが送出し、インターフェイス(以下、I/F)
28m 、 28bを介してディジタル・アナログ変
換器(以下DaC) 29m 、 29bへ与えるため
、これらがアナログ信号の制御信号を送出し、駆動回路
30a 、 30bを経て各版を装着した各版胴の天地
見当111i用モーメ31m 、 31bを駆動する。This is sequentially held by the latch circuit 26 and is given to the arithmetic unit 27 consisting of a microprocessor, memory, etc. together with the count value n of the extraction circuit 220, where the calculation of equation (2) is performed and control is performed according to Δd. The arithmetic unit 2γ sends out the output, and the interface (hereinafter referred to as I/F)
28m and 28b to digital-to-analog converters (hereinafter referred to as DaC) 29m and 29b, which send out analog control signals, which then pass through drive circuits 30a and 30b to control the top and bottom of each plate cylinder on which each plate is mounted. Drives the registers 31m and 31b for the register 111i.
したがって、第2図(4)のレジスタマーク3&と対応
するモータ31a、同マーク3bと対応するモータ31
bが応動し、見当調整が行なわれる。Therefore, the motor 31a corresponds to the register mark 3& in FIG. 2(4), and the motor 31 corresponds to the register mark 3b.
b responds and register adjustment is performed.
ただし、各版胴には、回転基準角度に応する天地見当位
置を検出するポテンショメータ41a、41bが各個に
設けてあり、これらの検出出力をマルチプレクサ42が
高速により交互に選択し、アナログ・デイジメル変換器
(以下、ADC)43へ与えておシ、これによシデイジ
タル信号へ変換された各検出出力がI/F44を介して
演算器2γへ与えられ、これに応じて演算器21が各版
胴の見当位置を確認し、所望の位置となったとき、また
は、調整上の限界位置となったときにモータ31a・3
1bK対する駆動を停止するものとなっている。However, each plate cylinder is provided with potentiometers 41a and 41b for detecting the vertical orientation position corresponding to the rotation reference angle, and a multiplexer 42 alternately selects these detection outputs at high speed to perform analog/daisymel conversion. Each detection output converted into a digital signal is sent to a digital signal converter (hereinafter referred to as ADC) 43, and is fed to a computing unit 2γ via an I/F 44. Check the target position of the motors 31a and 3, and when the desired position is reached or the adjustment limit position is reached,
The drive for 1bK is stopped.
第1図は、抽出回路22のブロック図であシ。FIG. 1 is a block diagram of the extraction circuit 22.
波形整形回路21からの出力がスイッチ51を介しカウ
ンタ52へ動作信号として与えられておシ、基準マーク
2の検出信号期間のみカウンタ52がクロックパルスC
LKをカウントし、このカウント値がnまたはnに対し
許容誤差±αの範囲であれば判別回路53がこれを判別
のうえ、ラッチ回路54をmJ#してカウント値nをラ
ッチ回路54に保持させ、これを演算器21へ送出され
ると共に、ゲートパルス発生回路55を制御し、これの
中に設けたカウンタによりクロックパルスCLKのカウ
ントを行なわせるため、このカウント値がnlへ達する
と同回路55がゲートパルスPa の退出を開始し、か
つ、スイッチ51を制御してゲート回路560入力側へ
切替えさせる。The output from the waveform shaping circuit 21 is given as an operating signal to the counter 52 via the switch 51, and the counter 52 receives the clock pulse C only during the detection signal period of the reference mark 2.
LK is counted, and if this count value is n or within a tolerance range of ±α for n, the determination circuit 53 determines this and then sets the latch circuit 54 to mJ# to hold the count value n in the latch circuit 54. This is sent to the arithmetic unit 21, and at the same time controls the gate pulse generation circuit 55 and causes a counter provided therein to count the clock pulse CLK. When this count value reaches nl, the circuit 55 starts exiting the gate pulse Pa and controls the switch 51 to switch to the input side of the gate circuit 560.
また、同回路55中のカウンタは更にカウントを継続し
、カウント値がn+十n2へ達するとゲートパルスPa
の送出を停止し、カウント値がn!+n z +n s
となれば、再びゲートパルスPaの送出を開始のうえ、
カウント値がn+ +nt 十13+n2へ達すると、
ゲートパルスPaの送出を停止すると共に、スイッチ5
1.カウンタ522判別回路53、ラッチ囲路54等を
リセットし、かつ、自己の中のカウンタもクリアし、初
期状態へ復する。。Further, the counter in the same circuit 55 continues counting, and when the count value reaches n+10n2, the gate pulse Pa
The transmission of is stopped and the count value is n! +n z +n s
If so, start sending out the gate pulse Pa again, and then
When the count value reaches n+ +nt 113+n2,
While stopping the transmission of the gate pulse Pa, the switch 5
1. The counter 522 discrimination circuit 53, latch circuit 54, etc. are reset, and the internal counter is also cleared to return to the initial state. .
したがって、ゲート回路56により第2図の関係として
レジスタマーク3a、3bの検出信号抽出がなされ、不
要な雑音成分等が阻止される。Therefore, the detection signals of the register marks 3a and 3b are extracted by the gate circuit 56 as shown in FIG. 2, and unnecessary noise components are blocked.
帛4図およびM5図は、他の冥施例を示す各マークの印
刷状況および抽出回路22のプaツク図であυ、この場
合は、クロック・(ルスCKとして印刷機の回転と非同
期状態のものを用いており、基準マーク2の長さdoを
大とし、印刷機の回転が高速となっても支障を生じない
ものとしである。Figures 4 and M5 show the printing status of each mark and a block diagram of the extraction circuit 22 showing other examples of printing. The length do of the reference mark 2 is made large so that no problem occurs even if the printing press rotates at high speed.
また、第5図においては、加減算カウンタ(以下UDC
)61を用い、基準マーク2の検出信号期間中アップカ
ウントを行なったうえ、同信号期間外ではダウンカウン
トを行ない、カウント値が零となれば各部をリセットす
るものとなっており、アップカウントによりカウント値
がnへ達すると、UDC61がゲートパルス発生回路5
5をl!1i11呻し、基準マーク2の検出信号終了に
応じてダウンカウント2!il−開始するほかはwJ1
図と同様である。In addition, in FIG. 5, an addition/subtraction counter (hereinafter referred to as UDC)
) 61, up-counting is performed during the detection signal period of reference mark 2, and down-counting is performed outside the same signal period, and when the count value reaches zero, each part is reset. When the count value reaches n, the UDC 61 activates the gate pulse generation circuit 5.
5 l! 1i11 groans, and in response to the end of the detection signal of reference mark 2, the countdown is 2! il-wJ1 except start
It is similar to the figure.
なお、つぎの演算をゲートパルス発生回路55が行ない
、ゲートパルスP。を発生するものとしてもよい。Note that the gate pulse generation circuit 55 performs the following calculation to generate the gate pulse P. may be generated.
すなわち、第6図に谷マークと検出信号およびゲートパ
ルスとの関係を示すとおシ、間隔tと対応する時間をt
t、ゲートノくルスPaのノ(ルス幅、twと対応する
長尺紙1上の距離をWとすれば、次式が成立する。That is, if the relationship between the valley mark, the detection signal, and the gate pulse is shown in FIG. 6, the time t corresponding to the interval t is
t, the distance on the long paper 1 corresponding to the width of the gate node Pa (the width of the gate node Pa, tw), the following equation holds true.
このため、 (3) 、(4)式から12およびtWヲ
各々求めると次式が得られる。Therefore, by calculating 12 and tW from equations (3) and (4), the following equations are obtained.
tw =−T
拳 ・ ・ ・ ・ (6
)d。tw=-T
Fist ・ ・ ・ ・ (6
) d.
したがって、時間Tをカウント値として求め。Therefore, find the time T as a count value.
既知のdo、t、wと共に用いて(5) 、 (6)式
の演算を行なうことによシ、基準マーク2の検出信号終
了時点を基準とした時間t1.twが定tジ、これ金カ
ウンメのカウント値によって規正すれば、正確なタイミ
ングのゲートパルスP、Jが得られる。By calculating equations (5) and (6) using known do, t, and w, time t1. If tw is a constant t and this is regulated by the count value of the gold counter, gate pulses P and J with accurate timing can be obtained.
なお、レジスタマーク3bと対応するゲートパルスPa
も同様に発生すればよく、クロックパルスとして印刷
機の回転と同期したものを用いれば。Note that the gate pulse Pa corresponding to the register mark 3b
can be generated in the same way, and if a clock pulse that is synchronized with the rotation of the printing press is used.
第5図の構成を第2回内のものへ適用することができる
。The configuration of FIG. 5 can be applied to the second round.
ただし、各マークの形状は、条件に応じた選定が任意で
あると共に、レジスタマーク3a 、 3bの数は、版
胴数に応じて定めればよく、これらを場合によっては同
色のものとしてもよい。However, the shape of each mark can be selected arbitrarily depending on the conditions, and the number of register marks 3a and 3b may be determined according to the number of plate cylinders, and they may be of the same color depending on the case. .
また、第3図の構成は、状況にしたがって定めればよく
、駆動回路30m 、 30bがディジタル信号に応動
するものであれば、 DAC29a 、 29b t−
省略できると共に、ポテンショメータ41a 、 41
bの代夛にディジタル信号を送出するものを用いれは。Further, the configuration shown in FIG. 3 may be determined depending on the situation, and if the drive circuits 30m and 30b respond to digital signals, the DACs 29a and 29b t-
Potentiometers 41a, 41 can be omitted.
A device that sends out digital signals can be used as a substitute for b.
ADC43を省略することができる。ADC 43 can be omitted.
このほか、長尺紙上のレジスタマークのみならず、板上
のレジスタマークを検出する場合にも適用することがで
きると共に、第1図および第5図においては、ゲート回
路35を省略し、スイッチ31をゲート回路と兼用に使
用してもよく1条件に応じてランチ回路33を省略する
こともできると共に、上述の各出願によ)開示されてい
る制御回路の入力側へ適用してもよい等、檀々の変形が
自在である。In addition, it can be applied not only to detecting register marks on a long sheet of paper but also to detecting register marks on a board. In FIGS. 1 and 5, the gate circuit 35 is omitted and the switch 31 The gate circuit may also be used as a gate circuit, the launch circuit 33 may be omitted depending on one condition, and it may be applied to the input side of the control circuit disclosed in each of the above-mentioned applications. , the various forms can be freely modified.
以上の説明により明らかなとおり本発明VCよれば、長
尺紙の伸縮による影4iが排除されると共に。As is clear from the above description, according to the VC of the present invention, the shadow 4i due to the expansion and contraction of the long paper is eliminated.
基準マークを基準としてレジスタマークの検出信号抽出
用ゲートパルスが発生されるため1%に調整を要さず常
に正確なタイミングとしてゲートパルスの発生が行なわ
れ、レジスタマークの検出信号を確実に抽出できるもの
となり、複数の版胴を有する各種輪転印刷機の見当誤差
検出および調整において顕著な効果が得られる1゜Since the gate pulse for extracting the register mark detection signal is generated using the reference mark as a reference, the gate pulse is always generated at accurate timing without requiring adjustment to 1%, and the register mark detection signal can be reliably extracted. 1°, which is extremely effective in detecting and adjusting registration errors in various types of rotary printing presses with multiple plate cylinders.
図は本発明の実施例を示し、第1図は抽出回路のブロッ
ク図、第2回内は各マークの印刷状況を示す図、同図(
B)は各マークの検出信号を示す図、同図(C)はクロ
ックパルスのカウント状況を示す図。
同図(ロ)はゲートパルスを示す図、第3図は制御即用
電気回路のブロック図、第4図は他の実施例による各マ
ークの印刷状況を示す図、第5図は第4図と対応する抽
出回路のブロック図、第6図は演算によりゲートパルス
を発生する場合の説明図である。
1・・・・長尺紙、2・・・・基準マーク、2a・・・
・前縁、3a、3b ・・・・レジスメマーク。
4・・・・走査線、5・・・・検1イ督j;、22・・
・・・抽出回路、24・・・・クロックパルス発生回路
、25,52.61・・・・カウンタ、27・・・・演
算器、31a 、 31b・・・・モータ、51・・・
・スイッチ、55・・・・ゲートパルス発生回路、56
・・・・ゲート回路、L・・・・規定間隔。The figures show an embodiment of the present invention. Figure 1 is a block diagram of the extraction circuit, the second part is a diagram showing the printing status of each mark, and the same figure (
B) is a diagram showing the detection signal of each mark, and FIG. 3C is a diagram showing the counting status of clock pulses. FIG. 3 is a block diagram of the electric circuit for control, FIG. 4 is a diagram showing the printing status of each mark according to another embodiment, and FIG. 5 is a diagram showing the gate pulse. FIG. 6 is a block diagram of a corresponding extraction circuit, and is an explanatory diagram when a gate pulse is generated by calculation. 1... Long paper, 2... Reference mark, 2a...
・Front edge, 3a, 3b... Registration mark. 4...Scanning line, 5...1st line, 22...
...Extraction circuit, 24...Clock pulse generation circuit, 25, 52.61...Counter, 27...Arithmetic unit, 31a, 31b...Motor, 51...
・Switch, 55... Gate pulse generation circuit, 56
...Gate circuit, L...Specified interval.
Claims (1)
レジスタマークの検出信号をゲート回路により抽出する
際、該ゲート回路をオンとするゲートパルスを発生する
回路において、前記基準マークの検出信号に基づき該基
準マークの前縁から前記基準マークとレジスタマークと
の期定間隔より短い間隔までと対応する時間の経過を検
出する手段と、該手段の検出に応じて前記レジスタマー
クの検出信号を含むパルス幅の前記ゲートパルスを発生
する手段とを備えたことを特徴とする検出信号抽出用ゲ
ートパルス発生回路。When a gate circuit extracts a detection signal of a register mark printed at a specified interval following a reference mark on a long sheet of paper, a circuit that generates a gate pulse to turn on the gate circuit extracts a signal based on the detection signal of the reference mark. means for detecting the passage of time corresponding from the leading edge of the fiducial mark to an interval shorter than a regular interval between the fiducial mark and the register mark, and a pulse comprising a detection signal of the register mark in response to detection by the means; A gate pulse generation circuit for detecting a detection signal, comprising means for generating the gate pulse having a width.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60177599A JPS6239242A (en) | 1985-08-14 | 1985-08-14 | Gate pulse generation circuit for extraction of detecting signal |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60177599A JPS6239242A (en) | 1985-08-14 | 1985-08-14 | Gate pulse generation circuit for extraction of detecting signal |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6239242A true JPS6239242A (en) | 1987-02-20 |
Family
ID=16033811
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP60177599A Pending JPS6239242A (en) | 1985-08-14 | 1985-08-14 | Gate pulse generation circuit for extraction of detecting signal |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6239242A (en) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO1994016893A1 (en) * | 1993-01-19 | 1994-08-04 | Eltromat Gesellschaft für Industrie-Elektronik mbH | Device for detecting registration errors between individual colours during multicolour printing in a long web-fed rotary press |
JPH0890946A (en) * | 1994-09-22 | 1996-04-09 | Rockwell Graphic Syst Japan:Kk | Press plate having register mark forming part |
JP2008126517A (en) * | 2006-11-21 | 2008-06-05 | Dainippon Printing Co Ltd | Calculation device of printing registration level and calculation method |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
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JPS4879011A (en) * | 1972-01-25 | 1973-10-23 | ||
JPS50127709A (en) * | 1974-03-29 | 1975-10-08 |
-
1985
- 1985-08-14 JP JP60177599A patent/JPS6239242A/en active Pending
Patent Citations (2)
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