JPS6228023B2 - - Google Patents

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JPS6228023B2
JPS6228023B2 JP53047938A JP4793878A JPS6228023B2 JP S6228023 B2 JPS6228023 B2 JP S6228023B2 JP 53047938 A JP53047938 A JP 53047938A JP 4793878 A JP4793878 A JP 4793878A JP S6228023 B2 JPS6228023 B2 JP S6228023B2
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JP
Japan
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signal
circuit
control signal
deceleration
acceleration
Prior art date
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Application number
JP53047938A
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Japanese (ja)
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JPS547085A (en
Inventor
Roode Konraato
Ruunau Geruharuto
Gudaato Uorufugangu
Panbatsukeru Herumuuto
Rindeman Kurausu
Uaize Rutsutsu
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
BABUKO UESUTEINGUHAUSU FUAARUTSUOIKUBUREMUZEN GmbH
Original Assignee
BABUKO UESUTEINGUHAUSU FUAARUTSUOIKUBUREMUZEN GmbH
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Publication date
Application filed by BABUKO UESUTEINGUHAUSU FUAARUTSUOIKUBUREMUZEN GmbH filed Critical BABUKO UESUTEINGUHAUSU FUAARUTSUOIKUBUREMUZEN GmbH
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Publication of JPS6228023B2 publication Critical patent/JPS6228023B2/ja
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Classifications

    • BPERFORMING OPERATIONS; TRANSPORTING
    • B60VEHICLES IN GENERAL
    • B60TVEHICLE BRAKE CONTROL SYSTEMS OR PARTS THEREOF; BRAKE CONTROL SYSTEMS OR PARTS THEREOF, IN GENERAL; ARRANGEMENT OF BRAKING ELEMENTS ON VEHICLES IN GENERAL; PORTABLE DEVICES FOR PREVENTING UNWANTED MOVEMENT OF VEHICLES; VEHICLE MODIFICATIONS TO FACILITATE COOLING OF BRAKES
    • B60T8/00Arrangements for adjusting wheel-braking force to meet varying vehicular or ground-surface conditions, e.g. limiting or varying distribution of braking force
    • B60T8/17Using electrical or electronic regulation means to control braking
    • B60T8/173Eliminating or reducing the effect of unwanted signals, e.g. due to vibrations or electrical noise

Landscapes

  • Engineering & Computer Science (AREA)
  • Transportation (AREA)
  • Mechanical Engineering (AREA)
  • Regulating Braking Force (AREA)
  • Valves And Accessory Devices For Braking Systems (AREA)

Description

【発明の詳細な説明】 本発明は、車輪の回転速度に比例するセンサ信
号を発生する少なくとも1つのセンサと、センサ
信号を微分して加速度信号および減速度信号を発
生する微分回路と、所定の限界値以上の加速度信
号および減速度信号において加速度制御信号およ
び減速度制御信号を発生する限界値回路と、セン
サ信号から滑り制御信号を形成する回路と、制動
が制御される場合加速度制御信号または減速度制
御信号を受けて制動圧力制御用電磁弁にパルスを
与えるパルス装置とを有し、外乱信号が生じた場
合これを抑制して制動装置の誤動作を防止する、
固着防止される車両制動装置の誤制御信号防止用
回路装置に関する。
DETAILED DESCRIPTION OF THE INVENTION The present invention comprises: at least one sensor that generates a sensor signal proportional to the rotational speed of a wheel; a differentiator circuit that differentiates the sensor signal to generate an acceleration signal and a deceleration signal; A limit value circuit generates an acceleration control signal and a deceleration control signal at acceleration and deceleration signals above a limit value, and a circuit forms a slip control signal from the sensor signal and generates an acceleration control signal or a deceleration signal when braking is controlled. a pulse device that receives a speed control signal and applies a pulse to a solenoid valve for braking pressure control, and suppresses a disturbance signal when it occurs to prevent malfunction of the braking device;
The present invention relates to a circuit device for preventing erroneous control signals of a vehicle braking device from sticking.

通常の走行運転においては、道路の凹凸のため
に起こる車体のピツチング、ローリングおよび垂
直振動や、荷重に関係して路面から車輪の中心ま
での距離すなわち車輪ころがり半径の変化が生ず
る可能性がある。このころがり半径の変化は、車
輪の回転速度を検出するセンサによつて検出され
る。時間的変化が減速度限界値を越えるほど大き
いと、電子制御装置において制御過程が開始され
る。このようなころがり半径変化が時間的に急速
に生ずる場合には、適当な頻度で制御過程が開始
される。その際行なわれる制動操作のため、きわ
めて短時間内に固着防止装置の構成部品が寿命限
界値に達して破壊する可能性がある。
During normal driving, pitching, rolling, and vertical vibration of the vehicle body may occur due to road irregularities, and changes in the distance from the road surface to the center of the wheel, that is, the rolling radius of the wheel, may occur in relation to the load. This change in rolling radius is detected by a sensor that detects the rotational speed of the wheel. If the temporal change is large enough to exceed the deceleration limit value, a control process is initiated in the electronic control unit. If such changes in the rolling radius occur rapidly over time, a control process is initiated at an appropriate frequency. Due to the braking operations carried out in this case, the components of the anti-sticking device can reach their service life limits and break down within a very short time.

本発明の課題は、制動操作によらない車輪の回
転数変化のため、特に車輪のころがり半径の変化
のため、生ずる誤制御信号を防止することであ
る。
The object of the invention is to prevent erroneous control signals that occur due to changes in the rotational speed of the wheels that are not caused by braking operations, in particular due to changes in the rolling radius of the wheels.

この課題を解決するため本発明によれば、加速
度制御信号または減速度制御信号が周波数比較回
路へ供給されて、その周波数が所定値と比較さ
れ、この周波数比較回路の出力信号が、減速度制
御信号またはパルス装置の出力信号を阻止する阻
止装置へ供給される。
In order to solve this problem, according to the present invention, an acceleration control signal or a deceleration control signal is supplied to a frequency comparison circuit, the frequency thereof is compared with a predetermined value, and the output signal of this frequency comparison circuit is used as the deceleration control signal. A blocking device is provided which blocks the signal or the output signal of the pulse device.

これにより、車輪の回転速度変化、特に車輪の
ころがり半径の変化により生ずる回転数変化の不
利な波及作用が防止される。
This prevents adverse effects of changes in rotational speed caused by changes in the rotational speed of the wheels, in particular changes in the rolling radius of the wheels.

制動されない走行運転においては、約10Hzの頻
度(周波数)をもつころがり半径変化が生ずる可
能性がある。通常の固着防止される制御過程で
は、約6Hz以下の制御頻度は、制御の質を低下さ
せることなく許容されるので、誤りのある制御経
過のおこる危険が存在するが、本発明によりこの
危険が回避される。
In unbraked driving, rolling radius changes can occur with a frequency of approximately 10 Hz. In a normal anti-stick control process, a control frequency of about 6 Hz or less is tolerated without degrading the quality of the control, so there is a risk of an erroneous control course; however, the present invention eliminates this risk. Avoided.

制御される制動では、特定の順序の制御信号が
予期される。一般に制御過程は、減速度制御信号
発生の際開始され、通常の場合時間的ずれをもつ
滑り制御信号が続くことになる。しかしこの滑り
制御信号は特定の大きさの制御振幅を必要とす
る。制動されない走行状態におけるころがり半径
変化の場合、滑りが限界値を越えることはない
が、パルス装置を制御する減速度限界値を越える
と、減速度制御信号の消失後パルス装置が電磁弁
を制御する。さて通常の制御過程において予期さ
れる制御信号の順序が維持されないと、これは誤
りを含むものと見なさねばならない。これにより
生ずる誤制御を避けるために、本発明によれば、
滑り制御信号により切換え可能で出力信号を発生
する装置が設けられ、この出力信号がパルス装置
の出力信号または減速度制御信号とANDゲート
において論理結合され、このANDゲートの出力
端が電磁弁に接続されている。
In controlled braking, a specific order of control signals is expected. In general, the control process is started upon generation of the deceleration control signal and is usually followed by a slip control signal with a time lag. However, this slip control signal requires a control amplitude of a certain magnitude. In the case of rolling radius changes in unbraked running conditions, the slip does not exceed the limit value, but when the deceleration limit value that controls the pulse device is exceeded, the pulse device controls the solenoid valve after the disappearance of the deceleration control signal. . Now, if the order of control signals expected in a normal control process is not maintained, this must be considered as containing an error. In order to avoid erroneous control caused by this, according to the present invention,
A device is provided which can be switched by the slip control signal and generates an output signal, which output signal is logically combined with the output signal of the pulse device or the deceleration control signal in an AND gate, the output end of the AND gate being connected to the solenoid valve. has been done.

本発明を図面に示された実施例について説明す
る。
The invention will now be described with reference to embodiments shown in the drawings.

制動されない走行運転において、車輪のころが
り半径変化による車輪の速度変化、およびそれに
対応する加速度制御信号および減速度制御信号
は、制御されかつ制動される走行状態において許
容される制御信号頻度(周波数)例えば約6Hzよ
り高い頻度(周波数)例えば10Hzをもつている。
さて第1図および第2図に示す回路により、制動
されない走行状態において、このような車輪速度
変化による制御信号の発生が、加速度制御信号の
周波数以上では阻止される。
In unbraked driving operation, the speed changes of the wheels due to changes in the rolling radius of the wheels, and the corresponding acceleration and deceleration control signals, are determined by the control signal frequency (frequency) that is permissible in controlled and braked driving conditions, e.g. It has a frequency higher than about 6 Hz, for example 10 Hz.
Now, the circuit shown in FIGS. 1 and 2 prevents generation of a control signal due to such a change in wheel speed in an unbraked running state at a frequency equal to or higher than the frequency of the acceleration control signal.

先ず第1図について述べる。1つまたは複数の
センサ2によつて1つまたは複数の車輪の回転速
度が検出される。微分回路4および6において加
速度信号および減速度信号が形成される。さらに
回路8で車輪の滑りに比例する信号が得られ、滑
り制御信号(λ信号)として制御に使用される。
微分回路4の出力信号は、小さい限界値をもつ限
界値回路としての比較器10へ与えられ、この限
界値以上の信号が加速度制御信号(+b信号)と
して、周波数比較回路12において例えば6Hzの
目標値と比較される。この目標値を越えると、比
較回路12が高レベル信号を発生し、この高レベ
ル信号はNOTゲート14を介して低レベル信号
としてANDゲート16の入力端へ達し、このゲ
ートを阻止する。微分回路6の出力信号は、限界
値回路としての比較器18において所定限界値と
比較され、この限界値を越えると、制御信号とし
ての減速度制御信号(−b信号)が発生され、
ANDゲート16の他入力端へ達する。このAND
ゲートは阻止されているから、通常の場合制御過
程を開始する−b信号は有効にはなり得ず、電磁
弁20の制御は、ORゲート22および増幅器2
4を介して行なわれない。
First, let's talk about Figure 1. One or more sensors 2 detect the rotational speed of one or more wheels. Acceleration and deceleration signals are generated in differentiating circuits 4 and 6. Furthermore, a signal proportional to wheel slippage is obtained in circuit 8 and is used for control as a slippage control signal (λ signal).
The output signal of the differentiating circuit 4 is given to a comparator 10 as a limit value circuit with a small limit value, and a signal exceeding this limit value is used as an acceleration control signal (+b signal) in the frequency comparator circuit 12 to output a target value of, for example, 6Hz. compared to the value. When this target value is exceeded, the comparator circuit 12 generates a high level signal which passes through the NOT gate 14 as a low level signal to the input of the AND gate 16 and blocks this gate. The output signal of the differentiating circuit 6 is compared with a predetermined limit value in a comparator 18 as a limit value circuit, and when this limit value is exceeded, a deceleration control signal (-b signal) is generated as a control signal.
It reaches the other input end of AND gate 16. This AND
Since the gate is blocked, the -b signal which normally initiates the control process cannot be activated and the control of the solenoid valve 20 is controlled by the OR gate 22 and the amplifier 2.
4.

制御されかつ制動される走行状態が存在する
と、−b信号はORゲート22を介して電磁弁20
を制御し、同時にORゲート26を介して、持続
信号からその中断によりパルス信号を形成するパ
ルス装置28をリセツトし、さらに応答または復
帰の遅延によりパルス信号を延長、短縮または遅
延させる公知の時限素子、この場合復帰遅延時限
素子30へ与えられる。この時限素子30は−b
信号の消失後も遅延時間だけ動作継続し、この時
限素子の高レベル出力信号はNOTゲート32お
よびORゲート26を介して低レベル信号として
パルス装置28のリセツト入力端Rへ供給される
ので、時限素子の動作継続中はパルス装置28が
パルスを発生して電磁弁20を制御する。時限素
子30の動作終了後その出力信号が低レベル信号
へ移行し、パルス装置28が再び阻止される。
When a controlled and braked driving condition exists, the -b signal is passed through the OR gate 22 to the solenoid valve 20.
and at the same time reset, via an OR gate 26, a pulse device 28 which forms a pulse signal from the continuous signal by its interruption, and further lengthens, shortens or delays the pulse signal by a delay in response or return. , in this case applied to the return delay timer 30. This timing element 30 is -b
After the signal disappears, it continues to operate for a delay time, and the high level output signal of this timer is supplied as a low level signal to the reset input R of the pulse device 28 via the NOT gate 32 and the OR gate 26, so that the timer remains in operation. A pulse device 28 generates pulses to control the solenoid valve 20 while the device continues to operate. After the timing element 30 has finished operating, its output signal goes to a low level signal and the pulse device 28 is blocked again.

第2図による回路は、第1図による回路にほぼ
一致するので、同じ構成部分に対しては同じ数字
符号を使用し、ダツシユを付けてある。周波数限
界値を越えた場合+b信号により−b信号を阻止
するために、もはや第1図のようにANDゲート
が阻止されず、−b信号用比較器18′の振幅限界
値が端子34を介して高められる。
Since the circuit according to FIG. 2 substantially corresponds to the circuit according to FIG. 1, the same numerical symbols and dashes have been used for the same components. Since the -b signal is blocked by the +b signal when the frequency limit is exceeded, the AND gate is no longer blocked as in FIG. 1, and the amplitude limit of the -b signal comparator 18' is can be enhanced.

制御される制動の場合一定順序の制御信号を予
期することができる。一般に制御過程は−b信号
発生の際開始され、通常の場合時間的にずれてλ
信号が続くことになる。しかしこのλ信号は特定
の大きさの制御振幅を必要とする。制動されてな
い走行状態における車輪のころがり半径変化の
際、滑り限界値を越えることはないが、その応動
の際パルス装置を制御する減速度限界値を越え、
パルス装置が−b信号の消失後電磁弁を切換え
る。さて通常の制御過程において種々の制御信号
の予期した順序が維持されないと、これは誤りの
場合と見なさねばならない。このような場合に誤
制御を防止する回路が第3図、第4図、第5図お
よび第6図に示されている。なお第3図および第
6図の実施例でも、第4図および第5図と同様に
加速度信号の微分回路および比較器が設けられる
が、図示を簡単にするため省略してある。
In the case of controlled braking a fixed sequence of control signals can be expected. In general, the control process is started on the occurrence of the -b signal, and is usually shifted in time to λ
The signal will continue. However, this λ signal requires a control amplitude of a certain magnitude. When the rolling radius of the wheels changes in unbraked driving conditions, the slip limit is not exceeded, but the deceleration limit that controls the pulse device is exceeded in response.
The pulse device switches the solenoid valve after the disappearance of the -b signal. Now, if in the normal control process the expected order of the various control signals is not maintained, this must be considered a case of error. Circuits for preventing erroneous control in such cases are shown in FIGS. 3, 4, 5, and 6. The embodiments shown in FIGS. 3 and 6 are also provided with an acceleration signal differentiation circuit and a comparator as in FIGS. 4 and 5, but these are omitted for the sake of simplicity.

まず第3図について述べると、センサ40から
得られた信号から、微分回路42により減速度信
号が形成され、回路44によりλ信号が形成され
る。減速度信号は、比較器46において所定限界
値と比較され、この限界値を越えると、−b信号
が発生されて、ORゲート48および増幅器50
を介して電磁弁52(入口弁)を制御、同時に
ORゲート56を介してパルス装置54をリセツ
トし、さらに時限素子58を制御する。この時限
素子58の出力端は、NOTゲート60およびOR
ゲート56を介してパルス装置54のリセツト入
力端Rに接続されている。パルス装置54は
ANDゲート62の入力端を介して電磁弁52に
接続されている。ANDゲート62の他の入力端
には、RSフリツプフロツプ64の出力端Qが接
続され、このフリツプフロツプのセツト入力端S
はλ信号発生回路44の出力端に接続され、その
リツセト入力端RはNOTゲート66を介して復
帰遅延時限素子68の出力端に接続され、この時
限素子は電磁弁52の制御信号を受ける。前述し
た誤りがあると、−b信号はまず電磁弁52を制
御し、パルス装置54をリセツトする。時限素子
58は−b信号の消失後も動作継続し、その動作
終了後フリツプフロツプ64をリセツトし、この
フリツプフロツプの低レベル出力信号がANDゲ
ート62を阻止するので、パルス装置54のパル
スによる電磁弁52の制御は、時限素子58の動
作経過後阻止される。正常は制御が行なわれてい
る場合には、特定の時間的ずれの後λ信号が続い
てフリツプフロツプ64をセツトし、それにより
ANDゲート62が導通状態になる。
Referring first to FIG. 3, from the signal obtained from the sensor 40, a differentiating circuit 42 forms a deceleration signal, and a circuit 44 forms a λ signal. The deceleration signal is compared to a predetermined limit value in comparator 46, and if this limit value is exceeded, a -b signal is generated and output to OR gate 48 and amplifier 50.
Control the solenoid valve 52 (inlet valve) through the
The pulse device 54 is reset via the OR gate 56 and also controls the timing element 58. The output terminal of this time element 58 is connected to a NOT gate 60 and an OR
It is connected via a gate 56 to the reset input R of the pulse device 54. The pulse device 54
It is connected to the solenoid valve 52 via the input end of the AND gate 62 . The output terminal Q of an RS flip-flop 64 is connected to the other input terminal of the AND gate 62, and the set input terminal S of this flip-flop is connected.
is connected to the output terminal of the λ signal generating circuit 44, and its reset input terminal R is connected via a NOT gate 66 to the output terminal of a return delay time element 68, which receives the control signal of the solenoid valve 52. If there is an error as described above, the -b signal first controls solenoid valve 52 and resets pulser 54. The timer 58 continues to operate after the disappearance of the -b signal and resets the flip-flop 64 after its operation, the low level output signal of which blocks the AND gate 62, so that the pulse of the pulser 54 causes the solenoid valve 52 to The control of is blocked after the operation of the timing element 58 has elapsed. Under normal control, after a certain time lag the λ signal will subsequently set the flip-flop 64, thereby
AND gate 62 becomes conductive.

第4図による回路は、第3図とは部の回路要素
を含んでいる。この回路と第3図による回路との
主な相違は、出口弁の制御が行なわれない限り+
b信号を阻止するために、応答遅延時限素子が設
けられていることである。
The circuit according to FIG. 4 includes more circuit elements than those of FIG. The main difference between this circuit and the circuit according to Figure 3 is that unless control of the outlet valve is
In order to block the b signal, a response delay time element is provided.

さてセンサ70の信号から、再び微分回路72
および比較器78により+b信号が、また微分回
路74および比較器80により−b信号が、さら
に回路76によりλ信号が発生される。
Now, from the signal of the sensor 70, the differentiation circuit 72
Comparator 78 generates a +b signal, differentiation circuit 74 and comparator 80 generate a -b signal, and circuit 76 generates a λ signal.

比較器78の出力端は、ANDゲート82とOR
ゲート84とを介して電磁弁(入口弁)86に接
続されている。比較器80の出力端は、まずOR
ゲート84を介して入口弁86に接続され、かつ
ORゲート88を介して出口弁90に接続され、
さらにORゲート92を介してパルス装置94の
リセツト入力端Rに、さらに復帰遅延時限素子9
6の入力端に接続されている。この時限素子の出
力端は、NOTゲート98とORゲート92とを介
してパルス装置94のリセツト入力端Rに接続さ
れている。パルス装置94のリセツト入力端R
は、さらにANDゲート82の出力端に接続さ
れ、出口弁90の入力端は応答および復帰遅延時
限素子100へ接続され、この時限素子の出力端
はNOTゲート102を介してフリツプフロツプ
104のリセツト入力端Rに接続され、かつ
ANDゲート82の他の入力端に接続されてい
る。
The output terminal of the comparator 78 is ORed with the AND gate 82.
It is connected to a solenoid valve (inlet valve) 86 via a gate 84 . The output terminal of the comparator 80 is first OR
connected to inlet valve 86 via gate 84;
connected to an outlet valve 90 via an OR gate 88;
Further, via an OR gate 92, a reset input terminal R of a pulse device 94 is connected to a return delay timer 9.
It is connected to the input terminal of 6. The output of this timing element is connected via a NOT gate 98 and an OR gate 92 to a reset input R of a pulse device 94. Reset input terminal R of pulse device 94
is further connected to the output of AND gate 82, and the input of outlet valve 90 is connected to a response and return delay timer 100 whose output is connected via NOT gate 102 to the reset input of flip-flop 104. connected to R, and
It is connected to the other input terminal of AND gate 82.

パルス装置94とフリツプフロツプ104の出
力端はANDゲート106の入力端に接続され、
このANDゲートの出力端は入口弁86に接続さ
れている。フリツプフロツプ104のセツト入力
端Sは、第3図による回路のようにλ信号発生回
路76に接続されている。
The outputs of pulse device 94 and flip-flop 104 are connected to the inputs of AND gate 106;
The output end of this AND gate is connected to the inlet valve 86. The set input S of flip-flop 104 is connected to a λ signal generation circuit 76, as in the circuit according to FIG.

比較器78を通過する+b信号は、時限素子1
00が動作せず、したがつてこの時限素子の出力
が零である限り、ゲート82によつて阻止され
る。この場合フリツプフロツプ104もリセツト
されている。−b信号はまずパルス装置94をリ
セツトし、出口弁90および時限素子100へも
達する。−b信号したがつて制御信号が消失して
も、時限素子96および100が動作継続し、その
結果パルス装置94が再びセツトされ、ANDゲ
ート82が導通状態となる。
The +b signal passing through comparator 78 is applied to timing element 1
00 is inactive and is therefore blocked by gate 82 as long as the output of this timer is zero. In this case, flip-flop 104 is also reset. The -b signal first resets the pulse device 94 and also reaches the outlet valve 90 and timing element 100. -b signal and therefore the control signal is lost, timer elements 96 and 100 continue to operate, so that pulser 94 is set again and AND gate 82 becomes conductive.

時限素子100の動作終了後フリツプフロツプ
104がリセツトされ、それによりANDゲート
106が阻止されるので、パルス装置94による
入口弁86の制御が阻止され、さらにANDゲー
ト82が再び阻止される。
After the operation of timer 100 is completed, flip-flop 104 is reset, thereby blocking AND gate 106, thereby preventing control of inlet valve 86 by pulse device 94, and again blocking AND gate 82.

フリツプフロツプ104のセツトしたがつて
ANDゲート106の導通は、λ信号の発生によ
りはじめて行なわれる。
Due to the setting of flip-flop 104
AND gate 106 is first turned on by the generation of the λ signal.

第4図と同じ部分には同じ数字符号とダツシユ
を付けた第5図による回路は、第4図による回路
と次の点で相違している。すなわちANDゲート
82′の阻止は、復帰遅延時限素子100を介す
る代りに、フリツプフロツプ104′を介して行
なわれる。
The circuit according to FIG. 5, in which the same parts as in FIG. 4 are given the same numerical symbols and dashes, differs from the circuit according to FIG. 4 in the following points. That is, blocking of AND gate 82' is done via flip-flop 104' instead of via return delay timer 100.

第6図による回路は、第3図による回路にほぼ
一致し、したがつてこの場合も対応する数字符号
にダツシユが付けられている。第6図による回路
では、パルス装置54′の阻止は、フリツプフロ
ツプ64′を介するANDゲート62′の阻止によ
つて行なわれるのではない。ANDゲート62′は
比較器46′に接続され、フリツプフロツプ6
4′がリセツトされている間−b信号を阻止す
る。
The circuit according to FIG. 6 substantially corresponds to the circuit according to FIG. 3, so that in this case also the corresponding numerical symbols are marked with a dash. In the circuit according to FIG. 6, the blocking of the pulse device 54' is not effected by blocking the AND gate 62' via the flip-flop 64'. AND gate 62' is connected to comparator 46' and flip-flop 62' is connected to comparator 46'.
Blocks the -b signal while 4' is reset.

短時間の−b信号列が発生する場合には、パル
ス装置による電磁弁の制御を阻止するため、第7
図の回路を使用することができる。
When a short -b signal train occurs, the seventh
The circuit shown in the figure can be used.

+b信号および−b信号は、微分回路110お
よび112と比較器114および116とにより
発生され、λ信号は回路118において発生され
る。
The +b and -b signals are generated by differentiating circuits 110 and 112 and comparators 114 and 116, and the λ signal is generated in circuit 118.

適当な大きさの−b信号が発生すると、電磁弁
120および122が制御される。同時に応答お
よび復帰遅延時限素子124へも−b信号が供給
されるが、この時限素子の応答遅延は、短時間の
−b信号列が時間的に含まれるような大きさであ
る。これによりANDゲート126がパルス装置
128を充分長い時間阻止できるので、−b信号
の消失後そのつど発生されるパルスは電磁弁12
0を制御できず、それにより有害な高い制御頻度
が避けられる。
When a -b signal of appropriate magnitude is generated, solenoid valves 120 and 122 are controlled. At the same time, the -b signal is also supplied to the response and return delay timing element 124, the response delay of which is of such a magnitude that a short -b signal sequence is temporally included. This allows the AND gate 126 to block the pulse device 128 for a sufficiently long time so that the pulse generated in each case after the disappearance of the -b signal is transmitted to the solenoid valve 12.
0 cannot be controlled, thereby avoiding harmful high control frequencies.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図ないし第7図は本発明による回路装置の
異なる実施例のブロツク線図である。 2,2′,40,40′,70,70′……セン
サ、4,4′,6,6′,42,42′,72,7
2′,74,74′,110,112……微分回
路、8,8′,44,44′,76,76′,11
8……信号発生回路、10,10′,18,1
8′,46,46′,78,78′,80,80′,
114,116……限界値回路(比較器)、1
2,12′……周波数比較回路、16,34,1
26……阻止装置、20,52,52′,86,
86′……電磁弁、28,28′,54,94,9
4′,128……パルス装置、62,62′,10
6,106′……ANDゲート、64,64′,1
04,104′……λ信号により切換え可能な装
置、124……時限素子。
1 to 7 are block diagrams of different embodiments of the circuit arrangement according to the invention. 2, 2', 40, 40', 70, 70'...sensor, 4, 4', 6, 6', 42, 42', 72, 7
2', 74, 74', 110, 112... Differential circuit, 8, 8', 44, 44', 76, 76', 11
8... Signal generation circuit, 10, 10', 18, 1
8', 46, 46', 78, 78', 80, 80',
114, 116...Limit value circuit (comparator), 1
2, 12'...Frequency comparison circuit, 16, 34, 1
26...Blocking device, 20, 52, 52', 86,
86'...Solenoid valve, 28, 28', 54, 94, 9
4', 128...Pulse device, 62, 62', 10
6,106'...AND gate, 64,64',1
04, 104'... Device switchable by λ signal, 124... Timing element.

Claims (1)

【特許請求の範囲】 1 車輪の回転速度に比例するセンサ信号を発生
する少なくとも1つのセンサと、センサ信号を微
分して加速度信号および減速度信号を発生する微
分回路と、所定の限界値以上の加速度信号および
減速度信号において加速度制御信号および減速度
制御信号を発生する限界値回路と、センサ信号か
ら滑り制御信号を形成する回路と、制動が制御さ
れる場合加速度制御信号または減速度制御信号を
受けて制動圧力制御用電磁弁にパルスを与えるパ
ルス装置とを有し、外乱信号が生じた場合これを
抑制して制動装置の誤動作を防止するものにおい
て、加速度制御信号または減速度制御信号が周波
数比較回路12,12′へ供給されて、その周波
数が所定値と比較され、この周波数比較回路の出
力信号が、減速度制御信号またはパルス装置2
8,28′の出力信号を阻止する阻止装置16,
34へ供給されることを特徴とする、固着防止さ
れる車両制動装置の誤制御信号防止用回路装置。 2 阻止装置がANDゲート16であり、周波数
比較回路12の否定出力信号が、加速度制御信号
および減速度制御信号のためこのANDゲート1
6において論理結合され、このANDゲート16
の出力端が電磁弁20に接続されていることを特
徴とする、特許請求の範囲第1項に記載の回路装
置。 3 阻止装置が、減速度制御信号用限界値回路1
8′の限界値を高める装置34であることを特徴
とする、特許請求の範囲第1項に記載の回路装
置。 4 車輪の回転速度に比例するセンサ信号を発生
する少なくとも1つのセンサと、センサ信号を微
分して加速度信号および減速度信号を発生する微
分回路と、所定の限界値以上の加速度信号および
減速度信号において加速度制御信号および減速度
制御信号を発生する限界値回路と、センサ信号か
ら滑り制御信号を形成する回路と、制動が制御さ
れる場合加速度制御信号または減速度制御信号を
受けて制動圧力制御用電磁弁にパルスを与えるパ
ルス装置とを有し、外乱信号が生じた場合これを
抑制して制動装置の誤動作を防止するものにおい
て、パルス装置128の出力信号を阻止する阻止
装置がANDゲート126であり、その2つの入
力端に、パルス装置128の出力端と応答および
復帰遅延時限素子124の出力端とが接続され、
時限素子124が電磁弁122へ供給される減速
度制御信号を受けることを特徴とする、固着防止
される車両制動装置の誤制御信号防止用回路装
置。 5 車輪の回転速度に比例するセンサ信号を発生
する少なくとも1つのセンサと、センサ信号を微
分して加速度信号および減速度信号を発生する微
分回路と、所定の限界値以上の加速度信号および
減速度信号において加速度制御信号および減速度
制御信号を発生する限界値回路と、センサ信号か
ら滑り制御信号を形成する回路と、制動が制御さ
れる場合加速度制御信号または減速度制御信号を
受けて制動圧力制御用電磁弁にパルスを与えるパ
ルス装置とを有し、外乱信号が生じた場合これを
抑制して制動装置の誤動作を防止するものにおい
て、滑り制御信号により切換え可能で出力信号を
発生する装置64,104,104′,64′が設
けられ、この出力信号がパルス装置54,94,
94′の出力信号または減速度制御信号とANDゲ
ート62,106,106′,62′において論理
結合され、このANDゲートの出力端が電磁弁5
2,86,86′,52′に接続されていることを
特徴とする、固着防止される車両制動装置の誤制
御信号防止用回路装置。 6 滑り制御信号により切換え可能な装置64,
104,104′,64′がRSフリツプフロツプ
であり、そのセツト入力端Sに滑り制御信号が印
加され、またそのリセツト入力端(R)が復帰遅
延時限素子68,100,100′,68′の否定
出力端に接続され、この時限素子が電磁弁へ供給
される減速度制御信号を受けることを特徴とす
る、特許請求の範囲第5項に記載の回路装置。 7 時限素子100の出力信号と加速度制御信号
とがANDゲート82において論理結合され、こ
のANDゲートの出力端が電磁弁86に接続され
ていることを特徴とする、特許請求の範囲第6項
に記載の回路装置。 8 RSフリツプフロツプ104′の出力端と加速
度制御信号用限界値回路78′の出力端とがAND
ゲート82′の両入力端に接続され、このANDゲ
ートの出力端が電磁弁86′に接続されているこ
とを特徴とする、特許請求の範囲第6項に記載の
回路装置。 9 時限素子100が応答遅延も行なうように構
成されていることを特徴とする、特許請求の範囲
第6項または第7項に記載の回路装置。
[Claims] 1. At least one sensor that generates a sensor signal proportional to the rotational speed of the wheel, a differentiation circuit that differentiates the sensor signal to generate an acceleration signal and a deceleration signal, and A limit value circuit for generating acceleration and deceleration control signals in the acceleration and deceleration signals and a circuit for forming the slip control signal from the sensor signal and for generating the acceleration or deceleration control signal if braking is controlled. and a pulse device that applies a pulse to a solenoid valve for braking pressure control in order to prevent a malfunction of the braking device by suppressing a disturbance signal when it occurs, the acceleration control signal or deceleration control signal has a frequency It is supplied to a comparator circuit 12, 12' and its frequency is compared with a predetermined value, and the output signal of this frequency comparator circuit is used as a deceleration control signal or a pulse device 2.
a blocking device 16 for blocking the output signals of 8, 28';
34. A circuit device for preventing erroneous control signals of a vehicle braking device that is prevented from sticking. 2. The blocking device is an AND gate 16, and the negative output signal of the frequency comparison circuit 12 is the acceleration control signal and the deceleration control signal.
6, and this AND gate 16
The circuit device according to claim 1, characterized in that an output end of the solenoid valve 20 is connected to the solenoid valve 20. 3. The blocking device is connected to the deceleration control signal limit value circuit 1.
8. Circuit arrangement according to claim 1, characterized in that it is a device 34 for increasing the limit value of 8'. 4. At least one sensor that generates a sensor signal proportional to the rotational speed of the wheel, a differentiation circuit that differentiates the sensor signal and generates an acceleration signal and a deceleration signal, and an acceleration signal and a deceleration signal that are greater than a predetermined limit value. a limit value circuit for generating an acceleration control signal and a deceleration control signal, a circuit for forming a slip control signal from the sensor signal, and a circuit for receiving an acceleration control signal or a deceleration control signal for braking pressure control when braking is controlled; In a device that has a pulse device that applies a pulse to a solenoid valve, and prevents malfunction of the braking device by suppressing a disturbance signal when it occurs, the blocking device that blocks the output signal of the pulse device 128 is an AND gate 126. and the output terminal of the pulse device 128 and the output terminal of the response and return delay time element 124 are connected to the two input terminals,
A circuit device for preventing erroneous control signals of a vehicle braking device from sticking, characterized in that a timing element 124 receives a deceleration control signal supplied to a solenoid valve 122. 5 at least one sensor that generates a sensor signal proportional to the rotational speed of the wheel; a differentiation circuit that differentiates the sensor signal to generate an acceleration signal and a deceleration signal; and an acceleration signal and a deceleration signal that are greater than or equal to a predetermined limit value. a limit value circuit for generating an acceleration control signal and a deceleration control signal, a circuit for forming a slip control signal from the sensor signal, and a circuit for receiving an acceleration control signal or a deceleration control signal for braking pressure control when braking is controlled; A device 64, 104 that is switchable by a slip control signal and that generates an output signal, in a device that has a pulse device that applies a pulse to a solenoid valve, and suppresses a disturbance signal when it occurs to prevent malfunction of the braking device. , 104', 64' are provided, and this output signal is sent to the pulse devices 54, 94,
94' output signal or deceleration control signal in AND gates 62, 106, 106', 62', and the output terminal of this AND gate is connected to the solenoid valve 5.
2, 86, 86', and 52'. 6 device 64 switchable by slip control signal;
Reference numerals 104, 104', and 64' designate RS flip-flops, to which a slip control signal is applied to the set input terminal S, and whose reset input terminal (R) is the negation of the return delay time elements 68, 100, 100', and 68'. 6. Circuit arrangement according to claim 5, characterized in that it is connected to the output terminal and that this timing element receives a deceleration control signal supplied to the solenoid valve. 7. Claim 6, characterized in that the output signal of the timing element 100 and the acceleration control signal are logically combined in an AND gate 82, and the output end of this AND gate is connected to the electromagnetic valve 86. The circuit arrangement described. 8 The output terminal of the RS flip-flop 104' and the output terminal of the acceleration control signal limit value circuit 78' are ANDed.
7. The circuit arrangement according to claim 6, wherein the AND gate is connected to both input ends of the gate 82', and the output end of the AND gate is connected to the solenoid valve 86'. 9. The circuit arrangement according to claim 6 or 7, characterized in that the timing element 100 is configured to also perform a response delay.
JP4793878A 1977-06-14 1978-04-24 Method of and device for supervising wrong control signals Granted JPS547085A (en)

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