JPS62194535A - Symbol processor - Google Patents

Symbol processor

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Publication number
JPS62194535A
JPS62194535A JP61036580A JP3658086A JPS62194535A JP S62194535 A JPS62194535 A JP S62194535A JP 61036580 A JP61036580 A JP 61036580A JP 3658086 A JP3658086 A JP 3658086A JP S62194535 A JPS62194535 A JP S62194535A
Authority
JP
Japan
Prior art keywords
symbol data
matched
circuit
matching
hash value
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP61036580A
Other languages
Japanese (ja)
Inventor
Noriaki Hyodo
兵頭 典明
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP61036580A priority Critical patent/JPS62194535A/en
Publication of JPS62194535A publication Critical patent/JPS62194535A/en
Pending legal-status Critical Current

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Abstract

PURPOSE:To perform a matching process at high speed with the large quantity of symbol data by using an electronic circuit to form the extracting means of an adding part which add the symbol data to be matched when the coincidence is obtained between the key part of the symbol data to be matched and the matching symbol data after the comparison of both symbol data. CONSTITUTION:When a matching process instruction is supplied to a control circuit 9, a hash function arithmetic circuit 2 calculates the hash value of the key part of the symbol data to be matched to store it in a main memory circuit 4 together with the symbol data to be matched. When a matching request is delivered, the hash value of the matching symbol data is calculated and compared with the memory data to be matched and stored in the circuit 4 through a hash value comparator 6. If the coincidence is obtained from said comparison, the key part of the symbol data to be matched is compared with the matching symbol data through a symbol data comparator 7. When the coincidence is obtained from this comparison, the adding part of the symbol data to be matched is read out and stored in an output buffer memory circuit 8.

Description

【発明の詳細な説明】 〔産業上の利用分野〕 この発明は情報処理装置において記号データをマツチン
グ処理する記号処理装置に関する。
DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a symbol processing device that performs matching processing of symbol data in an information processing device.

〔従来の技術〕[Conventional technology]

従来、記号データのマツチング処理は、汎用の情報処理
装置において、プログラムによって行なわれていた。次
のような2つの方法が一喰的であった。
Conventionally, symbol data matching processing has been performed by a program in a general-purpose information processing device. The following two methods were the most common.

(1)主記憶あるいは外部記憶上に要素の長さが一定の
配列を取り、被マツチング記号データを格納し、マツチ
ング要求が出された時、被マツチング記号データのキー
部を逐次取出し、マツチング記号データと比較し、一致
した場合、その被マツチング記号データの付加部を取り
出す。
(1) Store the symbol data to be matched in an array with a constant length of elements in the main memory or external memory, and when a matching request is issued, sequentially retrieve the key part of the symbol data to be matched and create the matching symbol. The data is compared, and if they match, the additional part of the symbol data to be matched is extracted.

(2)主記憶あるいは外部記憶上に要素の長さが一定の
配列を取り、被マツチング記号データのキー部のハツシ
ュ値を計算し、そのハツシュ値で示される配列上の位置
に被マツチング記号データを格納し、マツチング要求が
出された時、マツチング記号データのハツシュ値を計算
し、そのハフンユ値で示される配列上の位置に格納され
た被マツチング記号データのキー部とマツチング記号デ
ータとを比較し、一致した場合、その被マツチング記号
データの付加部を取り出す。
(2) Create an array with fixed element length in main memory or external memory, calculate the hash value of the key part of the symbol data to be matched, and place the symbol data to be matched at the position on the array indicated by the hash value. is stored, and when a matching request is issued, the hash value of the matching symbol data is calculated, and the key part of the symbol data to be matched stored at the position on the array indicated by the hash value is compared with the matching symbol data. If there is a match, the additional part of the symbol data to be matched is extracted.

〔発明が解決しようとする問題点〕[Problem that the invention seeks to solve]

上述した従来の記号データのマツチング処理は、被マツ
チング記号データの量が膨大になると、処理時間が非常
に長くかかることと、可変長の記号データを扱いにくい
こととの2つの欠点があった。
The conventional symbol data matching process described above has two drawbacks: it takes a very long processing time when the amount of symbol data to be matched becomes enormous, and it is difficult to handle variable length symbol data.

〔問題点を解決するための手段〕[Means for solving problems]

この発明の記号処理装置は、キー部と付加部とから成る
被マツチング記号データ又はマツチング記号データを入
力緩衝記憶回路に受取って一時的に記憶し、その入力緩
衝記憶回路の被マツチング記号データのキー部又はマツ
チング記号データをハツシュ関数演算回路である一定の
幅に切取って数値化し、ある一定の成算規則によって3
1算し、その計算により得られたハツシュ値とその被マ
ツチング記号データとを主記憶回路に記憶しておき、そ
の主記憶回路に格納された前記被マツチング記号データ
のハツシュ値と入力緩衝記憶回路のマツチング記号デー
タのハツシュ値とをハツシュ値比較回路で比較し、その
両ハツシュ値が一致したとJul明した場合に、主記憶
回路に格納されたその被マツチング記号データのキー部
と入力緩衝記憶回路のマツチング記号データとを記号デ
ータ比較回路で比較し、その両記号データが一致したと
判明した場合に主記憶回路上に格納されているその一致
した被マツチング記号データの付加部を抽出して出力緩
衝記憶回路に一時的に記憶する。
The symbol processing device of the present invention receives and temporarily stores matched symbol data or matching symbol data consisting of a key part and an additional part in an input buffer memory circuit, and stores the matched symbol data in the input buffer memory circuit. The part or matching symbol data is cut to a certain width using a hash function calculation circuit and converted into a numerical value, and then 3 is calculated according to a certain composition rule.
The hash value obtained by the calculation and the symbol data to be matched are stored in a main memory circuit, and the hash value of the symbol data to be matched stored in the main memory circuit and the input buffer memory circuit are The hash value of the matching symbol data is compared with the hash value of the matching symbol data in the hash value comparison circuit, and when it is determined that the two hash values match, the key part of the symbol data to be matched stored in the main memory circuit and the input buffer memory are The matching symbol data of the circuit is compared with the symbol data comparison circuit, and if it is found that both symbol data match, the additional part of the matched symbol data stored in the main memory circuit is extracted. Temporarily stored in the output buffer storage circuit.

〔実施例〕〔Example〕

次にこの発明を図面を参照して説明する。 Next, the present invention will be explained with reference to the drawings.

第1図はこの発明の一実施例を示す。入力緩衝記憶回路
1は、ハツシュ関数演算回路2と、記号データロ込み回
路3と、記号データ比較回路7とに接続され、ハツシュ
関数演算回路2は記号データ書込み回路3とハツシュ値
比較回路6とに接続され、記号データ書込み回路3は主
記憶回路4に接続され、主記憶回路上 5に接続され、記号データ読出し回路5はハツシュ値比
較回路6と、記号データ比較回路7と、出力緩衝記憶回
路8とに接続され、ハツシュ値比較回路6は記号データ
比較回路7に接続され、記号データ比較回路7は出力緩
衝記憶回路8に接続され、制j11回路9はハツシュ関
数演算回路2と、記号データ3込み回路3と、記号デー
タあ”C出し回路5と、ハツシュ値比較回路6と記号デ
ータ比較回路7に凄X4こされている。
FIG. 1 shows an embodiment of the invention. The input buffer storage circuit 1 is connected to a hash function calculation circuit 2, a symbol data write circuit 3, and a symbol data comparison circuit 7, and the hash function calculation circuit 2 is connected to a symbol data write circuit 3 and a hash value comparison circuit 6. The symbol data write circuit 3 is connected to the main memory circuit 4, and the symbol data read circuit 5 is connected to the main memory circuit 4, and the symbol data read circuit 5 has a hash value comparison circuit 6, a symbol data comparison circuit 7, and an output buffer memory circuit. 8, the hash value comparison circuit 6 is connected to the symbol data comparison circuit 7, the symbol data comparison circuit 7 is connected to the output buffer storage circuit 8, and the control circuit 9 is connected to the hash function calculation circuit 2 and the symbol data comparison circuit 7. 3 input circuit 3, symbol data A"C output circuit 5, hash value comparison circuit 6, and symbol data comparison circuit 7 are used.

次にこの発明の動作について説明する。Next, the operation of this invention will be explained.

まず制御回路9に、被マツチング記号データを入力する
1旨示が入ると、被マツチング記号データが入力緩衝記
憶回路1に記憶される。被マツチング記号データはハツ
シュ関数演算回路2でキー部がある一定の幅で切取られ
て数値化され、ある一定の演算規則で計算される。
First, when the control circuit 9 receives an instruction to input symbol data to be matched, the symbol data to be matched is stored in the input buffer storage circuit 1. The key part of the symbol data to be matched is cut out at a certain width in a hash function calculation circuit 2, converted into a numerical value, and calculated according to a certain calculation rule.

第2図はハツシュ関数演算回路2におけるハツシュ値の
計算過程例を示す。第2図において入力された被マツチ
ング記号データのキー部10はJISコードの場合、ビ
ット構成11で表わされ、これを7ビノト単位でハツシ
ュすると(切取ると)、ハツシュ後のビット構成12と
なり、これを10進化すると10進化後の数値13とな
り、これらを加算するとハノソユ値14が求められる。
FIG. 2 shows an example of the hash value calculation process in the hash function calculation circuit 2. In the case of the JIS code, the key part 10 of the symbol data to be matched inputted in FIG. , when this is evolved by 10, the value after 10 evolution becomes 13, and by adding these up, the Hanosoyu value of 14 is obtained.

計1γされたハノンユ値及び記号データは記号データ書
込み回路3によって主記憶回路4に書込まれ、蓄えられ
る。この一連の動作は被マツチング記号データがなくな
るまで続けられる。
The Hanonyu value and symbol data obtained by the total 1γ are written into the main memory circuit 4 by the symbol data writing circuit 3 and stored. This series of operations continues until there is no symbol data to be matched.

第3図に主記j17回路4の状態を示す。すなわち各ワ
ードごとに各被マツチング記号データのハツシュ値15
を先頭に、記号データのキー部の文字数16、記号デー
タのキー部17、記号データの付加部の文字数18、記
号データの付加部19が順次記憶されている。
FIG. 3 shows the state of the main j17 circuit 4. In other words, the hash value of each symbol data to be matched is 15 for each word.
Starting with 16 characters in the key part of symbol data, 17 characters in the key part of symbol data, 18 characters in the appended part of symbol data, and 19 characters in the appended part of symbol data are sequentially stored.

次に制御回路9にマツチング処理を行なう指示が入ると
、新しくマツチング記号データが入出緩衝記憶回路1に
記憶される。入力されたマツチング記号データは、被マ
ツチング記号データと同様にハフシュ関数演算回路2で
ハツシュ値が計算される0次に記号データ読出し回路5
によって、主記憶回路4に格納された被マツチング記号
データのハフシュ値15が逐次続出されて、ハツシュ値
比較回路6によってマツチング記号データのハツシュ値
と比較される。2個のハフシュ値が一致しない時、この
動作が繰返される。−敗した時、記号データ読出し回路
5によって主記憶に格納された被マツチング記号データ
のキー部17が読出されて、記号データ比較回路7によ
ってマツチング記号データと比較される。2個の記号デ
ータが一致しない時、被マツチング記号データのハノン
ユ値を読出す動作へ返る。−敗した時、記号データ読出
し回路5によって主記憶回路4に格納された被マツチン
グ記号データの付加部19が読出されて出力緩衝記憶回
路8に記憶される。一致する記号データが存在しない場
合、制御回路9は、その旨の信号を出力する。
Next, when an instruction to perform a matching process is input to the control circuit 9, new matching symbol data is stored in the input/output buffer storage circuit 1. The inputted matching symbol data is sent to the zero-order symbol data readout circuit 5 where the hash value is calculated by the hash function calculation circuit 2 in the same way as the symbol data to be matched.
As a result, the hash value 15 of the symbol data to be matched stored in the main memory circuit 4 is successively output and compared with the hash value of the symbol data to be matched by the hash value comparison circuit 6. This operation is repeated when the two hafsh values do not match. - When defeated, the symbol data reading circuit 5 reads out the key part 17 of the symbol data to be matched stored in the main memory, and the symbol data comparison circuit 7 compares it with the matching symbol data. When the two symbol data do not match, the process returns to the operation of reading the Hanonyu value of the symbol data to be matched. - When the symbol data reading circuit 5 loses, the appended portion 19 of the symbol data to be matched stored in the main memory circuit 4 is read out and stored in the output buffer memory circuit 8. If matching symbol data does not exist, the control circuit 9 outputs a signal to that effect.

〔発明の効果〕〔Effect of the invention〕

以上説明したようにこの発明は、被マツチング記号デー
タのキー部のハツシュ値を計算して、被マツチング記号
データとともに主記憶回路に記憶し、マツチング要求が
出された時、マツチング記号データのハツシュ値を計算
し主記憶回路上に格納された被マツチング記憶データと
マツチング記号データのハツシュ値とを比較し、これら
が一致した時、更に被マツチング記号データのキー部と
マツチング記号データとを比較し、これらが一致した時
、被マツチング記号データの付加部を抽出する一連の手
段を電子回路で実現することにより、大量の記号データ
を・高速でマツチング処理することができ、さらに、可
変長の記号データを容易に扱うことができるという効果
がある。
As explained above, the present invention calculates the hash value of the key part of the symbol data to be matched, stores it in the main memory circuit together with the symbol data to be matched, and when a matching request is issued, the hash value of the key part of the symbol data to be matched is calculated. , and compares the hash value of the matching memory data stored in the main memory circuit with the matching symbol data, and when they match, further compares the key part of the matching symbol data with the matching symbol data, By implementing a series of means using electronic circuits to extract the additional part of the symbol data to be matched when these match, it is possible to match a large amount of symbol data at high speed, and also to match variable length symbol data. This has the effect that it can be easily handled.

【図面の簡単な説明】[Brief explanation of drawings]

第1図はこの発明の実施例を示すブロック図、第2図は
第1図のハツシュ関数演算回路2におけるハツシュ値の
計算過程の例を示す図、第3図は第1図の上記jI2回
路4の記憶例を示す図である。 ■・・・入出力緩衝記憶回路、2・・・ハツシュ関数演
算回路、3・・・記号データ1込み回路、4・・・主記
憶回路、5・・・記号データ読出し回路、6・・・ハツ
シュ値比較回路、7・・・記号データ比較回路、8・・
・出カフ1 jj’r記憶回路、9・・・制御回路、1
0・・・被マツチング記号データのキー部及びマツチン
グ記号データ、11・・・JISコードのビット構成、
12・・・ハツシュ後のどノド構成、13・・・10進
数化後の数値、14・・・ハツシュ値、15・・・ハツ
シュ値、16・・・被マツチング記号データのキー部の
文字数、17・・・被マツチング記号データのキー部、
18・・・被マツチング記ぢデータの付加部の文字数、
19・・・被77ヂング記号データの(1加部。 陀 2図 第3図
FIG. 1 is a block diagram showing an embodiment of the present invention, FIG. 2 is a diagram showing an example of the hash value calculation process in the hash function calculation circuit 2 of FIG. 1, and FIG. 3 is a block diagram showing the above jI2 circuit of FIG. 1. 4 is a diagram showing a storage example of No. 4. FIG. ■...Input/output buffer memory circuit, 2...Hash function calculation circuit, 3...Symbol data 1 inclusion circuit, 4...Main memory circuit, 5...Symbol data reading circuit, 6... Hash value comparison circuit, 7... Symbol data comparison circuit, 8...
・Output cuff 1 jj'r memory circuit, 9...control circuit, 1
0...Key part of symbol data to be matched and matching symbol data, 11...Bit configuration of JIS code,
12... Dot configuration after hash, 13... Numerical value after decimal conversion, 14... Hash value, 15... Hash value, 16... Number of characters in key part of symbol data to be matched, 17 ...Key part of symbol data to be matched,
18...Number of characters in the additional part of the data to be matched,
19...77 digit symbol data (1 part. Figure 2 Figure 3

Claims (1)

【特許請求の範囲】[Claims] (1)キー部と付加部とから成る被マッチング記号デー
タ、又はマッチング記号データを受取って一時的に記憶
する入力緩衝記憶回路と、 その入力緩衝記憶回路の前記被マッチング記号データの
キー部又はマッチング記号データをある一定の幅に切取
って数値化し、ある一定の演算規則によって計算するハ
ッシュ関数演算回路と、前記被マッチング記号データと
その被マッチング記号データに関して前記ハッシュ関数
演算回路によって得られた値(以下ハッシュ値と呼ぶ)
とを記憶する主記憶回路と、 その主記憶回路に格納された前記被マッチング記号デー
タのハッシュ値と前記入力緩衝記憶回路に入力されたマ
ッチング記号データのハッシュ値とを比較するハッシュ
値比較回路と、 そのハッシュ値比較回路により前記2個のハッシュ値が
一致したと判明した場合に、主記憶回路に格納されたそ
の被マッチング記号データのキー部と前記入力緩衝記憶
回路のマッチング記号データとを比較する記号データ比
較回路と、 その記号データ比較回路により両記号データが一致した
と判明した場合に前記主記憶回路上に格納されている一
致した被マッチング記号データの付加部を抽出し、一時
的に記憶する出力緩衝記憶回路とを有する記号処理装置
(1) An input buffer memory circuit that receives and temporarily stores the symbol data to be matched or matching symbol data consisting of a key part and an additional part, and the key part or matching of the symbol data to be matched in the input buffer memory circuit. a hash function calculation circuit that cuts symbol data to a certain width, converts it into a numerical value, and calculates it according to a certain calculation rule; and a value obtained by the hash function calculation circuit regarding the symbol data to be matched and the symbol data to be matched. (hereinafter referred to as hash value)
a hash value comparison circuit that compares a hash value of the matching symbol data stored in the main memory circuit with a hash value of the matching symbol data input to the input buffer memory circuit; , If the hash value comparison circuit determines that the two hash values match, compare the key part of the symbol data to be matched stored in the main memory circuit with the matching symbol data in the input buffer memory circuit. and a symbol data comparison circuit that extracts the additional part of the matched symbol data stored in the main memory circuit when it is determined by the symbol data comparison circuit that the symbol data matches, and temporarily and an output buffer storage circuit for storing.
JP61036580A 1986-02-21 1986-02-21 Symbol processor Pending JPS62194535A (en)

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