JPS62176894U - - Google Patents

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JPS62176894U
JPS62176894U JP6535786U JP6535786U JPS62176894U JP S62176894 U JPS62176894 U JP S62176894U JP 6535786 U JP6535786 U JP 6535786U JP 6535786 U JP6535786 U JP 6535786U JP S62176894 U JPS62176894 U JP S62176894U
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JP
Japan
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display device
video output
clock
circuit
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JP6535786U
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Description

【図面の簡単な説明】
第１図はこの考案の一実施例によるデイスプレ
イ装置を示すブロツク構成図、第２図は実施例の
要部を示す回路図、第３図は第２図の各部の信号
波形を示すタイミングチヤート、第４図は従来の
デイスプレイ装置の一例を示すブロツク構成図で
ある。 １…ＣＲＴタイミング回路、２…ＣＰＵ、３…
マルチプレクサ、６…ＣＲＴ、７…表示メモリ、
８…ビデオ出力回路、９…クロツク発生回路、１
０…ナンド回路、１１…アンド回路、１２…制御
手段、７ａ，７ｂ…ビデオ信号、８ａ…ビデオ出
力、９ａ…クロツク。なお、図中同一符号は同一
又は相当部分を示す。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) 画像情報を記憶する表示メモリを備え、こ
    の記憶内容に対応して出力される２値のビデオ出
    力に基づき画面上の輝点を制御して画像情報を表
    示するようにしたデイスプレイ装置において、上
    記表示メモリを、画像情報と各画像情報の画面上
    における輝度を設定する制御情報とを記憶可能に
    構成するとともに、この制御情報にもとづき上記
    ビデオ出力のパルス幅を制御する制御手段を備え
    たことを特徴とするデイスプレイ装置。 (2) 制御手段は、ビデオ出力のパルス幅の基準
    となるクロツクを発生するクロツク発生回路と、
    このクロツクと制御情報とのナンドをとるナンド
    回路と、このナンド出力と画像情報とのアンドを
    とるアンド回路とから成ることを特徴とする実用
    新案登録請求の範囲第１項記載のデイスプレイ装
    置。
JP6535786U 1986-04-30 1986-04-30 Pending JPS62176894U (ja)

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Application Number Priority Date Filing Date Title
JP6535786U JPS62176894U (ja) 1986-04-30 1986-04-30

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Application Number Priority Date Filing Date Title
JP6535786U JPS62176894U (ja) 1986-04-30 1986-04-30

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Publication Number Publication Date
JPS62176894U true JPS62176894U (ja) 1987-11-10

Family

ID=30902351

Family Applications (1)

Application Number Title Priority Date Filing Date
JP6535786U Pending JPS62176894U (ja) 1986-04-30 1986-04-30

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JP (1) JPS62176894U (ja)

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