JPS6211047Y2 - - Google Patents

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JPS6211047Y2
JPS6211047Y2 JP6706778U JP6706778U JPS6211047Y2 JP S6211047 Y2 JPS6211047 Y2 JP S6211047Y2 JP 6706778 U JP6706778 U JP 6706778U JP 6706778 U JP6706778 U JP 6706778U JP S6211047 Y2 JPS6211047 Y2 JP S6211047Y2
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amplifier
transistor
circuit
equalizer
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  • Amplifiers (AREA)

Description

【考案の詳細な説明】 この考案はトランスデユーサの出力信号を増幅
する増幅器に係り、特に前記出力信号を信号系路
中で劣化させることなく取出し、かつ同信号をイ
コライズするようにした増幅器に関する。
[Detailed description of the invention] This invention relates to an amplifier that amplifies the output signal of a transducer, and particularly relates to an amplifier that extracts the output signal without deteriorating it in the signal path and equalizes the same signal. .

一般に、トランスデユーサ(プレーヤのピツク
アツプカートリツジ、テープレコーダのヘツド
等)の出力再生装置においては、トランスデユー
サの微少出力信号を各種リード線、コネクタ類を
介して増幅器に導くため、前記信号が前記リード
線等で構成される信号系路において劣化する問題
がある。例えばムービングコイル形ピツクアツプ
カートリツジを信号源とする信号再生系路におい
ては、前記信号源で得られる出力レベルが極めて
低いため、一旦これをヘツドアンプで増幅し、こ
の増幅出力をプリ・メインアンプに供給するよう
にしており、この場合の信号系路においては、前
記ヘツドアンプが通常プレーヤのケース内部やプ
リ・メインアンプの内部に設けられているため、
ピツクアツプカートリツジの微少信号をヘツドア
ンプに導くためのリード線が長くなり、このリー
ド線や同リード線を接続するためのコネクタ類に
おいて信号品質(周波数特性、SN比等)の劣化
を来たす問題がある。すなわち、前記信号系路を
構成するリード線、コネクタ類等の導体は、その
材質、構造、接続状態、収容物の構造等に応じて
直流抵抗R、インダクタンスL、キヤパシタンス
Cを構成し、また導体接合部において非直線性を
形成し(金属導体の表面に生じた酸化皮膜が、電
圧−電流特性上零位付近で非直線性を形成し、微
少信号に対して影響を与える)、これらが信号品
質の劣化原因となる。この問題は、信号系路の単
純化によつてその改善が計れるが、通常これが機
器構成上の制約等によつて実施できないのが実情
である。
Generally, in the output reproducing device of a transducer (pickup cartridge of a player, head of a tape recorder, etc.), the minute output signal of the transducer is guided to an amplifier via various lead wires and connectors, so that the signal is There is a problem of deterioration in the signal path made up of the lead wires and the like. For example, in a signal reproduction system that uses a moving coil pickup cartridge as a signal source, the output level obtained from the signal source is extremely low, so this is first amplified by a head amplifier, and this amplified output is supplied to the pre-main amplifier. In the signal path in this case, the head amplifier is usually installed inside the case of the player or inside the pre-main amplifier.
The lead wires used to guide the minute signals from the pick-up cartridge to the head amplifier become long, and there is a problem in that the signal quality (frequency characteristics, SN ratio, etc.) deteriorates in these lead wires and the connectors used to connect them. . That is, the conductors such as lead wires and connectors constituting the signal path constitute DC resistance R, inductance L, and capacitance C depending on their material, structure, connection state, structure of the contained object, etc. Nonlinearity is formed at the joint (the oxide film that forms on the surface of the metal conductor forms nonlinearity near zero in the voltage-current characteristics, affecting minute signals), and these This may cause quality deterioration. Although this problem can be improved by simplifying the signal path, the reality is that this is usually not possible due to constraints on the equipment configuration.

またトランスデユーサの出力再生装置において
これが例えば録音イコライザ信号の再生装置であ
る場合には、トランスデユーサの出力信号を再生
イコライズするために増幅器の構成をイコライザ
増幅器とする必要があるが、この際従来のイコラ
イザ増幅器にあつては、同増幅器において出力信
号が劣化する問題や同増幅器自体について構成上
の問題がある。すなわち、従来一般に用いられて
いるイコライザ増幅器について第1図を参照して
説明すると、同図aはCR形イコライザ増幅器を
示し、増幅器(バツフアアンプ)A1、A2間に抵
抗R1,R2,R3とコンデンサC1,C2とからなるイ
コライザ回路を介挿したものである。このCR形
イコライザ増幅器においては、イコライザ特性が
正確に得られ、比較的良好な音質特性を得ること
ができるが、反面増幅器出力の利用率が低く、回
路構成が複雑化する欠点がある。また、同図bは
NF形イコライザ増幅器を示し、非反転増幅器と
して構成された演算増幅器A3において、その帰
還回路をイコライザ素子(抵抗R4,R5,R6、コ
ンデンサC3,C4)で構成したものである。この
NF形イコライザ増幅器においては、増幅器出力
の利用率が高く、回路構成が簡素化されるが、反
面イコライザ特性の高域部分が理想特性から外
れ、上記したCR形に比較して一般的に音質特性
が劣る難点がある。また、同図c,dはCR・NF
混成形イコライザ増幅器を示すもので、同図cは
演算増幅器A3の帰還回路をイコライザ素子(抵
抗R7,R8,R9、コンデンサC5)で構成すると共に
出力回路にイコライザ素子(抵抗R10、コンデン
サC6)を介挿したものであり、同図dは演算増幅
器A3の入力回路にイコライザ素子(抵抗R11、コ
ンデンサC7)を介挿すると共に帰還回路をイコラ
イザ素子(抵抗R12,R13R14、コンデンサC8)で構
成されたものである。これらの混成形イコライザ
増幅器においては、イコライザ特性、増幅器出力
の利用率が改善されるものの回路構成が極めて複
雑となる欠点がある。
In addition, in the case of a transducer output reproducing device, for example, if this is a recording equalizer signal reproducing device, the amplifier must be configured as an equalizer amplifier in order to reproduce and equalize the output signal of the transducer. Conventional equalizer amplifiers have problems in that the output signal of the amplifier deteriorates and problems in the structure of the amplifier itself. That is, a conventionally commonly used equalizer amplifier will be explained with reference to FIG . 1. Figure a shows a CR type equalizer amplifier, in which resistors R 1 , R 2 , An equalizer circuit consisting of R 3 and capacitors C 1 and C 2 is inserted. In this CR type equalizer amplifier, equalizer characteristics can be obtained accurately and relatively good sound quality characteristics can be obtained, but on the other hand, the utilization rate of the amplifier output is low and the circuit configuration is complicated. Also, b in the same figure
This shows an NF type equalizer amplifier, in which the operational amplifier A 3 is configured as a non-inverting amplifier, and its feedback circuit is configured with equalizer elements (resistors R 4 , R 5 , R 6 , capacitors C 3 , C 4 ). . this
In the NF type equalizer amplifier, the utilization rate of the amplifier output is high and the circuit configuration is simplified, but on the other hand, the high frequency part of the equalizer characteristics deviates from the ideal characteristics, and the sound quality characteristics are generally lower than the above-mentioned CR type. There is a disadvantage that it is inferior. Also, c and d in the same figure are CR/NF
This figure shows a hybrid equalizer amplifier. Figure c shows the feedback circuit of operational amplifier A3 consisting of equalizer elements (resistors R 7 , R 8 , R 9 , capacitor C 5 ), and the output circuit including an equalizer element (resistor R 10 , capacitor C 6 ), and Figure d shows an equalizer element (resistance R 11 , capacitor C 7 ) inserted in the input circuit of operational amplifier A 3 , and a feedback circuit connected to the equalizer element (resistance R 12 , R 13 R 14 , and a capacitor C 8 ). Although these hybrid equalizer amplifiers improve the equalizer characteristics and the utilization rate of the amplifier output, they have the disadvantage that the circuit configuration is extremely complicated.

このように、従来用いられているトランスデユ
ーサの出力再生装置においては、トランスデユー
サの出力信号が信号系路中で劣化する問題があ
り、また同出力信号をイコライズする場合には、
この際用いられるイコライザ増幅器に様々な問題
点を抱えていた。
As described above, in conventional transducer output reproducing devices, there is a problem that the output signal of the transducer deteriorates in the signal path, and when equalizing the output signal,
The equalizer amplifier used in this case had various problems.

この考案は上記の事情に鑑み、トランスデユー
サの出力信号を信号系路中で劣化させることなく
取出すことができ、また増幅器出力の利用率低下
を招くことなく正確な再生イコライズをなすこと
ができ、しかも回路構成が簡単である増幅器を提
供するもので、トランスデユーサの近傍に配置さ
れ同トランスデユーサの出力電圧がゲート・ソー
ス間に印加される電界効果トランジスタと、この
電界効果トランジスタのドレインおよびソースに
各々接続された第1、第2の出力取出系路と、前
記第1の出力取出系路の他端にエミツタが接続さ
れたトランジスタと、前記第2の出力取出系路の
他端および前記トランジスタのベース間を定電圧
に保つ定電圧回路と、前記トランジスタのコレク
タおよび電源端子間に介挿されたCR形イコライ
ザ回路構成の負荷と、前記トランジスタのコレク
タおよび出力端子間に介挿されたコンデンサとか
らなるものである。
In view of the above circumstances, this invention allows the output signal of the transducer to be taken out without deteriorating in the signal path, and also enables accurate reproduction equalization without causing a decrease in the utilization rate of the amplifier output. , and provides an amplifier with a simple circuit configuration, consisting of a field effect transistor placed near a transducer and to which the output voltage of the transducer is applied between the gate and source, and the drain of this field effect transistor. and a first and second output extraction system connected to the source, a transistor whose emitter is connected to the other end of the first output extraction system, and the other end of the second output extraction system. and a constant voltage circuit that maintains a constant voltage between the bases of the transistor, a load of a CR type equalizer circuit inserted between the collector of the transistor and the power supply terminal, and a load of a CR type equalizer circuit inserted between the collector of the transistor and the output terminal. It consists of a capacitor and a capacitor.

以下、この考案の一実施例を第2図ないし第3
図を参照して説明する。
An embodiment of this invention is shown below in Figures 2 to 3.
This will be explained with reference to the figures.

この実施例は、この考案をプレーヤ再生システ
ムに適用したものであり、第2図は同システムの
結線状態を示す。同図において、1はプレーヤ、
2はプレーヤ1のケース、3はターンテーブル、
4はピツクアツプカートリツジ、5はヘツドシエ
ル、6はトーンアーム、7は外部アダプタであ
る。ヘツドシエル5の出力端子8はトーンアーム
6内を通るリード線9を介してプレーヤ出力端子
10に接続され、出力端子10は接続コード11
によつて外部アダプタ7の入力端子12に接続さ
れている。しかして、上記第2図に示すピツクア
ツプカートリツジ4からアダプタ7に至る間の信
号系路は第3図に示す回路を構成している。すな
わち、第3図においてピツクアツプカートリツジ
4の発電コイル13は、その一方の出力端子13
aが電界効果トランジスタQ1のゲートに接続さ
れ、他方の出力端13bが同電界効果トランジス
タQ1のソースに接続されている。電界効果トラ
ンジスタQ1は発電コイル13で生じた電圧を増
幅かつ電流変換するもので、発電コイル13の近
傍である例えばピツクアツプカートリツジ4、ヘ
ツドシエル5等の内部に配置され、そのドレイン
がヘツドシエル5の一方の出力端子8aに接続さ
れ、ソースが同他方の出力端子8bに接続されて
いる。出力端子8aはリード線9aによつてプレ
ーヤ出力端子10aに接続され、出力端子8bは
リード線9bによつて同出力端子10bに接続さ
れている。また、出力端子10aは一方の接続コ
ード11aによつてアダプタ7の入力端子12a
に接続され、出力端子10bは他方の接続コード
11bによつて同入力端子12bに接続されてい
る。上記のリード線9a,9bおよび接続コード
11a,11bは、後述するように、電界効果ト
ランジスタQ1への電源供給系路となると共に同
電界効果トランジスタQ1の出力取出系路となる
ものである。またアダプタ7において、入力端子
12aはトランジスタQ2のエミツタに接続さ
れ、入力端子12bは出力端子(アース端子)1
4bに接続されている。トランジスタQ2は、そ
のバイアス回路と共に電界効果トランジスタQ1
のドレイン−ソース間に一定の電源電圧を供給す
る定電圧供給回路を構成しており、そのコレクタ
が負荷15を介して正電源端子16に接続される
と共にコンデンサ17を介して出力端子14aに
接続され、ベースが定電流回路18を介して正電
源端子16に接続されると共に抵抗19を介して
出力端子14bに接続されている。また、出力端
子14a,14b間には抵抗20が介挿されてい
る。前記負荷15は、トランジスタQ2のコレク
タと正電源端子16との間に直列に介挿された抵
抗21,22と、これら抵抗21,22に各々並
列接続されたコンデンサ23,24とから構成さ
れており、抵抗21,22およびコンデンサ2
3,24が所謂CR形イコライザ回路として機能
し、出力端子14a,14bに得られる出力がイ
コライズされるようになつている。なおこの実施
例においては、イコライザ・カーブがRIAA再生
カーブとなるように各素子の時定数が次のように
設定されている。すなわち、抵抗21,22の値
を各々r21・r22、コンデンサ23,24の値を
各々C22,C24とした場合に、高域の時定数がTH
=C23,r21=75〔μsec〕、低域の時定数がTL
C24,r22=3180〔μsec〕、中域の時定数がTM
C24,(C23+C24)(r22r21)=318〔μsec〕であ
る。
In this embodiment, this invention is applied to a player playback system, and FIG. 2 shows the wiring state of the system. In the figure, 1 is a player;
2 is the case of player 1, 3 is the turntable,
4 is a pickup cartridge, 5 is a head shell, 6 is a tone arm, and 7 is an external adapter. The output terminal 8 of the head shell 5 is connected to the player output terminal 10 via a lead wire 9 passing through the tone arm 6.
It is connected to the input terminal 12 of the external adapter 7 by. The signal path from the pick-up cartridge 4 to the adapter 7 shown in FIG. 2 constitutes the circuit shown in FIG. 3. That is, in FIG. 3, the generator coil 13 of the pick-up cartridge 4 is connected to one output terminal 13
A is connected to the gate of the field effect transistor Q1 , and the other output terminal 13b is connected to the source of the field effect transistor Q1 . The field effect transistor Q 1 amplifies the voltage generated in the power generating coil 13 and converts it into a current. It is connected to one output terminal 8a, and its source is connected to the other output terminal 8b. The output terminal 8a is connected to the player output terminal 10a by a lead wire 9a, and the output terminal 8b is connected to the player output terminal 10b by a lead wire 9b. Further, the output terminal 10a is connected to the input terminal 12a of the adapter 7 by one connection cord 11a.
The output terminal 10b is connected to the same input terminal 12b by the other connection cord 11b. The above lead wires 9a, 9b and connection cords 11a, 11b serve as a power supply path to the field effect transistor Q1 as well as an output extraction path of the field effect transistor Q1 , as will be described later. . In addition, in the adapter 7, the input terminal 12a is connected to the emitter of the transistor Q2 , and the input terminal 12b is connected to the output terminal (ground terminal) 1.
4b. Transistor Q 2 along with its bias circuit connects field effect transistor Q 1
constitutes a constant voltage supply circuit that supplies a constant power supply voltage between the drain and source of the circuit, and its collector is connected to the positive power supply terminal 16 via a load 15 and to the output terminal 14a via a capacitor 17. The base thereof is connected to the positive power supply terminal 16 via a constant current circuit 18, and is also connected to the output terminal 14b via a resistor 19. Further, a resistor 20 is inserted between the output terminals 14a and 14b. The load 15 is composed of resistors 21 and 22 inserted in series between the collector of the transistor Q 2 and the positive power supply terminal 16, and capacitors 23 and 24 connected in parallel to the resistors 21 and 22, respectively. resistors 21, 22 and capacitor 2
3 and 24 function as a so-called CR type equalizer circuit, and the outputs obtained at the output terminals 14a and 14b are equalized. In this embodiment, the time constants of each element are set as follows so that the equalizer curve corresponds to the RIAA reproduction curve. That is, when the values of the resistors 21 and 22 are respectively r 21 and r 22 and the values of the capacitors 23 and 24 are C 22 and C 24 respectively, the high frequency time constant is T H
= C 23 , r 21 = 75 [μsec], the low frequency time constant is T L =
C 24 , r 22 = 3180 [μsec], the time constant in the middle range is T M =
C 24 , (C 23 + C 24 ) (r 22 r 21 ) = 318 [μsec].

次に、上記回路の動作について説明すると、第
3図において、トランジスタQ2のベースには定
電流回路18と抵抗19とにつて一定のバイアス
が与えられており、したがつて入力端子12a,
12b間に一定の電圧が得られ、この電圧は接続
コード11a,11b、リード線9a,9bを介
して電界効果トランジスタQ1のドレイン−ソー
ス間に印加される。電界効果トランジスタQ1
は、そのゲート−ソース間が発電コイル13によ
つて直流的に短絡されているため、これらの間が
同電位となつてドレイン−ソース間に一定の電流
が流れ、能動状態におかれる。ここで発電コイル
13に電圧が誘起されると、この電圧は電界効果
トランジスタQ1のゲート−ソース間に印加さ
れ、同電界効果トランジスタQ1によつて増幅さ
れる。この増幅出力は、電界効果トランジスタ
Q1のドレイン−ソース間からリード線9a,9
b、接続コード11a,11bを介してアダプタ
7側に供給され、負荷15の両端間電圧を変化さ
せてトランジスタQ2のコレクタ電圧を変化さ
せ、同コレクタからコンデンサ17を介して出力
端子14a,14b間に取出される。したがつ
て、この回路においては、リード線9a,9b、
接続コード11a,11bに発電コイル13に生
じた電圧のgm・rL倍(但し、gmは電界効果ト
ランジスタQ1の相互コンダクタンス、rLは負荷
抵抗15の値)された信号(電流変換された信
号)が供給されることになり、同信号がリード線
9a,9b、接続コード11a,11bの作る直
流抵抗R、インダクタンスL、キヤパシタンスC
によつて殆ど影響されることがない。また信号電
流は電界効果トランジスタQ1の電源電流(飽和
ドレイン電流)に重畳してリード線9a,9b、
接続コード11a,11bを流れることになり、
この信号系路中に介挿されたコネクタ類の作る非
直線性からの悪影響も防止される。すなわち、前
記信号系路中を流れる電界効果トランジスタQ1
の飽和ドレイン電流は、コネクタ類の作る非直線
性に対して影響を受け難いレベルにあり、この飽
和ドレイン電流に重畳する信号電流は前記非直線
性の影響を受けることがない。
Next, to explain the operation of the above circuit, in FIG. 3, a constant current circuit 18 and a resistor 19 are applied with a constant bias to the base of the transistor Q2 , so that the input terminals 12a,
A constant voltage is obtained between the transistors 12b and 12b, and this voltage is applied between the drain and source of the field effect transistor Q1 via the connection cords 11a and 11b and the lead wires 9a and 9b. Field effect transistor Q 1
Since its gate and source are short-circuited by the power generating coil 13 in a direct current manner, these are at the same potential, a constant current flows between the drain and the source, and the transistor is placed in an active state. When a voltage is induced in the generator coil 13, this voltage is applied between the gate and source of the field effect transistor Q1 , and is amplified by the field effect transistor Q1 . This amplified output is a field effect transistor
Lead wires 9a, 9 from between the drain and source of Q1
b, is supplied to the adapter 7 side via connection cords 11a, 11b, changes the voltage across the load 15 to change the collector voltage of the transistor Q2 , and from the collector via the capacitor 17 to the output terminals 14a, 14b. taken out in between. Therefore, in this circuit, the lead wires 9a, 9b,
The connection cords 11a and 11b receive a signal (current converted signal) will be supplied, and the same signal will be supplied to the DC resistance R, inductance L, and capacitance C created by the lead wires 9a and 9b and the connection cords 11a and 11b.
It is hardly affected by. Further, the signal current is superimposed on the power supply current (saturated drain current) of the field effect transistor Q 1 and is passed through the lead wires 9a, 9b,
It will flow through the connection cords 11a and 11b,
Adverse effects from non-linearity caused by connectors inserted in this signal path are also prevented. That is, the field effect transistor Q 1 flowing in the signal path
The saturated drain current is at a level that is not easily affected by nonlinearity created by connectors, and the signal current superimposed on this saturated drain current is not affected by the nonlinearity.

また、出力端子14a,14b間に取出される
出力は、負荷15がRIAA再生カーブを有するた
め、同カーブの周波数特性をもつて出力される。
この際電界効果トランジスタQ1での増幅出力
は、負荷15がCR形イコライザ回路で構成され
ているにもかかわらず、その利用率が低下しな
い。
Further, since the load 15 has the RIAA regeneration curve, the output taken out between the output terminals 14a and 14b has the frequency characteristics of the same curve.
At this time, the utilization rate of the amplified output of the field effect transistor Q1 does not decrease even though the load 15 is constituted by a CR type equalizer circuit.

なお、上記の実施例においては、この発明をム
ービングコイル形ピツクアツプカートリツジを有
するプレーヤの信号系路に適用した場合について
説明したが、その適用対象はテープレコーダにお
ける再生ヘツド等各種トランスデユーサの信号系
路であつてよい。
In the above embodiment, the present invention was applied to a signal path of a player having a moving coil type pickup cartridge, but the present invention is applicable to signals of various transducers such as a playback head of a tape recorder. It may be a line.

以上の説明から明らかなように、この考案によ
れば、ピツクアツプカートリツジ等トランスデユ
ーサの信号電圧を、同トランスデユーサの近傍に
配置した電界効果トランジスタにより電流変換し
て取り出すようにしたから、取り出される信号が
信号系路においてリード線、接続コード等の作る
インピーダンスによつて劣化することがなく、ま
た同信号が信号系路中に介挿されたコネクタ類等
の導体接合部を通過する際にこれが電界効果トラ
ンジスタに供給される電源電流のバイアス下で通
過するため、前記導体接合部の作る非直線性の影
響を受けることがない。
As is clear from the above explanation, according to this invention, the signal voltage of a transducer such as a pick-up cartridge is converted into a current by a field effect transistor placed near the transducer and extracted. The signal to be extracted is not degraded by impedance created by lead wires, connection cords, etc. in the signal path, and when the signal passes through conductor joints such as connectors inserted in the signal path. Since this is passed under the bias of the power supply current supplied to the field effect transistor, it is not affected by the nonlinearity created by the conductor junction.

また、負荷をコンデンサと抵抗とで構成して
CR形イコライザ増幅器としたから、構成が簡単
で、しかも回路に正確な再生イコライザカーブを
もたせることができる。またCR形イコライザ増
幅器でありながら増幅器出力の利用率低下を来た
すことがない。また、イコライザ増幅器であるに
もかかわらず信号源と出力端子との間を一つの増
幅段で構成できるから、信号が増幅段を通過する
際に生じる位相の回転を僅かに抑えることがで
き、安定した動作が得られる。また、回路を直流
増幅器で構成できるから、回路に直流の時定数を
もたせることがなく、したがつて低域特性の劣化
を来たすことがない。また更に、回路の利得調
整、周波数特性調整が容易にでき、任意の伝達負
荷関数を容易に設定することができる。
Also, the load can be configured with a capacitor and a resistor.
Since it is a CR type equalizer amplifier, the configuration is simple and the circuit can have an accurate reproduction equalizer curve. Furthermore, although it is a CR type equalizer amplifier, there is no reduction in the utilization rate of the amplifier output. In addition, even though it is an equalizer amplifier, it can be configured with a single amplification stage between the signal source and the output terminal, so the phase rotation that occurs when the signal passes through the amplification stage can be suppressed slightly, making it stable. You can get the desired behavior. Furthermore, since the circuit can be configured with a DC amplifier, the circuit does not have a DC time constant, and therefore the low frequency characteristics do not deteriorate. Furthermore, the gain and frequency characteristics of the circuit can be easily adjusted, and any transfer load function can be easily set.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図a,b,c,dは従来一般に用いられて
いるイコライザ増幅器の回路図、第2図はこの考
案を適用したプレーヤ再生システムの結線状態を
示す図、第3図はこの考案による増幅器の回路図
である。 13……発電コイル、9a,11a……第1の
出力取出系路、9b,11b……第2の出力取出
系路、15……負荷、17……コンデンサ、1
8,19……定電圧回路、Q1……電界効果トラ
ンジスタ、Q2……トランジスタ。
Figures 1a, b, c, and d are circuit diagrams of equalizer amplifiers commonly used in the past, Figure 2 is a diagram showing the connection state of a player playback system to which this invention is applied, and Figure 3 is an amplifier according to this invention. FIG. 13... Generator coil, 9a, 11a... First output extraction system path, 9b, 11b... Second output extraction system path, 15... Load, 17... Capacitor, 1
8,19...constant voltage circuit, Q1 ...field effect transistor, Q2 ...transistor.

Claims (1)

【実用新案登録請求の範囲】[Scope of utility model registration request] トランスデユーサの近傍に配置され同トランス
デユーサの出力電圧がゲート・ソース間に印加さ
れる電界効果トランジスタと、この電界効果トラ
ンジスタのドレインおよびソースに各々接続され
た第1、第2の出力取出系路と、前記第1の出力
取出系路の他端にエミツタが接続されたトランジ
スタと、前記第2の出力取出系路の他端および前
記トランジスタのベース間を定電圧に保つ定電圧
回路と、前記トランジスタのコレクタおよび電源
端子間に介挿されたCR形イコライザ回路構成の
負荷と、前記トランジスタのコレクタおよび出力
端子間に介挿されたコンデンサとを具備してなる
増幅器。
A field effect transistor disposed near the transducer and to which the output voltage of the transducer is applied between the gate and source, and first and second output outputs connected to the drain and source of the field effect transistor, respectively. a transistor having an emitter connected to the other end of the first output extraction circuit; and a constant voltage circuit that maintains a constant voltage between the other end of the second output extraction circuit and the base of the transistor. , an amplifier comprising: a load having a CR type equalizer circuit configuration inserted between the collector of the transistor and the power supply terminal; and a capacitor inserted between the collector of the transistor and the output terminal.
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