JPS62105548U - - Google Patents
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- Publication number
- JPS62105548U JPS62105548U JP19424285U JP19424285U JPS62105548U JP S62105548 U JPS62105548 U JP S62105548U JP 19424285 U JP19424285 U JP 19424285U JP 19424285 U JP19424285 U JP 19424285U JP S62105548 U JPS62105548 U JP S62105548U
- Authority
- JP
- Japan
- Prior art keywords
- input
- output
- ports
- output ports
- microcomputer
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Microcomputers (AREA)
Description
第１図・第２図は本考案の実施例を示す入出力
ポート制御回路の回路図、第３図・第４図は従来
例を示す回路図である。 ２０……マイクロコンピユータ、２１，２２，
３１，３２……ゲート、２７，２８，３７，３８
……入出力ポート。
ポート制御回路の回路図、第３図・第４図は従来
例を示す回路図である。 ２０……マイクロコンピユータ、２１，２２，
３１，３２……ゲート、２７，２８，３７，３８
……入出力ポート。
Claims (1)
- 複数の入出力ポートを持つマイクロコンピユー
タにおいて、その入出力ポートのうち一部にシリ
アル入出力やアナログ入出力等特別な機能を割付
け、マイクロコンピユータ内部で通常の入出力ポ
ートと特別の入出力ポートを接続するラインを持
ち、上記両ポートのうち、一方をイネーブル、他
方をデイセーブルにする制御回路を備えて成るこ
とを特徴とする入出力ポート制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19424285U JPS62105548U (ja) | 1985-12-19 | 1985-12-19 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19424285U JPS62105548U (ja) | 1985-12-19 | 1985-12-19 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62105548U true JPS62105548U (ja) | 1987-07-06 |
Family
ID=31151034
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP19424285U Pending JPS62105548U (ja) | 1985-12-19 | 1985-12-19 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62105548U (ja) |
-
1985
- 1985-12-19 JP JP19424285U patent/JPS62105548U/ja active Pending
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