JPS62103333U - - Google Patents

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JPS62103333U
JPS62103333U JP19354685U JP19354685U JPS62103333U JP S62103333 U JPS62103333 U JP S62103333U JP 19354685 U JP19354685 U JP 19354685U JP 19354685 U JP19354685 U JP 19354685U JP S62103333 U JPS62103333 U JP S62103333U
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JP
Japan
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circuit
holding
difference
converter
utility
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JP19354685U
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Description

【図面の簡単な説明】
第1図aは、本考案による波形平滑化回路の第
1の実施例を示すブロツク図、第1図b,cおよ
びdは、第1図aの回路の動作を説明する波形図
、第2図および第3図は、本考案による波形平滑
化回路の第2および第3の実施例を示すブロツク
図、第4図は、DCサーボ回路の実施例を示す図
である。 11,12,11′,12′…保持回路、2,
21,22…D/A変換器、3…差回路、4…積
分回路、5…DCサーボ回路、6…クロツク発生
器。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) 時間的に離散した標本値を再生側で連続し
    た滑らかな曲線に戻すため、標本点の間の時点の
    信号値を積分によつて求める波形平滑化回路にお
    いて、 連続した2つの標本値を一時記憶する保持回路
    、これら標本値の差を形成する差回路、およびこ
    の差を累積的に積分する積分回路が設けられてお
    り、さらにこの積分回路にDCサーボ回路が付加
    されていることを特徴とする波形平滑化回路。 (2) PCM変調されたデジタル入力信号を復調
    する場合、保持回路が、ラツチ回路として構成さ
    れており、これらラツチ回路の後にそれぞれD/
    A変換器が接続されており、これらD/A変換器
    の後に差動増幅器が接続されており、かつこの差
    動増幅器の後に、DCサーボ回路を付加した積分
    回路が接続されている、実用新案登録請求の範囲
    第1項記載の回路。 (3) PCM変調されたデジタル入力信号を復調
    する場合、保持回路が、アナログ標本化保持回路
    として構成されており、これら保持回路には、D
    /A変換器によつて変換されたアナログ信号が供
    給され、これら保持回路の後には差動増幅器が接
    続されており、かつこの差動増幅器の後に、DC
    サーボ回路を付加した積分回路が接続されている
    、実用新案登録請求の範囲第1項記載の回路。 (4) PCM変調されたデジタル入力信号を復調
    する場合、保持回路と差回路が、デジタル信号処
    理装置から成り、このデジタル信号処理装置によ
    り形成されたデジタル差信号が、後続のD/A変
    換器に供給され、このD/A変換器の後に、DC
    サーボ回路を付加した積分回路が接続されている
    、実用新案登録請求の範囲第1項記載の回路。
JP19354685U 1985-12-18 1985-12-18 Pending JPS62103333U (ja)

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