JPS6172628U - - Google Patents
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- Publication number
- JPS6172628U JPS6172628U JP15804884U JP15804884U JPS6172628U JP S6172628 U JPS6172628 U JP S6172628U JP 15804884 U JP15804884 U JP 15804884U JP 15804884 U JP15804884 U JP 15804884U JP S6172628 U JPS6172628 U JP S6172628U
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- JP
- Japan
- Prior art keywords
- digital value
- memory
- control circuit
- abnormality
- input
- Prior art date
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- Pending
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- 230000002159 abnormal effect Effects 0.000 claims description 2
- 230000005856 abnormality Effects 0.000 claims 2
- 230000006870 function Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Recording Measured Values (AREA)
Description
第１図は本考案の一実施例を示す構成説明図、
第２図は本考案に関わる異状信号記録計の記録例
図である。 １…Ａ／Ｄ変換器、２…制御回路、３…表示器
、４…メモリ、５…Ｄ／Ａ変換器、６…記録部。
第２図は本考案に関わる異状信号記録計の記録例
図である。 １…Ａ／Ｄ変換器、２…制御回路、３…表示器
、４…メモリ、５…Ｄ／Ａ変換器、６…記録部。
Claims (1)
- 入力信号をデジタル値に変換するＡ／Ｄ変換器
と、該変換されたデジタル値を入力とする制御回
路とを有し、該制御回路はあらかじめ設定された
トリガー条件と順次入力されるデジタル値を比較
し、この比較結果として異状時と通常時とを判定
し、通常時には制御回路は表示器およびメモリに
そのまま送出し、モニターとして動作し、異状時
には前記メモリに記憶されているデジタル値を読
み出し記録することを特徴とする異状信号記録計
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15804884U JPS6172628U (ja) | 1984-10-19 | 1984-10-19 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15804884U JPS6172628U (ja) | 1984-10-19 | 1984-10-19 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6172628U true JPS6172628U (ja) | 1986-05-17 |
Family
ID=30716032
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15804884U Pending JPS6172628U (ja) | 1984-10-19 | 1984-10-19 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6172628U (ja) |
-
1984
- 1984-10-19 JP JP15804884U patent/JPS6172628U/ja active Pending
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