JPS6148194B2 - - Google Patents

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JPS6148194B2
JPS6148194B2 JP5664681A JP5664681A JPS6148194B2 JP S6148194 B2 JPS6148194 B2 JP S6148194B2 JP 5664681 A JP5664681 A JP 5664681A JP 5664681 A JP5664681 A JP 5664681A JP S6148194 B2 JPS6148194 B2 JP S6148194B2
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JP
Japan
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memory
light
sensor
address
output
Prior art date
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JP5664681A
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Japanese (ja)
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JPS57172484A (en
Inventor
Tomomi Oota
Fumiaki Harada
Masanao Takaoka
Juji Isobe
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
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Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
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Publication of JPS57172484A publication Critical patent/JPS57172484A/en
Publication of JPS6148194B2 publication Critical patent/JPS6148194B2/ja
Granted legal-status Critical Current

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    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06KGRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
    • G06K7/00Methods or arrangements for sensing record carriers, e.g. for reading patterns
    • G06K7/10Methods or arrangements for sensing record carriers, e.g. for reading patterns by electromagnetic radiation, e.g. optical sensing; by corpuscular radiation
    • G06K7/10544Methods or arrangements for sensing record carriers, e.g. for reading patterns by electromagnetic radiation, e.g. optical sensing; by corpuscular radiation by scanning of the records by radiation in the optical part of the electromagnetic spectrum
    • G06K7/10821Methods or arrangements for sensing record carriers, e.g. for reading patterns by electromagnetic radiation, e.g. optical sensing; by corpuscular radiation by scanning of the records by radiation in the optical part of the electromagnetic spectrum further details of bar or optical code scanning devices
    • G06K7/10851Circuits for pulse shaping, amplifying, eliminating noise signals, checking the function of the sensing device

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  • Physics & Mathematics (AREA)
  • Electromagnetism (AREA)
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  • General Health & Medical Sciences (AREA)
  • Toxicology (AREA)
  • Artificial Intelligence (AREA)
  • Computer Vision & Pattern Recognition (AREA)
  • General Physics & Mathematics (AREA)
  • Theoretical Computer Science (AREA)
  • Controlling Sheets Or Webs (AREA)
  • Conveying Record Carriers (AREA)

Description

【発明の詳細な説明】 本発明は例えば帳票読取装置等において、状態
検出素子として多数の光学センサを使用する場合
に好適な制御方式に関し、光学センサ個々におい
て生ずる感度あるいは検出レベルの誤差を内部補
正する光学センサの制御方式に関する。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a control system suitable for using a large number of optical sensors as state detection elements in, for example, a form reading device, and involves internal correction of errors in sensitivity or detection level that occur in individual optical sensors. This invention relates to a control method for an optical sensor.

従来こうした多数のセンサを使用した各種の検
出レベルの2値化情報を検出使用する場合、セン
サそれぞれに対応して感度調整と2値化のための
比較器を持つ専用回路の構成を取つていた。
Conventionally, when using a large number of sensors to detect binary information at various detection levels, a dedicated circuit with a comparator for sensitivity adjustment and binarization has to be configured for each sensor. Ta.

その理由はいくつかあるが、第1に発光、受光
素子に感度のばらつきがあり、装置内においても
相互の感度の調整を要すること、第2に2値化す
るためのスライスレベルが必ずしも同一でない点
にあり、感度調整用ボリユーム調整点を個々に有
することになる。これら調整は一つ一つ調整者が
行うことになり、必要とするセンサの個数が増す
につれ調整に手がかかること、さらには実装にお
いてもボリユームを多数用意せねばならないこと
に判なう小型化困難性とコストアツプと言う欠点
を有していた。
There are several reasons for this; first, there are variations in sensitivity between the light emitting and light receiving elements, and mutual sensitivity adjustment is required within the device; second, the slice level for binarization is not necessarily the same. It has individual volume adjustment points for sensitivity adjustment. These adjustments must be made one by one by the adjuster, and as the number of sensors required increases, the adjustment becomes more labor-intensive, and further downsizing means that a large number of volumes must be prepared for mounting. It had the drawbacks of difficulty and increased costs.

本発明の目的はこうした背景にかんがみ、個々
の光学センサについて必要とした調整を自動的に
行いうる様に改良した光学センサの補正方式を提
供することにある。
SUMMARY OF THE INVENTION In view of this background, it is an object of the present invention to provide an improved optical sensor correction method that can automatically make necessary adjustments to individual optical sensors.

この目的の達成のため本発明制御方式は発光素
子と受光素子で構成される光学センサを複数備え
該光学センサの受光出力により媒体の有無を判別
する装置において、該光学センサ対応の記憶領域
を有し、かつ該光学センサの発光素子の発光量に
対応するデータを記憶するメモリと、複数の発光
素子に接続された該発光素子を駆動するアンプと
複数の受光素子に接続され選択的に受光出力を出
力する手段と、該メモリと出力手段を選択的に制
御するタイミング制御回路とを備え、該メモリの
選択されたデータにより該発光素子を駆動し、か
つ該出力手段により選択された受光出力を出力す
ることを特徴とする。
To achieve this objective, the control method of the present invention includes a plurality of optical sensors each consisting of a light-emitting element and a light-receiving element, and a device that determines the presence or absence of a medium based on the received light output of the optical sensor, which has a storage area corresponding to the optical sensor. and a memory for storing data corresponding to the amount of light emitted from the light emitting element of the optical sensor, an amplifier connected to the plurality of light emitting elements to drive the light emitting element, and an amplifier connected to the plurality of light receiving elements to selectively output light reception. and a timing control circuit that selectively controls the memory and the output means, and drives the light emitting element according to the data selected in the memory, and outputs the light reception output selected by the output means. It is characterized by output.

本発明を以下実施例にもとづき更にくわしく説
明する。
The present invention will be explained in more detail below based on Examples.

第1図は従来例を示し、n個中i番目のセンサ
1素子に従属する可変アンプおよびコンパレータ
を示す回路図であり、図中1は受光ダイオード、
2はフオトトランジスタ、3はアンプ、4はゲイ
ン調整用ボリユーム、5はコンパレータ、6はバ
イアスダイオード、R1〜R6は抵抗を示す。な
お、受光ダイオード1とフオトトランジスタ2は
基本的な光学センサで、光学センサをn個必要と
する場合は第1図の構成がn個必要となり、n個
所の調整点がある。
FIG. 1 shows a conventional example, and is a circuit diagram showing a variable amplifier and a comparator subordinate to one element of the i-th sensor among n elements, and 1 in the figure is a photodetector diode,
2 is a phototransistor, 3 is an amplifier, 4 is a gain adjustment volume, 5 is a comparator, 6 is a bias diode, and R1 to R6 are resistors. Note that the light receiving diode 1 and the phototransistor 2 are basic optical sensors, and if n optical sensors are required, n pieces of the configuration shown in FIG. 1 are required, and there are n adjustment points.

第2図は本発明の一実施例によるセンサ制御回
路の構成図を示す。図中1・1〜1・nは第1図
に対応するn個の発光素子、2・1〜2・nは第
1図に対応するn個の受光素子で、それぞれ素子
1・1と2・1,1・2と2・2,……1・nと
2・nで、それぞれ1対のセンサからセンサ
までを表わす。またそれぞれのバイアス抵抗を同
様はR1・1〜R1・n、またR2・1〜R2・
nで表わす。
FIG. 2 shows a configuration diagram of a sensor control circuit according to an embodiment of the present invention. In the figure, 1.1 to 1.n are n light emitting elements corresponding to FIG. 1, and 2.1 to 2.n are n light receiving elements corresponding to FIG.・1, 1, 2 and 2, 2, . . . 1, n and 2, n each represent a pair of sensors. Also, the respective bias resistors are R1・1~R1・n, and R2・1~R2・
Represented by n.

7,8,R7は光源駆動回路を示し、8はアン
プ、7は駆動トランジスタ、R7はブリート抵抗
を示す。また9はD/Aコンバータ、10はゲイン
測定用の第一のメモリー、11は第一のメモリー
制御用の第1のレジスタ、12はメモリー選択用
のレジスタを示す。また13は2値化スライスレ
ベル設定用の第2のメモリー、14は第2のメモ
リー制御用の第2のレジスタ、15はセンサ〜
までの出力を変換して選択的に出力するA/Dコ
ンバータ、16はメモリー13の内容とA/Dコン
バータ15の内容を比較する比較器を示す。1
7・1から17・nまでは比較器16で比較され
た結果をそれぞれのアドレスに記憶する第3のメ
モリー17の各フリツプフロツプを示し、18は
メモリー17の内容を読み出し制御するレジスタ
を示す。なお19はこれらを制御する論理制御回
路であるMPUを示す。20は制御クロツク発振
回路、21はセンサのタイミング制御回路を示
す。
7, 8, and R7 indicate a light source drive circuit, 8 indicates an amplifier, 7 indicates a drive transistor, and R7 indicates a bleed resistor. Further, 9 is a D/A converter, 10 is a first memory for gain measurement, 11 is a first register for controlling the first memory, and 12 is a register for memory selection. Further, 13 is a second memory for setting the binarization slice level, 14 is a second register for controlling the second memory, and 15 is a sensor ~
16 is a comparator that compares the contents of the memory 13 and the contents of the A/D converter 15. 1
7.1 to 17.n indicate flip-flops of the third memory 17 that store the results of comparison by the comparator 16 at respective addresses, and 18 indicates a register for reading and controlling the contents of the memory 17. Note that 19 indicates an MPU which is a logic control circuit that controls these. 20 is a control clock oscillation circuit, and 21 is a sensor timing control circuit.

また第3図は第1のメモリー10および第2の
メモリー13のメモリー領域の区分を示す説明図
であり、センサの数n個に対してセンサのそれぞ
れにわり付けられたn個のアドレス区分を有し、
レジスタ12のアドレスにより選択され、レジス
タ11によりメモリー10の内容がレジスタ14
によりメモリ13の内容が、それぞれ対応するア
ドレスを指定してセツトできる様になつている。
FIG. 3 is an explanatory diagram showing the division of the memory areas of the first memory 10 and the second memory 13, and shows n address divisions assigned to each sensor for n sensors. have,
The contents of the memory 10 are selected by the address of the register 12, and the contents of the memory 10 are transferred to the register 14 by the register 11.
The contents of the memory 13 can be set by specifying the corresponding addresses.

こうしてそれぞれのセンサ1〜nは、センサの
いづれかに対応するアドレスに応じてメモリ10
により発光素子の駆動条件を制御され、A/Dコン
バータ15より来るセンサの対応信号はメモリー
13の対応アドレスの内容に応じて比較器16に
よつて2値化スライスのレベルが制御され、2値
化された情報はアドレスにに対応して第3のメモ
リー17に記憶され、レジスタ18により読み出
され、制御情報として使用される。
In this way, each sensor 1 to n is stored in the memory 10 according to the address corresponding to any one of the sensors.
The driving conditions of the light emitting element are controlled by the comparator 16, and the level of the binarized slice of the corresponding sensor signal coming from the A/D converter 15 is controlled by the comparator 16 according to the content of the corresponding address in the memory 13, and the signal is converted into a binary signal. The encoded information is stored in the third memory 17 in correspondence with the address, read out by the register 18, and used as control information.

つまりセンサ群1〜nを選択アドレス1〜n′に
よつて時分割的にサンプリングし、アドレスの走
査をMPU19の指令により必要な時に行なうこ
とによりセンサ群1〜nの動作情報を検出する。
なお実際の装置においては動作のモード等によつ
ては、用意された全てのセンサの動作、あるいは
用意された全てのアドレスの状態情報を必要とし
ない場合があるが、この場合、MPU19の指令
により不要部分をとばして走査することも可能で
あるし、必要サンプル間隔がアドレス間で異なる
場合も指令を変更することにより同様にして対応
可能である。
That is, the sensor groups 1 to n are time-divisionally sampled using the selected addresses 1 to n', and address scanning is performed when necessary according to instructions from the MPU 19, thereby detecting operational information of the sensor groups 1 to n.
Note that in actual equipment, depending on the operation mode, the operation of all the prepared sensors or the status information of all the prepared addresses may not be necessary. It is also possible to scan by skipping unnecessary parts, and even if the required sample interval differs between addresses, this can be handled in the same way by changing the command.

次に各センサの感度レベルの初期設定の方法に
ついて説明する。
Next, a method of initial setting the sensitivity level of each sensor will be explained.

上記の初期設定は工場における組立後の動作値
の設定、あるいは電源投入時、あるいは再調整時
の動作条件の設定として行なわれる。
The above initial setting is performed as setting of operating values after assembly at the factory, or as setting of operating conditions at power-on or readjustment.

説明の構成はメモリ10およびメモリー13は
揮発性メモリーとして説明する。なお、MPU1
9には不揮発のメモリーが内蔵されており電源
ONと共に初期ローデイングのプログラム手順を
実行する。最初に装置の電源が投入された時、メ
モリー10および13はセツトされていない。
The configuration will be explained assuming that the memory 10 and the memory 13 are volatile memories. In addition, MPU1
9 has a built-in non-volatile memory and a power supply.
Executes the initial loading program procedure with ON. When the device is first powered on, memories 10 and 13 are not set.

電源ONに伴ないレジスタ12でメモリ13の
各アドレスを選択し、レジスタ14を介して初期
設定用の電圧レベルをメモリー13の各アドレス
に書込む。
When the power is turned on, each address of the memory 13 is selected by the register 12, and a voltage level for initial setting is written to each address of the memory 13 via the register 14.

次にレジスタ12でメモリー10を選択し、レ
ジスタ11を介してメモリ10の1つのアドレス
の設定値を書き込み、更にこの設定値を時間と共
に上昇させてやる。
Next, the memory 10 is selected with the register 12, a set value of one address of the memory 10 is written through the register 11, and this set value is further increased with time.

センサータイミング制御回路21のアドレス信
号により読出されるメモリー10の各アドレスの
設定値の上昇に伴ないD/Aコンバータ9の出力は
順次上昇し、これに伴なつて発光素子1・1〜
1・nの光量が増大し、受光素子2・1〜2・n
の出力も順次上昇する。このアドレスに対応する
受光素子2・1〜2・nの出力は制御回路21に
よりA/Dコンバータ15で選択的にデイジタル化
され、比較器16により初期設定レベルに書き込
まれたメモリー13の対応アドレスの設定値と比
較される。比較器16において受光素子の出力が
設定値より大きくなる、即ち、ターンオンする
と、ターンオン情報が第3のメモリ17の相当す
るアドレスに書き込まれ、レジスタ18を介して
MPU19に読み出され、レジスタ11を介して
メモリー10の相当するアドレスにおける設定値
の上昇を停止させ、メモリー10の1つのアドレ
スの初期値が設定される。なお、センサそれぞれ
は初期設定時には媒体等でさえぎられてない白の
条件とする。
As the set value of each address of the memory 10 read out by the address signal of the sensor timing control circuit 21 increases, the output of the D/A converter 9 increases sequentially, and accordingly, the output of the D/A converter 9 increases.
The light amount of 1・n increases, and the light receiving elements 2・1 to 2・n
The output will also increase gradually. The output of the light receiving elements 2.1 to 2.n corresponding to this address is selectively digitized by the A/D converter 15 by the control circuit 21, and the corresponding address of the memory 13 is written to the initial setting level by the comparator 16. is compared with the set value. When the output of the light-receiving element becomes larger than the set value in the comparator 16, that is, when it turns on, turn-on information is written to the corresponding address of the third memory 17 and sent via the register 18.
The value is read out by the MPU 19, stops increasing the set value at the corresponding address in the memory 10 via the register 11, and sets the initial value of one address in the memory 10. Note that each sensor is initially set under a white condition that is not obstructed by a medium or the like.

同様の手順で順次センサ10の各アドレスに対
応し切期値を設定する。こうして、センサそれぞ
れの出力が全てメモリー13によつて設定された
同一の出力レベルに設定されており、駆動条件、
センサ素子間のばらつき、装置間のばらつき等が
全て個別の操作なしに自動的調整されていること
になる。
The cut-off value is set corresponding to each address of the sensor 10 one after another using the same procedure. In this way, the outputs of each sensor are all set to the same output level set by the memory 13, and the driving conditions
This means that variations between sensor elements, variations between devices, etc. are all automatically adjusted without individual operations.

次にレジスタでメモリー13を選択しし、レジ
スタ14を介してメモリー13のそれぞれのアド
レスに、それぞれのアドレスの2値化スライスレ
ベルを設定する情報を書き入れることにより初期
設定は完了する。
Next, the memory 13 is selected with the register, and information for setting the binarization slice level of each address is written into each address of the memory 13 via the register 14, thereby completing the initial setting.

なお、それぞれのアドレスのスライスレベルの
設定値は、初期設定時の白、あるいは媒体なしの
出力に比し、使用時の媒体の透過量や使用黒レベ
ルの反射率等より、あらかじめ実験的に求めたス
ライスレベルをMPU19のメモリーに用意して
おき、使用する。以上の初期設定は電源ON時あ
るいは設定レベル変更時に行なえば調整完了とな
り、あとは動作可能となる。
The slice level setting value for each address is determined experimentally in advance based on the amount of transmission of the medium during use and the reflectance of the black level used, compared to the initial setting of white or output without a medium. Prepare slice levels in the MPU 19 memory and use them. If you perform the above initial settings when the power is turned on or when changing the setting level, the adjustment will be completed and the device will be ready for operation.

なお、メモリ10およびメモリ13が不揮発性
のPAMで構成されるならば投入毎の設定は省略
できることは説明するまでもない。
It goes without saying that if the memory 10 and the memory 13 are composed of non-volatile PAM, the setting for each input can be omitted.

以上説明して来た如く本発明によれば、ポリユ
ーム等の調整素子を構成素子として持たず、かつ
調整点をハードウエアとしては無くしたことによ
り手動による調整を不要として、多数のセンサ素
子の動作点の調整と設定が自動的に行ない得るた
め、調整工数の大幅削減が可能となる。
As explained above, according to the present invention, there is no adjustment element such as a polyurethane as a component, and adjustment points are eliminated as hardware, thereby eliminating the need for manual adjustment and allowing the operation of a large number of sensor elements. Since point adjustment and setting can be performed automatically, it is possible to significantly reduce the number of adjustment steps.

また、従来は個別に用意されていたセンサ回路
を集中制御することにより、部品数と実装のため
に使用する回路面積を大幅減少させ、また設定値
をデイジタル化し、アナログ部分はD/Aおよび
A/D変換器にはさまれたセンサ群に対する入力部
と出力部のみであるため、ドリフトや経時変化に
対して非常に安定な制御回路が実現でき、設計
上、コスト上、性能上に及ぼす本発明の効果は極
めて大である。
In addition, by centrally controlling sensor circuits that were previously prepared individually, the number of components and the circuit area used for mounting can be significantly reduced. Setting values are also digitized, and analog parts are replaced by D/A and
Since there are only input and output sections for the sensor group sandwiched between the A/D converters, it is possible to create a control circuit that is extremely stable against drift and changes over time, reducing the impact on design, cost, and performance. The effects of the present invention are extremely large.

なお、センサ数n個に対してアドレス数をn個
以上用意することによつて、複数のスライス検出
レベルが必要が場合、例えば、1.媒体なしから媒
体1枚の用紙端検出と1枚検出、2.媒体なしある
いは媒体1枚と媒体2枚以上の介在を検出するダ
ブルフイート検出、 の様に同一のセンサを異なつたレベルで動作さ
せる場合、複数のスライスレベルによるレベル判
定を可能とするものであり、本発明においてアド
レスの定義と対応するアドレスの判定レベルを制
御プログラムに設定して、特定の素子のアドレス
を複数に取ることにより、極めて容易に設定でき
る。
In addition, if multiple slice detection levels are required by preparing n or more addresses for n sensors, for example, , 2. Double-feet detection that detects no medium or the presence of one medium and two or more media, which enables level judgment using multiple slice levels when the same sensor is operated at different levels, such as . In the present invention, the definition of the address and the corresponding determination level of the address are set in the control program, and by setting a plurality of addresses for a specific element, it can be set extremely easily.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は従来のセンス回路構成図、第2図は本
発明の一実施例の構成ブロツク図、第3図は第2
図中のメモリ10およびセンサ13の中に割りつ
けられたアドレス領域の説明図をそれぞれ示す。 図中1・1〜1・nはセンサ発光部、2・1〜
2・nはセンサ受光部、10および13はそれぞ
れ第1、第2のメモリ、9および15はそれぞれ
D/A,A/Dコンバータ、16は比較器、17は第
3のメモリ、19は論理制御回路MPUである。
FIG. 1 is a block diagram of a conventional sense circuit, FIG. 2 is a block diagram of an embodiment of the present invention, and FIG. 3 is a block diagram of a conventional sense circuit.
Explanatory diagrams of address areas allocated in the memory 10 and the sensor 13 in the figure are shown, respectively. In the figure, 1・1~1・n are sensor light emitting parts, 2・1~
2 and n are sensor light receiving parts, 10 and 13 are first and second memories, respectively, and 9 and 15 are respectively
A D/A, A/D converter, 16 a comparator, 17 a third memory, and 19 a logic control circuit MPU.

Claims (1)

【特許請求の範囲】[Claims] 1 発光素子と受光素子で構成される光学センサ
を複数備え、該光学センサの受光出力により媒体
の有無を判別する装置において、該光学センサ対
応の記憶領域を有し、かつ該光学センサの発光素
子の発光量に対応するデータを記憶するメモリ
と、複数の発光素子に接続され該発光素子を駆動
するアンプと、複数の受光素子に接続され選択的
に受光出力を出力する手段と、該メモリと出力手
段を選択的に制御するタイミング制御回路とを備
え、該メモリの選択されたデータにより該発光素
子を駆動し、かつ該出力手段により選択された受
光出力を出力することを特徴とする光学センサの
制御方式。
1. A device comprising a plurality of optical sensors each consisting of a light-emitting element and a light-receiving element, and determining the presence or absence of a medium based on the light-receiving output of the optical sensor, which has a storage area corresponding to the optical sensor, and has a storage area corresponding to the optical sensor; a memory for storing data corresponding to the amount of light emitted by the light emitting device; an amplifier connected to the plurality of light emitting elements to drive the light emitting elements; a means connected to the plurality of light receiving elements for selectively outputting light reception output; An optical sensor comprising: a timing control circuit that selectively controls output means; the light emitting element is driven by the selected data of the memory; and the output means outputs the selected light reception output. control method.
JP5664681A 1981-04-15 1981-04-15 Controlling system of optical sensor Granted JPS57172484A (en)

Priority Applications (1)

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JP5664681A JPS57172484A (en) 1981-04-15 1981-04-15 Controlling system of optical sensor

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Publication Number Publication Date
JPS57172484A JPS57172484A (en) 1982-10-23
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ID=13033103

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JP (1) JPS57172484A (en)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0272090A (en) * 1988-08-25 1990-03-12 Keet Seisakusho:Kk Cap screw-on apparatus

Cited By (1)

* Cited by examiner, † Cited by third party
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JPH0272090A (en) * 1988-08-25 1990-03-12 Keet Seisakusho:Kk Cap screw-on apparatus

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JPS57172484A (en) 1982-10-23

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