JPS6146671A - Area designation system - Google Patents

Area designation system

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Publication number
JPS6146671A
JPS6146671A JP59167590A JP16759084A JPS6146671A JP S6146671 A JPS6146671 A JP S6146671A JP 59167590 A JP59167590 A JP 59167590A JP 16759084 A JP16759084 A JP 16759084A JP S6146671 A JPS6146671 A JP S6146671A
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JP
Japan
Prior art keywords
output
area
original
transparent sheet
points
Prior art date
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Pending
Application number
JP59167590A
Other languages
Japanese (ja)
Inventor
Taiji Nagaoka
永岡 大治
Hiroyuki Saito
宏之 斎藤
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujifilm Business Innovation Corp
Original Assignee
Fuji Xerox Co Ltd
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Filing date
Publication date
Application filed by Fuji Xerox Co Ltd filed Critical Fuji Xerox Co Ltd
Priority to JP59167590A priority Critical patent/JPS6146671A/en
Publication of JPS6146671A publication Critical patent/JPS6146671A/en
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Abstract

PURPOSE:To attain designation of optional area simply without giving dirt on an original with less memory capacity by reading in advance a sheet on which two diagonal apexes are described to designate an optional square area on the original so as to apply area designation. CONSTITUTION:At first, on the original 1 a transparent sheet 2 of the same size is overlapped and two diagonal points P1, P2 for discriminating a square area are marked on the transparent sheet 2 by using a proper mark pen. Then only the marked transparent sheet is read to the device to store coordinates of the two points P1, P2. When the original 1 is read by the device, the coordinates of the stored points P1, P2 are read, and a different picture processing is executed from the inside and the outside of the square area designated by the two points P1, P2.

Description

【発明の詳細な説明】[Detailed description of the invention]

〔産業上の利用分野〕 この発明は原稿読取装置で読取った原稿画像について指
定した領域とその他の領域とでそれぞれ異なる画信号処
理を行なわせるための領域指定方式に関する。 〔従来の技術〕 従来この種の領域指定方式としては、 (1)座標目盛が設けられたプラテン上に原稿を載置し
、指定する領域の4頂点をテンキーによって座標指定す
るもの (2)  プラテンに沿ってX、Y方向にそれぞれ摺動
する各2個のレバーで方形領域を指定するもの (3)複数色の判別が可能な読取装置において、特定色
によって原稿上に領域指定のための境界線を記入し、該
境界線を装置に判別させることにより領域指定するもの などがあった。 〔発明が解決しようとする問題点〕 ところが、上記(1)の方式では、頂点の座標を座標目
盛から正確に判断するのが面倒であり、上記(2)の方
式ではプラテン上にレバー摺動のための機構を必要する
ため、プラテン上が煩繁になるという不都合がある。ま
た上記(3)の方式では原稿上に直接境界線を記入する
ために原稿が汚れ、さらには境界線が原稿画像に重なり
合った際には、正確な色分離ができな(なり、原稿画像
自体の読取品質を劣化させてしまうという問題点がある
。 〔問題点を解決するための手段〕 この発明では、原稿」二の任意の方形領域を指定するた
めに、該方形領域に対応したシート位置に該方形領域の
対角する2頂点を記入するための例えば透明のシートと
、該シートに記入された2頂点の各座標を検出する手段
と、該検出した2頂点の各座標を記憶するメモリと、原
稿の読取時に前記メモリに記憶した2頂点の座標を読出
すことにより該2頂点で指定される方形領域の内外でそ
れぞれ異なる画信号処理を行なわせる手段とを具える。 〔作用〕 原稿の読取開始前に、前記対角する2頂点が記入された
シートを読取ることにより該2頂点の各座標を前記メモ
リに記憶させ、この後原稿の読取時に前記メモリに記憶
した2頂点の各座標を読出すことにより指定された方形
領域を識別し、こねにより前記2頂点で指定される方形
領域の内と外とでそれぞれ異tI「ろ画信号処理を行な
わせろ。 〔実施例〕 まず、本実施例では第2図(a)に示すように読取るべ
き原稿】の上に同じ大きさの透明シート2を重ね合わせ
、該透明シート2上に指定する方形領域を判別するため
の2点P1およびP2を適宜のマークベンを用いてマー
ク′1−る。 この後、第2図(b)に示すように2点P1およびP2
が記入された透明シート2のみをまず装置に読取らせる
のであるが、装置側では該21点P1およびP2を方形
領域の対角する2頂点とl−て認識することにより該2
点で一意的に決められる方形領域を判別する。前記2点
P、およびP2の座標は装置に記憶され、この後第2図
(、)に示す原稿1が装置に読取られるときに前記記憶
した2点P1およびP2の座標が読出されることにより
、該2点P、およびP2で指定される方形領域の内と外
とでそれぞれ異なる画像処理が行なわれる。 第2図に示I−だ例では文字「E」の部分のみがそれ以
外の部分と異なる画像処理が行なわれる。 次に、第1図に前述した作用を具現するための装置構成
例を示す。この装置は、透明シート2により指定l〜た
方形領域に対応する原稿領域の画像のみを部分的に消去
できるディジタル複写機を示すものである。 第1図において、光源3から発せられた光はプラテン4
−ヒの原稿1または透明シート2に照射され、その反射
光はミラー5、レンズ6を介してイメージセンサ7に入
力される。イメージセンサ7は例えばCCD形などの固
体撮像素子により構成されるラインセンサであり、入力
された1画素ごとに対応する光信号を電気信号に変換す
る。イメージセンサ7の出力はAカ変換器8に入力され
、ここで黒または白の1ビツトの2値データに変換され
る。A/D変換器8の出力はシフトレジスタ9およびア
ンド回路10に入力されている。 シフトレジスタ9は所定個数の7リツプフロツプにより
構成される直列入力並列出力のものであり、その並列出
力は全てアンド回路11に入力されている。これらシフ
トレジスタ9およびアンド回路11の構成により透明シ
ート2に記入された点と雑音やゴミなどとを区別させる
。すなわち、アンド回路11の出力はシフトレジスタ9
の並列出力が全て論理レベルで11」にならないと論理
レベル「1」として出力されないために、主走査方向に
黒画素がシフトレジスタ90ビツト数だけ連続したとき
のみにアンド回路11から論理レベル「1」の信号が出
力される。 アンド回路】1の出力はアンド回路12の一方の入力端
子およびインヒビット回路13に加えられる。アンド回
路12の他方の入力端子にはインバータ14を介してイ
ンヒビット回路13の出力が加えられている。インヒビ
ット回路13には、主走査線が1つ進む度に1パルスが
出力されるラインクロック信号φ1が入力されており、
インヒビット回路13はアンド回路11から論理レベル
「1」の信号が入力されると、該入力された時点以降の
ラインクロック信号φ1のカウントを開始するとともに
第1番目のラインクロック信号φ、が入力された時点で
その出力を論理レベル「1」に立上げる。該論理レベル
「1」の出力は上記信号φ、のカウント値が所定値に達
するまで保持されており、このためアンド回路11の出
力はインバータ14を介してインヒビット回路13の出
力により−H論理レベル「1」の信号を出力した後の次
ラインの走査開始時点から所定数ラインの走査の間イン
ヒビットされるようになっている。これは同じ点を異な
る座標として複数回検出するのを防止するためである。 次に、アンド回路12の出力はフリップフロップ15の
クロック端子CPに入力されている。フリップフロップ
15はトグル形の構成をとっており、クロック端子CP
に論理レベル「1」の信号が入力される度にその出力Q
、Qがそれぞれ反転する謂ゆるバイナリ動作を行なう。 すなわち、前述の構成により第1の指定点P、が検出さ
れたときはフリップフロップ15の出力Qが「1」かつ
Qが「0」となり、また第2の指定点P、が検出された
ときはQが10」かつQが「1」と端子に入力されてい
る4 次に、主走査アドレスカウンタ20には画素ごとの読取
りに同期したビデオクロックφ、が入力されており、主
走査アドレスカウンタ20は該ビデオクロックφ、に同
期して+1力ウント動作を1主走査線の画素数分サイク
リックに行なうことにより主走食方向のアドレスをスタ
ートアドレスレジスタ16およびエンドアドレスレジス
タ18に出力する。 副走査アドレスカウンタ21には、ラインクロックφ1
が入力されており、副走査アドレスカウンタ21は該ラ
インクロックφ、に同期して+1力ウント動作を行なう
ことにより副走査方向のアドレスをスタートアドレスレ
ジスタ17およびエンドアドレスレジスタ19に出力す
る。 すなわち、スタートアドレスレジスタ16および17は
フリップフロップ15のQ出力が立上がったときの主走
査アドレスカウンタ20および副走査アドレスカウンタ
21の各カウント出力をそれぞれ取込むことにより第1
の指定点の座標を記憶し、またエンドアドレスレジスタ
18および19はフリップフロップ15のQ出力が立上
がったときの主走査アドレスカウンタ20および副走査
アドレスカウンタ21の各カウント出力をそれぞれ取込
むことにより第2の指定点の座標を記憶する。 次に、マルチプレクサ22はフリップフロップ26の出
力によりスタートアドレスレジスタ16およびエンドア
ドレスレジスタ18のうちのいずれかを選択してコンパ
レータ24に出力する。この場合フリップフロップ26
の出力が「0」のときにスタートアドレスレジスタ16
の出力を選択し、フリップフロップ26の出力が「1」
のときにエンドアドレスレジスタ18の出力を選択する
とする。 同様にマルチプレクサ23はフリップフロップ27の出
力によりスタートアドレスレジスタ17およびエンドア
ドレスレジスタ18のうちのいずれかを選択してコンパ
レータ25に出力する。 コンパレータ24は前記マルチプレクサ22の出力と主
走査アドレスカウンタ20の出力とを比較し、該比較出
力が一致したときに「1」を出力スル、コンパレータ2
5も同様であり前記スル  ′チプレクサ23の出力と
副走査アドレスカウンタ21の出力とを比較し、該比較
出力が一致したときに「1」を出力する。 フリップフロップ26および27はそれぞれコンパレー
タ24および25の出力によってバイナリ動作を行なう
ものであり、その各出力はコンパレータ24および25
からそれぞれ第1番目の「1」出力が入力されたときに
11」に立上がり第2番目の「1」出力が入力されたと
きに「0」に立下がるようになっている。 すなわち、マルチプレクサ22、コンパレータ24、フ
リップフロップ26の構成により主走査方向の領域が識
別され、マルチプレクサ23、コンパレータ25、フリ
ップフロップ27の構成により副走査方向の領域が識別
されるようになっている。 フリップフロップ26および27の出力はナンド回路2
8に入力され、ナンド回路28の出力はアンド回路10
によりA/l)変換器8の出力と論理積がとられた後、
出力される。 かかる構成例において、オペレータはまず、第2図(3
)に示したように原稿1の上に透明シート2を重ね合わ
せ、透明シート2上に所定の方形領域を判別させるため
の対角する2頂点P0およびP、を適宜記入する。 次に、第2図(b)に示したように、2頂点P1および
P、2が記入された透明シート2のみをプラテン4上の
所定位置に載置して該透明シート2の読取りを開始する
。該透明シート2の画像はイメージセンサ7により読取
られ、A/l)変換器8で黒か白かの2値データに変換
されて、順次シフトレジスタ9に入力される。 この後、第1の指定点P、に対応するデータがシフトレ
ジスタ9に入力され、シフトレジスタ9の並列出力が全
て「1」になった時点で初めてアンド回路11の出力が
11」となり、アンド回路12を介してフリップフロッ
プ15のQ出力が立上がる。これにより、この時点にお
ける主走査アドレスカウンタ20および副走査アドレス
カウンタ21の各カウント出力がスタートアドレスレジ
スタ16および17にそれぞれ取込まれる。 この後、所定数ラインの読取りの間、アンド回路11の
出力が再び「1」になったとしても、インヒビット回路
13により該出力はインヒビットされるために、該点P
1に起因して71Jツブフロツプ15が再び動作するこ
とはない。 同様にして、第2の指定点P2がシフトレジスタ9およ
びアンド回路11により検出され、該検出時点でフリッ
プフロップ15のQ出力が立上がることにより該検出時
点における主走査アドレスカウンタ20および副走査ア
ドレスカウンタ21の各カウント出力がエンドアドレス
レジスタ18および19にそれぞれ取込まれ
[Industrial Application Field] The present invention relates to an area specifying method for performing different image signal processing on a specified area and other areas of a document image read by a document reading device. [Prior Art] Conventionally, this type of area specification method includes: (1) A document is placed on a platen provided with a coordinate scale, and the coordinates of the four vertices of the specified area are specified using a numeric keypad.(2) Platen (3) In a reading device capable of distinguishing multiple colors, a boundary for specifying an area on a document using a specific color is used. There was a method for specifying an area by drawing a line and having the device determine the boundary line. [Problems to be Solved by the Invention] However, in the method (1) above, it is troublesome to accurately determine the coordinates of the vertex from the coordinate scale, and in the method (2) above, the lever slides on the platen. Since a mechanism for this is required, there is an inconvenience that the space on the platen becomes complicated. In addition, in method (3) above, since the border line is written directly on the document, if the document gets dirty and the border line overlaps the document image, accurate color separation may not be possible (or the document image itself There is a problem that the reading quality of the document is deteriorated. [Means for solving the problem] In the present invention, in order to specify an arbitrary rectangular area of the document, the sheet position corresponding to the rectangular area is set. For example, a transparent sheet for writing two diagonal vertices of the rectangular area, means for detecting the coordinates of the two vertices written on the sheet, and a memory for storing the coordinates of the two detected vertices. and means for reading out the coordinates of the two vertices stored in the memory when reading the original, thereby performing different image signal processing inside and outside a rectangular area specified by the two vertices. [Operation] Original Before starting to read the sheet, each coordinate of the two diagonal vertices is stored in the memory by reading the sheet on which the two diagonal vertices are written, and after that, when reading the document, each coordinate of the two vertices stored in the memory is stored in the memory. The specified rectangular area is identified by reading out the square area, and different tI filter image signal processing is performed inside and outside the rectangular area specified by the two vertices by kneading. In the embodiment, as shown in FIG. 2(a), a transparent sheet 2 of the same size is superimposed on the document to be read, and two points P1 and P1 are placed on the transparent sheet 2 to determine the designated rectangular area. Mark P2 using an appropriate marking tool. After this, mark the two points P1 and P2 as shown in Figure 2(b).
The device first reads only the transparent sheet 2 on which is written, but the device recognizes the 21 points P1 and P2 as two diagonal vertices of a rectangular area, and reads the 21 points P1 and P2.
Determine a rectangular area uniquely determined by points. The coordinates of the two points P and P2 are stored in the device, and when the document 1 shown in FIG. , the two points P, and different image processing is performed inside and outside the rectangular area specified by P2. In the example shown in FIG. 2, only the portion of the letter "E" undergoes image processing that is different from that of the other portions. Next, FIG. 1 shows an example of a device configuration for realizing the above-described effect. This device is a digital copying machine that is capable of partially erasing only the image of an original document area corresponding to a rectangular area specified by a transparent sheet 2. In FIG. 1, the light emitted from the light source 3 is transmitted to the platen 4.
- The reflected light is irradiated onto the original document 1 or the transparent sheet 2, and the reflected light is input to the image sensor 7 via the mirror 5 and lens 6. The image sensor 7 is a line sensor composed of a solid-state image pickup device such as a CCD type, and converts an optical signal corresponding to each input pixel into an electrical signal. The output of the image sensor 7 is input to an A converter 8, where it is converted into 1-bit binary data of black or white. The output of the A/D converter 8 is input to a shift register 9 and an AND circuit 10. The shift register 9 is a serial input/parallel output type composed of a predetermined number of seven lip-flops, and all of the parallel outputs are input to an AND circuit 11. The configuration of the shift register 9 and the AND circuit 11 allows points written on the transparent sheet 2 to be distinguished from noise, dust, and the like. That is, the output of the AND circuit 11 is sent to the shift register 9.
Logic level ``1'' is not output unless all the parallel outputs of the logic level ``11'' are reached. " signal is output. The output of AND circuit 1 is applied to one input terminal of AND circuit 12 and to inhibit circuit 13. The output of the inhibit circuit 13 is applied to the other input terminal of the AND circuit 12 via an inverter 14. The inhibit circuit 13 is inputted with a line clock signal φ1 that outputs one pulse each time the main scanning line advances by one.
When the inhibit circuit 13 receives a signal of logic level "1" from the AND circuit 11, it starts counting the line clock signal φ1 after the input, and also receives the first line clock signal φ. At that point, the output is raised to logic level "1". The output of the logic level "1" is held until the count value of the signal φ reaches a predetermined value, and therefore the output of the AND circuit 11 is changed to the -H logic level by the output of the inhibit circuit 13 via the inverter 14. The signal is inhibited for a predetermined number of lines from the start of scanning of the next line after outputting the signal "1". This is to prevent the same point from being detected multiple times with different coordinates. Next, the output of the AND circuit 12 is input to the clock terminal CP of the flip-flop 15. The flip-flop 15 has a toggle type configuration, and has a clock terminal CP.
Whenever a signal of logic level "1" is input to the output Q
, Q are respectively inverted, so-called binary operation is performed. That is, when the first designated point P is detected by the above-described configuration, the output Q of the flip-flop 15 becomes "1" and Q is "0", and when the second designated point P is detected, "Q is 10" and Q is "1" are input to the terminals. Next, a video clock φ synchronized with the reading of each pixel is input to the main scanning address counter 20. 20 outputs an address in the main scanning direction to the start address register 16 and the end address register 18 by cyclically performing a +1 power count operation for the number of pixels of one main scanning line in synchronization with the video clock φ. The sub-scanning address counter 21 has a line clock φ1.
is input, and the sub-scanning address counter 21 outputs an address in the sub-scanning direction to the start address register 17 and the end address register 19 by performing a +1 count operation in synchronization with the line clock φ. That is, the start address registers 16 and 17 receive the count outputs of the main scanning address counter 20 and the sub-scanning address counter 21 when the Q output of the flip-flop 15 rises, thereby starting the first address register.
The end address registers 18 and 19 capture the count outputs of the main scanning address counter 20 and the sub scanning address counter 21 when the Q output of the flip-flop 15 rises. Store the coordinates of the second designated point. Next, multiplexer 22 selects either start address register 16 or end address register 18 based on the output of flip-flop 26 and outputs it to comparator 24 . In this case flip-flop 26
When the output of the start address register 16 is "0",
selects the output of the flip-flop 26, and the output of the flip-flop 26 is "1".
Suppose that the output of the end address register 18 is selected when . Similarly, multiplexer 23 selects either start address register 17 or end address register 18 based on the output of flip-flop 27 and outputs it to comparator 25 . The comparator 24 compares the output of the multiplexer 22 and the output of the main scanning address counter 20, and outputs "1" when the comparison outputs match.
5 also compares the output of the multiplexer 23 and the output of the sub-scanning address counter 21, and outputs "1" when the comparison outputs match. Flip-flops 26 and 27 perform binary operations based on the outputs of comparators 24 and 25, respectively;
When the first "1" output is inputted, the output signal rises to "11" and when the second "1" output is inputted, the output signal falls to "0". That is, the area in the main scanning direction is identified by the configuration of the multiplexer 22, comparator 24, and flip-flop 26, and the area in the sub-scanning direction is identified by the configuration of the multiplexer 23, comparator 25, and flip-flop 27. The outputs of flip-flops 26 and 27 are NAND circuit 2
8, and the output of the NAND circuit 28 is input to the AND circuit 10.
A/l) After being ANDed with the output of converter 8,
Output. In such a configuration example, the operator first starts by referring to FIG.
), the transparent sheet 2 is placed on top of the original 1, and two diagonal vertices P0 and P for identifying a predetermined rectangular area are appropriately written on the transparent sheet 2. Next, as shown in FIG. 2(b), only the transparent sheet 2 on which the two vertices P1, P, and 2 are written is placed at a predetermined position on the platen 4, and reading of the transparent sheet 2 is started. do. The image on the transparent sheet 2 is read by an image sensor 7, converted into black or white binary data by an A/l) converter 8, and sequentially input to a shift register 9. After that, the data corresponding to the first specified point P is input to the shift register 9, and when all the parallel outputs of the shift register 9 become "1", the output of the AND circuit 11 becomes "11", and the AND circuit 11 becomes "11". The Q output of the flip-flop 15 rises via the circuit 12. As a result, the count outputs of the main scanning address counter 20 and the sub-scanning address counter 21 at this point are taken into the start address registers 16 and 17, respectively. After that, even if the output of the AND circuit 11 becomes "1" again during reading of a predetermined number of lines, the output is inhibited by the inhibit circuit 13, so that the point P
1, the 71J block flop 15 will not operate again. Similarly, the second specified point P2 is detected by the shift register 9 and the AND circuit 11, and the Q output of the flip-flop 15 rises at the detection point, thereby increasing the main scanning address counter 20 and the sub-scanning address at the detection point. Each count output of the counter 21 is taken into the end address registers 18 and 19, respectively.

【記憶され
る。 なお、該透明シート2の読取りの際には、アンドケート
10、マルチプレクサ22.23 、コンパレータ24
 、25、フリップフロップ26 、27などの構成部
分は非動作であり、前記指定点P1およびP、の判別処
理に悪影響を及ぼさないようになっている。 次に、オペレータはプラテン4上に第2図(C)に示し
た原稿1を載置して装置を動作させることにより透明シ
ート2で指定した領域に対応する画像の消去処理を実行
する。 この処理の間、フリップフロップ15はクリア信号CL
Hによりクリアされており、該フリップフロップ15の
出力QまたはQによりスタートアドレスレジスタ16お
よび】7、エンドアドレスレジスタ18および19が動
作して記憶内容が更新されることはない。 原稿1の画像はイメージセンサ7によって読取られ、A
10変換器8で2値データに変換された後、順次アンド
回路10に出力される。 まず、主走査方向にのみ注目すると、フリップフロップ
26の出力は初期状態のときは「0」であるため、マル
チプレクサ22は初めにスタートアドレスレジスタ16
に記憶している第1の指定点P、の主走査方向アドレス
を選択し、該選択したアドレスをコンパレータ24に加
える。コンパレータ24は該第1の指定点P、の主走査
方向アドレスと主走査アドレスカウンタ200カウント
出力とを比較し、これらが−到した時点で「1」を出力
することによりフリップフロップ26の出力を「1」に
立上げる。該フリップフロップ26の出力の立上がりに
よりマルチプレクサ22は入力を切換え、今度はエンド
アドレスレジスタ18に記憶している第2の指定点P、
の主走査方向アドレスをコンパレータ24に加える。コ
ンパレータ24は前記同様にして該第2の指定点P、の
主走査方向アドレスと主走査アドレスカウンタ20のカ
ウント出力とを比較し、これらが一致した時点で再び「
1」を出力することにより、「1」状態を維持している
フリップフロップ26の出力を「0」に立下げる。これ
により、マルチプレクサ22は再びスタートアドレスレ
ジスタ16側を選択し、以後このような動作が各主走査
線の読取りの度に繰返して行なわれる。すなわち、フリ
ップフロップ26からは第3図に左下がりのハツチング
で示した原稿領域が読取られるときに11」となり、そ
れ以外の領域では「0」となるような信号が出力され、
指定点P1およびP、により指定される主走査方向の領
域を区別することができる。 次に、副走査方向の指定領域の判別であるが、これはス
タートアドレスレジスタ17、エンドアドレス、レジス
タ19、マルチプレクサ23、コンパレータ25、主走
査アドレスカウンタ20、副走査アドレスカウンタ21
およびフリップフロップ27の構成によって前記同様に
して判別処理され、フリップフロップ27からは第3図
に右下がりのハツチングで示した原稿領域が読取られる
ときに「1」となり、それ以外の領域では「0」となる
ような信号が出力され、指定点P1およびP2により指
定される副走査方向の領域を区別することができる。 上記フリップ70ツブ26および27の出力はナンド回
路28に入力されることにより、ナンド回路28からは
第3図にクロスハツチングで示される領域以外のときに
論理レベル「1」の信号が出力され、クロスハツチング
で示される領域のときは論理レベル「0」の信号が出方
される。 したがって、原稿1の画像が読取られる際、アンド回路
10の出力は第3図にクロスハツチングで示された領域
のときは全て「o」となり、対角する2頂点P1および
P、で指定された領域が消去されることになる。 このように、本実施例によれば、オペレータは原稿1に
透明シート2を重ね合わせ、透明シート2上に所定の対
角する2頂点を記入し、この後原稿の読取開始前に該2
頂点が記入された透明シート2を装置に読取らせるだけ
で、原稿読取時の領域指定が可能となることから、少な
いメモリ容量で、原稿を汚すことのない簡便な領域指定
をなし得るようになる。 なお、上記実施例では、指定した原稿領域の画像を消去
処理するようにしたが、本発明が適用できる画信号処理
としてはこれに限らず、例えば指定領域の画像の抽出で
あってもよいし、また指定した領域とその他の領域とで
中間調再現のための階調数、拡大率、縮小率、MTF補
正に用いるフィルタ係数、ディジタル処理の閾値レベル
などを異ならせるようにしてもよい。 また、上記実施例では、透明シート2上に1組の対角す
る点を記入して1つの方形領域のみを指定するようにし
たが、複数組の対角する点を記入することにより複数の
異なる方形領域が指定できるように装置を構成するよう
にしてもよい。この場合、スタートアドレスレジスタ1
6.17およびエンドアドレスレジスタ18および19
などを複数組設け、例えば第1番目に検出した点と第2
番目に検出した点とにより形成される方形領域を第1の
領域とし、また第3番目に検出した点と第4番目に検出
した点とにより形成される領域を第2の領域、・・・・
・・とするようにすれば実現化は容易である。 さらに、本発明で用いるシートは透明なものが実用上便
利であるのは勿論であるが、適宜の座標目盛が予め印刷
された不透明のシートを用い、該座標目盛上に方形領域
の対角する2頂点を記入するようにしてもよい。 〔発明の効果〕 以上説明したように、この発明によれば、方形領域を指
定するための対角する2頂点が記入されたシートを装置
に予め読取らせることにより領域指定を行なうようにし
たことから、少ないメモリ容量で原稿を汚すことなく簡
便に任意の方形領域を指定することができるようになる
[Remembered. In addition, when reading the transparent sheet 2, the AND Kate 10, the multiplexer 22, 23, the comparator 24
, 25 and flip-flops 26 and 27 are inactive, so as not to adversely affect the determination process of the specified points P1 and P. Next, the operator places the original 1 shown in FIG. 2(C) on the platen 4 and operates the apparatus to erase the image corresponding to the area specified on the transparent sheet 2. During this process, the flip-flop 15 outputs a clear signal CL.
It is cleared by H, and the output Q or Q of the flip-flop 15 does not operate the start address register 16 and ]7 and the end address registers 18 and 19 to update the stored contents. The image of the original 1 is read by the image sensor 7, and
After being converted into binary data by a 10 converter 8, the data is sequentially output to an AND circuit 10. First, focusing only on the main scanning direction, since the output of the flip-flop 26 is "0" in the initial state, the multiplexer 22 initially outputs the start address register 16.
The main scanning direction address of the first designated point P stored in is selected, and the selected address is added to the comparator 24. The comparator 24 compares the main scanning direction address of the first specified point P with the main scanning address counter 200 count output, and outputs "1" when these two reach -, thereby changing the output of the flip-flop 26. Raise it to "1". As the output of the flip-flop 26 rises, the multiplexer 22 switches the input, and this time the input is changed to the second specified point P stored in the end address register 18.
The main scanning direction address is added to the comparator 24. The comparator 24 compares the main scanning direction address of the second specified point P with the count output of the main scanning address counter 20 in the same manner as described above, and when they match, it returns to "
By outputting ``1'', the output of the flip-flop 26, which maintains the ``1'' state, falls to ``0''. As a result, the multiplexer 22 selects the start address register 16 side again, and thereafter, such an operation is repeated every time each main scanning line is read. In other words, the flip-flop 26 outputs a signal that becomes "11" when the document area indicated by the hatching on the lower left in FIG. 3 is read, and becomes "0" in other areas.
The area in the main scanning direction specified by the specified points P1 and P can be distinguished. Next, the specified area in the sub-scanning direction is determined.
According to the structure of the flip-flop 27, the discrimination process is performed in the same manner as described above, and the flip-flop 27 reads "1" when the document area indicated by the downward hatching in FIG. ” is output, and the area in the sub-scanning direction specified by the specified points P1 and P2 can be distinguished. The outputs of the flip 70 knobs 26 and 27 are input to the NAND circuit 28, so that the NAND circuit 28 outputs a signal of logic level "1" outside the area shown by crosshatching in FIG. , a signal of logic level "0" is output in the area shown by cross hatching. Therefore, when the image of the document 1 is read, the output of the AND circuit 10 is all "o" in the area shown by crosshatching in FIG. The area that was created will be erased. As described above, according to this embodiment, the operator overlays the transparent sheet 2 on the original 1, writes two predetermined diagonal vertices on the transparent sheet 2, and then writes the two diagonal vertices on the transparent sheet 2 before starting to read the original.
By simply having the device read the transparent sheet 2 on which the vertices have been written, it is possible to specify an area when reading a document, making it possible to easily specify an area without smearing the document with a small memory capacity. Become. In the above embodiment, the image in the specified document area is erased, but the image signal processing to which the present invention can be applied is not limited to this. For example, the image signal processing in the specified area may be extracted. Furthermore, the number of gradations for halftone reproduction, the enlargement rate, the reduction rate, the filter coefficient used for MTF correction, the threshold level of digital processing, etc. may be made different between the specified area and other areas. Furthermore, in the above embodiment, one set of diagonal points is written on the transparent sheet 2 to designate only one rectangular area, but by writing multiple sets of diagonal points, multiple square areas can be specified. The device may be configured so that different rectangular areas can be specified. In this case, start address register 1
6.17 and end address registers 18 and 19
For example, the first detected point and the second
The rectangular area formed by the third detected point is defined as the first area, and the area formed by the third detected point and the fourth detected point is defined as the second area, etc.・
It is easy to realize this by doing... Furthermore, although it is of course practical to use a transparent sheet as the sheet used in the present invention, an opaque sheet on which an appropriate coordinate scale is printed in advance is used, and diagonal corners of a rectangular area are printed on the coordinate scale. Two vertices may be entered. [Effects of the Invention] As explained above, according to the present invention, the area is specified by having the device read in advance a sheet on which two diagonal vertices for specifying a rectangular area are written. Therefore, it becomes possible to easily specify an arbitrary rectangular area with a small memory capacity and without staining the original.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図はこの発明の一実施例構成を示すブロック図、第
2図および第3図はそれぞれこの発明の一実施例態様を
説明するための図である。 1・・・原稿、2・・・透明シート、3・・・光源、4
・・・プラテン、5・・・ミラー、6・・・レンズ、7
・・・イメ−ジセンサ、8・・・A/1)変換器、9・
・・シフトレジスタ、10.11.12・・・アンド回
路、13・・・インヒビット回路、14・・・インバー
タ、  15,26,27・・・フリップフロップ、1
6.17・・・スタートアドレスレジスタ、18.19
・・・エンドアドレスレジスタ、20・・・主走査アド
レスカウンタ、21・・・副走査アドレスカウンタ、2
2.23・・・マルチプレクサ、24.25・・・コン
パレータ、28・・・ナンド回路。 第2図 第3図 (b) (C)
FIG. 1 is a block diagram showing the configuration of an embodiment of the present invention, and FIGS. 2 and 3 are diagrams for explaining aspects of the embodiment of the invention, respectively. 1... Original, 2... Transparent sheet, 3... Light source, 4
...Platen, 5...Mirror, 6...Lens, 7
...Image sensor, 8...A/1) converter, 9.
...Shift register, 10.11.12...AND circuit, 13...Inhibit circuit, 14...Inverter, 15,26,27...Flip-flop, 1
6.17...Start address register, 18.19
...End address register, 20...Main scanning address counter, 21...Sub-scanning address counter, 2
2.23... Multiplexer, 24.25... Comparator, 28... NAND circuit. Figure 2 Figure 3 (b) (C)

Claims (1)

【特許請求の範囲】[Claims] 原稿の読取開始前に、所定の方形領域の対角する2頂点
が記入されたシートを読取ることにより該対角する2頂
点の各座標を所定のメモリに記憶し、その後、原稿の読
取時に前記メモリに記憶した前記2頂点の座標を読出す
ことにより原稿の読取データを前記指定された方形領域
の内と外とで別々の処理を行なうようにしたことを特徴
とする領域指定方式。
Before starting to read the original, each coordinate of the two diagonal vertices of a predetermined rectangular area is stored in a predetermined memory by reading a sheet in which two diagonal vertices of a predetermined rectangular area are written. An area specifying method characterized in that by reading the coordinates of the two vertices stored in a memory, the read data of the original is processed separately inside and outside the specified rectangular area.
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Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62298886A (en) * 1986-06-18 1987-12-25 Nec Corp Destination information reader
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JPS63260265A (en) * 1987-04-16 1988-10-27 Fuji Xerox Co Ltd Color picture processing method
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