JPS61311U - Ｐｌｌによる変調回路 - Google Patents

Ｐｌｌによる変調回路

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Publication number
JPS61311U
JPS61311U JP8326884U JP8326884U JPS61311U JP S61311 U JPS61311 U JP S61311U JP 8326884 U JP8326884 U JP 8326884U JP 8326884 U JP8326884 U JP 8326884U JP S61311 U JPS61311 U JP S61311U
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JP
Japan
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circuit
pll
utility
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modulation
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Pending
Application number
JP8326884U
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English (en)
Inventor
健司 伊藤
Original Assignee
株式会社富士通ゼネラル
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Publication date
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  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は本考案によるＰＬＬ回路による変調回路の一実
施例を示すブロック図、第２図は積分回路の具体的電気
回路図、第３図は積分回路の他の例の電気回路図、第４
図は従来の回路のブロック図、第５図は従来の回路の他
の例のブロック図である。 １，１１・・・基準信号発振回路、２，１２・・・位相
比較回路、３．１３・・・ループフィルタ回路、４，１
４・・・ＶＣ０． ５・・−ミクサ回路、６，１５・・
・分周回路、７，１７・・・変調信号入力端子、８，１
６・・・出力端子、９・・・局部発振信号入力端子、１
０，１８・・・積分回路、１９・・一制御回路、２ ０
＝２ ３・・・レンジデータ入力端子、２４〜２７・・
・スイッチング回路。

Claims (4)

    【実用新案登録請求の範囲】
  1. （１）基準信号発振回路、位相比較回路、ループフィル
    タ回路、ＶＣＯおよび分周回路を具備したＰＬＬ回路に
    おいて、変調信号入力端子を、該■ＣＯには直接結合し
    、該ループフィルタ回路には該分周向路の分周数の変化
    に対応して積分時定数を制御可能な積分回路を介して結
    合、してなることを特徴とするＰ比による変調回路。
  2. （２）実用新案登録請求の範囲第１項記載において、積
    分回路は、積分可変素子に２ｎの重みをもたせ、レンジ
    データにより可変するようにしたＰＬＬによる変調回路
    。
  3. （３）実用新案登録請求の範囲第２項記載において、積
    分可変素子は容量値が順次２ｎの複数のコンデンサを並
    列に結合してなるＰＬＬによる凌調回路。
  4. （４）実用新案登録請求の範囲第２項記載において、積
    分可変素子は抵抗値が順次２゜め複数の抵抗を直列に結
    合してなるＰＬＬによる変調回路。
JP8326884U 1984-06-05 1984-06-05 Ｐｌｌによる変調回路 Pending JPS61311U (ja)

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