JPS61242450A - Power supply circuit of telephone set speech circuit - Google Patents
Power supply circuit of telephone set speech circuitInfo
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- JPS61242450A JPS61242450A JP8491085A JP8491085A JPS61242450A JP S61242450 A JPS61242450 A JP S61242450A JP 8491085 A JP8491085 A JP 8491085A JP 8491085 A JP8491085 A JP 8491085A JP S61242450 A JPS61242450 A JP S61242450A
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Abstract
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、半導体基板内に容易に集積化するこ ゛
とのできる電話機通話回路の電源回路に関するも
・のである。DETAILED DESCRIPTION OF THE INVENTION Field of the Invention The present invention relates to a power supply circuit for a telephone communication circuit that can be easily integrated into a semiconductor substrate.
・It is.
従来の技術
電話機の簡略化した構成を第4図に示す。第4図におい
て、1は電話局、2は通話回路、3〜5は線路、6はダ
イオードブリッジ、(PL)(Pl)は電話機の入出力
端子、(P、)は通話回路2の入力端子、(P、)は通
話回路2の共通端子である。電話機の入出力端子(p
z ) (p x )は、線路3を通って電話局1に接
続される。電話機の入出力端子(Pl)(Pl)間には
、電話局1から線路3を通して直流電圧と受話信号とが
送られ、また電話機から線路3を通して送話信号を送る
ことにより、直流電圧に音声信号が重畳された電圧が印
加される。音声信号をυL″sinωtと仮定すると、
入出力端子(Pl)(Pl)間には直流電圧VL′に交
流信号υL’ sinωtが重畳された電圧が印加され
、直流電流ILに交流電流i1.sinωtが重畳され
た電流が流入する。通話回路2の端子(P、)(Pl)
間にはダイオードブリッジ6の電圧降下を差し引いたV
L+υtsinωtが印加される。A simplified configuration of a prior art telephone is shown in FIG. In Fig. 4, 1 is the telephone office, 2 is the communication circuit, 3 to 5 are the lines, 6 is the diode bridge, (PL) (Pl) are the input/output terminals of the telephone, and (P, ) are the input terminals of the communication circuit 2. , (P,) are common terminals of the communication circuit 2. Telephone input/output terminal (p
z ) (p x ) is connected to the central office 1 through line 3 . Between the input and output terminals (Pl) (Pl) of the telephone, a direct current voltage and a receiving signal are sent from the telephone office 1 through the line 3, and a transmitting signal is sent from the telephone through the line 3, so that the direct current voltage and the voice signal are sent. A voltage with a superimposed signal is applied. Assuming that the audio signal is υL″sinωt,
A voltage in which an AC signal υL' sinωt is superimposed on a DC voltage VL' is applied between the input and output terminals (Pl), and an AC current i1. A current on which sinωt is superimposed flows. Terminals (P, ) (Pl) of communication circuit 2
In between is V, which is the voltage drop of the diode bridge 6.
L+υtsinωt is applied.
第5図に電話機に要求される直流特性を示す。Figure 5 shows the DC characteristics required for a telephone.
線路電流ILは線路の抵抗等の条件により、20+s
A〜100mAの範囲で変化する。−例をあげると、日
本電信電話公社公示第149号第18条によると、電話
機の直流抵抗は50Ω以上220Ω以下と規定されてい
る。この範囲を第5図に破線7,8で示した。The line current IL is 20+s depending on conditions such as line resistance.
It varies in the range of A to 100mA. - For example, according to Article 18 of Nippon Telegraph and Telephone Corporation Public Notice No. 149, the direct current resistance of a telephone is defined as 50Ω or more and 220Ω or less. This range is indicated by broken lines 7 and 8 in FIG.
ダイオードブリッジ6の電圧降下を1.4vとして、通
話回路2に許容されるVL−ILの範囲が実線9゜10
で囲まれている領域である。この領域に入る通話回路2
の直流特性VL−Itの1つの従来例を実線11で示し
た。Assuming that the voltage drop of the diode bridge 6 is 1.4V, the range of VL-IL allowed for the communication circuit 2 is shown by the solid line 9°10
This is the area surrounded by. Call circuit 2 that falls into this area
One conventional example of the DC characteristic VL-It is shown by a solid line 11.
また、日本電信電話公社公示第149号第19条による
と、電話機の特性インピーダンスは600Ωと規定され
ている。この特性インピーダンスを実現するために1通
話回路2尼並列にその他の回路が接続されることを配慮
して1通話回路2の特性インピーダンスVL/itは2
にΩ以上であることが望ましい。Furthermore, according to Article 19 of Nippon Telegraph and Telephone Public Corporation Public Notice No. 149, the characteristic impedance of a telephone is defined as 600Ω. In order to realize this characteristic impedance, the characteristic impedance VL/it of 1 communication circuit 2 is set to 2, considering that other circuits are connected in parallel with 1 communication circuit 2.
It is desirable that the resistance is Ω or more.
次に、音声送話信号及びDTMF(Dual Tone
MultiFrequency)信号の送出レベルを
配慮して、υP≧3vpP、THD(歪率)≦3%を満
たすことが必要である。Next, a voice transmission signal and DTMF (Dual Tone
It is necessary to satisfy υP≧3vpP and THD (distortion rate)≦3%, taking into consideration the transmission level of the MultiFrequency signal.
第5図によルトIL=20111A(7)ときOV<V
L≦3vと規定されているが、上記のvLの送出レベル
を確保するためにはvLが高いことが望ましく、一般的
1c I t、= 20mA (7)ときV L=
2 、7 V 〜3 Vに設定される。以下では、IL
=20111A(7)ときV t、 :3 Vとして説
明する。According to FIG. 5, when IL=20111A(7), OV<V
Although it is specified that L≦3v, it is desirable that vL be high in order to secure the above-mentioned vL sending level, and generally 1c I t, = 20 mA (7) When V L =
It is set at 2,7 V to 3 V. In the following, IL
=20111A(7) When Vt, :3V will be explained.
一般的に電子化された通話回路2は、V L = 3
Vに交流信号υLsinωtが重畳されると、ある瞬時
電圧で直流電流 工りが流れなくなるため、交流信号電
圧がクリップされ、波形が歪む。この様に、電流 IL
が流れなくなる電圧を飽和電圧VL(sat)と呼ぶこ
とにする。 υL≧3Vpp、TI(063%を満たす
ためには、 VL(sat)≦1.5Vでなければなら
ない。 −
これまで述べてきた特性は通話回路2の中の電源回路を
保証しなければならない特性であり、以下にまとめて記
述する。Generally, the electronic communication circuit 2 has V L = 3.
When the AC signal υLsinωt is superimposed on V, the DC current stops flowing at a certain instantaneous voltage, so the AC signal voltage is clipped and the waveform is distorted. In this way, the current IL
The voltage at which the current stops flowing is called the saturation voltage VL (sat). υL≧3Vpp, TI (To satisfy 063%, VL(sat) must be ≦1.5V. - The characteristics described so far are the characteristics that must be guaranteed for the power supply circuit in the communication circuit 2. , and are summarized below.
条件■
直流抵抗数:IL=2011A(7)ときV t =
3 VI L= 100mA (7)とき3.6v≦V
L=20.6v条件■
特性インピーダンス:V+、/iL≦2にΩ条件■
vL(sat)≦1.5V
上記の3条件を満たす従来例の説明を行なう。Condition ■ Number of DC resistance: When IL = 2011A (7), V t =
3 VI L= 100mA (7) when 3.6v≦V
L=20.6v condition ■Characteristic impedance: V+, /iL≦2 and Ω condition■ vL(sat)≦1.5V A conventional example that satisfies the above three conditions will be explained.
日本電信電話公社「研究実用化報告」第33巻第6号P
137〜P151及び昭和55年度電子通信学会総合全
国大会No2265に報告されている従来の通話回路の
ブロック図を第6図に、回路例を第7図に示す。第6図
において、12は定電流回路、13は電子スイッチ、1
4は放電防止回路、15は定電圧回路、16は比較制御
回路、(P、)は出力端子である。また第7図において
、(Q、) 〜(Q、)はトランジスタ、(zl)はツ
ェナーダイオード、(C工)(C,)はコンデンサ、(
R工)〜(R3)は抵抗である。定電流回路12は、上
記条件■を満たす直流特性VL−ILを持つように設定
され、直流 ILが放電防止回路14を通して定電圧回
路15に供給され、端子(Ps)(Pl)に直流電圧V
oが発生するこの直流電圧vOは、一般的にVo=1.
7V〜2v程度に設定され通話回路駆動のための電圧源
として使われる。上記条件■を満たすための回路が電子
スイッチ13及び比較制御回路l6である。いま、電子
スイッチ13を回路から取り除き、端子(P 3 )
(P 4 )間に直流電圧vLを印加し、この直流電圧
vLの電圧値を下げていったとき直流電流■しが流れな
くなるVLの電圧値をVsatとする。Nippon Telegraph and Telephone Public Corporation “Research and Practical Application Report” Volume 33 No. 6 P
A block diagram of a conventional communication circuit reported in No. 137 to P151 and 1988 Institute of Electronics and Communication Engineers General Conference No. 2265 is shown in FIG. 6, and an example of the circuit is shown in FIG. In FIG. 6, 12 is a constant current circuit, 13 is an electronic switch, 1
4 is a discharge prevention circuit, 15 is a constant voltage circuit, 16 is a comparison control circuit, and (P, ) is an output terminal. Furthermore, in Fig. 7, (Q,) to (Q,) are transistors, (zl) is a Zener diode, (C) is a capacitor, (
R) to (R3) are resistances. The constant current circuit 12 is set to have a DC characteristic VL-IL that satisfies the above condition (2), and the DC IL is supplied to the constant voltage circuit 15 through the discharge prevention circuit 14, and the DC voltage V is applied to the terminals (Ps) (Pl).
This DC voltage vO generated by o is generally Vo=1.
It is set to about 7V to 2V and is used as a voltage source for driving the communication circuit. The circuit for satisfying the above condition (2) is the electronic switch 13 and the comparison control circuit 16. Now, remove the electronic switch 13 from the circuit and connect the terminal (P 3 )
When a DC voltage vL is applied between (P 4 ) and the voltage value of this DC voltage vL is lowered, the voltage value of VL at which the DC current 2 stops flowing is defined as Vsat.
Vt、+υLsin (13t≧V、a、のとき、電子
スイッチ13は開かれ、直流電流ILは放電回路14及
び定電圧回路15を通して、共通端子P4に流される。Vt, +υLsin (13t≧V,a), the electronic switch 13 is opened and the DC current IL is passed through the discharge circuit 14 and the constant voltage circuit 15 to the common terminal P4.
vL+υtsin (1) t≧v g a tのとき
、電子スイッチ13は閉じられ、直流電流ILは電子ス
イッチ13を通して、共通端子P4に流される。この間
、定電圧回路15の出力電圧Voはコンデンサ(C2)
により所定の電圧vOに維持され1通話回路2の動作が
維持される。この様にして、工し交流信号υ1.sin
ωtが印加されても一定に保たれ、上記条件■を実現し
ている。vL+υtsin (1) When t≧v g a t, the electronic switch 13 is closed and the DC current IL is passed through the electronic switch 13 to the common terminal P4. During this time, the output voltage Vo of the constant voltage circuit 15 is connected to the capacitor (C2).
Therefore, the predetermined voltage vO is maintained, and the operation of the 1-communication circuit 2 is maintained. In this way, the AC signal υ1. sin
Even when ωt is applied, it is kept constant, and the above condition (2) is realized.
発明が解決しようとする問題点
上記従来の構成では、第1の問題点として、定電流源ト
ランジスタ (C2)のアーリー効果による特性インピ
ーダンスの低下がある。第7図において、電子スイッチ
13が開放のとき、トランジスタ(C2)のエミッタ・
コレクタ間は交流電圧υLsinωtで振られているた
め、アーリー効果により11sinωtが流れる。一般
的にトランジスタ (C2)のコレクタ電流ICは下記
第0式で表わされる。Problems to be Solved by the Invention The first problem with the conventional configuration described above is a reduction in characteristic impedance due to the Early effect of the constant current source transistor (C2). In FIG. 7, when the electronic switch 13 is open, the emitter of the transistor (C2)
Since the AC voltage υL sin ωt is applied between the collectors, 11 sin ωt flows due to the Early effect. Generally, the collector current IC of the transistor (C2) is expressed by the following equation 0.
ただし、V(jEはコレクタ・エミッタ間の電圧、V^
はアーリー電圧、IcoはI(!−VCE特性を外そう
して求めたV(!E=OのときのICである。上記0式
より、トランジスタ(C2)のコレクタ・エミッタ間の
交流インピーダンスυt、/Itは次式で表わされる。However, V(jE is the collector-emitter voltage, V^
is the early voltage, and Ico is the IC when V(!E=O, obtained by removing the I(!-VCE characteristic). From the above equation 0, the AC impedance between the collector and emitter of the transistor (C2) υt , /It is expressed by the following formula.
端子(P3)(P、)から見た特性インピーダンスを2
にΩ以上にするためには、υL/i工≧2にΩである必
要がある。υL/11≧2にΩ、及び ICO〜Ia=
100mAを上記■式に代入すると、下記第0式となる
。The characteristic impedance seen from the terminal (P3) (P, ) is 2
In order to make Ω or more, it is necessary that υL/i ≧ 2 and Ω. υL/11≧2, Ω, and ICO~Ia=
Substituting 100 mA into the above equation (2) gives the following equation 0.
V^≧200■・・・・・・・・・・・・■すなわち、
第7図の従来回路を用いて、端子(P、)(P4)から
見た特性インピーダンスを、 IL=too■Aのとき
、2にΩ以上にしようとすると、トランジスタ(C2)
のアーリー電圧がVA≧200 Vである必要がある。V^≧200■・・・・・・・・・■In other words,
Using the conventional circuit shown in Fig. 7, if you try to make the characteristic impedance seen from the terminal (P, ) (P4) more than 2Ω when IL=too■A, then the transistor (C2)
It is necessary that the early voltage of VA≧200V.
しかし、集積回路のPNPトランジスタのアーリー電圧
は一般的にV^=50〜100Vであり、従来回路では
端子(P、)(P4)から見た特性インピーダンスをυ
L/i工≧2にΩを達成できなIll。However, the early voltage of a PNP transistor in an integrated circuit is generally V = 50 to 100V, and in conventional circuits, the characteristic impedance seen from the terminal (P, ) (P4) is υ
Ill be unable to achieve Ω when L/i engineering≧2.
第2の問題点として、PNPトランジスタ(C4)の逆
方向トランジスタによるコンデンサ(C8)の放電を無
視できないことがある。第7図の従来回路がIL:20
1OA、VL=3V、 υL=3Vppで動作している
ときの各ノードの電圧波形を第8図に示す。A second problem is that the discharge of the capacitor (C8) due to the reverse direction transistor of the PNP transistor (C4) cannot be ignored. The conventional circuit in Figure 7 has an IL of 20
FIG. 8 shows the voltage waveforms at each node when operating at 1OA, VL=3V, υL=3Vpp.
なお第8図は簡略化のため鋸歯状波で示しているが、実
際は正弦波である。実線17〜20はそれぞれvt、+
υLsin (11t、トランジスタ (C3)のベー
ス電圧VBa、トランジスタ (C2)のコレクタ電圧
vC2、出力電圧vO及びトランジスタ(C4)のベー
ス電圧VB4である。なお、第8図の動作例では、各ト
ランジスタの飽和電圧を0.2V、活性領域でのベース
・エミッタ間電圧を0.7V及びラニーダイオード(Z
l)のツェーナ電圧を2vとした。tlの期間はV B
z > V B 4であり、定電流源トランジスタ(
C2)の電流がトランジスタ (C4)を通してラニー
ダイオード(Zl)に供給され、所定電圧vOが出力端
子(P5)に出力される。t2の期間はV B 3 >
V 84であり、トランジスタ(C2)のコレクタ電
流はトランジスタ(Q、)を通して共通端子(P4)に
バイパスされ、入力端子(P3)の交流波形のクリップ
を防いでいる。ところが、第8図で期間t、はトランジ
スタ (C4)エミッタ電圧がコレクタ電圧よりも低く
、トランジスタ (C4)が逆方向トランジスタとして
動作する期間である。このため、コンデンサ(C2)に
蓄積された電荷が急速に両トランジスタ(Q、)(Q、
)を通して共通端子(P4)に放電され、定電圧回路電
圧vOにリップルが乗る不都合が生じる。Although FIG. 8 shows a sawtooth wave for simplification, it is actually a sine wave. Solid lines 17 to 20 are vt, +
υLsin (11t, base voltage VBa of transistor (C3), collector voltage vC2 of transistor (C2), output voltage vO, and base voltage VB4 of transistor (C4). The saturation voltage is 0.2V, the base-emitter voltage in the active region is 0.7V, and the Raney diode (Z
The Zener voltage of 1) was set to 2V. The period of tl is V B
z > V B 4, and the constant current source transistor (
The current of C2) is supplied to the Raney diode (Zl) through the transistor (C4), and a predetermined voltage vO is output to the output terminal (P5). During the period t2, V B 3 >
V 84, and the collector current of the transistor (C2) is bypassed to the common terminal (P4) through the transistor (Q, ) to prevent clipping of the AC waveform at the input terminal (P3). However, period t in FIG. 8 is a period in which the emitter voltage of the transistor (C4) is lower than the collector voltage and the transistor (C4) operates as a reverse transistor. Therefore, the charge accumulated in the capacitor (C2) is rapidly transferred to both transistors (Q, ) (Q,
) is discharged to the common terminal (P4), causing the inconvenience that a ripple is added to the constant voltage circuit voltage vO.
本発明上記従来の問題点を解消するもので、アーリー効
果による特性インピーダンスの低下や。The present invention solves the above-mentioned conventional problems, such as a reduction in characteristic impedance due to the Early effect.
定電圧回路出力へのリップルの重畳がなく、しかも半導
体集積化の容易な電話機通話回路の電源回路を提供する
ことを目的とする。It is an object of the present invention to provide a power supply circuit for a telephone communication circuit that does not cause ripples to be superimposed on the output of a constant voltage circuit and can be easily integrated into semiconductors.
問題点を解決するための手段
上記問題点を解決するため、本発明の電話機通話回路の
電源回路は、電源供給及び信号入出力のための入力端子
と、回路駆動のための定電圧出力端子と、共通端子と、
前記入力端子と定電圧出力端子との間に接続された定電
流回路と放電防止回路との直列回路と、前記定電圧出力
端子と共通端子との間に接続された定電圧回路と、前記
定電流回路と放電防止回路との接続点と前記共通端子と
の間に接続された電子スイッチと、前記放電防止回路の
開閉を制御するバイアス回路とを備えた構成としたもの
である。Means for Solving the Problems In order to solve the above problems, the power supply circuit of the telephone communication circuit of the present invention has an input terminal for power supply and signal input/output, and a constant voltage output terminal for driving the circuit. , a common terminal,
a series circuit of a constant current circuit and a discharge prevention circuit connected between the input terminal and the constant voltage output terminal; a constant voltage circuit connected between the constant voltage output terminal and the common terminal; The configuration includes an electronic switch connected between a connection point between the current circuit and the discharge prevention circuit and the common terminal, and a bias circuit that controls opening and closing of the discharge prevention circuit.
作用
上記構成によれば、バイアス回路は、定電圧出力端子の
電圧と入力端子の電圧とをコンパレートし、定電流回路
と放電防止回路とが飽和しない期間は、放電防止回路に
電流を流し、飽和する期間は、放電防止回路を開放する
ようにコントロールする。この際、入力端子の交流信号
電圧を放電防止回路を通して定電流回路に伝達すること
によって、定電流回路に印加される電圧を直流にしてい
る。このことによって、定電流回路のトランジスタのア
ーリー効果による端子から見た特性インピーダンスの低
下を防止できると同時に、放電防止回路のトランジスタ
が逆方向トランジスタとして働くことを防止している。Effects According to the above configuration, the bias circuit compares the voltage of the constant voltage output terminal and the voltage of the input terminal, and allows current to flow through the discharge prevention circuit during a period when the constant current circuit and the discharge prevention circuit are not saturated. During the saturation period, the discharge prevention circuit is controlled to be open. At this time, the voltage applied to the constant current circuit is made into direct current by transmitting the AC signal voltage of the input terminal to the constant current circuit through the discharge prevention circuit. This prevents the characteristic impedance seen from the terminal from decreasing due to the Early effect of the transistor in the constant current circuit, and at the same time prevents the transistor in the discharge prevention circuit from functioning as a reverse transistor.
実施例
以下、本発明の一実施例を第1図〜第3図に基づいて説
明する。EXAMPLE Hereinafter, an example of the present invention will be described based on FIGS. 1 to 3.
第1図は本発明の一実施例における電話機通話回路の電
源回路の回路ブロック図で、21は定電流回路、22は
電子スイッチ、23は放電防止回路、24は定電圧回路
、25は比較制御回路、26はバイアス回路、(R6)
は入力端子、(R7)は共通端子、(R8)は定電圧出
力端子である。電源供給及び信号入出力のための入力端
子(R6)と共通端子(P、)との間に定電流回路21
放電防止回路23と定電圧回路24とが直列に接続され
ており、放電防止回路23と定電圧回路24との接続点
に定電圧出力端子(R8)が接続されている。また、定
電流回路21と共通端子(R7)との間に比較制御回路
25の機能を有する電子スイッチ22が接続されている
。さらに、定電流回路21と放電防止回路23との間に
バイアス回路26が接続されている。FIG. 1 is a circuit block diagram of a power supply circuit of a telephone communication circuit in an embodiment of the present invention, in which 21 is a constant current circuit, 22 is an electronic switch, 23 is a discharge prevention circuit, 24 is a constant voltage circuit, and 25 is a comparison control. circuit, 26 is a bias circuit, (R6)
is an input terminal, (R7) is a common terminal, and (R8) is a constant voltage output terminal. A constant current circuit 21 is connected between the input terminal (R6) and the common terminal (P, ) for power supply and signal input/output.
The discharge prevention circuit 23 and the constant voltage circuit 24 are connected in series, and a constant voltage output terminal (R8) is connected to the connection point between the discharge prevention circuit 23 and the constant voltage circuit 24. Furthermore, an electronic switch 22 having the function of a comparison control circuit 25 is connected between the constant current circuit 21 and the common terminal (R7). Further, a bias circuit 26 is connected between the constant current circuit 21 and the discharge prevention circuit 23.
第2図は上記電源回路の回路図で、 (Q、)〜(Q、
)はトランジスタ、(z2)はツェナーダイオード、(
D工)はダイオード、(C2)(C4)はコンデンサ、
(R4)〜(R8)は抵抗、(工□)は定電流源で
ある。共通ベース結合対PNP )−ランジスタ(Q、
)(Q6)のエミッタを共通接続して入力端子(R6)
を接続し、且つPNPトランジスタ (Q、)のベース
とコレクタとを共通接続し、直列抵抗(R4)(R1)
をPNPトランジスタ(Q、)と共通端子(R7)との
間に接続し、且つ、トランジスタ (Q、)のエミッタ
と抵抗(R,)(RS)の接続点との間にコンデンサ(
C1)を接続して、定電流回路21を構成している。Figure 2 is a circuit diagram of the above power supply circuit, (Q,) to (Q,
) is a transistor, (z2) is a Zener diode, (
D) is a diode, (C2) (C4) is a capacitor,
(R4) to (R8) are resistors, and (D) is a constant current source. Common base coupling pair PNP )-ransistor (Q,
) (Q6) and connect them to the input terminal (R6).
and the base and collector of the PNP transistor (Q,) are connected in common, and the series resistors (R4) (R1)
is connected between the PNP transistor (Q,) and the common terminal (R7), and a capacitor (
C1) is connected to constitute a constant current circuit 21.
またPNPトランジスタ (Q、)のコレクタと共通端
子(R7)との間に、ベースを抵抗(R4) (RS
)の接続点に接続したPNP トランジスタ(Q7)の
エミッタ・コレクタを接続して電子スイッチ22を構成
している。また、PNP トランジスタ (Q、)のエ
ミッタをPNP トランジスタ (Q6)のコレクタに
接続し、トランジスタ (Q、)のコレクタを逆方向接
続のツェナーダイオード(z2)とコンデンサ(C4)
との並列回路に接続して、それぞれ放電防止回路23と
定電圧回路24とを構成している。なお、比較制御回路
25は、電子スイッチ22で共用される。In addition, the base is connected to a resistor (R4) (RS
) is connected to the emitter-collector of a PNP transistor (Q7) to form an electronic switch 22. In addition, the emitter of the PNP transistor (Q,) is connected to the collector of the PNP transistor (Q6), and the collector of the transistor (Q,) is connected to a reversely connected Zener diode (z2) and a capacitor (C4).
A discharge prevention circuit 23 and a constant voltage circuit 24 are respectively connected to the parallel circuit. Note that the comparison control circuit 25 is shared by the electronic switch 22.
さらに、NPNトランジスタ (Q、)のコレクタを入
力端子(R6)に接続し、ベースを定電圧出力端子(P
、)と共通端子(R7)との間に形成した直列抵抗(R
s)(Rff)の接続点に接続し、入力端子(P、)と
共通端子(R7)との間に順方向のダイオード(Dl)
と抵抗(R8)と定電流電源(工、)とを直列接続し、
抵抗(Ro)と定電流電源(工、)との間にPNPトラ
ンジスタ (Q9)のエミッタを接続してバイアス回路
26を構成し、同エミッタを放電防止回路23を構成す
るPNP トランジスタ (Q、)のベースにも共通接
続している。Furthermore, the collector of the NPN transistor (Q,) is connected to the input terminal (R6), and the base is connected to the constant voltage output terminal (P
) and the common terminal (R7).
s) (Rff) and connect a forward diode (Dl) between the input terminal (P, ) and the common terminal (R7).
Connect the resistor (R8) and constant current power supply (Engineer) in series,
The emitter of a PNP transistor (Q9) is connected between the resistor (Ro) and the constant current power supply (Engine) to constitute the bias circuit 26, and the emitter is connected to the PNP transistor (Q9) that constitutes the discharge prevention circuit 23. It also has a common connection to the base.
第21ffl(7)回路を、Vt、= 3 V 、 υ
L= 3 Vppで動作したときの主要ノードの電圧波
形を第3図に示す。なお第3図では図面の簡略化のため
に鋸歯状波で表わしたが、実際は正弦波である。NPN
トランジスタ(Q9)と定電流弦(工、)とエミッタフ
ォロアを形成し、NPNトランジスタ (Q、)のベー
スは、定電圧Voを抵抗抵抗(R,)(R,)とで分割
された電圧でバイアスされている。このような回路構成
を採用すると、 ダイオード(Dl)と抵抗(R6)と
を通してエミッタを交流電圧υ(、sinωtで振って
も、NPNトランジスタ (Q、)のエミッタ電位はベ
ースの直流電流で決定される電位以下には下がらず、波
形がクリップされる。この波形を第3図に実線27で示
した。従って、期間ttt tz及びt4は放電防止回
路23のPNP トランジスタ(Q、)が閉じて、定電
流回路21の電流が定電圧回路24に供給され、定電圧
出力端子(P、)に電圧V。The 21st ffl(7) circuit is defined as Vt, = 3 V, υ
FIG. 3 shows the voltage waveforms at the main nodes when operating at L=3 Vpp. In FIG. 3, a sawtooth wave is used to simplify the drawing, but it is actually a sine wave. NPN
The transistor (Q9) and a constant current string (Eng.,) form an emitter follower, and the base of the NPN transistor (Q,) is a voltage obtained by dividing the constant voltage Vo by the resistor (R,) (R,). Biased. If such a circuit configuration is adopted, the emitter potential of the NPN transistor (Q,) is determined by the base DC current even if the emitter is swung by the AC voltage υ(, sinωt) through the diode (Dl) and resistor (R6). The voltage does not fall below the potential of the discharge prevention circuit 23, and the waveform is clipped.This waveform is shown by the solid line 27 in FIG. The current of the constant current circuit 21 is supplied to the constant voltage circuit 24, and the voltage V is applied to the constant voltage output terminal (P,).
が出力される。一方、期間t、は電子スイッチ22が閉
じて、定電流回路21の電流共通端子(R7)にバイパ
スされる。このt3の期間はコンデンサ(C4)により
、所定の電圧Voを維持する。期間t3のときは、PN
Pトランジスタ(Q7)のベース電圧の波形が、また期
間t工y t、及びt4では。is output. On the other hand, during period t, the electronic switch 22 is closed and the current is bypassed to the common terminal (R7) of the constant current circuit 21. During this period t3, a predetermined voltage Vo is maintained by the capacitor (C4). During period t3, PN
The waveform of the base voltage of the P transistor (Q7) is also during periods t, yt, and t4.
PNP トランジスタ (Q、)のベース電圧の波形が
各々PNPトランジスタ (Q6)のコレクタに伝達さ
れ、その波形は実線28で示した波形になる。このこと
から、PNPトランジスタ (Q6)のエミッタ・コレ
クタ間電圧は直流に近くなり、PNPトランジスタ (
Q6)のアーリー効果が無視できるようになる。t2の
期間は、PNP トランジスタ(Q6)のエミッタ・コ
レクタ間に一部リップルが生じるが、経験によると、実
用上支障がないことが判明した。なお第3図、の実線2
9はVL十υ1.sinωtの波形である。The waveforms of the base voltages of the PNP transistors (Q,) are respectively transmitted to the collectors of the PNP transistors (Q6), and the waveforms become the waveforms shown by solid lines 28. From this, the emitter-collector voltage of the PNP transistor (Q6) becomes close to direct current, and the PNP transistor (
The early effect of Q6) can now be ignored. During the period t2, some ripples occur between the emitter and collector of the PNP transistor (Q6), but experience has shown that there is no practical problem. In addition, solid line 2 in Figure 3
9 is VL 10υ1. This is the waveform of sinωt.
発明の効果
以上述べたごとく本発明によれば、素子数増加も少なく
、容易に、特性インピーダンス2にΩ以上で、 しかも
定電圧出力vOのリップルが少ない電話機通話回路の電
源回路を得ることができる。Effects of the Invention As described above, according to the present invention, it is possible to easily obtain a power supply circuit for a telephone communication circuit that has a characteristic impedance of 2Ω or more and less ripple in the constant voltage output vO, with a small increase in the number of elements. .
第1図は本発明の一実施例における電話機通話回路の電
源回路の回路ブロック図、第2図は同電源回路の回路図
、第3図は第2図に示す回路の各部電圧波形図、第4図
は電話機の概略構成図、第5図は電話機及びその通話回
路が満たすべき直流特性の説明図、第6図は従来の電源
回路の回路ブロック図、第7図は同電源回路の回路図、
第8図は第7図に示す回路の各部電圧波形図である。
21・・・定電流回路、22・・・電子スイッチ、23
・・・放電防止回路、24・・・定電圧回路、26・・
・バイアス回路、(P、)・・・入力端子、(R7)・
・・共通端子、 (P、)・・・定電圧出力端子、(Q
5)〜(Q9)・・・トランジスタ、(Dl)・・・ダ
イオード、(工□)・・・定電流源、(R4)〜(R8
)・・・抵抗、(C3)(C4)・・・コンデンサ、
(Z2)・・・ツェナーダイオード
代理人 森 本 義 弘
第1図
r6−−−入〃鳴)
Py−一老通j’1i)
h゛−“定電圧出〃端す
第j図
第7図
、12
第3図
VCV)FIG. 1 is a circuit block diagram of a power supply circuit of a telephone communication circuit in one embodiment of the present invention, FIG. 2 is a circuit diagram of the same power supply circuit, FIG. 3 is a voltage waveform diagram of each part of the circuit shown in FIG. Figure 4 is a schematic configuration diagram of a telephone, Figure 5 is an explanatory diagram of the DC characteristics that must be satisfied by the telephone and its communication circuit, Figure 6 is a circuit block diagram of a conventional power supply circuit, and Figure 7 is a circuit diagram of the same power supply circuit. ,
FIG. 8 is a voltage waveform diagram of each part of the circuit shown in FIG. 7. 21... Constant current circuit, 22... Electronic switch, 23
...Discharge prevention circuit, 24... Constant voltage circuit, 26...
・Bias circuit, (P,)...input terminal, (R7)・
...Common terminal, (P,)...Constant voltage output terminal, (Q
5)~(Q9)...Transistor, (Dl)...Diode, (D)...Constant current source, (R4)~(R8
)...Resistor, (C3) (C4)...Capacitor,
(Z2)...Zener diode agent Yoshihiro Morimoto Figure 1 r6 --- Input ring) Py-Ichiro-dori j'1i) h゛-" Constant voltage output terminal Figure J Figure 7 , 12 Figure 3 VCV)
Claims (1)
駆動のための定電圧出力端子と、共通端子と、前記入力
端子と定電圧出力端子との間に接続された定電流回路と
放電防止回路との直列回路と、前記定電圧出力端子と共
通端子との間に接続された定電圧回路と、前記定電流回
路と放電防止回路との接続点と前記共通端子との間に接
続された電子スイッチと、前記放電防止回路の開閉を制
御するバイアス回路とを備えた電話機通話回路の電源回
路。 2、バイアス回路は、入力端子と共通端子との間に接続
された順方向のダイオードと第1の抵抗と定電流源との
直列回路と、定電圧出力端子と前記共通端子との間に接
続された第2の抵抗と第3の抵抗との直列回路と、コレ
クタが前記入力端子に接続されエミッタが前記第1の抵
抗と定電流源との接続点に接続されベースが前記第2の
抵抗と第3の抵抗との接続点に接続されたNPN型の第
1のトランジスタとを備え、定電流回路は、エミッタが
共に前記入力端子に接続されたPNP型の第2及び第3
のトランジスタを備え、放電防止回路は、ベースが前記
第1のトランジスタのエミッタに接続されコレクタが定
電圧回路に接続されエミッタが前記第2及び第3のトラ
ンジスタのうちの一方のトランジスタのコレクタに接続
されたPNP型の第4のトランジスタを備えた構成とし
た特許請求の範囲第1項記載の電話機通話回路の電源回
路。[Claims] 1. An input terminal for power supply and signal input/output, a constant voltage output terminal for driving a circuit, a common terminal, and an input terminal connected between the input terminal and the constant voltage output terminal. a series circuit of a constant current circuit and a discharge prevention circuit, a constant voltage circuit connected between the constant voltage output terminal and the common terminal, a connection point between the constant current circuit and the discharge prevention circuit, and the common terminal. A power supply circuit for a telephone communication circuit, comprising an electronic switch connected between the discharge prevention circuit and a bias circuit for controlling opening and closing of the discharge prevention circuit. 2. The bias circuit includes a series circuit of a forward diode, a first resistor, and a constant current source connected between the input terminal and the common terminal, and a constant voltage output terminal and the common terminal. a series circuit of a second resistor and a third resistor, the collector of which is connected to the input terminal, the emitter of which is connected to the connection point of the first resistor and the constant current source, and the base of which is connected to the second resistor; and a first NPN transistor connected to a connection point between the input terminal and the third resistor, and the constant current circuit includes second and third PNP transistors whose emitters are both connected to the input terminal.
The discharge prevention circuit has a base connected to the emitter of the first transistor, a collector connected to a constant voltage circuit, and an emitter connected to the collector of one of the second and third transistors. 2. A power supply circuit for a telephone communication circuit according to claim 1, wherein the power supply circuit includes a PNP type fourth transistor.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP8491085A JPH0683331B2 (en) | 1985-04-19 | 1985-04-19 | Power circuit for telephone communication circuit |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP8491085A JPH0683331B2 (en) | 1985-04-19 | 1985-04-19 | Power circuit for telephone communication circuit |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS61242450A true JPS61242450A (en) | 1986-10-28 |
JPH0683331B2 JPH0683331B2 (en) | 1994-10-19 |
Family
ID=13843883
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP8491085A Expired - Lifetime JPH0683331B2 (en) | 1985-04-19 | 1985-04-19 | Power circuit for telephone communication circuit |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0683331B2 (en) |
-
1985
- 1985-04-19 JP JP8491085A patent/JPH0683331B2/en not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
JPH0683331B2 (en) | 1994-10-19 |
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