JPS61228755A - Communication control equipment - Google Patents

Communication control equipment

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Publication number
JPS61228755A
JPS61228755A JP60068940A JP6894085A JPS61228755A JP S61228755 A JPS61228755 A JP S61228755A JP 60068940 A JP60068940 A JP 60068940A JP 6894085 A JP6894085 A JP 6894085A JP S61228755 A JPS61228755 A JP S61228755A
Authority
JP
Japan
Prior art keywords
reception
data
register
transmission
program
Prior art date
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Pending
Application number
JP60068940A
Other languages
Japanese (ja)
Inventor
Kenichiro Oda
織田 健一郎
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Ltd
Original Assignee
Hitachi Ltd
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Filing date
Publication date
Application filed by Hitachi Ltd filed Critical Hitachi Ltd
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Publication of JPS61228755A publication Critical patent/JPS61228755A/en
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Abstract

PURPOSE:To prevent the deterioration in the line utilizing efficiency due to excess error processing and data retransmission by avoiding the reception of incorrect data caused by an RD noise due to a residual carrier of a MODEM. CONSTITUTION:A program sets a reception status register 18 to the reception stop state at the end of reply reception. Signals 16 and 17 generated by a 1-character reception end detection circuit 14 are stopped by the setting and the reception is stopped. When a carrier detection signal CD changes to the OFF state, an interruption signal is sent from a CD OFF supervisory circuit 6 and a main control unit 1 rewrites a reception status register 18 into the reception start state according to the command of the program. The signals 16, 17 generated by the circuit 14 are produced through the rewrite and the reception is started. Thus, the incorrect data reception caused by the RD noise due to the residual carrier is avoided and the program overhead for the incorrection data reception processing and the deterioration of the line utilizing efficiency due to data retransmission are improved.

Description

【発明の詳細な説明】 〔発明の利用分野〕 本発明は、モデムおよび通信回線を介して端末装置等に
接続されてデータの送受信を行なう通信制御装置に係り
、特にモデムインタフェースのキャリア検出信号(CD
信号)のオフを監視して行な5データ送受信制御の改良
に関する。
DETAILED DESCRIPTION OF THE INVENTION [Field of Application of the Invention] The present invention relates to a communication control device that is connected to a terminal device or the like via a modem and a communication line to transmit and receive data, and particularly relates to a communication control device that transmits and receives data via a modem interface and a carrier detection signal ( CD
This invention relates to improvements in data transmission/reception control performed by monitoring the off state of signals (signals).

〔発明の背景〕[Background of the invention]

マルチポイント構成の通信回線を使用するシステムでは
、1次局から2次局ヘボーリングシーケンスを送信する
場合は、CD信号オフを確認して、次の2次局へ送信す
る方式が一般的であり、その理由は次の通りである。
In a system that uses a multi-point communication line, when transmitting a boring sequence from a primary station to a secondary station, it is common to check that the CD signal is off and then transmit it to the next secondary station. , The reason is as follows.

第2図および第3図を用いて説明する。第2図において
、CCUは通信制御装置を1M、M+M2はモデムを、
T+、T2は端末装置を表わし、マルチポイント構成で
データ送受信を行う。第3図はCCU側のSDおよび端
末装置TI、T2側のSD、R8とモデムM1. M2
のキャリアの状態を示す。
This will be explained using FIGS. 2 and 3. In Figure 2, CCU is a communication control device of 1M, M+M2 is a modem,
T+ and T2 represent terminal devices, which transmit and receive data in a multipoint configuration. FIG. 3 shows SD and terminal device TI on the CCU side, SD on the T2 side, R8 and modem M1. M2
Indicates the status of the carrier.

いま、CCUよりT1に対してポーリングシーケンスを
送信したとすると、T1は該ポーリングシー1yX受信
後、 応答シーケンスをCCUへ□返す。この時、T1
はR8をオンにして、5DIII。
Suppose that the CCU sends a polling sequence to T1. After receiving the polling sequence 1yX, T1 returns a response sequence to the CCU. At this time, T1
Turn on R8 and set it to 5DIII.

に応答シーケンスを乗せ、その後、R8をオフとする。After that, R8 is turned off.

MlはRSオンでキャリアを送出し、RSオフで送出を
停止するが、モデム、回線の特性により、キャリアはあ
る時間第3図の如く残1゛留する。ここでCCU側にて
CDオフを監視せずに次の端末T2ヘボーリングシーケ
ンスを送出したとすると、T2からの応答シーケンスが
CCUへ送信される際、第3図の破線部に示す様にモデ
ムM1の残留キャリアがモデムM2のキャリアトに重な
ることにより、応答シーケンスを正常に受信できないこ
とがある。
M1 transmits the carrier when RS is on and stops transmitting when RS is off, but depending on the characteristics of the modem and line, the carrier remains for a certain period of time as shown in FIG. If the CCU side sends the boring sequence to the next terminal T2 without monitoring CD off, when the response sequence from T2 is sent to the CCU, the modem If the residual carrier of M1 overlaps the carrier of modem M2, the response sequence may not be received normally.

以上の理由により、CDオフを確認して送信を行うこと
が必要である。また全二重通信を用いている時は、T2
へのポーリング送信中も残留・「1、3 キャリアによるノイズが受信され得るため、その対策も
必要である。
For the above reasons, it is necessary to confirm that the CD is off before transmitting. Also, when using full-duplex communication, T2
Noise from residual carriers 1 and 3 can be received even during polling transmission to the terminal, so countermeasures are also required.

次に従来方式を以下に述べる。Next, the conventional method will be described below.

CCU側はポーリングシーケンスに対する応答シーケン
スを受信すると、プログラムから、ある時間間隔で発行
される監視指令に従ってCDオフを監視し、CDオフに
なるとプログラムからの送信指令で次の端末ヘポーリン
グシーケンスを送出する。また受信処理については、応
答シーケンス受信後から次の端末へのボーリン・グシー
ケンス送信完了までの間に取り込んだ不正データは、プ
ログラムで読み捨て処理を行う(第4図参照)。
When the CCU side receives the response sequence to the polling sequence, it monitors the CD off according to the monitoring command issued from the program at certain time intervals, and when the CD turns off, sends the polling sequence to the next terminal according to the transmission command from the program. . Regarding reception processing, invalid data taken in between the reception of the response sequence and the completion of transmission of the boring sequence to the next terminal is read and discarded by the program (see FIG. 4).

本方法では以下に述べる不具合がある。This method has the following drawbacks.

(1)応答シーケンス受信後の残留キャリアによ・るR
Dノイズにより同期が確立(例えばHDLC手順の場合
はX’7E’パターンを受信)しテ1次端末へのポーリ
ングシーケンス送4N 完了後に、該残留キャリアによ
る不正データ受信の報告が発生することがある。この場
合は、・該ポーリングに対する応答が不正であったとみ
なし再送処理を行う。これにより、回線使用効率が低下
する。
(1) R due to residual carrier after receiving response sequence
After synchronization is established due to D noise (for example, in the case of HDLC procedure, X'7E' pattern is received) and the polling sequence is sent to the primary terminal (4N), a report of invalid data reception by the remaining carrier may occur. . In this case, it is assumed that the response to the polling is invalid and retransmission processing is performed. This reduces line usage efficiency.

(2)  上記(1)で不正データ受信報告が次端末へ
のポーリング送信完了以前であっても、プログラムでの
読み捨て処理を必要とし、プログラムのオーバヘッドが
増加する。
(2) In (1) above, even if the fraudulent data reception report is received before the polling transmission to the next terminal is completed, the program needs to perform read-discard processing, which increases program overhead.

(5)CDの状態を意識したプログラム設計が必゛要で
ある。
(5) It is necessary to design a program that takes into account the state of the CD.

なお、この種の装置として関連するものにはシ・・例え
ば特開昭57−18383号公報がある。
Note that related devices of this type include, for example, Japanese Unexamined Patent Publication No. 18383/1983.

〔発明の目的〕[Purpose of the invention]

本発明の目的は、全二重通信のマルチポイント回線にお
いて、モデムの残留キャリアによるRDノイズに起因す
る不正データ受信を回避す1jることにより、余分なエ
ラー処理およびデータ再送による回線使用効率の低下を
防ぐ手段を提・供することにある。
The purpose of the present invention is to avoid a reduction in line usage efficiency due to redundant error processing and data retransmission by avoiding incorrect data reception caused by RD noise caused by residual carriers of modems in full-duplex communication multipoint lines. The goal is to provide and provide means to prevent this.

〔発明の概要〕[Summary of the invention]

本発明の特徴とするところは、モデムおよび・1・通信
回線を介して端末装置等と接続してデータ送受信を行な
うプログラム制御方式の通信制御装置において、送信デ
ータ格納用メモリと当該メモリからの読み出しデータを
格納する第1のレジスタと、当該第1レジスタ内のデー
タを取り込んで回線へビット直列に送出するために用い
る第2のレジスタと、モデムインタフェースのCDを監
視して、CDオフとなるまでは、前記第1レジスタに置
かれたデータを繰り返し送出する手段と、CDオフにな
ると前記メモリに・格納されているデータを前記第1レ
ジスタに読み出し送信し、以降順次前記メモリからデー
タを読み出して前記第1レジスタにセットしてデータ送
信を行なう手段と、CDがオンからオフになって前記メ
モリ内データを前記第1レジスタに読み出す時プログラ
ムへ報告信号を送出する手段と、プログラムで書替え可
能な受信動作の実行、停止に用いる状態レジスタとを設
けることにより、プログラムでのCD監視処理を簡略化
するとともに、モデムの残留キャリアによるRDノイズ
に起因する不正データ受信を回避し、余分なエラー処理
およびデータ再送による回線使用効率の低下を防ぐこと
である。
The present invention is characterized by: a program-controlled communication control device that connects to a terminal device, etc. via a modem and a communication line to transmit and receive data; A first register that stores data, a second register that is used to take in the data in the first register and send it serially to the line, and a CD of the modem interface until the CD is turned off. means for repeatedly transmitting the data placed in the first register; and a means for reading and transmitting the data stored in the memory to the first register when the CD is turned off, and sequentially reading data from the memory thereafter. means for transmitting data by setting it in the first register; means for sending a report signal to the program when the CD is turned from on to off and the data in the memory is read out to the first register; By providing a status register that is used to execute and stop receiving operations, it simplifies the CD monitoring process in the program, avoids incorrect data reception caused by RD noise due to the residual carrier of the modem, and eliminates unnecessary error processing and This is to prevent a decrease in line usage efficiency due to data retransmission.

〔発明の実施例〕[Embodiments of the invention]

以下、本発明の一実施例を第1図と第5図により説明す
る。
An embodiment of the present invention will be described below with reference to FIGS. 1 and 5.

第1図は本発明を通信制御装置の回線制御部に適用した
一実施例のブロック図である。
FIG. 1 is a block diagram of an embodiment in which the present invention is applied to a line control section of a communication control device.

1は主制御ユニットであり、回線制御部との送受信デー
タの授受、電文の処理、エラー処理1”。
1 is a main control unit, which sends and receives data to and from the line control unit, processes messages, and handles errors.

等をプログラム処理により行う。2は送信データ格納用
メモリであり、主制御ユニット1からのデータ書込みバ
ス19とアドレスバス21.7’−・夕書込み指示信号
20の制御の下に、送信データ書込みを行い、送信デー
タが格納される。3は1・第1送信レジスタであり、C
Dオフ監視回路6・からのセット信号9により、送信デ
ータ格納用メモリ2の内容を取り込む。4は第2送信レ
ジ。
etc. are performed by program processing. 2 is a memory for storing transmission data, and under the control of the data write bus 19 and the address bus 21.7'-/event write instruction signal 20 from the main control unit 1, transmission data is written and the transmission data is stored. be done. 3 is the 1/1st transmission register, and C
The contents of the transmission data storage memory 2 are taken in by the set signal 9 from the D-off monitoring circuit 6. 4 is the second transmission register.

スタであり、1キャラクタ送信完了検出回路5からのセ
ット信号8により第1送信レジスタ3・・・の内容を取
り込んだ後、回線速度に合わせて1ビツトシフトを行な
い、SD信号31にビット直列のデータをのせる。5は
1キャラクタ送信完了検出回路であり、第2送信レジス
タ4のデータの送信完了検出時にレジスタ4のセット信
号8を出す。6はCDオフ監視回路であり、第2送信レ
ジスタ4のデータ送信完了時にCDオフであったら、第
1送信レジスタセツト信号9を出すと共に、メモリ2の
アドレス更新指示信号10を出す。また該レジスタ4の
データ送信完了・時にCDオフへの変化を検出したら、
主制御ユニット1に対し割込み信号11を送出する。7
はアドレス発生回路であり、主制御ユ;ット1から送信
データを書込む場合は、アドレスバス21に従ってアド
レスを発生させ、それ以外の場合・は、CDオフ監視回
路6からのアドレス更新指示信号10に従ってアドレス
を発生させる。12は受信データ格納用メモリであり、
受信データ書込み指示信号17とアドレス更新指示信号
16の制御′の下に受信データの書込みを行い、受信デ
ー・ 7 りを格納する。13は受信レジスタであり、回線からの
ビット直列データをキャラクタに組立てる。14は1キ
ャラクタ受信完了検出回路であり、受信ステータスレジ
スタ18が開始状態を示していた場合は受信レジスタ1
3でのキャラクタ組立・完了を検出した時、アドレス更
新指示信号16と受信データ書込み指示信号17を出し
、該レジスタ18が停止状態を示していた場合は、該信
号16と17の送出を止める。15はアドレス発生回路
で、主制御ユニット1が受信データを読み出す場合1゛
・はアドレスバス21.それ以外の場合は回路14から
のアドレス更新指示信号16に従ってアドレスを発生さ
せる。1Bは受信ステータスレジスタであり、主制御ユ
ニット1からのデータ書込みバスを用いて、受信ステー
タスを規定するバターI・ンが書込まれる。
After taking in the contents of the first transmission register 3 by the set signal 8 from the 1-character transmission completion detection circuit 5, it performs a 1-bit shift according to the line speed, and transmits the bit series data to the SD signal 31. put on. Reference numeral 5 denotes a one-character transmission completion detection circuit, which outputs a set signal 8 for the register 4 when detecting the completion of transmission of data in the second transmission register 4. Reference numeral 6 denotes a CD off monitoring circuit, which outputs a first transmission register set signal 9 and an address update instruction signal 10 for the memory 2 if the CD is off when data transmission from the second transmission register 4 is completed. In addition, when the data transmission of register 4 is completed and a change to CD OFF is detected,
An interrupt signal 11 is sent to the main control unit 1. 7
is an address generation circuit, which generates an address according to the address bus 21 when writing transmission data from the main control unit 1, and otherwise generates an address update instruction signal from the CD-off monitoring circuit 6. 10 to generate an address. 12 is a memory for storing received data;
The received data is written under the control of the received data write instruction signal 17 and the address update instruction signal 16, and the received data is stored. A receiving register 13 assembles bit serial data from the line into characters. 14 is a one-character reception completion detection circuit, and when the reception status register 18 indicates a start state, reception register 1 is detected.
When character assembly/completion in step 3 is detected, an address update instruction signal 16 and a received data write instruction signal 17 are output, and if the register 18 indicates a stopped state, the output of the signals 16 and 17 is stopped. 15 is an address generation circuit, and when the main control unit 1 reads received data, 1' is an address bus 21. In other cases, an address is generated according to the address update instruction signal 16 from the circuit 14. 1B is a reception status register, into which a data write bus from the main control unit 1 is used to write the data specifying the reception status.

上記構成でCD信号がオンとオフの場合の動作を第1図
と第5図を用いて説明する。
The operation when the CD signal is on and off in the above configuration will be explained with reference to FIGS. 1 and 5.

初めにCDオンの場合の動作について述べる。・第2送
信レジスタ4のデータ送信完了時、1キ・・ヤラクタ送
信完了検出回路5より信号8が出る。
First, the operation when the CD is on will be described. - When the data transmission of the second transmission register 4 is completed, the signal 8 is output from the first character transmission completion detection circuit 5.

この時はCDオンのため信号9は出ない。従って第1送
信レジスタ3には前のデータカ残す、第2送信レジスタ
4には、該第1送信レジスタ3の内容が移され、つまり
同じデータを送信することKなる。CDオフとなるまで
この動作を繰り返す。第5図には、第1送信レジスタ3
にHDLC手順でのF TJ A Gパターンが入って
いる例を示し、CDオフとなるまでFLAGパターンを
送り続ける。
At this time, signal 9 is not output because the CD is on. Therefore, the previous data remains in the first transmission register 3, and the contents of the first transmission register 3 are transferred to the second transmission register 4, that is, the same data is transmitted. Repeat this operation until the CD is turned off. In FIG. 5, the first transmitting register 3
An example is shown in which the F TJ A G pattern in the HDLC procedure is included, and the FLAG pattern is continued to be sent until the CD is turned off.

次にCD信号がオフとなった場合の動作は次の様になる
。第2送信レジスタ4のデータ送信を終えると1回路5
から信号8が出る。この時CD信号32はオフのため、
第1送信レジスタセツト信号9が出る。従って第2レジ
スタ5に、送信データ格納用メモリ2に入っている送信
データが読み出され、さらに第2レジスタ4には、第2
レジスタの該読み出しデータが移されることになる。そ
の後、第2レジスタのデータはビットシフトを繰り返し
て回線へ送出される。またアドレス更新指示信号10を
受けたアドレス発生回路7では、メモリアドレスの更新
を行い、次の送信キャラクタのアクセスを可能にする。
Next, the operation when the CD signal is turned off is as follows. When data transmission from the second transmission register 4 is finished, one circuit 5
Signal 8 comes out from. At this time, the CD signal 32 is off, so
A first transmission register set signal 9 is output. Therefore, the transmission data stored in the transmission data storage memory 2 is read into the second register 5, and the second
The read data of the register will be transferred. Thereafter, the data in the second register is repeatedly bit-shifted and sent to the line. Further, the address generation circuit 7 that receives the address update instruction signal 10 updates the memory address to enable access to the next transmission character.

これ以降は順次メモリ2からデータを読み出して第1送
信レジスタ3.さらに第2送信レジス・り4にセットし
てデータを送信を行なう。
After this, data is sequentially read from the memory 2 and the data is read from the first transmitting register 3. Furthermore, the second transmission register is set to 4 and data is transmitted.

一方、受信動作について述べると、応答受信完了時(第
5図す部)、プログラムは受信ステータスレジスタ18
を受信停止状態に設定する。
On the other hand, regarding the reception operation, when the response reception is completed (part shown in Figure 5), the program executes the reception status register 18.
Set the reception stop state.

該設定により1キャラクタ受信完了検出回路141・で
生成している信号16および17は止まり・受信動作は
停止する。この状態は第5図a部に相当する。その後C
D信号がオフに変わると、CDオフ監視回路6から割込
み信号が送出され、主制御ユニット1はプログラムの指
示に従って受1信ステータスレジスタ18を受信開始状
態に書き替える。該書き替えにより回路14で生成して
いる信号16および17が出る様になり受信動作を開始
する。
With this setting, the signals 16 and 17 generated by the one character reception completion detection circuit 141 stop and the reception operation stops. This state corresponds to part a in FIG. Then C
When the D signal turns off, an interrupt signal is sent from the CD off monitoring circuit 6, and the main control unit 1 rewrites the reception status register 18 to the reception start state according to the instructions of the program. As a result of this rewriting, the signals 16 and 17 generated by the circuit 14 are outputted, and the receiving operation is started.

〔発明の効果〕〔Effect of the invention〕

本発明にあっては、次の如き効果を得ることができる。 According to the present invention, the following effects can be obtained.

(1)端末からの応答受信後、次の端末ヘボーリングシ
ーケンスを送出する際、CDオフを監視し、CDオフと
なった時にプログラムへ報告し、該プ目グラムからの受
信開始指示により受信を開始するということが可能とな
るため、残留キャリアによるRDノイズに起因する不正
データ受信を回避でき、不正データ受信処理のためのプ
ログラムオーバヘッドおよびデータ再送による回線使用
効率の低下を改善できる。
(1) After receiving a response from a terminal, when sending a boring sequence to the next terminal, monitor the CD off, report to the program when the CD is off, and start receiving according to the reception start instruction from the program program. Therefore, it is possible to avoid illegal data reception due to RD noise caused by residual carriers, and it is possible to improve program overhead for processing illegal data reception and decrease in line usage efficiency due to data retransmission.

(2)  プログラムからの送信指示があった時、CD
オフとなるまでは任意のパターン例えばHDLC手順で
のX’7B’パターン)を送信し続け、CDオフとなっ
た時、電文(例えばHDLC手。
(2) When there is a transmission instruction from the program, the CD
Until the CD is turned off, it continues to send an arbitrary pattern (for example, the

順ではアドレスフィールド以降)の送出を開始するとい
う動作を可能とすることにより、プログラムはCD信号
の状態を意識することなく、唯送信開始の指示をするだ
けで済み、プログラム処理を簡略化できる。
By making it possible to start sending data (after the address field in order), the program only needs to issue an instruction to start sending without being aware of the state of the CD signal, which simplifies program processing.

夕送受信時の第1図における8D、RD、CDの各信号
および受信ステータスを示す図、第3図及び第4図はモ
デムインタフェースのCD信号のオフを確認してデータ
送信を開始することの必要性を説明する図、第5図は従
来技術を表わす図である。
The diagrams showing the 8D, RD, and CD signals and reception status in Figure 1 during evening transmission/reception, Figures 3 and 4 show the need to confirm that the CD signal of the modem interface is off before starting data transmission. FIG. 5 is a diagram illustrating the conventional technology.

1・・・主制御ユニット、  2・・・送信データ格納
メモリ・、・3・・・第1送信レジスタ、 4・・・第
2送信レジスタ、5・・・1キャラクタ送信完了検出回
路、6・・・CDオフ監視回路、 7・・・アドレス発生回路(送信側)、8・・・第2送
信レジスタセツト信号19・・・第1送信レジスタセツ
ト信号、10・・・アドレス更新指示信号(送信側)、
11・・・受信開始報告割込み信号、 12・・・受信データ格納メモリ、 13・・・受信レジスタ、 14・・・1キャラクタ受信完了検出回路、15・・・
アドレス発生回路、 16・・・アドレス更新指示信号(受信側)、17・・
・受信データ書込み指示信号、1日・・・受信ステータ
スレジスタ、 19・・・データ書込みバス、 20・・・送信データ書込み指示信号、21・・・アド
レスバス、 30・・・RD倍信号受信データ)、 31・・・8D信号(送信データ)、 32・・・CD信号(キャリア検出)。
DESCRIPTION OF SYMBOLS 1... Main control unit, 2... Transmission data storage memory,... 3... First transmission register, 4... Second transmission register, 5... 1 character transmission completion detection circuit, 6. ...CD off monitoring circuit, 7.Address generation circuit (transmission side), 8..Second transmission register set signal 19..First transmission register set signal, 10..Address update instruction signal (transmission side). side),
11... Reception start report interrupt signal, 12... Reception data storage memory, 13... Reception register, 14... 1 character reception completion detection circuit, 15...
Address generation circuit, 16...Address update instruction signal (receiving side), 17...
・Receive data write instruction signal, 1st...Receive status register, 19...Data write bus, 20...Transmit data write instruction signal, 21...Address bus, 30...RD double signal receive data ), 31...8D signal (transmission data), 32...CD signal (carrier detection).

Claims (1)

【特許請求の範囲】[Claims] 1、送信データ格納用メモリと、当該メモリから読み出
した送信データを格納する第1レジスタと、当該第1レ
ジスタ内送信データを回線へビット直列に送出するため
に用いる第2レジスタと、モデムインタフェースのCD
(キャリア検出信号)を監視して、CDオフとなるまで
は前記第1レジスタ内データを繰り返し送出する手段と
、CDオフになると前記メモリ内データを前記第1レジ
スタに読み出して送信し、以降は順次前記メモリからデ
ータを読み出して前記第1レジスタにセットしてデータ
送信を行う手段とCDオンからCDオフになって、前記
メモリ内データを前記第1レジスタに読み出す時プログ
ラムへ報告信号を送出する手段と、前記プログラムで書
替え可能な受信開始及び受信停止指示用状態レジスタと
、当該状態レジスタから生成した信号で受信動作の実行
および停止を行う手段とを有することを特徴とする通信
制御装置。
1. A memory for storing transmission data, a first register for storing transmission data read from the memory, a second register used for transmitting the transmission data in the first register to the line in bit series, and a modem interface. CD
means for monitoring (carrier detection signal) and repeatedly sending the data in the first register until the CD is turned off, and reading out and transmitting the data in the memory to the first register when the CD is turned off; Means for sequentially reading data from the memory, setting it in the first register, and transmitting the data, and sending a report signal to the program when the data in the memory is read out to the first register when the CD is turned on and the CD is turned off. 1. A communication control device comprising: means for instructing reception to start and stop receiving; and means for executing and stopping a reception operation using a signal generated from the state register.
JP60068940A 1985-04-03 1985-04-03 Communication control equipment Pending JPS61228755A (en)

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