JPS61209485A - Image display unit - Google Patents

Image display unit

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Publication number
JPS61209485A
JPS61209485A JP60051006A JP5100685A JPS61209485A JP S61209485 A JPS61209485 A JP S61209485A JP 60051006 A JP60051006 A JP 60051006A JP 5100685 A JP5100685 A JP 5100685A JP S61209485 A JPS61209485 A JP S61209485A
Authority
JP
Japan
Prior art keywords
image
memory
image data
display
image memory
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP60051006A
Other languages
Japanese (ja)
Inventor
落合 和博
高橋 晶二
二郎 和泉
啓二 山本
泉沢 仁
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
Priority to JP60051006A priority Critical patent/JPS61209485A/en
Publication of JPS61209485A publication Critical patent/JPS61209485A/en
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.

Description

【発明の詳細な説明】 [概 要] 画像表示装置であって、表示領域よりやや広い領域の画
像データを格納する画像メモリを複数のブロックに分割
し、画像メモリの先頭座標と現在の表示領域の先頭座標
との差の値を、予め定めた基準値と比較して、その基準
値を越える条件が得られたとき、その成立条件に対応す
る隣接方向に、ブロック単位に、上位メモリから画像デ
ータをロードするよう構成したものである。
[Detailed Description of the Invention] [Summary] An image display device in which an image memory that stores image data in an area slightly larger than a display area is divided into a plurality of blocks, and the starting coordinates of the image memory and the current display area are divided into blocks. The value of the difference from the first coordinate of It is configured to load data.

これによって、比較的小容量の画像メモリを用いて切れ
目のない連続的なスクロール(表示画面上において画像
を左右または上下に連続的に移動させること)が可能と
なる。
This makes it possible to perform seamless, continuous scrolling (continuously moving the image horizontally or vertically on the display screen) using a relatively small-capacity image memory.

[産業上の利用分野] 本発明は、画像表示装置に係わり、さらに特定すれば、
仮想的な画像空間の中から、任意の位置を選択し、上下
左右に自由にスクロールして表示することのできる画像
表示装置に関するものである。
[Industrial Application Field] The present invention relates to an image display device, and more specifically,
The present invention relates to an image display device that can select an arbitrary position from a virtual image space and display the image by freely scrolling it vertically and horizontally.

[従来の技術] 画像表示装置においては、そのメモリ内に全画像データ
を格納すれば、表示領域を自由にスクロールして表示す
ることができるが、画像データが、例えば3次元の画像
データのように、データ量が大きくなるに従って、メモ
リの量は非常に大きなものとしなければならない。
[Prior Art] In an image display device, if all image data is stored in its memory, the display area can be freely scrolled and displayed. In addition, as the amount of data increases, the amount of memory must become extremely large.

一方、全画像データを格納しである上位メモリから、ロ
ードし直すことはできるが、切れ目のない連続的なスク
ロールは不可能である。
On the other hand, although it is possible to reload all image data from the upper memory where it is stored, continuous scrolling without breaks is impossible.

[発明が解決しようとする問題点] 本発明は、比較的小容量のメモリを用いて、仮想的に存
在する画像データを、スクロールによって切れ目なく表
示するこたとを可能とした新規な画像表示装置を提供し
ようとするものである。
[Problems to be Solved by the Invention] The present invention provides a novel image display device that allows virtually existing image data to be displayed seamlessly by scrolling using a relatively small memory capacity. This is what we are trying to provide.

[問題点を解決するための手段] 第1図は、本発明の画像表示装置の原理ブロック図を示
す。
[Means for Solving the Problems] FIG. 1 shows a block diagram of the principle of an image display device of the present invention.

第1図において、■はディスプレイ、2は中央処理装置
の逐一の制御なく直接メモリ間の転送を制御するDMA
制御回路、3は画像メモリである。
In Figure 1, ■ is a display, and 2 is a DMA that directly controls transfer between memories without the control of the central processing unit.
The control circuit 3 is an image memory.

4および5は、それぞれ画像メモリ3に格納している画
像データの先頭座標値(XI、 Yl )を記憶するX
I レジスタおよびYl レジスタである。6および7
は、それぞれディスプレイ1に現在表示している表示領
域の先頭座標値(X2. Y2 )を記憶するX2レジ
スタおよびY2 レジスタである。
4 and 5 are X for storing the start coordinate values (XI, Yl) of the image data stored in the image memory 3, respectively.
The I register and the Yl register. 6 and 7
are an X2 register and a Y2 register that respectively store the leading coordinate values (X2.Y2) of the display area currently displayed on the display 1.

8は(X2− XI )を算出するX@算器、9は(Y
2   Yl)を算出するYM算器である。 10はX
減算器8の出力(X2   XI)を基準値α1および
α2と比較するX比較器であって、(X2−XI)<α
直または、 (X2   XI ) >α2 になったときは、DMA制御回路2に出力を送出する。
8 is an X@ calculator that calculates (X2-XI), 9 is (Y
This is a YM calculator that calculates 2 Yl). 10 is X
An X comparator that compares the output (X2
or when (X2 XI) > α2, the output is sent to the DMA control circuit 2.

12は全画像データを格納している大容量の上位メモリ
であって、処理装置の主記憶装置、或いは画像処理専用
の大容量メモリ等である。
Reference numeral 12 denotes a large-capacity upper memory that stores all image data, such as a main memory of a processing device or a large-capacity memory dedicated to image processing.

画像メモリ3は、X方向、Y方向ともに複数のブロック
に分割してあり、口MAi制御回路2はX比較器10か
らの出力を受けると、上位メモリ12から画像メモリ3
へ、Y方向のブロック列単位に画像データをロードする
The image memory 3 is divided into a plurality of blocks in both the X direction and the Y direction, and when the mouth MAi control circuit 2 receives the output from the X comparator 10, the image memory 3 is
Image data is loaded in units of block columns in the Y direction.

同様に、11はY比較器であって、Y減算器9の出力を
基準値β1.β2と比較し、 (Y2− Yl ) <βlまたは、 (Y2−Yl)>β2 になったときは、1八制御回路2へ送出し、DMA制御
回路2は上位メモリ12から画像メモリ3へ、X方向の
ブロック列単位に画像データをロードする。
Similarly, 11 is a Y comparator which converts the output of the Y subtracter 9 to a reference value β1. When it is compared with β2 and becomes (Y2-Yl) <βl or (Y2-Yl)>β2, it is sent to the 18 control circuit 2, and the DMA control circuit 2 sends it from the upper memory 12 to the image memory 3. Load image data in units of block columns in the X direction.

[作用] 画像メモリ3が、その左端と右端、および上端と下端と
はリンクするように構成しであるとき(通常、表示メモ
リはそのようになっている)、表示WJ面をスクロール
させて画像メモリの境界を越えると、左右または上下の
画像が結合した表示になる、いわゆるラップ(Wrap
)動作を行うことを利用し、境界を越える前に、メモリ
の反対側の成る一定領域に、越えようとする側の画像デ
ータをロードし、あたかも、全画像データが画像メモリ
にあるようにして、切れ目のないスクロール機能を持た
せるようにしたものである。
[Function] When the image memory 3 is configured so that its left end and right end and its upper end and lower end are linked (usually the display memory is configured like this), the display WJ surface is scrolled to display the image. When the memory boundary is exceeded, the left and right or top and bottom images are combined into a display, so-called wrap.
), and before crossing the boundary, load the image data of the side you are trying to cross into a certain area on the opposite side of the memory, as if all the image data were in the image memory. , which has a seamless scrolling function.

画像を観測するオペレータによって、表示画面がスクス
ールされ、画像メモリ3の境界に近付くのを検出するた
め、画像メモリ3の先頭座標(XI。
In order to detect when the display screen is scrolled by the operator observing the image and approaches the boundary of the image memory 3, the start coordinate (XI) of the image memory 3 is detected.

Yl)と、現在ディスプレイ1において表示されている
表示領域の先頭座標(X2. Y2 )の差分を算出し
、これを予め定めた基準値と比較する。
Yl) and the top coordinates (X2.Y2) of the display area currently displayed on the display 1, and compares this with a predetermined reference value.

例えば、(X2   XI ) <αlとなったらば、
表示領域が画像メモリ3の左側の境界に近付いたことを
示し、(X2−Xl)>α2となったならば、表示領域
が画像メモリ3の右側の境界に近付いたことを示す。
For example, if (X2 XI ) < αl, then
This indicates that the display area has approached the left boundary of the image memory 3, and if (X2-Xl)>α2, it indicates that the display area has approached the right boundary of the image memory 3.

ディスプレイ1は、DMA制御回路2を通して、画像メ
モリ3からの画像データを表示している。
A display 1 displays image data from an image memory 3 through a DMA control circuit 2.

画像メモリ3は、水平および垂直に複数のブロックに分
割してあり、X比較器およびX比較器から出力が上がる
と、DMA制御回路2は越えようとする側と反対側の1
ブロック列に、越えようとする境界に隣接する画像デー
タを、上位メモリ12から転送する。
The image memory 3 is divided horizontally and vertically into a plurality of blocks, and when the output from the X comparator and the
Image data adjacent to the boundary to be crossed is transferred from the upper memory 12 to the block column.

[実施例] 以下第1図に示す原理ブロック図および第2図〜第3図
に示す実施例により、本発明の要旨を具体的に説明する
[Example] The gist of the present invention will be specifically explained below with reference to the principle block diagram shown in FIG. 1 and the examples shown in FIGS. 2 and 3.

第2図(a)は、画像メモリ3内に格納した画像データ
Aと、ディスプレイ1において現在表示している表示領
域Bの関係を示す。画像データAの先頭座標値が(XI
、 Yl ) 、表示領域Bの先頭座標値が(X2. 
Y2 )である。
FIG. 2(a) shows the relationship between the image data A stored in the image memory 3 and the display area B currently displayed on the display 1. The starting coordinate value of image data A is (XI
, Yl), the leading coordinate value of display area B is (X2.
Y2).

第2図(b)は、画像メモリ3を、水平方向4、垂直方
向4、即ち、4X4=16のブロックに分割しているこ
とを示す。また同時に、オペレータのタブレット等によ
る操作によってスクロールされ、同図(alに示す位置
から左に移動して、(X2   XI)〈α1の条件が
満たされたことを示している。
FIG. 2(b) shows that the image memory 3 is divided into 4 blocks in the horizontal direction and 4 blocks in the vertical direction, that is, 4×4=16 blocks. At the same time, the image is scrolled by the operator's operation using a tablet or the like and moved to the left from the position shown in the figure (al), indicating that the condition (X2 XI) <α1 is satisfied.

第2図(C)は、同図(blのような状況になり、X比
較器10からα1の条件が満たされた旨の出力を受けて
、DMA制御回路2が、13〜16のブロックに対して
、1〜4のブロックの左側の画像データを上位メモリ1
2からロードした結果を示している。
FIG. 2(C) shows that the situation as shown in FIG. 2 (bl) occurs, and upon receiving the output from the On the other hand, the image data on the left side of blocks 1 to 4 is stored in the upper memory 1.
This shows the results loaded from 2.

即ち、1〜4のブロックの左端と13〜16のブロック
の右端はリンクしているからである。
That is, the left ends of blocks 1 to 4 and the right ends of blocks 13 to 16 are linked.

上方向のスクロールについては、(Y2   Yl)〈
βiの条件が満たされたとき、4.8.12.16のブ
ロックに対して、1.5.9.13のブロックの上側の
画像データをロードする。右方向および下方1ii1の
スクロールについては、これらと逆方向に一同様に行わ
れる。
For upward scrolling, (Y2 Yl)
When the condition of βi is satisfied, the upper image data of the block 1.5.9.13 is loaded into the block 4.8.12.16. Scrolling to the right and downward 1ii1 is performed in the same manner in the opposite direction.

以上の処理を行うことによって、全画像データがあたか
も画像メモリ3にあるような、自由なスクロールを行う
ことができる。
By performing the above processing, it is possible to scroll freely as if all the image data were in the image memory 3.

本実施例では、画像メモリ3を4×4のブロックに分割
したが、この分割数を変化させると、次のような関係と
なるので、表示画面の大きさ、メモリの転送速度、スク
ロールの速度などから最適なものを選択することができ
る。
In this embodiment, the image memory 3 is divided into 4 x 4 blocks, but if the number of divisions is changed, the following relationship will be obtained, so the size of the display screen, the transfer speed of the memory, and the speed of scrolling will change. You can select the most suitable one from among them.

■分割数を多くするほど、表示領域に対する画像メモリ
容量の比率は小さくて済む。
(2) The larger the number of divisions, the smaller the ratio of image memory capacity to display area.

■分割数を多くするほど、画像データ転送の頻度は高く
なるが、1回の転送データ量は少なくなる。
(2) As the number of divisions increases, the frequency of image data transfer increases, but the amount of data transferred at one time decreases.

第3図は、画像メモリ3の分割数を多くし、16×16
とした例を示す。
In Figure 3, the number of divisions of the image memory 3 is increased to 16 x 16.
An example is shown below.

[発明の効果] 以上説明のように本発明により、比較的小容量の画像メ
モリによって、あたかも全画像データが画像メモリにあ
るように、切れ目のないスクロール機能を持たせること
ができ、実用上の効果は大なるものがある。
[Effects of the Invention] As explained above, according to the present invention, a seamless scrolling function can be provided using a relatively small-capacity image memory, as if all image data were in the image memory, which is practical. The effects are huge.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明の原理ブロック図、 第2図は本発明の実施例における画像メモリ構成図、 第3図は本発明の他の実施例における画像メモリ構成図
である。 図面において、 1はディスプレイ、  2はDMA制御回路、3は画像
メモリ、   4,5.6.7はレジスタ、8.9は減
算器、  10.11は比較器、12は上位メモリ、 をそれぞれ示す。 %1月 2本発明のデオ己t1【−巧・け3重N9ノ吃り刷1級
凹第22
FIG. 1 is a block diagram of the principle of the present invention, FIG. 2 is a configuration diagram of an image memory in an embodiment of the invention, and FIG. 3 is a configuration diagram of an image memory in another embodiment of the invention. In the drawings, 1 is a display, 2 is a DMA control circuit, 3 is an image memory, 4, 5, 6.7 are registers, 8.9 is a subtracter, 10.11 is a comparator, and 12 is an upper memory. . % January 2 This invention's deo self t1

Claims (1)

【特許請求の範囲】 画像データを格納する上位メモリ(12)の画像データ
の一部を表示する画像表示装置であって、表示領域を完
全に包含する画像データを格納する画像メモリ(3)と
、 該画像メモリ(3)の格納する画像データの先頭座標と
、現在の表示領域の先頭座標の差分を算出する減算器(
8)、(9)と、 該差分値出力を、第1および第2の基準値と比較する比
較器(10)、(11)とを備え、該差分値出力が第1
の基準値より小、若しくは第2の基準値より大となった
とき、前記画像メモリ(3)を複数に分割したブロック
列単位ごとに、前記比較成立条件に対応した隣接方向に
、前記上位メモリ(12)より画像データをロードする
よう構成したことを特徴とする画像表示装置。
[Scope of Claims] An image display device that displays a part of image data in an upper memory (12) that stores image data, comprising an image memory (3) that stores image data that completely encompasses a display area; , a subtractor (
8), (9), and comparators (10), (11) that compare the difference value output with first and second reference values, and the difference value output compares with the first and second reference values.
is smaller than the reference value or larger than the second reference value, the image memory (3) is divided into a plurality of blocks, and for each block column unit, the upper memory is (12) An image display device characterized in that it is configured to load image data from.
JP60051006A 1985-03-14 1985-03-14 Image display unit Pending JPS61209485A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP60051006A JPS61209485A (en) 1985-03-14 1985-03-14 Image display unit

Applications Claiming Priority (1)

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JP60051006A JPS61209485A (en) 1985-03-14 1985-03-14 Image display unit

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Publication Number Publication Date
JPS61209485A true JPS61209485A (en) 1986-09-17

Family

ID=12874684

Family Applications (1)

Application Number Title Priority Date Filing Date
JP60051006A Pending JPS61209485A (en) 1985-03-14 1985-03-14 Image display unit

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JP (1) JPS61209485A (en)

Cited By (9)

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