JPS61199731U - - Google Patents
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- Publication number
- JPS61199731U JPS61199731U JP8165685U JP8165685U JPS61199731U JP S61199731 U JPS61199731 U JP S61199731U JP 8165685 U JP8165685 U JP 8165685U JP 8165685 U JP8165685 U JP 8165685U JP S61199731 U JPS61199731 U JP S61199731U
- Authority
- JP
- Japan
- Prior art keywords
- output
- counter
- control signal
- frequency dividing
- signal
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 4
- 238000003708 edge detection Methods 0.000 description 1
Description
第１図は実施例の回路ブロツク図、第２図は波
形図、第３図は従来例の回路ブロツク図、第４図
、第５図は従来動作説明のための波形図である。 １３……カウンタ、１４……ｍカウントデコー
ダ、１５……１２ｎ分周回路、１９……エツジ検
出回路、２０……Ｄ型フリツプフロツプ。
形図、第３図は従来例の回路ブロツク図、第４図
、第５図は従来動作説明のための波形図である。 １３……カウンタ、１４……ｍカウントデコー
ダ、１５……１２ｎ分周回路、１９……エツジ検
出回路、２０……Ｄ型フリツプフロツプ。
Claims (1)
- 再生コントロール信号を入力とする１２ｎ分周
手段と、該１２ｎ分周手段出力の一方のエツジを
検出するエツジ検出手段と、テープを駆動するキ
ヤプスタンモータのＦＧ信号を入力して前記エツ
ジ検出手段出力でリセツトされるカウンタと、該
カウンタ出力のｍカウント目に出力を発生するｍ
カウントデコーダ手段と、該ｍカウントデコーダ
出力のタイミングで前記１２ｎ分周手段出力を保
持する保持手段を備える記録速度判別回路におい
て、第１速度及び第２速度でのＦＧ信号とコント
ロール信号との比を夫々ａ，ｂ（ただしａ＞ｂ）
とし、許容する再生コントロール信号の欠落又は
ノイズの混入の数を１としたとき、上記ｎとｍを
ｎ＞１（ａ＋ｂ）ａ−ｂ及び（ｎ―１）ａ＞ｍ＞
（ｎ＋１）ｂを満足する様に設定したことを特徴
とする記録速度判別回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8165685U JPS61199731U (ja) | 1985-05-30 | 1985-05-30 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8165685U JPS61199731U (ja) | 1985-05-30 | 1985-05-30 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61199731U true JPS61199731U (ja) | 1986-12-13 |
Family
ID=30628639
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8165685U Pending JPS61199731U (ja) | 1985-05-30 | 1985-05-30 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61199731U (ja) |
-
1985
- 1985-05-30 JP JP8165685U patent/JPS61199731U/ja active Pending
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