JPS61196368A - Ｉｃカ−ド不正検出方式 - Google Patents
Ｉｃカ−ド不正検出方式Info
- Publication number
- JPS61196368A JPS61196368A JP60036381A JP3638185A JPS61196368A JP S61196368 A JPS61196368 A JP S61196368A JP 60036381 A JP60036381 A JP 60036381A JP 3638185 A JP3638185 A JP 3638185A JP S61196368 A JPS61196368 A JP S61196368A
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- Japan
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- card
- circuit
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- Pending
Links
- 238000000034 method Methods 0.000 title description 6
- 238000012544 monitoring process Methods 0.000 claims abstract description 8
- 238000001514 detection method Methods 0.000 claims description 4
- 238000010586 diagram Methods 0.000 description 6
- 230000005540 biological transmission Effects 0.000 description 5
- 230000002159 abnormal effect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000001105 regulatory effect Effects 0.000 description 1
- 238000012795 verification Methods 0.000 description 1
Landscapes
- Credit Cards Or The Like (AREA)
- Control Of Vending Devices And Auxiliary Devices For Vending Devices (AREA)
- Financial Or Insurance-Related Operations Such As Payment And Settlement (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明はＩＣカードの不正検出方式に関するものである
。
。
ＩＣカードの不正検出方式として、例えば特開昭５９−
７５５８０号公報に示されるように１１Ｃカード内＆で
記憶されている暗証番号と外部装置から与えられる暗証
番号をＩＣカード内のマイクロコンビエータによって照
合を行い、照合結果だけがＩＣカードより外部装置に出
力されるものが知られている。
７５５８０号公報に示されるように１１Ｃカード内＆で
記憶されている暗証番号と外部装置から与えられる暗証
番号をＩＣカード内のマイクロコンビエータによって照
合を行い、照合結果だけがＩＣカードより外部装置に出
力されるものが知られている。
しかしこの方法も完全なものでなく、暗証番号を知らな
くても、試行錯誤的に番号を設定することにより、知る
ことは可能であった。よってＩＣカード内のデータを引
き出される心配があった。
くても、試行錯誤的に番号を設定することにより、知る
ことは可能であった。よってＩＣカード内のデータを引
き出される心配があった。
本発明の目的とするところは前記の如き問題点を除去す
るものであり、ＩＣカードが端末装置にデータを渡して
から、それに対する応答がＩＣカードに返ってくるまで
の時間を測定−し。
るものであり、ＩＣカードが端末装置にデータを渡して
から、それに対する応答がＩＣカードに返ってくるまで
の時間を測定−し。
それが適切な時間であるか否かをＩＣカードが判定する
ことができる不正検出方式を提供することにある。
ことができる不正検出方式を提供することにある。
本発明の特徴とするをこ、ろは、前記目的を達成するた
めに、ＩＣカードと端末装置に最小応答時間と最大応答
時間を設定し、ＩＣカードから端末装置にメツセージを
渡してから、その回答がＩＣカードに返ってくるまでの
時間が上記の最小応答時間と最大応答時間の間になるよ
うにしたことである。
めに、ＩＣカードと端末装置に最小応答時間と最大応答
時間を設定し、ＩＣカードから端末装置にメツセージを
渡してから、その回答がＩＣカードに返ってくるまでの
時間が上記の最小応答時間と最大応答時間の間になるよ
うにしたことである。
次に本発明の一実施例につき図面を用いて詳細に説明す
る。
る。
第１図は本発明におけるＩＣカード内の回路例を示した
ものであり、１は端末装置に対する送受信回路、２は間
合わせ送信回路、３は応答受信回路、４け間合わせ送信
回路２がデータを送信してから応答時間受信回路３によ
って応答が受信されるまでの時間を監視する応答時間監
視回路、５は最小の応答時間がセットされる最小応答時
間保持レジスタ、６は最大の応答時間がセットされる最
大応答時間保持レジスタ、７は処理部、８は応答時間を
測定するタイマを示す・ 第２図は端末装置の回路例を示したものであり、９はＩ
Ｃカードに対する送受信回路、１０は回答送信回路、１
１は問い合わせ受信回路、１２はＩＣカードに回答を送
信する時間を調節する応答時間調節回路、１３は最小の
応答時間がセットされる最小応答時間保持レジスタ、１
４は最大の応答時間がセットされる最大応答時間保持レ
ジスタ、１５は処理部、１６は回答時間調整のために用
いるタイマを示す。
ものであり、１は端末装置に対する送受信回路、２は間
合わせ送信回路、３は応答受信回路、４け間合わせ送信
回路２がデータを送信してから応答時間受信回路３によ
って応答が受信されるまでの時間を監視する応答時間監
視回路、５は最小の応答時間がセットされる最小応答時
間保持レジスタ、６は最大の応答時間がセットされる最
大応答時間保持レジスタ、７は処理部、８は応答時間を
測定するタイマを示す・ 第２図は端末装置の回路例を示したものであり、９はＩ
Ｃカードに対する送受信回路、１０は回答送信回路、１
１は問い合わせ受信回路、１２はＩＣカードに回答を送
信する時間を調節する応答時間調節回路、１３は最小の
応答時間がセットされる最小応答時間保持レジスタ、１
４は最大の応答時間がセットされる最大応答時間保持レ
ジスタ、１５は処理部、１６は回答時間調整のために用
いるタイマを示す。
第３図は、ＩＣカードと端末装置間のデータのやりとり
の応答時間の幅を示す。
の応答時間の幅を示す。
第４図は、応用実施例で使用するものであり最小応答時
間と最大応答時間の組を複数個設定したテーブルを示す
。
間と最大応答時間の組を複数個設定したテーブルを示す
。
第５図も、応用実施例で使用するものでありＩＣカード
から端末装置あてのデータ例を示す次に本発明を具体的
に実現する手段を図面を用いて説明する。
から端末装置あてのデータ例を示す次に本発明を具体的
に実現する手段を図面を用いて説明する。
第１図における問い合わせ送信回路２は、処理部７によ
り起動され、送受信回路にメツセージを渡したのち、応
答時間監視回路４に起動をかける。起動をかけられた応
答時間監視回路４は、タイマ８を用いて時間のカウント
を開始する。また最小応答時間保持レジスタ（以下最小
時間レジスタと略す）５と最大応答時間保持レジスタ（
以下最大時間レジスタ）６には、あらかじめ数値がセッ
トしである。
り起動され、送受信回路にメツセージを渡したのち、応
答時間監視回路４に起動をかける。起動をかけられた応
答時間監視回路４は、タイマ８を用いて時間のカウント
を開始する。また最小応答時間保持レジスタ（以下最小
時間レジスタと略す）５と最大応答時間保持レジスタ（
以下最大時間レジスタ）６には、あらかじめ数値がセッ
トしである。
第２図における送受信回路９はＩＣカードからの問い合
わせデータを受信すると、問い合わせ受信回路１１にデ
ータを渡す０問い合わせ受信回路１１け、データを受け
とると同時に応答時間調節回路１２に起動をかけ、応答
時間調節回路１２はタイマ１６を用いて時間のカウント
を開始する。データを問い合わせ受信回路１１から処理
部１５に渡し処理を行った後、処理部１５Ｆｉ回答送信
回路１０に回答送信依頼する。
わせデータを受信すると、問い合わせ受信回路１１にデ
ータを渡す０問い合わせ受信回路１１け、データを受け
とると同時に応答時間調節回路１２に起動をかけ、応答
時間調節回路１２はタイマ１６を用いて時間のカウント
を開始する。データを問い合わせ受信回路１１から処理
部１５に渡し処理を行った後、処理部１５Ｆｉ回答送信
回路１０に回答送信依頼する。
ここで応答時間調節回路１２は、第３図に示す応答時間
が、第２図の最小時間レジスタ１３と最大時間レジスタ
１４にセットされている最小応答時間と最大応答時間の
平均になるように回答送信回路１０を調節する。最小応
答時間と最大応答時間はＩＣカードと同じ値である６回
答送信回路１０から送受信回路９をへて第１図の送受信
回路１へ、そして応答受信回路３へと回答が渡されると
、応答時間監視回路４はタイマ８によってカウントして
いた時間が最小応答時間と最大応答時間の間に入ってい
るかチェックし、時間内なら正常応答、時間外なら不正
応答とし処理部７に連絡する。
が、第２図の最小時間レジスタ１３と最大時間レジスタ
１４にセットされている最小応答時間と最大応答時間の
平均になるように回答送信回路１０を調節する。最小応
答時間と最大応答時間はＩＣカードと同じ値である６回
答送信回路１０から送受信回路９をへて第１図の送受信
回路１へ、そして応答受信回路３へと回答が渡されると
、応答時間監視回路４はタイマ８によってカウントして
いた時間が最小応答時間と最大応答時間の間に入ってい
るかチェックし、時間内なら正常応答、時間外なら不正
応答とし処理部７に連絡する。
これＫより不正にＩＣカードよりデータを引き出そうと
して、不正な手段でＩＣカードに応答を返した場合は、
最小応答時間と最大応答時間の間に応答時間が入るとい
う確率が非常に小さい。よってＩＣカード側で不正検出
ができる上記した実施例は最小応答時間と最大応答時間
を固定しているが、固定せずに実施する場合を第６図の
フローチャートに添って説明する。
して、不正な手段でＩＣカードに応答を返した場合は、
最小応答時間と最大応答時間の間に応答時間が入るとい
う確率が非常に小さい。よってＩＣカード側で不正検出
ができる上記した実施例は最小応答時間と最大応答時間
を固定しているが、固定せずに実施する場合を第６図の
フローチャートに添って説明する。
まず第４図に示すような最小応答時間と最大応答時間の
テーブルをＩＣカードと端末装置内に設けておく。ＩＣ
カードは動作を開始すると送信メツセージを作成しく第
６図５ＴＥＰ１）次に第１図の処理部７において００〜
９９の乱数を発生させ（ＳＴＥＰ２）数値を１つ選択す
る。
テーブルをＩＣカードと端末装置内に設けておく。ＩＣ
カードは動作を開始すると送信メツセージを作成しく第
６図５ＴＥＰ１）次に第１図の処理部７において００〜
９９の乱数を発生させ（ＳＴＥＰ２）数値を１つ選択す
る。
それをテーブル番号として第４図のテーブルより最小応
答時間と最大応答時間を求め最小時間レジスタ５と最大
時間レジスタ６にセットする。
答時間と最大応答時間を求め最小時間レジスタ５と最大
時間レジスタ６にセットする。
（ＳＴＥＰ５）そして第５図に示すように、端末に送信
するメツセージ上にテーブル番号をセットしく５ＴＥＰ
４）問い合わせ送信回路２に送信依頼する。（ＳＴＥＰ
５）メツセージを受は取った端末の処理部１５ＶｉＩＣ
カードの場合と同様にテーブルよりテーブル番号に対応
する最小応答時間と最大応答時間を求め、最小時間レジ
スタ１５と最大時間レジスタ１４にセットし、その時間
内にＩＣカードに回答を送信する。
するメツセージ上にテーブル番号をセットしく５ＴＥＰ
４）問い合わせ送信回路２に送信依頼する。（ＳＴＥＰ
５）メツセージを受は取った端末の処理部１５ＶｉＩＣ
カードの場合と同様にテーブルよりテーブル番号に対応
する最小応答時間と最大応答時間を求め、最小時間レジ
スタ１５と最大時間レジスタ１４にセットし、その時間
内にＩＣカードに回答を送信する。
その間ＩＣカードは時間をカウントしながら受信終了を
待っている。（ＳＴＥＰ６）回答を受信するとその応答
時間が最小応答時間と最大応答時間内であるか判定し、
（ＳＴＥＰ７）時間内であればす°トライカウンタ（応
答時間が異常だった場合の回数をカウントするもの）を
クリアしく５ＴＥＰ８）受信メツセージを処理する。
待っている。（ＳＴＥＰ６）回答を受信するとその応答
時間が最小応答時間と最大応答時間内であるか判定し、
（ＳＴＥＰ７）時間内であればす°トライカウンタ（応
答時間が異常だった場合の回数をカウントするもの）を
クリアしく５ＴＥＰ８）受信メツセージを処理する。
（ＳＴＥＰ９）処理が続くならば（ＳＴＥＰｌｏ）ＳＴ
ＥＰＩへ戻り同様の処理をする。応答時間が最小応答時
間と最大応答時間内でなかった場合は、リトライカウン
タを＋ＩＬ（ＳＴＥＰｌｌ）次にリトライカウンタの数
値が許容範囲を越えていないか判定する。（ＳＴＥＰ１
２）許容範囲を越えていなければ５ＴＥＰ１へ行き再度
同一メツセージを送信する。許容範囲を越えている時は
、ＩＣカードを無効としく５ＴＥＰ １ｓ ）終了する
。
ＥＰＩへ戻り同様の処理をする。応答時間が最小応答時
間と最大応答時間内でなかった場合は、リトライカウン
タを＋ＩＬ（ＳＴＥＰｌｌ）次にリトライカウンタの数
値が許容範囲を越えていないか判定する。（ＳＴＥＰ１
２）許容範囲を越えていなければ５ＴＥＰ１へ行き再度
同一メツセージを送信する。許容範囲を越えている時は
、ＩＣカードを無効としく５ＴＥＰ １ｓ ）終了する
。
最小応答時間と最大応答時間を固定にした場合は測定器
で応答時間を測られることにより容易に外部に知られて
しまうが、このように乱数で最小応答時間と最大応答時
間を指定すれば測定器で調べても全く無意味なことであ
り、最小応答時間と最大応答時間を知ることは、まず不
可能である。よってＩＣカードのセキュリティを向上す
ることができる。
で応答時間を測られることにより容易に外部に知られて
しまうが、このように乱数で最小応答時間と最大応答時
間を指定すれば測定器で調べても全く無意味なことであ
り、最小応答時間と最大応答時間を知ることは、まず不
可能である。よってＩＣカードのセキュリティを向上す
ることができる。
本実施例はＩＣカードが端末側の不正を検出するもので
あるが、前述実施例のごとき機能を端末装置にもたせる
ことにより、端末側がＩＣカードの不正を検出すること
もできる。また端末装置およびＩＣカードの両方に該機
能を有することにより、相互監視することも可能である
。
あるが、前述実施例のごとき機能を端末装置にもたせる
ことにより、端末側がＩＣカードの不正を検出すること
もできる。また端末装置およびＩＣカードの両方に該機
能を有することにより、相互監視することも可能である
。
以上述べたように本発明によれば、ＩＣカードと端末装
置のデータの受は渡しを最小応答時間と最大応答時間内
に行うようにしたので、不正にＩＣカードとやりとりを
行おうとしても、上記の時間内に回答を返すことは非常
に困難なため、ＩＣカードで不正を検出でき、データ漏
えいを防止できるという効果がある。
置のデータの受は渡しを最小応答時間と最大応答時間内
に行うようにしたので、不正にＩＣカードとやりとりを
行おうとしても、上記の時間内に回答を返すことは非常
に困難なため、ＩＣカードで不正を検出でき、データ漏
えいを防止できるという効果がある。
第１図は本発明の一実施例のＩＣカードの回路図、第２
図は、端末装置の回路図、第５図は応答時間の説明図、
第４図は、ＩＣカード及び端末装置に保有している最小
応答時間と最大応答時間の表示図、ｆ４５図は、ＩＣカ
ードから端末装置へ送信するデータを示す表示図、第６
図は本発明の実施例のフローチャートである。 １・・・送受信回路、２・・・問い合わせ送信回路、５
・・応答受信回路、４・・・応答時間監視回路、５・・
最小応答時間保持レジスタ、 ６・・・最大応答時間保持レジスタ、 ７・・・処理部、８・・・タイマ、９・・・送受信回路
、１０・回答送信回路、１１・・・問い合わせ受信回路
、１２・・・応答時間調節回路、 １３・・・最小応答時間保持レジスタ、１４・・・最大
応答時間保持レジスタ、１５・・処理部、 １６・・・
タイマ。 ’、ｆ、、ｔ 図 第２図 第３図 ｖ−Ｉ ４ 図 第 ５ 図
図は、端末装置の回路図、第５図は応答時間の説明図、
第４図は、ＩＣカード及び端末装置に保有している最小
応答時間と最大応答時間の表示図、ｆ４５図は、ＩＣカ
ードから端末装置へ送信するデータを示す表示図、第６
図は本発明の実施例のフローチャートである。 １・・・送受信回路、２・・・問い合わせ送信回路、５
・・応答受信回路、４・・・応答時間監視回路、５・・
最小応答時間保持レジスタ、 ６・・・最大応答時間保持レジスタ、 ７・・・処理部、８・・・タイマ、９・・・送受信回路
、１０・回答送信回路、１１・・・問い合わせ受信回路
、１２・・・応答時間調節回路、 １３・・・最小応答時間保持レジスタ、１４・・・最大
応答時間保持レジスタ、１５・・処理部、 １６・・・
タイマ。 ’、ｆ、、ｔ 図 第２図 第３図 ｖ−Ｉ ４ 図 第 ５ 図
Claims (1)
- １． ＣＰＵとメモリとタイマから成るＩＣカードにお
いて、最小応答時間保持レジスタと最大応答時間保持レ
ジスタと応答時間監視回路を設け、端末からの応答が上
記２つのレジスタにセットされている最小応答時間と最
大応答時間の間に返ってこない場合は不正とみなすこと
を特徴とするＩＣカード不正検出方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60036381A JPS61196368A (ja) | 1985-02-27 | 1985-02-27 | Ｉｃカ−ド不正検出方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60036381A JPS61196368A (ja) | 1985-02-27 | 1985-02-27 | Ｉｃカ−ド不正検出方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61196368A true JPS61196368A (ja) | 1986-08-30 |
Family
ID=12468264
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60036381A Pending JPS61196368A (ja) | 1985-02-27 | 1985-02-27 | Ｉｃカ−ド不正検出方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61196368A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2007145366A1 (en) * | 2006-06-15 | 2007-12-21 | Kabushiki Kaisha Toshiba | Portable electronic device and control method thereof |
-
1985
- 1985-02-27 JP JP60036381A patent/JPS61196368A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2007145366A1 (en) * | 2006-06-15 | 2007-12-21 | Kabushiki Kaisha Toshiba | Portable electronic device and control method thereof |
| US8595826B2 (en) | 2006-06-15 | 2013-11-26 | Kabushiki Kaisha Toshiba | Portable electronic device and control method thereof |
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