JPS6116758Y2 - - Google Patents
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- JPS6116758Y2 JPS6116758Y2 JP11039477U JP11039477U JPS6116758Y2 JP S6116758 Y2 JPS6116758 Y2 JP S6116758Y2 JP 11039477 U JP11039477 U JP 11039477U JP 11039477 U JP11039477 U JP 11039477U JP S6116758 Y2 JPS6116758 Y2 JP S6116758Y2
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Landscapes
- Protection Of Static Devices (AREA)
- Control Of Voltage And Current In General (AREA)
- Power Conversion In General (AREA)
Description
【考案の詳細な説明】
(産業上の利用分野)
本考案は、サイリスタ変換装置における停電時
のサイリスタ素子の破壊を防止し、あるいはサイ
リスタ素子保護用フユーズ溶断を防止するように
した停電保護装置に関し、とくに、逆並列接続方
式可逆サイリスタレオナード装置において、イン
バータ動作を行つているときの主回路電源停電や
移相器電源停電に対するサイリスタ素子の保護お
よびフユーズ溶断防止装置に係る。[Detailed description of the invention] (Field of industrial application) The present invention relates to a power failure protection device that prevents the destruction of the thyristor element in a thyristor conversion device during a power outage, or prevents the fuse for protecting the thyristor element from blowing out. In particular, the present invention relates to protection of thyristor elements and fuse blowout prevention device against main circuit power outage or phase shifter power outage during inverter operation in an anti-parallel connection type reversible thyristor Leonard device.
(従来の技術)
インバータ動作を行うサイリスタレオナード装
置において、インバータ動作中に主回路電源が停
電すると直流短絡を生じ、また移相器電源が停電
すると、ゲートパルス消失による転流失敗を生じ
る。いずれの場合にもサイリスタ素子が破壊され
るおそれがあり、またサイリスタ素子保護用フユ
ーズが溶断され取り替えを要する。(Prior Art) In a thyristor Leonard device that performs inverter operation, if the main circuit power supply fails during inverter operation, a DC short circuit occurs, and if the phase shifter power supply fails, commutation failure occurs due to loss of gate pulses. In either case, there is a risk that the thyristor element will be destroyed, and the fuse for protecting the thyristor element will be blown out and must be replaced.
このため従来は、移相器電源に誘導電動機ある
いはコンデンサの充電回路を並列接続して、主回
路電源が停電しても誘導電動機の残留電圧あるい
はコンデンサの放電電圧によつてしばらくのあい
だ移相器電源が確保されるようにして、主回路の
高速度遮断器が完全に開放するまでゲートパルス
が消滅しないようにしている。 For this reason, in the past, an induction motor or a capacitor charging circuit was connected in parallel to the phase shifter power supply, and even if the main circuit power supply failed, the phase shifter would continue to operate for a while due to the residual voltage of the induction motor or the discharge voltage of the capacitor. The power supply is ensured so that the gate pulse does not disappear until the high-speed circuit breaker in the main circuit is completely opened.
第1図は、誘導電動機を用いた従来例を示す回
路のブロツクダイアグラムで、100は停電保護
装置、101はサイリスタスイツチ、102は低
電圧リレー、103は誘導電動機、104はサイ
リスタ変換装置制御部、105はサイリスタレオ
ナード主回路部、106は高速度遮断器、107
は直流電動機、108は直流リアクトル、109
はサイリスタで図示しない保護フユーズをそれぞ
れ直列に設けている。110は三相主回路電源で
ある。 FIG. 1 is a block diagram of a circuit showing a conventional example using an induction motor, in which 100 is a power failure protection device, 101 is a thyristor switch, 102 is a low voltage relay, 103 is an induction motor, 104 is a thyristor converter control unit, 105 is a thyristor Leonard main circuit section, 106 is a high speed circuit breaker, 107
is a DC motor, 108 is a DC reactor, 109
are thyristors and are connected in series with protective fuses (not shown). 110 is a three-phase main circuit power supply.
停電時には低電圧リレー102が主回路電源電
圧の低下を検出して、高速度遮断器106を開路
するとともに、サイリスタスイツチ101を開路
状態にしてサイリスタ変換装置制御部104内の
移相器(図示せず)電源を主回路電源110から
誘導電動機103による残留誘起電圧に切りかえ
る。また、低電圧リレー102からゲートブロツ
ク信号がサイリスタ変換装置制御部104に与え
られて、ゲートパルスは制御遅れ角α゜(=約
150゜)の位置に固定される。 During a power outage, the low voltage relay 102 detects a drop in the main circuit power supply voltage and opens the high-speed circuit breaker 106, and also opens the thyristor switch 101 to open the phase shifter (not shown) in the thyristor converter control unit 104. 1) Switch the power source from the main circuit power source 110 to the residual induced voltage generated by the induction motor 103. Further, a gate block signal is given from the low voltage relay 102 to the thyristor converter control unit 104, and the gate pulse is generated at a control delay angle α° (=approximately
150°).
(考案が解決しようとする問題点)
ところがこのような従来例においては、誘導電
動機あるいはコンデンサによる電源の切りかえに
より、基準となる位相がなくなるため、切りかえ
後のゲートブロツク信号によるサイリスタ制御位
相が主回路電源による停電前の位相と一致しない
ことがあり、転流が円滑に行われずにサイリスタ
素子を損傷するおそれがあるだけでなく、回転機
を用いるものでは振動や騒音を生じるなどの欠点
があつた。(Problem that the invention aims to solve) However, in such a conventional example, the reference phase disappears when the power supply is switched by the induction motor or the capacitor, so the thyristor control phase by the gate block signal after switching is changed to the main circuit. The phase may not match the phase before the power outage, and commutation may not occur smoothly, potentially damaging the thyristor element. In addition, those using a rotating machine have drawbacks such as vibration and noise. .
(問題点を解決するための手段)
本考案は、以上のような欠点をなくすようにし
たもので、停電時の移送器電源にコンデンサを用
いるとともに、定常状態(停電前の状態)におけ
る移相器電源の1相を基準にして、鋸歯状波方式
によるトリガパルス発生器およびリングカウンタ
を備えた回路によつて、サイリスタ制御位相と同
期したゲートブロツク信号を発生させておき、電
源切りかえ時にこのゲートブロツク信号によつて
ゲートパルスの位相を一致させるようにしてあ
る。(Means for solving the problem) The present invention is designed to eliminate the above-mentioned drawbacks, and uses a capacitor as the power source for the transfer device during a power outage. A gate block signal synchronized with the thyristor control phase is generated by a circuit equipped with a sawtooth wave type trigger pulse generator and a ring counter using one phase of the device power supply as a reference, and this gate block signal is synchronized with the thyristor control phase when switching the power supply. The phases of the gate pulses are matched by a block signal.
(実施例)
第2図は、本考案の一実施例を示す回路のブロ
ツクダイアグラムである。第1図と同じ符号は同
一部分を示している。200は本考案の停電保護
装置、201はサイリスタ変換装置制御部、20
2は低電圧リレー、203は転流重なり区間での
誤動作を防ぐための低域通過フイルタ、204は
低域通過フイルタ203からの遅れ信号Fにより
制御遅れ角α゜(=約150゜)のトリガパルス発
生器、205は単安定マルチバイブレータ、20
6はクロツクパルス発生器、207はリングカウ
ンタ、208はダイオード、209はコンデンサ
である。(Embodiment) FIG. 2 is a block diagram of a circuit showing an embodiment of the present invention. The same reference numerals as in FIG. 1 indicate the same parts. 200 is a power failure protection device of the present invention, 201 is a thyristor converter control unit, 20
2 is a low-voltage relay, 203 is a low-pass filter to prevent malfunction in the commutation overlap section, and 204 is a trigger for control delay angle α° (= about 150°) by delay signal F from low-pass filter 203. Pulse generator, 205 monostable multivibrator, 20
6 is a clock pulse generator, 207 is a ring counter, 208 is a diode, and 209 is a capacitor.
定常状態において、主回路電源110からの給
電によつて、サイリスタ変換装置制御部201内
でサイリスタ素子数に応じてこの実施例では6相
に変換された移相器電源Eがつくられ、このうち
の一相たとえばR−Sを基準とし、この電圧と同
期した信号Dを低域通過フイルタ203に加えて
位相を遅らせた、遅れ信号Fをトリガパルス発生
器204に入力させる。トリガパルス発生器20
4は昭和48年特許出願公告第21187号に開示され
ているような手段で、この遅れ信号Fの負の区間
で鋸歯状台形波SWを発生させ、基準バイアス電
圧VB等としくなつたとき、制御遅れ角α゜(=
約150゜)のパルス信号KPを送出させる。このパ
ルス信号KPで単安定マルチバイブレータ205
をトリガさせ、単安定マルチバイブレータ205
から、電源周波数に応じて1サイクル分たとえば
50Hzのときは約20ミリ秒幅のインヒビツト信号
INを送出する。このインヒビツト信号INが送出
される間に、クロツクパルス発生器206からサ
イリスタ素子数に応じた6個のクロツクパルス
CLが送出される。このクロツクパルスCLは6段
リングカウンタ207に入り、各クロツクパルス
ごとにゲートブロツク信号CB1〜CB6を発生さ
せる。 In a steady state, a phase shifter power supply E, which is converted into six phases in this embodiment according to the number of thyristor elements, is created in the thyristor converter control unit 201 by power supply from the main circuit power supply 110, and among these, A signal D synchronized with this voltage, for example, R-S, is applied to a low-pass filter 203, and a delayed signal F, whose phase is delayed, is input to a trigger pulse generator 204. Trigger pulse generator 20
4 is a means as disclosed in Patent Application Publication No. 21187 of 1971, when a sawtooth trapezoidal wave SW is generated in the negative section of this delayed signal F, and the reference bias voltage V B etc. , control delay angle α゜(=
A pulse signal KP of approximately 150°) is sent out. With this pulse signal KP, the monostable multivibrator 205
Trigger the monostable multivibrator 205
For example, for one cycle depending on the power supply frequency,
At 50Hz, the inhibit signal is approximately 20ms wide.
Send IN. While this inhibit signal IN is being sent, the clock pulse generator 206 generates six clock pulses corresponding to the number of thyristor elements.
CL is sent. This clock pulse CL enters a six-stage ring counter 207, which generates gate block signals CB1 to CB6 for each clock pulse.
しかるに、定常状態では、低電圧リレー202
から常にクリア(またはリセツト)信号Kが送出
されているため、リングカウンタ207からゲー
トブロツク信号GBは送出されない。 However, in steady state, low voltage relay 202
Since the clear (or reset) signal K is always sent from the ring counter 207, the gate block signal GB is not sent from the ring counter 207.
たとえば、時間tにおいて停電などにより主回
路電源電圧あるいは移相器電源電圧が低下する
と、低電圧リレー202が電圧低下を検出し、サ
イリスタ変換装置制御部201内で移相器に入る
信号を遮断させる信号Tを送出するともに、高速
度遮断器106を開路する信号HSおよび単安定
マルチバイブレータ205の出力を保持させる信
号Hを送出し、クリア信号Kを消失させる。ま
た、主回路電源にかわつて、定常状態でダイオー
ド208を通して蓄えられたコンデンサ209の
放電電圧Sが各部の電源として放電される。 For example, if the main circuit power supply voltage or the phase shifter power supply voltage drops at time t due to a power outage or the like, the low voltage relay 202 detects the voltage drop and cuts off the signal entering the phase shifter within the thyristor converter control unit 201. In addition to sending out the signal T, the signal HS which opens the high-speed circuit breaker 106 and the signal H which holds the output of the monostable multivibrator 205 are sent out, and the clear signal K disappears. Further, instead of the main circuit power supply, the discharge voltage S of the capacitor 209 stored through the diode 208 in a steady state is discharged as a power supply for each part.
このため、移相器は信号Tにより移相器電源E
に応じた位相で発生していた定常のゲートパルス
が消去され、電源がコンデンサ209の放電電圧
Sに切りかえられるとともに、リングカウンタ2
07から送出されるゲートブロツク信号GBにし
たがつてゲートパルスGPを送出し、コンデンサ
209に蓄えられた電荷が放電終了するまでゲー
トパルスGPを継続させ、この間に高速度遮断器
106が完全に開路される。 Therefore, the phase shifter is powered by the phase shifter power supply E by the signal T.
The steady gate pulse that had been generated at a phase corresponding to
The gate pulse GP is sent out in accordance with the gate block signal GB sent from the capacitor 209, and the gate pulse GP is continued until the charge stored in the capacitor 209 finishes discharging. During this time, the high speed circuit breaker 106 is completely opened. be done.
(本考案の効果)
このように、本考案では、リングカウンタから
のゲートブロツク信号を定常状態のときから、電
源電圧の一相を基準にして発生させており、停電
などの電圧低下により移相器電源が主回路電源か
らコンデンサに蓄えられた放電電圧に切りかえら
れたあとのゲートパルスを前記ゲートブロツク信
号によつて発生させ、その位相を切りかえ前の位
相と完全に一致させることができ、サイリスタ電
流を安全に減流させ、確実な保護を行い得るとと
もに、リングカウンタおよび単安定マルチバイブ
レータなどはC2MOS(Clocked Complementary
Metal Oxide Semiconductor)で構成されている
ため消費電力が少なく、コンデンサ容量が小さく
ても、高速度遮断器が完全に開路するまで装置を
安定に働かせることができ、装置が小形になるな
どの効果がある。(Effects of the present invention) As described above, in the present invention, the gate block signal from the ring counter is generated based on one phase of the power supply voltage even in a steady state, and the phase shift occurs due to a voltage drop such as a power outage. The gate pulse after the device power source is switched from the main circuit power source to the discharge voltage stored in the capacitor is generated by the gate block signal, and its phase can be completely matched with the previous phase, and the thyristor In addition to safely reducing the current and providing reliable protection, ring counters and monostable multivibrators are also equipped with C2MOS (Clocked Complementary
Metal Oxide Semiconductor), it consumes less power, and even if the capacitor capacity is small, the device can operate stably until the high-speed circuit breaker is completely opened, and the device can be made smaller. be.
第1図は従来例の回路を示すブロツクダイアグ
ラム、第2図は本考案の実施例を示すブロツクダ
イアグラム、第3図は第2図の回路各部の入出力
信号のタイムチヤートである。
100……従来の停電保護装置、101……サ
イリスタスイツチ、102……低電圧リレー、1
03……誘導電動機、104……サイリスタ変換
装置制御部、105……サイリスタレオナード主
回路部、106……高速度遮断器、107……直
流電動機、108……直流リアクトル、109…
…サイリスタ、110……三相主回路電源、20
0……本考案の停電保護装置、201……サイリ
スタ変換装置制御部、202……低電圧リレー、
203……低域通過フイルタ、204……トリガ
パルス発生器、205……単安定マルチバイブレ
ータ、206……クロツクパルス発生器、207
……リングカウンタ、208……ダイオード、2
09……コンデンサ。
FIG. 1 is a block diagram showing a conventional circuit, FIG. 2 is a block diagram showing an embodiment of the present invention, and FIG. 3 is a time chart of input and output signals of various parts of the circuit shown in FIG. 100... Conventional power failure protection device, 101... Thyristor switch, 102... Low voltage relay, 1
03...Induction motor, 104...Thyristor conversion device control section, 105...Thyristor Leonard main circuit section, 106...High speed circuit breaker, 107...DC motor, 108...DC reactor, 109...
...Thyristor, 110...Three-phase main circuit power supply, 20
0... Power outage protection device of the present invention, 201... Thyristor converter control unit, 202... Low voltage relay,
203... Low pass filter, 204... Trigger pulse generator, 205... Monostable multivibrator, 206... Clock pulse generator, 207
...Ring counter, 208 ...Diode, 2
09...Capacitor.
Claims (1)
の低下時に放電電圧を供給してゲートパルスを維
持するようにしたサイリスタ変換装置において、
定常状態の移相器電源電圧位相に応じてトリガパ
ルスを送出するトリガパルス発生器と、前記トリ
ガパルスを入力し電源電圧低下時にも保持される
インヒビツト信号を送出する単安定マルチバイブ
レータと、前記インヒビツト信号が送出されてい
る間に所定数のクロクパルスを送出するクロツク
パルス発生器と、前記クロツクパルスごとに順次
ゲートパルスを生じさせるためのゲートブロツク
信号をつくり、このゲートブロツク信号を電源電
圧の低下時に送出するリングカウンタをそなえた
ことを特徴とする停電保護装置。 In a thyristor conversion device that maintains a gate pulse by supplying a discharge voltage when the power supply voltage drops using a capacitor charged in a steady state,
a trigger pulse generator that sends out a trigger pulse according to the phase of the phase shifter power supply voltage in a steady state; a monostable multivibrator that receives the trigger pulse and sends out an inhibit signal that is maintained even when the power supply voltage drops; A clock pulse generator that sends out a predetermined number of clock pulses while a signal is being sent, a gate block signal that generates gate pulses sequentially for each of the clock pulses, and this gate block signal that is sent out when the power supply voltage drops. A power outage protection device featuring a ring counter.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP11039477U JPS6116758Y2 (en) | 1977-08-17 | 1977-08-17 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP11039477U JPS6116758Y2 (en) | 1977-08-17 | 1977-08-17 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5437057U JPS5437057U (en) | 1979-03-10 |
JPS6116758Y2 true JPS6116758Y2 (en) | 1986-05-23 |
Family
ID=29057233
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP11039477U Expired JPS6116758Y2 (en) | 1977-08-17 | 1977-08-17 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6116758Y2 (en) |
-
1977
- 1977-08-17 JP JP11039477U patent/JPS6116758Y2/ja not_active Expired
Also Published As
Publication number | Publication date |
---|---|
JPS5437057U (en) | 1979-03-10 |
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