JPS61131255U - - Google Patents
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- Publication number
- JPS61131255U JPS61131255U JP1216285U JP1216285U JPS61131255U JP S61131255 U JPS61131255 U JP S61131255U JP 1216285 U JP1216285 U JP 1216285U JP 1216285 U JP1216285 U JP 1216285U JP S61131255 U JPS61131255 U JP S61131255U
- Authority
- JP
- Japan
- Prior art keywords
- switches
- data
- loop counter
- read
- display device
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Techniques For Improving Reliability Of Storages (AREA)
- Debugging And Monitoring (AREA)
- Digital Computer Display Output (AREA)
Description
第１図は本考案の一実施例を示す構成図、第２
図は従来のデータチエツク回路を示す図である。 １…記憶部、２…切換スイツチ、３…表示装置
、４…ループカウンタ、５…操作スイツチ。
図は従来のデータチエツク回路を示す図である。 １…記憶部、２…切換スイツチ、３…表示装置
、４…ループカウンタ、５…操作スイツチ。
Claims (1)
- 複数のデータを格納する記憶部と、この複数の
記憶部に各々接続されて格納データを読出す複数
のスイツチと、この複数のスイツチを順次切換え
操作するループカウンタと、このループカウンタ
に歩進入力信号を供給する操作スイツチと、上記
複数のスイツチにより読出されたデータを表示す
る表示装置を有することを特徴とするデータチエ
ツク回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1216285U JPS61131255U (ja) | 1985-02-01 | 1985-02-01 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1216285U JPS61131255U (ja) | 1985-02-01 | 1985-02-01 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61131255U true JPS61131255U (ja) | 1986-08-16 |
Family
ID=30494961
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1216285U Pending JPS61131255U (ja) | 1985-02-01 | 1985-02-01 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61131255U (ja) |
-
1985
- 1985-02-01 JP JP1216285U patent/JPS61131255U/ja active Pending
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