JPS61126347U - - Google Patents
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- Publication number
- JPS61126347U JPS61126347U JP575485U JP575485U JPS61126347U JP S61126347 U JPS61126347 U JP S61126347U JP 575485 U JP575485 U JP 575485U JP 575485 U JP575485 U JP 575485U JP S61126347 U JPS61126347 U JP S61126347U
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- JP
- Japan
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- count
- register
- holding register
- holding
- cpu
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- Pending
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- 238000010586 diagram Methods 0.000 description 1
Description
第１図は本考案のインターバルタイマの１実施
例の回路構成図である。 ５……第１保持レジスタ、８……第１カウント
レジスタ、６……第２保持レジスタ、９……第２
カウントレジスタ。
例の回路構成図である。 ５……第１保持レジスタ、８……第１カウント
レジスタ、６……第２保持レジスタ、９……第２
カウントレジスタ。
Claims (1)
- ＣＰＵからの指令に基づいて第１の設定データ
が設定される第１保持レジスタと、カウントパル
ス発生部からのカウントパルスを計数する第１カ
ウントレジスタと、前記ＣＰＵの指令に基づいて
第２の設定データが設定される第２保持レジスタ
と、前記カウントパルス発生部からのカウントパ
ルスを計数する第２カウントレジスタと、を備え
、前記第１保持レジスタの内容と前記第１カウン
トレジスタによる計数値とが一致したときに第１
割込発生信号を発生し、前記第２保持レジスタの
内容と前記第２カウントレジスタによる計数値と
が一致したときに第２割込発生信号を発生するこ
とを特徴とするインターバルタイマ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP575485U JPS61126347U (ja) | 1985-01-18 | 1985-01-18 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP575485U JPS61126347U (ja) | 1985-01-18 | 1985-01-18 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61126347U true JPS61126347U (ja) | 1986-08-08 |
Family
ID=30482552
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP575485U Pending JPS61126347U (ja) | 1985-01-18 | 1985-01-18 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61126347U (ja) |
-
1985
- 1985-01-18 JP JP575485U patent/JPS61126347U/ja active Pending
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