JPS61102992U - - Google Patents

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JPS61102992U
JPS61102992U JP18672484U JP18672484U JPS61102992U JP S61102992 U JPS61102992 U JP S61102992U JP 18672484 U JP18672484 U JP 18672484U JP 18672484 U JP18672484 U JP 18672484U JP S61102992 U JPS61102992 U JP S61102992U
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JP
Japan
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processing
switch input
measured value
performs
switch
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JP18672484U
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Description

【図面の簡単な説明】
図面はこの考案の一実施例を示したもので、第
1図はこの考案を適用したストツプウオツチ付電
子腕時計のブロツク回路図、第2図はその表示部
の構成とスイツチの種類を示した図、第3図はス
トツプウオツチ機能を説明する為にスイツチ操作
に応じて変換する表示状態図、第4図は第1図で
示した計時タイミング信号発生回路の構成図、第
5図は第1図で示したRAMの構成図、第6図は
全体動作の概要を示すジエネレールフローチヤー
ト、第7図は第6図におけるS処理の具体的内
容を示すフローチヤート、第8図は第6図におけ
るS処理の具体的内容を示すフローチヤート、
第9図は計時処理サブルーチンの具体的内容を示
したフローチヤート、第10図は表示処理サブル
ーチンの具体的内容を示したフローチヤートであ
る。 11……発振回路、13……計時タイミング信
号発生回路、16……ROM、17……入力部、
18……RAM、21……演算部。

Claims (1)

    【実用新案登録請求の範囲】
  1. 一定時間毎の計時タイミングで計時処理及び表
    示処理を行なうと共に計測値を表示させる為のス
    イツチ入力があつた際にスイツチ処理を行なうマ
    イクロプログラム制御方式のストツプウオツチ装
    置において、前記スイツチ入力による計測値の表
    示処理を前記スイツチ入力の次の計時タイミング
    で行なわせる手段を設けたことを特徴とするスト
    ツプウオツチ装置。
JP18672484U 1984-12-11 1984-12-11 Pending JPS61102992U (ja)

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JP18672484U JPS61102992U (ja) 1984-12-11 1984-12-11

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Application Number Priority Date Filing Date Title
JP18672484U JPS61102992U (ja) 1984-12-11 1984-12-11

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Publication Number Publication Date
JPS61102992U true JPS61102992U (ja) 1986-07-01

Family

ID=30744189

Family Applications (1)

Application Number Title Priority Date Filing Date
JP18672484U Pending JPS61102992U (ja) 1984-12-11 1984-12-11

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