JPS6088620U - レベル制限回路 - Google Patents

レベル制限回路

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JPS6088620U
JPS6088620U JP17963183U JP17963183U JPS6088620U JP S6088620 U JPS6088620 U JP S6088620U JP 17963183 U JP17963183 U JP 17963183U JP 17963183 U JP17963183 U JP 17963183U JP S6088620 U JPS6088620 U JP S6088620U
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JP
Japan
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circuit
input terminal
input
limit circuit
level limit
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Pending
Application number
JP17963183U
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English (en)
Inventor
達夫 田中
Original Assignee
株式会社東芝
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Publication date
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Publication of JPS6088620U publication Critical patent/JPS6088620U/ja
Pending legal-status Critical Current

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Landscapes

  • Signal Processing Not Specific To The Method Of Recording And Reproducing (AREA)
  • Tone Control, Compression And Expansion, Limiting Amplitude (AREA)
  • Amplifiers (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図及び第２図はそれぞれ従来のレベル制限回路を示
す回路構成図及びその動作を説明するための波形図、第
３図はこの考案に係るレベル制限回路の一実施例を示す
ブロック回路構成図、第４図は同実施例の差動回路の具
体例を示すブロック回路構成図、第５図は同実施例を具
体的な回路素子で構成した一例を示す回路構成図、第６
図及び第７図はそれぞれ第５図に示す回路の動作を説明
するための等価回路図及び波形図である。 １１・・・入力端子、１２・・・出力端子、１３・・・
入力端子、１４・・・差動回路、１５・・・出力端子、
１６・・・定電圧源、１７・・・定電流源、１８．１９
・・・負荷回路、２０・・・電源端子、２１・・・演算
増幅器、２２・・・信号源、２３・・・第１のカレント
ミラー回路、２４・・・第２のカレントミラー回路、２
５・・・第３のカレントミラー回路。 〜Ｑ４ 〜Ｑ６ ξ ４ ５

Claims (1)

    【実用新案登録請求の範囲】
  1. 、　　　　　　第１の入力端に交流電圧信号が入力され
    第２の入力端に出力電流が入力されるとともに該出力電
    流が内部電流源の出力電流で制限されるボルテージフォ
    ロワ構成の差動回路を備え、前記差動回路の第１の入力
    端及び出力端にそれぞれ抵抗及び負荷抵抗を介してバイ
    アス電圧を印加するようにしてなることを特徴とするレ
    ベル制限回路。
JP17963183U 1983-11-21 1983-11-21 レベル制限回路 Pending JPS6088620U (ja)

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JPS6088620U true JPS6088620U (ja) 1985-06-18

Family

ID=30389699

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