JPS6082395U - ロ−ドサ−ベイ装置 - Google Patents

ロ−ドサ−ベイ装置

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Publication number
JPS6082395U
JPS6082395U JP17453983U JP17453983U JPS6082395U JP S6082395 U JPS6082395 U JP S6082395U JP 17453983 U JP17453983 U JP 17453983U JP 17453983 U JP17453983 U JP 17453983U JP S6082395 U JPS6082395 U JP S6082395U
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JP
Japan
Prior art keywords
memory
load survey
time limit
circuit
physical quantity
Prior art date
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Pending
Application number
JP17453983U
Other languages
English (en)
Inventor
郁雄 前田
Original Assignee
株式会社東芝
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Filing date
Publication date
Application filed by 株式会社東芝 filed Critical 株式会社東芝
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  • Arrangements For Transmission Of Measured Signals (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第1図は従来のロードサーベイ装置の構成を示す図、第
2図はこの考案の一実施例を示す構成図、第3図はこの
考案に用いられるカートリッジ検出回路の一例を示す回
路図、第4図はこの考案に用いられる時限出力回路の一
例を示す回路図である。 100・・・・・・ロードサーベイモータ、110・・
・・・・CPU、115・・・・・・時限出力回路、1
16・・・・・・カートリッジ検出回路、117・・・
・・・補助メモリ、200・・・・・・メモリカートリ
ッジ、204・・・・・・時計回路、205・・・・・
・メモリ回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. 所定時限毎に積算した物理量を外部出力するロードサー
    ベイメータと、前記ロードサーベイメータに時限信号を
    供給する時計回路および外部出力された前記所定時限毎
    の物理量を格納するメモリ回路を備えかつ前記ロードサ
    ーベイメータに着脱可能に装着されたメモリカートリッ
    ジとを具備してなるロードサーベイ装置において、前記
    ロードサーベイメータ内に、前記メモリカートリッジの
    着脱を検出するカートリッジ検出回路と、前記メモリカ
    ートリッジの脱落期間中にも前記時計回路の時限信号と
    同相の時限信号を出力する時限出力回路と、前記メモリ
    カートリッジの脱落期間中の計測物理量を格納して保持
    する補助メモリとを設け、前記メモリカートリッジ脱落
    時には前記時限出力回路からの時限信号によって時限毎
    の動作を開始し、脱落期間中の時限毎の計測物理量は前
    記補助メモリにいったん格納し、前記メモリカートリッ
    ジ装着時に前記メモリ回路に移送する事を特徴とするロ
    ードサーベイ装置。
JP17453983U 1983-11-11 1983-11-11 ロ−ドサ−ベイ装置 Pending JPS6082395U (ja)

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JPS6082395U true JPS6082395U (ja) 1985-06-07

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