JPS6065681U - 周波数弁別回路 - Google Patents
周波数弁別回路Info
- Publication number
- JPS6065681U JPS6065681U JP15871883U JP15871883U JPS6065681U JP S6065681 U JPS6065681 U JP S6065681U JP 15871883 U JP15871883 U JP 15871883U JP 15871883 U JP15871883 U JP 15871883U JP S6065681 U JPS6065681 U JP S6065681U
- Authority
- JP
- Japan
- Prior art keywords
- frequency
- discrimination circuit
- frequency discrimination
- passed
- digitally controlled
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Landscapes
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第1図は従来の周波数弁別回路のを示すブロック図、第
2図は本考案の周波数弁別回路を示すブロック図である
。 図において、1は電力分配器、2は遅延線、3は混合器
、4はデジタル制御形移相器である。
2図は本考案の周波数弁別回路を示すブロック図である
。 図において、1は電力分配器、2は遅延線、3は混合器
、4はデジタル制御形移相器である。
Claims (1)
- 電力分配器の入力端子に加えられた信号を2分配し、一
方は遅延線、他方はデジタル制御形移相器を通して、各
々混合器に加え、この2つの信号の位相差に応じて直流
出力電圧を取り出す周波数弁別器でデジタル制御形移相
器の移相量を変換させることによって、弁別中心周波数
を変化させる周波数弁別回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP15871883U JPS6065681U (ja) | 1983-10-12 | 1983-10-12 | 周波数弁別回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP15871883U JPS6065681U (ja) | 1983-10-12 | 1983-10-12 | 周波数弁別回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6065681U true JPS6065681U (ja) | 1985-05-09 |
Family
ID=30349578
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP15871883U Pending JPS6065681U (ja) | 1983-10-12 | 1983-10-12 | 周波数弁別回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6065681U (ja) |
-
1983
- 1983-10-12 JP JP15871883U patent/JPS6065681U/ja active Pending
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