JPS6059569A - Digital sound converter - Google Patents

Digital sound converter

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Publication number
JPS6059569A
JPS6059569A JP16607183A JP16607183A JPS6059569A JP S6059569 A JPS6059569 A JP S6059569A JP 16607183 A JP16607183 A JP 16607183A JP 16607183 A JP16607183 A JP 16607183A JP S6059569 A JPS6059569 A JP S6059569A
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JP
Japan
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encoding
digital
conversion
codec
decoding
Prior art date
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Pending
Application number
JP16607183A
Other languages
Japanese (ja)
Inventor
Yoshiaki Nakamura
能章 中村
Tetsuo Okazaki
哲夫 岡崎
Shinichi Yamazaki
真一 山崎
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Nippon Telegraph and Telephone Corp
Original Assignee
Nippon Telegraph and Telephone Corp
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Publication date
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Publication of JPS6059569A publication Critical patent/JPS6059569A/en
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    • GPHYSICS
    • G11INFORMATION STORAGE
    • G11BINFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
    • G11B20/00Signal processing not specific to the method of recording or reproducing; Circuits therefor
    • G11B20/10Digital recording or reproducing
    • G11B20/10527Audio or video recording; Data buffering arrangements

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  • Engineering & Computer Science (AREA)
  • Multimedia (AREA)
  • Signal Processing (AREA)
  • Signal Processing For Digital Recording And Reproducing (AREA)

Abstract

PURPOSE:To transmit mutually digital sound signals also between different kinds of devices by coupling plural coding decoding device (codec) and executing the conversion of a coding/decoding system, rate conversion of coding, etc. on the basis of the combination of these codecs. CONSTITUTION:A digital sound conversion part selects the coupling of a PCM codec 51 and ADM codecs 52, 53 having different bit rates and a parallel/serial conversion circuit 66, a serial/parallel conversion circuit 63, etc. are enabled to operate in accordance with the combination of these codecs. ADM digital data of 32kb/S are decoded by the codec 52, encoded by the codec 53 and then converted into ADM digital data of 16kb/S, which are outputted from the circuit 63 in parallel. In the same manner, PCM data are converted into the ADM data. By executing the conversion of the coding/decoding system, coding rate conversion, etc., transmission of digital sound signals also between different kinds of terminal equipments are made possible.

Description

【発明の詳細な説明】 この発明は音声信号を符号化、復号化する装置に関し、
特に符号化、復号化方式および符号化レートの少くとも
一方を変換できるようにしようとするものである。
[Detailed Description of the Invention] The present invention relates to an apparatus for encoding and decoding audio signals;
In particular, it is intended to enable conversion of at least one of encoding, decoding methods, and encoding rates.

く背 景〉 従来の音の符号化、復号化装置は符号化レートの固定さ
れた単一種の符号器、復号器あるいはコーデックを用い
て構成されていた。このためディジタル音の符号化、復
号化方式はその装置に固有の方式となシ、異機種間での
互換性がないため、通信回線を用いて異機種間で音の伝
送を行うことができず、従って雑音に影響され難い高品
質のディジタル伝送を行うことができず、アナログ信号
で伝送しなければならず雑音に影響され易いものとなる
。また現在の音声ディジタル伝送においては一般に64
kb/sPCM方式が用いられている。このように高速
、高品質のディジタル音信号を蓄積する場合、大容量化
の蓄積装置を必要とし、高価なものとなる。また従来の
ディジタル伝送方式はその伝送路に対し、変換方式、符
号化レートが固定されているため記録内容の伝達の観点
からすると場合によっては過剰品質であったり、低品質
であったシと内容伝達に十分かつ最低限必要な適当なレ
ートを設定できない欠点があった。
Background: Conventional sound encoding and decoding devices have been constructed using a single type of encoder, decoder, or codec with a fixed encoding rate. For this reason, the encoding and decoding methods for digital sound are unique to each device, and are not compatible between different models, so it is not possible to transmit sound between different models using communication lines. Therefore, it is not possible to perform high-quality digital transmission that is not easily affected by noise, and it is necessary to transmit an analog signal, which is easily affected by noise. In addition, in current audio digital transmission, generally 64
The kb/sPCM method is used. Storing such high-speed, high-quality digital sound signals requires a storage device with a large capacity, which is expensive. In addition, in conventional digital transmission systems, the conversion method and encoding rate are fixed for the transmission path, so from the perspective of transmitting the recorded content, the quality may be excessive or low quality in some cases. There was a drawback that it was not possible to set an appropriate rate that was sufficient and minimally necessary for transmission.

〈発明の概要〉 この発明の目的は異機種間でもディジタル音信号の伝送
が可能であり、また記憶する場合に比較的記憶容量が小
さい蓄積装置を用いても比較的多くの音情報を記憶する
ことができ、更に内容伝達に十分かつ最低限必要なレー
トで伝送や記憶を可能とするディジタル音変換装置を提
供することにある。
<Summary of the Invention> The purpose of the present invention is to enable the transmission of digital sound signals even between different types of devices, and to store a relatively large amount of sound information even if a storage device with a relatively small storage capacity is used. It is an object of the present invention to provide a digital sound converting device which is capable of transmitting and storing data at a rate sufficient and minimum necessary for transmitting contents.

この発明によれば符号化及び復号化方式とね量化レート
及び復号化レートとの少くとも一方を異にする複数のコ
ーデック(あるいは符号化器及び復号化器)が設けられ
、プロセッサ部の制御によシ、これらコーデックの1つ
を選択してその後号化出力を、他のコーデックの狗号化
入力側に供給することができるようにされる。
According to the present invention, a plurality of codecs (or encoders and decoders) that differ in at least one of the encoding and decoding methods and the quantization rate and the decoding rate are provided, and the control of the processor section It is possible to select one of these codecs and then feed its encoded output to the encoded input of the other codec.

〈実施例〉 第1図はこの発明によるディジタル音変換装置の一例を
示し、テイジタル音変換部11は機能的にディジタル符
号化部12と、アナログ復号化部13と、変換部]4と
をもっている。ディジタル音変換部11にマイクロホン
や電話機のピックアップコイルなどの入力機器15.ス
ピーカなどの出力機器161通信回線インタフェース1
7.更にプロセッサ部18が接続される。プロセッサ部
18は機能的に演算・制御回路19.記憶回路21など
を備え、磁気ディスク。
<Embodiment> FIG. 1 shows an example of a digital sound conversion device according to the present invention, in which a digital sound conversion section 11 functionally includes a digital encoding section 12, an analog decoding section 13, and a conversion section 4. . An input device 15 such as a microphone or a pick-up coil of a telephone is connected to the digital sound converter 11. Output devices such as speakers 161 Communication line interface 1
7. Furthermore, a processor section 18 is connected. The processor section 18 functionally includes an arithmetic/control circuit 19. A magnetic disk including a storage circuit 21 and the like.

磁気テープ々どの蓄積部221表示部23.キーボード
などの文字・命令入力部24と接続されている。
Magnetic tape storage section 221 display section 23. It is connected to a character/command input section 24 such as a keyboard.

プロセッサ部18の演算・制御回路19がソフトウェア
でディジタル音変換部112通信回線インタフェース1
7及び蓄積部22の管理・制御を行う。
The arithmetic/control circuit 19 of the processor section 18 is implemented by software as the digital sound converter section 112 and the communication line interface 1.
7 and the storage unit 22.

音を入力する場合は、入力音は入力機器15でアナログ
電気信号に変換されてディジタル符号化部12に入力さ
れ、ディジタル信号に変換される。あるい(ハ、通信回
線を通して通信回線インタフェース17が受信した音の
アナログ信号はディジタル符号化部12でディジタル信
号に変換される。これらティジタルネ]−号化部12で
変換されたディジタル信号あるいは通信回線を通してイ
ンタフェース17が受信したb声のディジタル信号はプ
ロセッサ部18の演算・制御回路19により制御されて
記憶回路21へ一旦転送され、更に蓄積部22へ転送さ
れてこれに蓄積される。
When inputting sound, the input sound is converted into an analog electrical signal by the input device 15, inputted to the digital encoding section 12, and converted into a digital signal. (C) The analog sound signal received by the communication line interface 17 through the communication line is converted into a digital signal by the digital encoding unit 12. The digital signal of the b voice received by the interface 17 through the processor section 18 is controlled by the arithmetic and control circuit 19 of the processor section 18, and is once transferred to the storage circuit 21, and further transferred to the storage section 22 and stored therein.

音を出力する場合はプロセッサ部18の演算・制御回路
19の制御により蓄積部22からディジタル信号を読み
出してアナログ復号化部13へ転送し、そのディジタル
信号をアナログ信号に変換して出力機器16を通じて出
力する。あるいは、アナログ復号化部13から変換した
アナログ信号を通信回線インタフェース17を通してア
ナログ通信回線に出力するか、蓄積部22から読み出し
たディジタル信号のまま通信回線インタフェース17を
通して通信回線に出力する。
When outputting sound, the digital signal is read out from the storage section 22 under the control of the arithmetic/control circuit 19 of the processor section 18 and transferred to the analog decoding section 13, and the digital signal is converted into an analog signal and sent through the output device 16. Output. Alternatively, the analog signal converted from the analog decoding section 13 is output to the analog communication line through the communication line interface 17, or the digital signal read from the storage section 22 is output to the communication line through the communication line interface 17.

ディジタル音の変換は、プロセッサ部18は蓄積部22
からディジタル信号を読み出してディジタル音変換部1
1へ送る。ここではまず、そのディジタル信号をアナロ
グ復号化部13でアナログ信号に変換し、このアナログ
信号を変換回路14を通してディジタル符号化部12へ
入力して他の符号化方式、および/または符号化レート
でディジタル信号に変換する。その変換されたディジタ
ル信号は蓄積部22に再蓄積する。
The processor section 18 converts the digital sound using the storage section 22.
The digital signal is read out from the digital sound converter 1.
Send to 1. Here, first, the digital signal is converted into an analog signal by the analog decoding section 13, and this analog signal is inputted to the digital encoding section 12 through the conversion circuit 14 to be converted to another encoding method and/or encoding rate. Convert to digital signal. The converted digital signal is stored again in the storage section 22.

文字・命令入力部24は、音の入出力の開始、終了、変
換方法の入力、指示に用いる。また、表示部23は実行
状態のモニタに用いられる。
The character/command input section 24 is used for starting and ending input/output of sounds, inputting conversion methods, and giving instructions. Further, the display unit 23 is used to monitor the execution state.

ディジタル音変換部11の具体例を第2図に示す。A specific example of the digital sound conversion section 11 is shown in FIG.

この例は64 kb / s PCMコーデック51と
、32kb/SADM (アダプティブデルタ変調)コ
ーデック52と、16 kb / s AD−PCM 
(アダプティブデファレンシャル−PCM )コーデッ
ク53とを用いた場合で、マルチプレクサ54よシのア
ナログ信号はバッファ増幅器55 、56 、57をそ
れぞれ通じてコーデック51 、52゜53へ接続され
、これらコーデック51 、52 、53で符号化され
たディジタルデータはそれぞれ直列並列変換部61 、
62 、63へそれぞれ供給される。これら直列並列変
換部61 、62 、63からの直列データに変換され
たディジタルデータはデータ線64を通じてプロセッサ
部18へ入力される。
This example includes a 64 kb/s PCM codec 51, a 32 kb/SADM (Adaptive Delta Modulation) codec 52, and a 16 kb/s AD-PCM codec.
(Adaptive Differential-PCM) codec 53, the analog signals from the multiplexer 54 are connected to the codecs 51, 52, 53 through buffer amplifiers 55, 56, 57, respectively, and these codecs 51, 52, The digital data encoded in step 53 is sent to serial-to-parallel converter 61, respectively.
62 and 63, respectively. The digital data converted into serial data from these serial/parallel converters 61 , 62 , and 63 is input to the processor section 18 through a data line 64 .

一方プロセツザ部18からの信号線64を通じて入力さ
れたディジタルデータは並列直列変換部65゜66 、
67でそれぞれ並列ディジタルデータに変換されてコー
デック51 、52 、53に人力され、こJLらコー
デック51 、52 、53でアナログ信月に復号化さ
れる。これらアナログ信号はマルチプレクサ68でその
1つを取出すことができ、その取出されたアナログ信号
はマルチプレクサ69によpマルチプレクサ54.出力
機器162通信回線インタフェース17の何れかに出力
される。マルチプレクサ54は入力機器15又はマルチ
プレクサ69の何れからのアナログ信号を選択してバッ
ファ増幅器51 、52 、53へ供給する。
On the other hand, the digital data input from the processor section 18 through the signal line 64 is transferred to parallel-to-serial converters 65, 66,
At 67, the parallel digital data is converted into parallel digital data, which is manually input to codecs 51, 52, and 53, and decoded into analog signal data by codecs 51, 52, and 53, respectively. One of these analog signals can be taken out by the multiplexer 68, and the taken out analog signal is sent to the multiplexer 69 and the p multiplexer 54. It is output to either the output device 162 or the communication line interface 17. Multiplexer 54 selects an analog signal from either input device 15 or multiplexer 69 and supplies it to buffer amplifiers 51 , 52 , 53 .

プロセッサ部18はマルチプレクサ54 、68 、6
9をそれぞれ信号線71 、72 、73を通じて制御
することができ、コーデック51 、52 、53をそ
れぞれ信号線74 、75 、76をそれぞれ通じて動
作可能(イネーブル)状態と動作不能(ディスイネーブ
ル)状態にすることができる。更に直列並列変換部61
 、62 。
The processor section 18 includes multiplexers 54, 68, 6
9 can be controlled through signal lines 71, 72, and 73, respectively, and codecs 51, 52, and 53 can be controlled in enabled and disabled states through signal lines 74, 75, and 76, respectively. It can be done. Furthermore, a serial-parallel converter 61
, 62.

63、また並列直列変換部65 、66 、67は3ス
テートバツフアをもっており、プロセッサ部18からそ
れぞれ信号線77 、78 、79また81 、82 
、83を通じてこれら変換部の出力インピーダンスを無
限大としてその出力側を実質的に切離した状態と出力可
能状態とに制御することができ、また動作クロック及び
変換の先頭位置を指示するパルスを送ることができる。
63, and the parallel-to-serial converters 65, 66, and 67 have three-state buffers, and are connected to signal lines 77, 78, 79, and 81, 82 from the processor section 18, respectively.
, 83, it is possible to control the output impedance of these converters to infinity and to put the output side in a substantially disconnected state and in an output enabled state, and also to send an operation clock and a pulse indicating the start position of the conversion. Can be done.

信号線77 、81の制御信号はOR回路84を通じて
コーチツク51の起動及びクロック端子に与えられ、信
号線78 、82の制御信号はOR回路85を通じてコ
ーデック52の起動及びクロック端子に与えられ、信号
線79..83の制御信号はOR回路86を通してコー
デック53の起動及びクロック端子に与えられている。
The control signals on the signal lines 77 and 81 are applied to the activation and clock terminals of the codec 51 through an OR circuit 84, and the control signals on the signal lines 78 and 82 are applied to the activation and clock terminals of the codec 52 through an OR circuit 85. 79. .. The control signal 83 is applied to the activation and clock terminals of the codec 53 through an OR circuit 86.

なおマルチプレクサ54 、68 、69は一種のアナ
ログスイッチであり、バッファ増幅器55 、56 、
57はアナログ信号がコーデック51 、52 。
Note that the multiplexers 54 , 68 , 69 are a kind of analog switches, and the buffer amplifiers 55 , 56 ,
57 is an analog signal codec 51 , 52 .

53の相互間で影響するのを防止するものである。53 from influencing each other.

アナログ信号を符号化する場合はプロセッサ部18はマ
ルチプレクサ54を入力機器15側に接続し、また目的
とする符号化形式及び符号化レートに応じて1つのコー
チツク、例えば64kb/sコーデツク51を動作可能
状態にすると共に直列並列変換部61を動作状態にする
。入力機器15がらのアナログ信号はマルチプレクサ5
4を通り、更にバッファ増幅器55 、56 、57を
通じてコーデック51 、52 、53へ入力される。
When encoding an analog signal, the processor section 18 connects the multiplexer 54 to the input device 15 side, and can also operate one coach, for example, a 64 kb/s codec 51, depending on the desired encoding format and encoding rate. At the same time, the serial-to-parallel converter 61 is brought into operation. The analog signal from the input device 15 is sent to the multiplexer 5.
4 and further input to codecs 51 , 52 , 53 via buffer amplifiers 55 , 56 , 57 .

これらコーデック51 、52 、53中のプロセッサ
部18によって起動されている64kb/sPCMコー
デック51はその人力アナログ信号をディジタル符号化
し、そのディジタルデータは直列並列変換部61を通じ
てプロセッサ部18へ転送される。
The 64 kb/s PCM codec 51 activated by the processor section 18 in these codecs 51 , 52 , and 53 digitally encodes the human analog signal, and the digital data is transferred to the processor section 18 through the serial/parallel converter section 61 .

ディジタルデータを出力する場合は、そのディジタルデ
ータの符号形式及び符号化レートに応じて例えば64k
b/sPCMコーデック51を動作状態にすると共に並
列直列変換部65を動作状態にし、かつマルチプレクサ
68をそのコーデック51に接続する。
When outputting digital data, for example 64K, depending on the encoding format and encoding rate of the digital data.
The b/s PCM codec 51 is activated, the parallel-to-serial converter 65 is activated, and the multiplexer 68 is connected to the codec 51.

プロセッサ部18からデータ線64を通じて入力された
ディジタルデータは並列直列変換部65にて直列データ
に変換され、更にコーデック51にょシアナログ信号に
復号化される。そのアナログ信号はマルチプレクサ68
を通じ、マルチプレクサの接続状態により出力機器16
又は通信回線インタフェース17へ出力される。
Digital data input from the processor section 18 through the data line 64 is converted into serial data by the parallel-to-serial converter 65, and further decoded into a digital analog signal by the codec 51. The analog signal is sent to the multiplexer 68
through the output device 16 depending on the connection state of the multiplexer.
Alternatively, it is output to the communication line interface 17.

次に変換動作を、32kb/sADMディジタルテータ
を16 kb / s AD−PCMディジタルデータ
に変換する場合を例として説明する。マルチプレク54
をマルチプレクサ69側に接続し、マルチプレクサ68
を32 kb / s ADMコーデック52側に接続
し、マルチプレクサ69をマルチプレクサ54側に接続
し、コーチツク52 、53 、また並列直列変換部6
6、直列並列変換部63をそれぞれ動作可能状態にする
。プロセッサ部18からの32kb/sADMディジタ
ルデータは並列直列変換部66を通じて32 kb /
 s ADMコーデック52に入力されてアナログ信号
に復号化される。このアナログ信号はマルチプレクサ6
8 、69 、54を順次通じ、更にバッファ増幅器5
5 、56 、57を通じてコーデック51 、52 
、53へ入力されて動作可能なコーデック52 、53
でそれぞれディジタルデータに符号化されるが、そのう
ちの16 kb / s AD −PCMディジタルデ
ータは直列並列変換部63を通じてプロセッサ部18に
入力される。プロセッサ部18はその入力されたディジ
タルデータを一旦記憶回路21に記憶した後、蓄積部2
2へ転送して再蓄積する。
Next, the conversion operation will be explained using an example in which 32 kb/s ADM digital data is converted to 16 kb/s AD-PCM digital data. multiplex 54
is connected to the multiplexer 69 side, and the multiplexer 68
is connected to the 32 kb/s ADM codec 52 side, the multiplexer 69 is connected to the multiplexer 54 side, and the coaches 52 and 53 as well as the parallel-serial converter 6
6. Make each of the serial-parallel converters 63 operational. The 32 kb/s ADM digital data from the processor section 18 is converted into 32 kb/s ADM digital data through the parallel/serial converter 66.
s is input to the ADM codec 52 and decoded into an analog signal. This analog signal is sent to multiplexer 6
8, 69, and 54 in sequence, and then the buffer amplifier 5.
Codec 51, 52 through 5, 56, 57
, 53 and operable codecs 52 , 53
Of these, 16 kb/s AD-PCM digital data is input to the processor unit 18 through the serial/parallel converter 63. The processor section 18 temporarily stores the input digital data in the storage circuit 21, and then stores it in the storage section 2.
2 and re-storage.

〈効 果〉 以上説明したように、この発明のディジタル音変換装置
によれば、複数のコーデックを結合し、その組み合わせ
で符号化・復号化方式の変換および符号化のレート変換
の少くとも一方を行えるようにしたため、符号化・復号
化方式、省号化レートの異なる端末間において、音声テ
ークのディジタル通信が可能となる利点がある。また、
ザービスに応じて音声の符号化方式や符号化レートが設
定できるため、効率的な音声蓄積が可能になる。
<Effect> As explained above, according to the digital sound conversion device of the present invention, a plurality of codecs are combined, and the combination performs at least one of encoding/decoding method conversion and encoding rate conversion. This has the advantage that digital communication of voice taking can be performed between terminals with different encoding/decoding methods and encoding rates. Also,
Since the audio encoding method and encoding rate can be set according to the service, efficient audio storage becomes possible.

なお上述において演算・制御回路19内に直列並列変換
あるいはその逆変換の機能をもつものかあシ、その場合
は第2図において直列並列変換部及び並列直列変換部を
省略することができる。蓄積部22は記憶回路21で兼
用することもできる。
In the above description, if the arithmetic/control circuit 19 has a function of serial-to-parallel conversion or its inverse conversion, in that case, the serial-to-parallel converter and the parallel-to-serial converter can be omitted in FIG. The storage section 22 can also be used as the storage circuit 21.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図はこの発明装置の一例を示すブロック図、第2図
はディジタル音変換部の具体例を示すブロック図である
。 11:ディジタル音変換部、12:ディジタル符号化部
、13:アナログ復号化部、15:入力機器、16:出
力機器、17:通信回線インタフェース、18:グロセ
ツザ部、19:演算・制御回路、21:記憶回路、22
:蓄積部、23:表示部、24:文字・命令入力部、5
1 : 64 kb / s PCMコーデック、52
 : 32 kb / s ADMコーデック、53:
16kb / s AD −PCM ニア−デック、6
1〜63:3ステート・バッファー伺直列並列変換部、
65〜67:3ステート・バッファー付並列直列変換部
。 特許出願人 日本電信電話公社 代理人 草野 卓
FIG. 1 is a block diagram showing an example of the device of the present invention, and FIG. 2 is a block diagram showing a specific example of a digital sound converter. 11: Digital sound conversion section, 12: Digital encoding section, 13: Analog decoding section, 15: Input device, 16: Output device, 17: Communication line interface, 18: Glossary section, 19: Arithmetic/control circuit, 21 :Memory circuit, 22
: Storage section, 23: Display section, 24: Character/command input section, 5
1: 64 kb/s PCM codec, 52
: 32 kb/s ADM codec, 53:
16kb/s AD-PCM Near Deck, 6
1 to 63: 3-state buffer serial/parallel converter,
65-67: Parallel-serial converter with 3-state buffer. Patent applicant: Takashi Kusano, agent of Nippon Telegraph and Telephone Public Corporation

Claims (1)

【特許請求の範囲】[Claims] (1)アナログ信号をディジタル信号に変換するA/D
変換器、ディジタル信号をアナログ信号に変換するD/
A変換器、符号化方式、復号化方式及び符号(復号)化
レートの少くとも一方を異にする複数のコーデックを含
む符号化復号化部、これら符号化復号化部の復号化出力
側を選択してこれら複数の符号化復号化部の符号化入力
側へ接続することができるスイッチ手段と、少くとも演
算制御機能をもち、符号化、復号化方式、符号化レート
の変換に応じて前記スイッチ手段の制御を行うプロセッ
サ部とを具備するディジタル音変換装置。
(1) A/D that converts analog signals to digital signals
converter, converting digital signals to analog signals
A converter, an encoding/decoding section including a plurality of codecs that differ in at least one of the encoding method, decoding method, and encoding (decoding) rate, and selecting the decoding output side of these encoding/decoding sections. switch means that can be connected to the encoding input side of the plurality of encoding/decoding sections, and a switch means having at least an arithmetic control function, and the switching means that can be connected to the encoding input side of the plurality of encoding/decoding units; A digital sound conversion device comprising: a processor section for controlling the means;
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4904070A (en) * 1988-02-19 1990-02-27 Asahi Kogaku Kogyo Kabushiki Kaisha Telephoto lens system

Cited By (1)

* Cited by examiner, † Cited by third party
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US4904070A (en) * 1988-02-19 1990-02-27 Asahi Kogaku Kogyo Kabushiki Kaisha Telephoto lens system

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