JPS6056014B2 - Tuner channel selection device - Google Patents

Tuner channel selection device

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Publication number
JPS6056014B2
JPS6056014B2 JP7147778A JP7147778A JPS6056014B2 JP S6056014 B2 JPS6056014 B2 JP S6056014B2 JP 7147778 A JP7147778 A JP 7147778A JP 7147778 A JP7147778 A JP 7147778A JP S6056014 B2 JPS6056014 B2 JP S6056014B2
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JP
Japan
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channel
circuit
signal
clock signal
output
Prior art date
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Application number
JP7147778A
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Japanese (ja)
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JPS54162902A (en
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英作 阿久津
重雄 松浦
博 宮本
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Hitachi Ltd
Original Assignee
Hitachi Ltd
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Publication date
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  • Channel Selection Circuits, Automatic Tuning Circuits (AREA)

Description

【発明の詳細な説明】 〔発明の利用分野〕 本発明は、テレビジョンチューナなどにおける順次選
局装置に関する。
DETAILED DESCRIPTION OF THE INVENTION [Field of Application of the Invention] The present invention relates to a sequential channel selection device in a television tuner or the like.

〔発明の背景〕[Background of the invention]

従来、テレビジョン受像機などの選局操作は、一チヤ
ンネル番号に対応した選局ボタンを押すことにより、或
いは選局用のツマミを順次回転させ又はリモコン装置な
どにより順送りさせたりして行なつていた。
Conventionally, channel selection operations on television receivers, etc., have been performed by pressing a channel selection button corresponding to a channel number, by sequentially rotating a channel selection knob, or by sequentially switching channels using a remote control device, etc. Ta.

通常の場合は、勿論、このような方法で充分であつた
が、しかし、チャンネル数が増加してプログラム内容も
豊富になつてくると、このままではチャンネル選択がか
なり煩雑になり、さらに、コマーシヤル時などにおいて
一時的に他のチャンネルのプログラム内容を確認したり
、必要なプログラムを捜索したりする場合には、上記の
ような従来の方式によつていたのでは、操作が複雑なば
かりではなく、他のチャンネルのプログラム内容をすべ
て確認した後に再び元のチャンネルに戻すための操作を
短時間で行なうことは、極めて困難で、誤操作などによ
る故障の恐れも多くなつていた。
Of course, this method was sufficient in normal cases, but as the number of channels increases and the program content becomes richer, channel selection becomes quite complicated, and furthermore, when it comes to commercials, When you want to temporarily check the program contents of other channels or search for a necessary program, using the conventional method described above is not only complicated, but also complicated. It is extremely difficult to return to the original channel in a short period of time after checking all the program contents of other channels, and there is a high risk of malfunction due to erroneous operation.

そこで、簡単な操作で短時間のうちに必要とする他のチ
ャンネルのプログラム内容をすべて確認すること、すな
わち、一巡選局ができる選局装置が提案されており、第
7図は、かかる選局装置の一例を示すブロック図で、こ
の図において、1はチューナの順次選局装置で、12チ
ャンネルの選局が行なえ、それらのチャンネルに対応し
た選局がボタンを有し、順送り制御信号により順次チャ
ンネル切換えが行なえるように構成されている。
Therefore, a channel selection device has been proposed that can check all the program contents of other channels required in a short time with simple operations, that is, can perform one round selection. This is a block diagram showing an example of a device. In this figure, 1 is a tuner sequential selection device, which can select 12 channels, the selection corresponding to those channels has buttons, and the sequential selection is performed by a sequential control signal. It is configured to allow channel switching.

2は制御回路、3は12進カウンタ、4はクロック発生
器、5は動作開始用のスイッチ、6は順送り制御信号入
力端子である。
2 is a control circuit, 3 is a hexadecimal counter, 4 is a clock generator, 5 is a switch for starting operation, and 6 is a forward control signal input terminal.

次にこの選局装置の動作について説明する。Next, the operation of this channel selection device will be explained.

いま、一巡選局を行なうため、スイッチ5を押すと、制
御回路2は動作を開始し、クロック発生器4に動作信号
を送つてクロック発生器4を動作状態にし、このクロッ
ク発生器4からクロックパルスを受け入れるようにする
。制御回路2は、このクロックパルスを12進カウンタ
3と順次選局装置1に供給し、これにより順次選局装置
1は、そのときに選択されていたチャンネルから順次選
局動作を開始して、順次次のチーヤンネルに切替つてゆ
く。
Now, when the switch 5 is pressed to perform one-round selection, the control circuit 2 starts operating, sends an operating signal to the clock generator 4, puts the clock generator 4 into the operating state, and receives a clock from the clock generator 4. Be open to the pulse. The control circuit 2 supplies this clock pulse to the hexadecimal counter 3 and the sequential channel selection device 1, whereby the sequential channel selection device 1 starts the sequential channel selection operation from the channel selected at that time. Switching to the next channel one after another.

このときのチャンネルが切替えられてゆく時間間隔は、
クロック発生器4からのクロックパルスの周期で決まり
、切替えられたチャンネルにおけるプログラムの内容を
聴視者が確認するに必要な、時間、たとえば、1ないし
数秒に定められている。
The time interval at which channels are switched at this time is
It is determined by the period of the clock pulse from the clock generator 4, and is set to the time required for the viewer to confirm the content of the program on the switched channel, for example, from one to several seconds.

一方、カウンタ3に供給されたクロックパルスによつて
カウンタ3も歩進してゆき、クロックパルスが12個供
給されると、カウンタ3は出力信号!を発生する。
On the other hand, the counter 3 also increments according to the clock pulses supplied to the counter 3, and when 12 clock pulses are supplied, the counter 3 outputs an output signal! occurs.

この出力信号は制御回路2に送られ、制御回路2はそれ
に応じてクロックパルスの受け入れを停止すると共に、
12進カウンタ3をリセットさせ、端子6に対するクロ
ックパルス、すなわち順送り制御信号の供給をストップ
させる。4したがつて、チューナの順次選局装置1には
、スイッチ5が押されると、その都度、12個のクロッ
クパルスが順送り制御信号として端子6から供給され、
そのときに選択されていたチャンネルから始まつて順次
他のチャンネルを一巡し、もとのチャンネルに戻つて選
局を停止する。
This output signal is sent to the control circuit 2, which accordingly stops accepting clock pulses and
The hexadecimal counter 3 is reset and the supply of clock pulses, ie, forward control signals, to the terminal 6 is stopped. 4. Therefore, each time the switch 5 is pressed, 12 clock pulses are supplied from the terminal 6 to the tuner's sequential tuning device 1 as a sequential control signal.
Starting from the channel selected at that time, it sequentially cycles through other channels, returns to the original channel, and stops tuning.

したがつて、そのテレビジョン受像機の使用者は、必要
なときにスイッチ5を押rだけで、すべてのチャンネル
を所定の間隔で順次に受信し、それらのプログラム内容
を確認した上、元のチャンネルに戻すことができ、それ
によつてそのままのチャンネルにとどめるか、他のチャ
ンネルに切換えるかを任意に決めることができる。
Therefore, the user of the television receiver can receive all the channels in sequence at predetermined intervals by simply pressing switch 5 when necessary, check the program contents, and then return to the original. You can then switch back to the current channel, allowing you to decide whether to stay on that channel or switch to another channel.

このため、従来のごとく、選局ボタンを短時間のうちに
すべて操作したり、リモコンなどを所定のタイミングで
操作したりすることなく、極めて簡単に一巡選局を行な
うことができる。
Therefore, it is possible to perform one round of channel selection extremely easily without operating all the channel selection buttons in a short time or operating a remote control at a predetermined timing as in the conventional case.

第8図は、第7図の従来例における制御回路2の一例を
示すもので、11は動作開始用のスイッチ5からのスタ
ート信号入力端子、12は順次選局装置1の端子6に接
続される順送り制御信号出力端子、13,14は微分回
路を構成する抵坑とコンデンサ、21,22は入力信号
を記憶すなわちラッチするためのフリップフロップを構
成するNAND回路、23,24はゲート用のNAND
回路、24aはその出力端子、25はインバータ、32
は12進カウンタ3からの出力信号が供給される入力端
子、33は12進カウンタ3にクロックパルスを供給す
るための出力端子、42はクロック発生器4に動作信号
を供給するための出力端子、43はクロック発生器4か
らクロックパルスを受け入れるための入力端子である。
FIG. 8 shows an example of the control circuit 2 in the conventional example shown in FIG. 13 and 14 are resistors and capacitors forming a differential circuit, 21 and 22 are NAND circuits forming a flip-flop for storing or latching input signals, and 23 and 24 are NAND gates.
circuit, 24a is its output terminal, 25 is an inverter, 32
is an input terminal to which an output signal from the hexadecimal counter 3 is supplied; 33 is an output terminal for supplying clock pulses to the hexadecimal counter 3; 42 is an output terminal for supplying an operating signal to the clock generator 4; 43 is an input terminal for receiving clock pulses from the clock generator 4.

次にこの回路の動作について説明する。第9図は、第8
図の回路の各部分における信号の波形を示す。
Next, the operation of this circuit will be explained. Figure 9 shows the 8th
The waveforms of signals in each part of the circuit shown in the figure are shown.

まず、スイッチ5からの信号により端子11の入力レベ
ルが゜゜0゛になると、NAND回路21の出力が゜“
1゛になり、この出力はN.AND回路21,22によ
りラッチされる。なお、このとき、最初の状態ではNA
ND回路21の出力は“゜0゛、NAND回路22の出
力は“゜1゛となつていたものとする。NAND回路2
1の出力が66r′になつたことにより、出力端子42
から信号がクロック発生器4に供給され、その結果、入
力端子43にはクロックパルスが供給される。
First, when the input level of the terminal 11 becomes ゜゜0゛ due to the signal from the switch 5, the output of the NAND circuit 21 becomes ゜“
1, and this output is N. It is latched by AND circuits 21 and 22. Note that at this time, in the initial state, NA
It is assumed that the output of the ND circuit 21 is "0", and the output of the NAND circuit 22 is "01". NAND circuit 2
1 becomes 66r', the output terminal 42
A signal is supplied to the clock generator 4 from , so that an input terminal 43 is supplied with a clock pulse.

このとき、NAND回路23の一方の入力は端子42と
同様に“1゛となつているから、端子43からのクロッ
クパルスによりNAND回路23の出力にもクロックパ
ルスが現われ、その立下がり部分が抵坑13とコンデン
サ14で微分され、インバータ25で反転されて、端子
43に供給されているクロックパルスと同じ周期で、し
かも幅の短かい正の順送り制御信号が端子12から順次
選局装置1に供給され、そのとき選択されていたチャン
ネルから順次、次のチャンネルへ、短かい切替時間でし
かも所定の時間だけそのチャンネルにとどまりながら切
替えられてゆく。
At this time, since one input of the NAND circuit 23 is at "1" like the terminal 42, a clock pulse appears at the output of the NAND circuit 23 due to the clock pulse from the terminal 43, and the falling part of the clock pulse appears at the output of the NAND circuit 23. After being differentiated by the well 13 and the capacitor 14 and inverted by the inverter 25, a positive progressive control signal having the same period as the clock pulse supplied to the terminal 43 and having a short width is sequentially sent from the terminal 12 to the tuning device 1. The currently selected channel is sequentially switched to the next channel in a short switching time, and the channel remains on that channel for a predetermined period of time.

この端子12に現われる制御信号は、同時に端子33か
ら12進カウンタ3に入カへ供給されるため、スタート
入力端子11に信号が加えられてから12個目の制御信
号が出力端子12,33に現われたとき、12進カウン
タ3は出力信号を発生し、その信号は入力端子32から
NAND回路24に供給され、NAND回路24の出力
端子24aは出力端子12,33の信号と入力端子32
の信号が共に゜“1゛になつたときに出力゜“0゛を発
生し、それをフリップフロップを構成する一方のNAN
D回路22の入力の1つに加え、ラッチ状態を反転させ
てNAND回路21の出力を゜゜『゛、NAND回路2
2の出力を゜゜1゛に保持させる。
Since the control signal appearing at this terminal 12 is simultaneously supplied from the terminal 33 to the input of the hexadecimal counter 3, the 12th control signal is applied to the output terminals 12 and 33 after the signal is applied to the start input terminal 11. When the signal appears, the hexadecimal counter 3 generates an output signal, which is supplied from the input terminal 32 to the NAND circuit 24, and the output terminal 24a of the NAND circuit 24 is connected to the signals at the output terminals 12, 33 and the input terminal 32.
When both of the signals of the
In addition to one of the inputs of the D circuit 22, the latch state is inverted and the output of the NAND circuit 21 is
The output of 2 is held at ゜゜1゛.

この結果、NAND回路23の一方の入力と端子42の
信号ぱ゛0゛となり、クロック発生器4は動作を停止し
、端子43に供給されていたクロックパルスも消滅し、
出力端子12,33に対する制御信号の供給もストップ
してチャンネル切替動作は停止する。
As a result, the signal at one input of the NAND circuit 23 and the terminal 42 becomes 0, the clock generator 4 stops operating, and the clock pulse supplied to the terminal 43 also disappears.
The supply of control signals to the output terminals 12 and 33 is also stopped, and the channel switching operation is stopped.

したがつて、この従来例によれば、スイッチ5を一瞬押
すだけで任意の時期に一巡選局を行なうことができ、そ
のままのチャンネルで受信を継続するか、或いは他のチ
ャンネルに切替えるかを決めることができる。
Therefore, according to this conventional example, by pressing the switch 5 for a moment, it is possible to perform one round selection of stations at any time, and decide whether to continue receiving reception on the same channel or to switch to another channel. be able to.

なお、このとき他のチャンネルへの切替えは、従来の場
合と同様に、選局ボタン、選局ツマミ、或はリモコン装
置などを操作して行なうことはいうまでもない。
It goes without saying that at this time, switching to another channel is performed by operating a channel selection button, a channel selection knob, a remote control device, etc., as in the conventional case.

しかしながら、この従来の選局装置では、予め定められ
たチャンネルについては、それぞれのチャンネルの状態
とは無関係に、とにかく一巡選局が行なわれてしまうた
め、何らかの理由、例えば電界強度が不充分であつたり
、その地域ではサービスエリアに含まれていないなどの
理由により、放送が受信できないチャンネル、いわゆる
空チャンネルについても忠実に選局を行ない、所定の時
間づつ選局してゆくことになり、一巡選局に無駄な時間
を要する上、空チャンネル選択によるノイズ(画像ノイ
ズと音声ノイズ)についても所定時間づつ受信が行なわ
れることによる不快感を除くことができないという問題
点がある。
However, with this conventional channel selection device, for predetermined channels, one round of channel selection is performed anyway, regardless of the state of each channel. Channels whose broadcasts cannot be received, so-called empty channels, may be faithfully selected due to reasons such as the area is not included in the service area, etc., and the channels are selected at predetermined time intervals. There is a problem in that it requires wasted time for the station, and it is not possible to eliminate the discomfort caused by reception of noise (image noise and audio noise) caused by selecting an empty channel for a predetermined period of time.

〔発明の目的〕[Purpose of the invention]

本発明の目的は、上記した従来例の問題点に対処し、空
チャンネルが存在しても充分に効率的に、かつ快適な一
巡選局が得られるようにした選局装置を堤供するにある
SUMMARY OF THE INVENTION An object of the present invention is to provide a channel selection device that solves the above-mentioned problems of the prior art and allows sufficiently efficient and comfortable channel selection even if there are empty channels. .

〔発明の概要〕[Summary of the invention]

この目的を達成するため、本発明は、一巡選局により次
々と選択されるチャンネルごとの受信信号を調べ、この
受信信号の状態に応じてそのチャンネルの早送りを行な
うようにした点を特徴とする。
In order to achieve this object, the present invention is characterized in that the received signal of each channel selected one after another in a round selection is checked, and the channel is fast-forwarded depending on the state of the received signal. .

〔発明の実施例〕[Embodiments of the invention]

以下、本発明によるチューナの選局装置について、図示
の実施例により詳細に説明する。
DESCRIPTION OF THE PREFERRED EMBODIMENTS A tuner selection device according to the present invention will be described in detail below with reference to illustrated embodiments.

第1図は本発明の一実施例を示すブロック図で、第7図
の従来例と異なる点は、受信判定回路7が設けられてい
ることであり、その他の構成は第7図の場合と同様で、
従つて選局装置の基本的な動作は、第7図の選局装置と
同様であるが、制御回路2から端子6を介して順送り制
御信号が供給され、順次選局装置1が順次、次のチャン
ネルに切替えられたとき、そのチャンネルにおいて放送
が受信できたか否かを、受信判定回路7が、受像回路の
AGC電圧、AFC電圧、または水平、垂直同期一致信
号、或いはこれらの組合せにより判断し、そのチャンネ
ルに放送局が存在していなかつたり、或いは電界強度が
不足していたようなときには、通常の順送り制御信号に
加えて早送りパルスを発生し、切替動作をただちに行な
わせて瞬時に次のチャンネルに切替えられるようになつ
ている。
FIG. 1 is a block diagram showing an embodiment of the present invention, which differs from the conventional example shown in FIG. 7 in that a reception determination circuit 7 is provided, and the other configurations are the same as in the case of FIG. 7. Similarly,
Therefore, the basic operation of the channel selection device is the same as that of the channel selection device shown in FIG. When the channel is switched to, the reception determination circuit 7 determines whether or not the broadcast can be received on that channel based on the AGC voltage, AFC voltage, horizontal and vertical synchronization coincidence signals of the image receiving circuit, or a combination thereof. If there is no broadcast station on that channel or the electric field strength is insufficient, a fast forward pulse is generated in addition to the normal forward control signal to immediately perform the switching operation and instantly switch to the next one. It is now possible to switch channels.

この動作は、どのチャンネルにおいても、そのチャンネ
ルで充分な信号が受信できない限り引続いて行なわれ、
順次にチャンネルの切替えを行なつて一巡選局を行なう
This operation continues on any channel unless a sufficient signal is received on that channel;
Channels are sequentially switched to perform one-round selection.

したがつて、この実施例によれば、順次選局装置1によ
つて、第7図の従来例と同様に、スイッチ5の操作によ
り1巡選局を行ない、簡単に他のすべてのチャンネルの
プログラムを確認することができるばかりでなく、放送
が受信できないチャンネル、いわゆる空チャンネルは早
送り動作により瞬時に次のチャンネルに切替わり、短時
間で一巡選局を行なつて他のチャンネルのプログラムの
確認を容易になし得る上、空チャンネルをも所定の時間
間隔て選局してゆく不愉快さを解消することができる。
Therefore, according to this embodiment, the sequential channel selection device 1 performs one round of channel selection by operating the switch 5, as in the conventional example shown in FIG. 7, and easily selects all other channels. Not only can you check the program, but you can also use the fast-forward operation to instantly switch to the next channel on channels where broadcasts cannot be received, so-called empty channels, and check the programs on other channels by performing a round of tuning in a short time. In addition, it is possible to eliminate the inconvenience of having to tune in to empty channels at predetermined time intervals.

第2図は、第1図の実施例における制御回路2の一例を
示すもので、第8図と同等もしくは同じ部分には同じ符
号を付してある。第2図において、26はインバータ、
26aはその出力導線、27,28はゲート用のNAN
D回路、28aはその出力導線、29a,29bは立下
がり信号トリガ形の単安定回路、29c,29dはそれ
らの出力導線、71は電圧比較回路、71aはその出力
導線、72は基準電圧源、73は受信回路からの受信信
号の電界強度などに対応した信号をが加えられる比較入
力端子である。
FIG. 2 shows an example of the control circuit 2 in the embodiment of FIG. 1, and parts that are equivalent or the same as those in FIG. 8 are given the same reference numerals. In FIG. 2, 26 is an inverter;
26a is its output conductor, 27 and 28 are NAN for gate
D circuit, 28a is its output conductor, 29a, 29b are falling signal trigger type monostable circuits, 29c, 29d are their output conductors, 71 is a voltage comparison circuit, 71a is its output conductor, 72 is a reference voltage source, 73 is a comparison input terminal to which a signal corresponding to the electric field strength of the received signal from the receiving circuit is applied.

次に、この回路の動作を第3図を参照して説明する。第
8図および第9図て述べたように、入力端子11にスタ
ート信号が加えられると、インバータ25の出力に順送
り制御用のパルスが現われ、インバータ26、NAND
回路27を介して出力端子12,33から順次選局装置
1と12進カウンタ3に制御信号が送られてチャンネル
が次々に切替えられてゆくが、このとき、入力端子73
から受信信号の電界強度に比例した大きさの伝圧が加え
られ、比較回路71はこの電圧が基準電圧源72の、電
圧よりも高くなつたときだけ出力導線71aに出力“゜
0゛を発生する。
Next, the operation of this circuit will be explained with reference to FIG. As described in FIGS. 8 and 9, when a start signal is applied to the input terminal 11, a sequential control pulse appears at the output of the inverter 25, and the inverter 26, NAND
Control signals are sequentially sent from the output terminals 12 and 33 to the channel selection device 1 and the hexadecimal counter 3 via the circuit 27, and the channels are switched one after another.
A transmission voltage proportional to the electric field strength of the received signal is applied from the comparator circuit 71, and the comparator circuit 71 generates an output "゜0゛" on the output conductor 71a only when this voltage becomes higher than the voltage of the reference voltage source 72. do.

したがつて、基準電圧源72の電圧を適当な値に選ぶこ
とにより、空チャンネルとして判定すべき電界強度を任
意に設定することができる。
Therefore, by selecting the voltage of the reference voltage source 72 to an appropriate value, the electric field strength to be determined as an empty channel can be arbitrarily set.

そこで、切替えられたチャンネルの電界強度が所定の値
以上に達しているときには、切替時に極めて短かい時間
だけ端子73の電圧が低下するだけであるから、導線7
1aの電圧も瞬間的に゜゜1゛になるだけである。この
とき、出力端子12,33に現われたパルスは、単安定
回路29a,29bによつて、第6図の29dのように
、所定時間だけ遅延されているから、比較回路71の出
力導線71aのパルスとは時間的に一致せす、N.AN
D回路28の出力導線28aの出力ぱ“1゛に保たれた
ままであり、したがつて、NAND回路27による出力
端子12,33へのパルスの供給は、インバータ26の
出力導線26aに発生している、入力端子43に供給さ
れたクロックパルスから作られたパルスだけである。
Therefore, when the electric field strength of the switched channel has reached a predetermined value or more, the voltage at the terminal 73 only decreases for a very short time at the time of switching.
The voltage of 1a also momentarily becomes ゜゜1゛. At this time, the pulses appearing at the output terminals 12 and 33 are delayed by a predetermined time by the monostable circuits 29a and 29b, as shown in 29d in FIG. Coinciding with the pulse in time, N. AN
The output voltage of the output conductor 28a of the D circuit 28 remains at "1", and therefore, the pulses supplied to the output terminals 12 and 33 by the NAND circuit 27 are generated in the output conductor 26a of the inverter 26. The only pulses produced from the clock pulses supplied to the input terminal 43 are the same.

しかしながら、この導線26aのパルスによつてNAN
D回路27から出力端子12,33に送りノ出されたパ
ルス、すなわち順送り制御信号により、次のチャンネル
に切替えられたとき、そのチャンネルが空チャンネルで
充分な電界強度の電波が受信できなかつたりすると、端
子73には電圧源72の電圧より低い電圧しか供給され
ず、出力導線71aに切替後も出力゛1゛が発生したま
まとなり、単安定回路29a,29bて遅延されてきた
インバータ26からのパルスによる制御信号と、NAN
D回路28て一致条件を生し、出力導線28aにパルス
が発生してN.AND回路27に加え゛られ、出力端子
12,33に付加的なパルスを発生させ、ただちに次の
チャンネルに切替え動作を起こさせる。
However, due to the pulse of this conductor 26a, the NAN
When switching to the next channel using the pulses sent from the D circuit 27 to the output terminals 12 and 33, that is, the sequential control signal, if the channel is empty and radio waves with sufficient electric field strength cannot be received. , only a voltage lower than the voltage of the voltage source 72 is supplied to the terminal 73, and even after switching to the output conductor 71a, the output ゛1゛ remains generated, and the monostable circuits 29a and 29b delay the output from the inverter 26. Control signal by pulse and NAN
D circuit 28 generates a matching condition, and a pulse is generated on output conductor 28a, causing N. It is applied to AND circuit 27 to generate additional pulses at output terminals 12, 33, causing immediate switching to the next channel.

すなわち、早送りを行なわせる。この状態は、第3図の
左側から2番目、3番目、および5番目に、ぞれそれ充
分な電界強度が得られないチャンネルが2チャンネル、
3チャンネル、および1チャンネル続いて存在していた
場合として示されている。このとき、NAND回路28
から付加的に供給された早送り用の制御信号は、もちろ
ん12進カウンタ3にも端子33から供給されているか
ら、空チャンネルが存在しても必す始めのチャンネルに
戻つて一巡選局は停止する。
In other words, fast forwarding is performed. In this state, there are two channels, the second, third and fifth from the left in Figure 3, where sufficient electric field strength cannot be obtained.
Three channels are shown as being present followed by one channel. At this time, the NAND circuit 28
Of course, the fast-forward control signal additionally supplied from the terminal 33 is also supplied to the hexadecimal counter 3 from the terminal 33, so even if there is an empty channel, the channel always returns to the first one and the one-round selection stops. do.

したがつて、この実施例によれば、受信可能なチャンネ
ルだけを順次に選局する一巡選局が可能で、チャンネル
状態によつてプリセットしたりする必要がなく、放送終
了チャンネルなどを自動的に除いて一巡選局を行なうこ
とができ、プログラムの内容確認を一層スピーデイに、
しかも快適に行なうことができる。
Therefore, according to this embodiment, it is possible to perform one-round selection in which only receivable channels are sequentially selected, and there is no need to preset depending on the channel status, and it is possible to automatically select channels that have finished broadcasting, etc. You can check the contents of the program even more quickly,
Moreover, it can be done comfortably.

第4図は、本発明の他の一実施例を示したもので、一巡
選局動作中に必要なチャンネルが見出せたときには、そ
のチャンネルでただちに停止し、受信が継続し得るよう
にしたものである。
FIG. 4 shows another embodiment of the present invention, in which when a necessary channel is found during one round selection operation, reception is immediately stopped on that channel and reception can be continued. be.

この実施例が第1図の実施例と異なつている点は、一巡
選局動作を任意のチャンネルで停止させるための停止入
力スイッチ8が設けられ、このスイッチ8を押すことに
より制御回路2は順次選局装置1に対する順送り制御信
号の供給をただちに停止すると共に、12進カウンタ3
をリセットして、そのカウント状態に無関係に最初の状
態に戻すように構成したことであり、その他の構成や動
作は第1図の実施例の場合と同じである。
This embodiment differs from the embodiment shown in FIG. Immediately stops supplying the forward control signal to the channel selection device 1, and starts the hexadecimal counter 3.
is configured to reset and return to the initial state regardless of the count state, and other configurations and operations are the same as in the embodiment shown in FIG.

すなわち、コマーシヤル時などにおいて、スイッチ5を
押して一巡選局動作に入つたとき、希望するプログラム
内容のチャンネルが選択されたら、ただちに停止入力ス
イッチ8を押す。
That is, during a commercial or the like, when the switch 5 is pressed to start one-round channel selection operation, the stop input switch 8 is pressed immediately after the channel with the desired program content is selected.

これにより制御回路2はクロック発生器4に対する動作
用の信号を止め、12進カウンタ3にリセット信号を送
ると共に順送り制御信号の送出を停止させる。
As a result, the control circuit 2 stops the operation signal to the clock generator 4, sends a reset signal to the hexadecimal counter 3, and stops sending out the forward control signal.

したがつて、そのときのチャンネルが選局されたままの
状態で一巡選局動作は停止するから、他の実施例のよう
に一巡選局が終了して元のチャンネルに戻つてから再び
チャンネル選択を行なう必要がなくなり、希望する放送
局の選択がさらに容易に、しかも短時間で行なうことが
できる。
Therefore, the first round selection operation stops while the current channel is still selected, so the channel selection is performed again after the first round selection is completed and the original channel is returned to, as in other embodiments. This eliminates the need for selecting a desired broadcasting station, making it easier and faster to select a desired broadcasting station.

そして、その後は、この新しく選択されたチャンネルを
起点として一巡選局動作が行なわれることになる。第5
図は、第4図の実施例における制御回路2の一例で、第
2図の実施例と同等もしくは同じ部分には同一符号を付
し、動作について特に必要のない部分は省略した。
Thereafter, a round channel selection operation will be performed starting from this newly selected channel. Fifth
The figure shows an example of the control circuit 2 in the embodiment of FIG. 4, in which the same or similar parts as in the embodiment of FIG. 2 are denoted by the same reference numerals, and parts not particularly necessary for operation are omitted.

第5図において、82は第4図のスイッチ8からの停止
信号が供給される入力端子、83は単安定回路、34は
12進カウンタ3のリセット入力に接続され、リセット
信号を供給するための出力端子である。なお、この実施
例では、ラッチ用フリップフロップを構成する一方のN
AND回路22として3入力のものを用い、その増加し
た入力に単安定回路83の出力を供給するようになつて
いる。
In FIG. 5, 82 is an input terminal to which the stop signal from the switch 8 in FIG. It is an output terminal. Note that in this embodiment, one of the N
A three-input one is used as the AND circuit 22, and the output of the monostable circuit 83 is supplied to the increased inputs.

次に第6図の波形図を参照してこの回路の動作を説明す
る。
Next, the operation of this circuit will be explained with reference to the waveform diagram in FIG.

スタート信号が入力端子11に加えられ、空チャンネル
も含めて4チャンネル目に希望する放送局のチャンネル
が選択されたとする。
Assume that a start signal is applied to the input terminal 11, and the fourth desired broadcasting station channel, including empty channels, is selected.

そこで、この選局装置が組込まれたテレビジョン受像機
の使用者は、ただちにスイッチ8を押して入力端子82
に“゜0゛信号を供給する。この端子82の信号によつ
て単安定回路83はトリガされて所定幅のパルスを出力
、すなわち端子34に発生する。
Therefore, the user of the television receiver incorporating this channel selection device should immediately press the switch 8 to connect the input terminal 82.
A "0" signal is supplied to the terminal 82. The signal at the terminal 82 triggers the monostable circuit 83 to output a pulse of a predetermined width, that is, to generate it at the terminal 34.

これによりNAND回路22の出力は“1゛になり、そ
の結果、N.AND回路21の出力は“0゛に戻る。
As a result, the output of the NAND circuit 22 becomes "1", and as a result, the output of the N.AND circuit 21 returns to "0".

したがつて、端子42の出力も“゜0゛になつてクロッ
ク発生器4が停止し、一巡選局動作は停止する。
Therefore, the output of the terminal 42 also becomes "0", the clock generator 4 stops, and the one-round tuning operation stops.

これと共に、端子34に発生した゜゜0゛信号は12進
カウンタ3のリセット入力に供給され、12進カウンタ
3はリセットされて初期の状態に戻される。以上の動作
によソー巡選局動作は任意のチャンネルに達したときに
停止され、これに続く一巡選局動作は、そのチャンネル
を起点として行なわれるように準備される。
At the same time, the ゜゜0゛ signal generated at the terminal 34 is supplied to the reset input of the hexadecimal counter 3, and the hexadecimal counter 3 is reset and returned to its initial state. As a result of the above operations, the station selection operation is stopped when an arbitrary channel is reached, and the subsequent station selection operation is prepared to be performed starting from that channel.

なお、単安定回路83は、スイッチ8の操作状態にかか
わらず、必要な時間幅の信号を発生し、NAND回路2
1,22からなるフリップフロップ及び12進カウンタ
3のリセットを確実に行なわせるためのものであり、こ
の条件を満足させることができるものであればどのよう
な手段と置き換えてもよい。また、以上の実施例は、す
べて、順次選局装置1を12チャンネル選択形式のもの
として説明し、そのためカウンタ3も12進のものとな
つているが、本発明はこれに限ることなく、任意のチャ
ンネル数のものとすることとができる。
Note that the monostable circuit 83 generates a signal with a necessary time width regardless of the operating state of the switch 8, and the NAND circuit 2
This is to ensure that the flip-flop consisting of 1 and 22 and the hexadecimal counter 3 are reset, and may be replaced with any means that can satisfy this condition. Further, in all of the above embodiments, the sequential channel selection device 1 is described as having a 12-channel selection type, and therefore the counter 3 is also in 12 decimal notation. However, the present invention is not limited to this, and any number of channels can be selected. The number of channels can be as follows.

さらに、以上の実施例では、チャンネルの切替動作を順
送り方向のものとして説明したが、本発明はこれに限る
ことなく、順方向と逆方向を切替えたり、混用したりす
ることもでき、さらには、クロック発生器4を制御して
クロックパルスの周期を変え、切替えてゆく時間を可変
にして早送り、遅送りなどの機能を付加することも容易
で、さらに操作性の優れた選局装置を得ることができる
Furthermore, in the above embodiments, the channel switching operation was explained as being in the forward direction, but the present invention is not limited to this, and the forward direction and reverse direction can be switched or used in combination. , it is easy to control the clock generator 4 to change the period of the clock pulse and change the switching time to add functions such as fast forwarding and slow forwarding, thereby obtaining a tuning device with even better operability. be able to.

なおさらに、順次選局装置1を用いない場合でも、適当
な変換回路を使用し、順送り制御信号或いは12進カウ
ンタ3から直接選局信号に変換し、この信号を選局ボタ
ンと対応して選局装置に供給し、自動的にチャンネルを
切替えてゆくようにすることも可能で、このためには例
えば4ビット12ライン変換回路などを利用すればよい
Furthermore, even if the sequential channel selection device 1 is not used, an appropriate conversion circuit can be used to convert the sequential control signal or the hexadecimal counter 3 into a direct channel selection signal, and this signal can be used to select a channel in correspondence with the channel selection button. It is also possible to supply the signal to the station equipment and automatically switch channels; for example, a 4-bit 12-line conversion circuit may be used for this purpose.

〔発明の効果〕〔Effect of the invention〕

以上説明したように、本発明によれば、極めて簡単な操
作で多数のチャンネルのプログラムをすべて短時間に確
認することができ、従来技術のように複雑な操作と無駄
な時間を要することがなくなる。
As explained above, according to the present invention, all the programs of a large number of channels can be checked in a short time with extremely simple operations, eliminating the need for complicated operations and wasted time unlike the conventional technology. .

また、リモコン装置などを使用した場合でも、単純な命
令信号と単純な操作で済み、すべてのチャンネルに切換
えるため長時間操作することなく一巡選局を行なわせる
ことができ、リモコン装置の付加も簡単にすむという利
点がある。
In addition, even if a remote control device is used, it only requires a simple command signal and simple operation, and since it switches to all channels, it is possible to perform one round of tuning without having to operate for a long time, and it is easy to add a remote control device. It has the advantage of being able to live in

しかも、快適な受信ができなかつたり、受信電波が存在
しないチャンネルがあつた場合には、これらのチャンネ
ルを自動的に跳び越して切替えが行なえるので、一巡選
局に要する時間をさらに短かくすることができ、空チャ
ンネルなどを一々選択することの不快さがなくなつて快
適な操作が期待できる。
Moreover, if you cannot receive comfortable reception or there is a channel that does not have reception radio waves, you can automatically skip over these channels and switch, further shortening the time required for one round selection. This eliminates the discomfort of selecting empty channels one by one, and allows for more comfortable operation.

その上、必要なプログラムのチャンネルが選択されたと
きには、ただちにそのチャンネルへの停止ができ、選局
時間をさらに短縮することができる。
Furthermore, when a desired program channel is selected, that channel can be stopped immediately, further shortening the channel selection time.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明の一実施例に係る選局装置のブロック図
、第2図はその主要部分てある制御回路の一例を示す結
線図、第3図はその動作説明用の波形図、第4図は本発
明の他の実施例に係る選局装置のブロック図、第5図は
その制御回路の一例を示す結線図、第6図はその動作説
明用の波形図、第7図は従来の選局装置の一例を示すブ
ロック図、第8図はその制御回路の一例を示す結線図、
第9図はその動作説明用の波形図である。 1・・・・・・チューナの順次選局装置、2・・・・・
・制御回路、3・・・・・・12進カウンタ、4・・・
・・・クロック発生器、5・・・・・・開始用スイッチ
、7・・・・・・受信判定回路、8・・・・・・停止用
スイッチ。
FIG. 1 is a block diagram of a channel selection device according to an embodiment of the present invention, FIG. 2 is a wiring diagram showing an example of a control circuit that is the main part of the device, FIG. 3 is a waveform diagram for explaining its operation, and FIG. FIG. 4 is a block diagram of a channel selection device according to another embodiment of the present invention, FIG. 5 is a wiring diagram showing an example of its control circuit, FIG. 6 is a waveform diagram for explaining its operation, and FIG. 7 is a conventional channel selection device. FIG. 8 is a block diagram showing an example of a channel selection device, and FIG. 8 is a wiring diagram showing an example of its control circuit.
FIG. 9 is a waveform diagram for explaining the operation. 1...Sequential tuning device for tuner, 2...
・Control circuit, 3... Decimal counter, 4...
... Clock generator, 5 ... Start switch, 7 ... Reception judgment circuit, 8 ... Stop switch.

Claims (1)

【特許請求の範囲】 1 クロック信号などにより順次動作する順次選局回路
と、選択可能なチャンネル数に等しいカウント数を有す
るカウンタと、クロック信号をこのカウンタと前記順次
選局回路に供給する制御回路と、この制御回路に動作信
号を与えクロック信号の供給を開始させるための記憶回
路と、この記憶回路にスタート信号を供給するスイッチ
とを備え、前記カウンタの出力を前記記憶回路のリセッ
ト入力に供給することにより、任意のチャンネルを起点
として選択可能なチャンネルのすべてを自動的に順次選
択した後、起点となつたチャンネルにおいて選択動作を
停止するようにしたチューナの選局装置において、前記
チューナで受信された信号を検出する手段と、この検出
手段の出力を基準電圧と比較する手段と、クロック信号
より短かい周期の付加的なクロック信号を発生する手段
とを備え、選択されたチャンネルにおいて所定値以上の
受信信号が得られなかつたときには、クロック信号に加
えてさらに付加的なクロック信号を前記順次選局回路と
前記カウンタに供給するように構成したことを特徴とす
るチューナの選局装置。 2 特許請求の範囲第1項において、前記記憶回路と前
記カウンタのそれぞれのリセット入力が共通の停止信号
発生用のスイッチを備えていることを特徴とするチュー
ナの選局装置。
[Scope of Claims] 1. A sequential channel selection circuit that operates sequentially based on a clock signal, etc., a counter having a count equal to the number of selectable channels, and a control circuit that supplies a clock signal to the counter and the sequential channel selection circuit. a memory circuit for supplying an operation signal to the control circuit to start supplying a clock signal; and a switch for supplying a start signal to the memory circuit, and supplying the output of the counter to the reset input of the memory circuit. In a tuner selection device that automatically sequentially selects all selectable channels starting from an arbitrary channel and then stops the selection operation at the starting channel, the tuner receives the means for detecting the detected signal, means for comparing the output of the detecting means with a reference voltage, and means for generating an additional clock signal having a shorter period than the clock signal, the clock signal having a predetermined value on the selected channel. A tuner tuning device characterized in that, when the above received signals cannot be obtained, an additional clock signal is supplied to the sequential tuning circuit and the counter in addition to the clock signal. 2. The tuner channel selection device according to claim 1, characterized in that each reset input of the memory circuit and the counter is provided with a switch for generating a common stop signal.
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