JPS6025243U - リセット信号発生回路 - Google Patents
リセット信号発生回路Info
- Publication number
- JPS6025243U JPS6025243U JP11664583U JP11664583U JPS6025243U JP S6025243 U JPS6025243 U JP S6025243U JP 11664583 U JP11664583 U JP 11664583U JP 11664583 U JP11664583 U JP 11664583U JP S6025243 U JPS6025243 U JP S6025243U
- Authority
- JP
- Japan
- Prior art keywords
- transistor
- resistor
- rectifier circuit
- output
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Electronic Switches (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は従来のリセット信号発生回路を示す回路構成図
、第２図ａｔ ｂはそれぞれ同信号発生回路の動作を説
明する出力電圧特性図、第３図は本考案の一実施例に係
るリセット信号発生回路を示す回路構成図である。 １・・・電源トランス、４・・・整流回路、６・・・定
電圧回路、８・・田シック信号出力端子、９・・・第１
の抵抗、１０・・・第１のトランジスタ、１１・・・リ
セット信号出力端子、１２．２１・・・第２の抵抗、１
３・・・第２のトランジスタ、１５・・・ツェナーダイ
オード、１６ａ、１６ｂ・・・抵抗、１７・・・中間接
続点。 補正 昭５＆ ９．２２ 実用新案登録請求の範囲を次のように補正する。 Ｏ実用新案登録請求の範囲 交流電源と、この交流電源に接続された整流回路と、こ
の整流回路の出力端に接続され、直流定電圧を出力する
定電圧回路と、この定電圧回路の両出力端子間に第１の
抵抗を正極側に介して接続され、この第１の抵抗側端に
設けられた出力端子からのリセット信号の出力を制御す
る第１のトランジスタと、前記整流回路の両出力端子間
に第２の抵抗を正極側に介して接続され、かつこの第２
の抵抗側端が前記第１のトランジスタのベース端子に接
続され、前記第１のトランジスタをオン・オフ制御する
第２のトランジスタと、前記整流回路の両出力端子間に
中間接続点が前記第２のトランジスタのベース端子に接
続された分圧抵抗を介して接続され、前記整流回路の出
力電圧が予め定められた設定値以上のとき、前記第２の
トランジスタをオン制御するツェナーダイオードとを具
備したことを特徴とするリセット信号発生回路。 図面の簡単な説明を次のように補正する。 明細書第１２頁第１１行目に「ロジック信号出力端子」
とあるを「ロジック電源出力端子」と訂正する。
、第２図ａｔ ｂはそれぞれ同信号発生回路の動作を説
明する出力電圧特性図、第３図は本考案の一実施例に係
るリセット信号発生回路を示す回路構成図である。 １・・・電源トランス、４・・・整流回路、６・・・定
電圧回路、８・・田シック信号出力端子、９・・・第１
の抵抗、１０・・・第１のトランジスタ、１１・・・リ
セット信号出力端子、１２．２１・・・第２の抵抗、１
３・・・第２のトランジスタ、１５・・・ツェナーダイ
オード、１６ａ、１６ｂ・・・抵抗、１７・・・中間接
続点。 補正 昭５＆ ９．２２ 実用新案登録請求の範囲を次のように補正する。 Ｏ実用新案登録請求の範囲 交流電源と、この交流電源に接続された整流回路と、こ
の整流回路の出力端に接続され、直流定電圧を出力する
定電圧回路と、この定電圧回路の両出力端子間に第１の
抵抗を正極側に介して接続され、この第１の抵抗側端に
設けられた出力端子からのリセット信号の出力を制御す
る第１のトランジスタと、前記整流回路の両出力端子間
に第２の抵抗を正極側に介して接続され、かつこの第２
の抵抗側端が前記第１のトランジスタのベース端子に接
続され、前記第１のトランジスタをオン・オフ制御する
第２のトランジスタと、前記整流回路の両出力端子間に
中間接続点が前記第２のトランジスタのベース端子に接
続された分圧抵抗を介して接続され、前記整流回路の出
力電圧が予め定められた設定値以上のとき、前記第２の
トランジスタをオン制御するツェナーダイオードとを具
備したことを特徴とするリセット信号発生回路。 図面の簡単な説明を次のように補正する。 明細書第１２頁第１１行目に「ロジック信号出力端子」
とあるを「ロジック電源出力端子」と訂正する。
Claims (1)
- 交流電源と、この交流電源に接続された整流回路と、こ
の整流回路の出力端に接続され、直流定電圧を出力する
定電圧回路と、この定電圧回路の両出力端子間に第１の
抵抗を正極側に介して接続され、この第１の抵抗側端に
設けられた出力端子より出力されるリセット信号をオン
・オフ制御する第１のトランジスタと、前記整流回路の
面出力゛ 端子間に第２の抵抗を正極側に介して接
続され、かつこの第２の抵抗側端に前記第１のトランジ
スタのベース端子に接続され、前記第１のトランジスタ
をオン・オフ制御する第２のトランジスタと、前記整流
回路の両出力端子間に中間接続点が前記第２のトランジ
スタのベース端子に接続された分圧抵抗を介して接続さ
れ、前記整流回路の出力電圧が予め定められた設定値以
上のとき、前記第２のトランジスタをオン制御するツェ
ナーダイオードとを具備したことを特徴とするリセット
信号発生回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11664583U JPS6025243U (ja) | 1983-07-27 | 1983-07-27 | リセット信号発生回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11664583U JPS6025243U (ja) | 1983-07-27 | 1983-07-27 | リセット信号発生回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6025243U true JPS6025243U (ja) | 1985-02-20 |
Family
ID=30268811
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11664583U Pending JPS6025243U (ja) | 1983-07-27 | 1983-07-27 | リセット信号発生回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6025243U (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5094461A (ja) * | 1973-12-21 | 1975-07-28 |
-
1983
- 1983-07-27 JP JP11664583U patent/JPS6025243U/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5094461A (ja) * | 1973-12-21 | 1975-07-28 |
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