JPS6020258A - Input/output instruction converting system - Google Patents

Input/output instruction converting system

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Publication number
JPS6020258A
JPS6020258A JP12756683A JP12756683A JPS6020258A JP S6020258 A JPS6020258 A JP S6020258A JP 12756683 A JP12756683 A JP 12756683A JP 12756683 A JP12756683 A JP 12756683A JP S6020258 A JPS6020258 A JP S6020258A
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JP
Japan
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input
output
instruction
processor
status report
Prior art date
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Pending
Application number
JP12756683A
Other languages
Japanese (ja)
Inventor
Fumiaki Ishibashi
石橋 文明
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Nippon Electric Co Ltd
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Publication date
Application filed by NEC Corp, Nippon Electric Co Ltd filed Critical NEC Corp
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Publication of JPS6020258A publication Critical patent/JPS6020258A/en
Pending legal-status Critical Current

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    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/10Program control for peripheral devices
    • G06F13/12Program control for peripheral devices using hardware independent of the central processor, e.g. channel or peripheral processor
    • G06F13/122Program control for peripheral devices using hardware independent of the central processor, e.g. channel or peripheral processor where hardware performs an I/O function other than control of data transfer

Abstract

PURPOSE:To run an input/output instruction which generates from programs of different concepts by installing a converter of input/output is struction between a processor in input/output processor. CONSTITUTION:When the converter 100 receives an input/output instruction from the processor 800, said instruction is converted to the input/output instruction which is fitted to the input/output processor 200 and the execution of input/output instruction is indicated to the input/output processor 200. The input/output processor 200 is started by this execution instruction and controls input/output movement according to the converted intput/output instruction. Status report words generated as a results of this input/output movement are informed to the converter 100. The converter 100 changes the status report words to the form which can be processed by the processor 800, and reports the converted status report words to the processor 800.

Description

【発明の詳細な説明】 発明の属する技術分野 本発明はプロセッサからの入出力命令に従ってデータ転
送を行う入出力処理システムに関し、特に、プロセッサ
装置からの入出力命令を入出力処理システムに合致した
入出力命令に変換する入出力命令変換方式に関する。
DETAILED DESCRIPTION OF THE INVENTION Field of the Invention The present invention relates to an input/output processing system that transfers data according to input/output instructions from a processor, and in particular, to an input/output processing system that transfers data according to input/output instructions from a processor. This invention relates to an input/output instruction conversion method for converting into output instructions.

従来技術 従来、この種の入出力処理システムにおいては。Conventional technology Conventionally, in this type of input/output processing system.

プロセッサ装置から指示される入出力命令は成る一定の
形式に固定されているが、又はその一部機能を拡張した
形式に修正されたものであシ、異なった設計思想で作成
されたオペレーティングシステムプログラム及び利用者
ノログラムから発行される入出力命令を実行する事がで
きない欠点があったO 又、同一中央処理装置内に異なった設計思想を持ったオ
にレーティングシステムを共存させたノロオッサ装置と
、入出力処理装置とを直接接続できないか、或いは接続
できたとしても共存させるオペレーティングシステムの
数に匹敵する倍数の金物量が必要となる欠点があった。
The input/output instructions issued by the processor device are fixed in a certain format, or some of the functions have been modified to expand the format, and the operating system program is created with a different design concept. Also, there was a drawback that it was not possible to execute input/output commands issued from the user program and the user program. There is a drawback that it is not possible to connect directly to the output processing device, or even if it is possible to connect it, the amount of hardware is required to be a multiple of the number of operating systems that are to coexist.

更に、最近の入出力装置は高速化傾向にあるため、オペ
レーティングシステムプログラム及び利用者プログラム
から発行する入出力命令のTRANSFERIN CI
(ANNEL命令の発生頻度がデータ転送のオーバーラ
ンを発生させる要因となっている。
Furthermore, as recent input/output devices tend to be faster, the TRANSFERIN CI of input/output instructions issued from operating system programs and user programs
(The frequency of occurrence of the ANNEL command is a factor that causes data transfer overruns.

そのため、 TRANSFERIN CHANNEL命
令の発生頻度がデータ転送の成功/不成功を左右し、入
出力処理システムに最適な入出力命令となっていない欠
点があった。
Therefore, the frequency of occurrence of the TRANSFERIN CHANNEL command determines the success/failure of data transfer, which has the disadvantage that it is not an optimal input/output command for the input/output processing system.

発明の目的 本発明の目的は、異なる設計思想で作成された入出力命
令を統一した入出力命令に変換するとともに、統一した
状態報告語を異なる設計思想で作成された状態報告語に
変換する変換装置を、プロセッサ装置と入出力処理装置
の間に置く事によシ。
Purpose of the Invention The purpose of the present invention is to convert input/output commands created with different design concepts into unified input/output commands, and to convert unified status report words into status report words created with different design concepts. By placing the device between the processor unit and the input/output processing unit.

上記従来の欠点を除去し、同一中央処理装置内でログラ
ム及び利用者プログラムよシ発生する入出力命令の走行
を可能とした入出力処理システムを提供することにある
It is an object of the present invention to provide an input/output processing system that eliminates the above-mentioned conventional drawbacks and allows input/output commands generated by programs and user programs to run within the same central processing unit.

本発明の他の目的は、同一中央処理装置内での異なる設
計思想で作成されたグロセ、す装置を極めて少ない量の
金物量を増加することにょシシステムと直接接続した入
出力処理システムを提供することにある。
Another object of the present invention is to provide an input/output processing system in which gross equipment created with different design concepts within the same central processing unit is directly connected to a system that increases the amount of hardware with an extremely small amount. It's about doing.

本発明の更に他の目的は、オペレーティングシステムプ
ログラム及び利用者プログラムよシ発行される入出力命
令を変換するととにょシ。
Yet another object of the present invention is to convert input/output instructions issued by operating system programs and user programs.

TRANSFERIN CHANNEL命令の発生が殆
んどナイが。
There are almost no TRANSFERIN CHANNEL commands.

あったとしても極めて少ない発生頻度とすることができ
、オーバーランの発生頻度の極めて少ない入出力処理シ
ステムを提供することにある。
It is an object of the present invention to provide an input/output processing system in which overruns occur at a very low frequency, even if they occur, and in which overruns occur at a very low frequency.

発明の構成 本発明によれば、7°ロセ、す装置がらの入出力命令に
従ってデータ転送を行う入出力処理システムに於−いて
、変換装置と入出力処理装置とを有し。
DESCRIPTION OF THE INVENTION According to the present invention, an input/output processing system that transfers data in accordance with input/output commands from devices includes a conversion device and an input/output processing device.

前記変換装置は、前記プロセッサ装置からの入出力命令
を受けると、この入出力命令を前記入出力処理装置に合
致した入出力命令に変換し、この変換された入出力命令
の実行を前記入出力処理装置に指示し、前記入出力処理
装置は、この実行指示の状態報告語を前記変換装置に報
告し、前記変換装置は、前記状態報告語を前記プロセッ
サ装置が処理可能な形式に変換し、この変換された状態
報告語を前記プロセッサ装置に報告することを特徴とす
る入出力命令変換方式が得られる。
When the conversion device receives an input/output instruction from the processor device, the conversion device converts the input/output instruction into an input/output instruction that matches the input/output processing device, and executes the converted input/output instruction to the input/output instruction. the input/output processing device reports a status report word of this execution instruction to the conversion device, and the conversion device converts the status report word into a format that can be processed by the processor device; An input/output instruction conversion method is obtained which is characterized in that the converted status report word is reported to the processor device.

この発明の実施例 次に本発明について図面を参照して詳細に説明する。Examples of this invention Next, the present invention will be explained in detail with reference to the drawings.

第1図を参照すると9本発明の一実施例に係る入出力処
理システムの構成が示されている。プロセッサ装置80
0は、第1の演算装置500.第2の演算装置600.
主記憶装置700.及びシステム制御装置400から構
成され、第1の演算装置500.第2の演算装置600
.及び主記憶装置700は、各々信号線9.08,90
9.及び910によってシステム制御装置400に接続
されている。変換装置100は、信号線90/I〜90
6によってシステム制御装置400と、信号a902に
よって入出力処理装置200とl (1m号線901に
よって入出力共用メモリ300と、それぞれ接続されて
いる。又、入出力処理装置200は、信号線907によ
ってシステム制御装置400と、信号線903によって
入出力共用メモリとそれぞれ接続されている。
Referring to FIG. 1, there is shown a configuration of an input/output processing system according to an embodiment of the present invention. Processor device 80
0 is the first arithmetic device 500. Second arithmetic device 600.
Main storage device 700. and a system control device 400, including a first arithmetic device 500. Second arithmetic device 600
.. and the main storage device 700 are connected to signal lines 9, 08 and 90, respectively.
9. and 910 are connected to the system control device 400. The conversion device 100 has signal lines 90/I to 90
The input/output processing device 200 is connected to the system control device 400 by a signal line 902, and the input/output shared memory 300 is connected to the input/output shared memory 300 by a signal line 901. The controller 400 is connected to the input/output shared memory by a signal line 903, respectively.

第2図をも参照して1本発明による変換装置100の構
成を更に詳細に述べると、信号線904゜905、及び
906によって、システム制御装置400と、各々第1
の演算装置インタフェース回路140.第2の演算装置
インタフェース回路150、及び主記憶アクセス回路1
60とが接続されている。変換回路120は、信号線9
21によって第1の演算装置インタフェース回路140
ト、信号a922によって第2の演算装置インクフェー
ス回路150と、信号線923によって主記憶アクセス
回路160と、信号線920によって入出力共用メモリ
アクセス回路110と、信号線924によって入出力処
理装置インタフェース回路130とにそれぞれ接続され
ている。又、信号線901によって入出力共用メモリ3
00と入出力共用メモリアクセス回路110が接続され
Describing the configuration of the converter 100 according to the present invention in more detail with reference to FIG. 2, signal lines 904, 905, and 906 connect the system controller 400 and
arithmetic unit interface circuit 140. Second arithmetic unit interface circuit 150 and main memory access circuit 1
60 are connected. The conversion circuit 120 connects the signal line 9
21 by the first arithmetic unit interface circuit 140
The signal a922 connects the second arithmetic unit interface circuit 150, the signal line 923 connects the main memory access circuit 160, the signal line 920 connects the input/output shared memory access circuit 110, and the signal line 924 connects the input/output processing unit interface circuit. 130, respectively. In addition, the input/output shared memory 3 is connected to the signal line 901.
00 and the input/output shared memory access circuit 110 are connected.

信号m902によって入出力処理装置200と入出力処
理装置インタフェース回路130が接続されている。
The input/output processing device 200 and the input/output processing device interface circuit 130 are connected by a signal m902.

次に、第1図と第2図を参照して本実施例の動作を説明
する。
Next, the operation of this embodiment will be explained with reference to FIGS. 1 and 2.

第1の演算装置500と第2の演算装置600は、各々
異なった段別思想で設計され、入出力命令の起動方法、
データ転送制御語形式、入出力命令の処理の結果として
の報告方法、及び状態報告語の形式が各々相異している
。このように相異した第1の演算装置500又は第2の
演算装置600から変換装置100に入出力命令の実行
指示が行われると、この入出力命令の実行指示が信号線
908又は信号線909を介してシステム制御装置40
0及び、信号線904を介して第1の演算装置インタフ
ェース回路140又は信号線905を介して第2の演算
装置インタフェース回路150に通知される。入出力命
令の実行指示が通知された第1の演算装置インクフェー
ス回路140又は第2の演算装置インタフェース回路1
50は、信号線921又は信号線922を介して、変換
回路120に対して入出力命令の変換処理を指示する。
The first arithmetic device 500 and the second arithmetic device 600 are designed with different stage-based concepts, and have different methods for starting input/output instructions.
The format of the data transfer control word, the method of reporting the results of input/output command processing, and the format of the status report word are each different. When the conversion device 100 is instructed to execute an input/output command from the different first arithmetic device 500 or second arithmetic device 600, the instruction to execute the input/output command is sent to the signal line 908 or the signal line 909. System controller 40 via
0 and is notified to the first arithmetic unit interface circuit 140 via the signal line 904 or to the second arithmetic unit interface circuit 150 via the signal line 905. The first arithmetic unit interface circuit 140 or the second arithmetic unit interface circuit 1 to which the input/output command execution instruction has been notified
50 instructs the conversion circuit 120 to convert input/output instructions via a signal line 921 or 922.

変換処理を指示された変換回路120は、主記憶装置7
00の予め決められた番地よシチャネルアドレス、デバ
イスアドレス、データ転送制御語アドレス等を得るだめ
のアドレス制御語のゝ読出しのため、信号線923を介
して主記憶アクセス回路160に対し主記憶読出し指示
を行う。主記憶906、主記憶アクセス回路160.及
び信号線923を介して変換回路120に送られてくる
The conversion circuit 120 instructed to perform the conversion process stores the main storage device 7
In order to read the address control word for obtaining the channel address, device address, data transfer control word address, etc. from the predetermined address of 00, the main memory access circuit 160 is sent to the main memory access circuit 160 via the signal line 923. Give instructions. Main memory 906, main memory access circuit 160. and is sent to the conversion circuit 120 via the signal line 923.

変換回路120は、この読出されたアドレス制御語を入
出力処理装置200に合致°したアドレス制御語に変換
し、信号線920を介して入出力共用メモリアクセス回
路110に、この変換したアドレス制御語を入出力共用
メモリ300に書込む様・に指示する。
The conversion circuit 120 converts the read address control word into an address control word that matches the input/output processing device 200, and sends the converted address control word to the input/output shared memory access circuit 110 via the signal line 920. is written to the input/output shared memory 300.

次に、変換回路120は、上記読出されたアドレス制御
語に含まれるデータ転送制御語アドレスに従って、デー
タ転送制御語を同様に主記憶装置700よシ読出し、入
出力処理装置200に合致したデータ転送制御語に変換
し、入出力共用メモIJ 300に書込む。但し、読出
されたデータ転送制御語がTRANSFERIN CH
ANNEL命令であれば、変換回路120は、変換及び
入出力共用メモリ300への書込みを行わず、そのデー
タ転送制御語に含まれるデータ転送制御語アドレスを使
用してデータ転送制御語を読出し、変換して入出力共用
メモリ300に書込む。データ転送制御語の変換はデー
タ転送fl?U御語にあるデータ転送終了フラグが検出
される丑で継続される。
Next, the conversion circuit 120 similarly reads the data transfer control word from the main storage device 700 according to the data transfer control word address included in the read address control word, and transfers the data in accordance with the input/output processing device 200. Convert it into a control word and write it to the input/output shared memo IJ 300. However, the read data transfer control word is TRANSFERIN CH.
If it is an ANNEL command, the conversion circuit 120 does not convert or write to the input/output shared memory 300, but reads the data transfer control word using the data transfer control word address included in the data transfer control word and converts it. and writes it to the input/output shared memory 300. Conversion of data transfer control word is data transfer fl? The process continues when the data transfer end flag in the U word is detected.

次に変換装置100は、データ転送制御語の変換途中又
は終了後、信号線902を介してアドレス制御語アドレ
スと共に入出力処理装置200に起動を指示する。起動
指示された入出力処理装置200は、信号線903を介
して入出力共用メモリ300より変換されたアドレス制
御語及び変換されたデータ転送制御語を使用してデータ
転送を開始する。
Next, the conversion device 100 instructs the input/output processing device 200 to start up along with the address control word address via the signal line 902 during or after the conversion of the data transfer control word. The input/output processing device 200 that has been instructed to start starts data transfer using the converted address control word and the converted data transfer control word from the input/output shared memory 300 via the signal line 903.

次に入出力処理装置200は、前記入出力命令の処理結
果としての状態報告語を信号線90:3を介して入出力
共用メモリ300の予め定められた番地に格納後、信号
線902を介して変換装置100に割込みを発生する。
Next, the input/output processing device 200 stores the status report word as a processing result of the input/output command in a predetermined address of the input/output shared memory 300 via the signal line 90:3, and then stores it via the signal line 902. An interrupt is generated in the conversion device 100.

変換装置100は、前記割込みが来ると信号線9’01
を介して入出力共用メモリ300よシ格納された状態報
告語を読出し、この読出された状態報告語を入出力命令
を発行した第1の演算装置500又は第2の演算装置6
00に適合した状態報告語に変換後、第1の演算装置5
00又は第2の演算装置600に適合する報告処理方法
に従い。
When the interrupt occurs, the conversion device 100 transmits the signal line 9'01.
The status report word stored in the input/output shared memory 300 is read out via the input/output shared memory 300, and the read status report word is transmitted to the first arithmetic unit 500 or the second arithmetic unit 6 that issued the input/output command.
After converting into a status report word compatible with 00, the first arithmetic unit 5
00 or according to a report processing method compatible with the second computing device 600.

信号線904又は信号#J905及び信号m906を介
してプロセッサ装置800に入出力命令の結果を報告す
る。
The result of the input/output command is reported to the processor device 800 via the signal line 904 or the signal #J905 and the signal m906.

発明の効果 本発明には以上説明したように、プロセッサ装置と入出
力処理装置との間に入出力命令の変換装置を設けた構成
をとることによシ、同一中央処理装置内での異なるオペ
レーティングシステムプログラム及び利用者プログラム
よ多発生する入出力命令の走行を可能とし、又同一中央
処理装置内での異なる設計思想で作成されたプロセッサ
装置を極めて少ない量の金物量を増加することによシシ
ステムと直接接続できるように構築でき、更に入出力処
理システムに最適な入出力命令の形式となるためオーバ
ーランの発生頻度の極めて少ない入出力処理システムを
提供できるという効果がある。
Effects of the Invention As explained above, the present invention has a configuration in which an input/output instruction conversion device is provided between a processor unit and an input/output processing unit, thereby allowing different operating systems to be used within the same central processing unit. It enables the execution of input/output commands that occur frequently in system programs and user programs, and allows processor devices created with different design concepts within the same central processing unit to be easily processed by increasing the amount of hardware with an extremely small amount. It can be constructed so that it can be directly connected to the system, and furthermore, it has an input/output instruction format that is optimal for the input/output processing system, so it has the effect of providing an input/output processing system with extremely low overrun frequency.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本発明の一実施例の構成を示したブロック図、
第2図は第1図に示した変換装置の構成を更に詳細に示
したブロック図である。 100・・変換装置、11o・・人出カ共用メモリアク
セス回路、120・・・変換回路、13o・・・入出力
処理装置インタフェース回路、14o・・・第1の演算
装置インタフェース回路、15o・・第2の演算装置イ
ンタフェース回路、1Go・・・主記憶アクセス回路、
20o・・・入出力処理装置、300・・・入出力共用
メモIJ 、 400・・・システム制御装置。 500・・・第1の演算装置、600・・・第2の演算
装置、70o・・・主記憶装置、 8’OO・・・プロ
セ、す装ft、9ox〜924・・・インタフェース信
号線。
FIG. 1 is a block diagram showing the configuration of an embodiment of the present invention.
FIG. 2 is a block diagram showing the configuration of the converting device shown in FIG. 1 in more detail. 100... Conversion device, 11o... Output shared memory access circuit, 120... Conversion circuit, 13o... Input/output processing device interface circuit, 14o... First arithmetic device interface circuit, 15o... Second arithmetic unit interface circuit, 1Go...main memory access circuit,
20o... Input/output processing device, 300... Input/output common memo IJ, 400... System control device. 500...First arithmetic unit, 600...Second arithmetic unit, 70o...Main storage device, 8'OO...Process, unit ft, 9ox-924...Interface signal line.

Claims (1)

【特許請求の範囲】 1、 グロセ、す装置からの入出力命令に従ってデータ
転送を行う入出力処理システムに於いて。 変換装置と入出力処理装置とを有し、前記変換装置は、
前記プロセッサ装置からの入出力命令を受けると、該入
出力命令を前記入出力処理装置に合致した入出力命令に
変換し、該変換された入出力命令の実行を前記入出力処
理装置に指示し、前記入出力処理装置は、該実行指示に
よシ起動され。 前記変換された入出力命令に従って入出力動作を制御し
、該入出力動作の実行結果としての状態報告語を前記変
換装置に報告し、前記変換装置は。 前記状態報告語を前記プロセッサ装置が処理可能な形式
に変換し、該変換された状態報告語を前記プロセッサ装
置に報告することを特徴とする入出力命令変換方式。
[Claims] 1. In an input/output processing system that transfers data according to an input/output command from a gross device. It has a conversion device and an input/output processing device, and the conversion device includes:
When receiving an input/output instruction from the processor device, it converts the input/output instruction into an input/output instruction that matches the input/output processing device, and instructs the input/output processing device to execute the converted input/output instruction. , the input/output processing device is activated by the execution instruction. The converting device controls an input/output operation according to the converted input/output command, and reports a status report word as a result of execution of the input/output operation to the converting device. An input/output instruction conversion method characterized by converting the status report word into a format that can be processed by the processor device, and reporting the converted status report word to the processor device.
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0378398A2 (en) * 1989-01-13 1990-07-18 International Business Machines Corporation Data processing system with means for detecting status of data processing device receiving commands

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