JPS60194800U - メモリカ−ド - Google Patents
メモリカ−ドInfo
- Publication number
- JPS60194800U JPS60194800U JP8058384U JP8058384U JPS60194800U JP S60194800 U JPS60194800 U JP S60194800U JP 8058384 U JP8058384 U JP 8058384U JP 8058384 U JP8058384 U JP 8058384U JP S60194800 U JPS60194800 U JP S60194800U
- Authority
- JP
- Japan
- Prior art keywords
- memory card
- memory device
- interface unit
- interface
- memory
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Landscapes
- Static Random-Access Memory (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は従来のメモリカードの構成図、第２図は本考案
によるメモリカードの一実施例を示す構成図、第３図お
よび第４図は他の実施例の構成図を示す６ 図中において、１はコントロールカード、２゜３．５，
６はコネクタ、４．４−１〜４−ｎはメモリカード１．
７Ａ、７Ｂはパス、８は線材、９はメモリ素子を示す。
によるメモリカードの一実施例を示す構成図、第３図お
よび第４図は他の実施例の構成図を示す６ 図中において、１はコントロールカード、２゜３．５，
６はコネクタ、４．４−１〜４−ｎはメモリカード１．
７Ａ、７Ｂはパス、８は線材、９はメモリ素子を示す。
Claims (1)
- メモリ装置と、該メモリ装置と外部装置との間の信号の
送受信を行う第１インターフェース部、第２インターフ
ェース部と、該第１インターフェース部のみを使用して
該メモリ装置と該外部装置との間の信号の送受信を行う
場合に該第２インター −フェース部と該メモリ装置と
の間を遮断する手、 段とを有することを特徴とす
るメモリカード。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8058384U JPS60194800U (ja) | 1984-05-31 | 1984-05-31 | メモリカ−ド |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8058384U JPS60194800U (ja) | 1984-05-31 | 1984-05-31 | メモリカ−ド |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60194800U true JPS60194800U (ja) | 1985-12-25 |
Family
ID=30626567
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8058384U Pending JPS60194800U (ja) | 1984-05-31 | 1984-05-31 | メモリカ−ド |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60194800U (ja) |
-
1984
- 1984-05-31 JP JP8058384U patent/JPS60194800U/ja active Pending
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