JPS60167522A - Semiconductor switch - Google Patents

Semiconductor switch

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Publication number
JPS60167522A
JPS60167522A JP2180184A JP2180184A JPS60167522A JP S60167522 A JPS60167522 A JP S60167522A JP 2180184 A JP2180184 A JP 2180184A JP 2180184 A JP2180184 A JP 2180184A JP S60167522 A JPS60167522 A JP S60167522A
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JP
Japan
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pnpn
switch
gate
anode
junction
Prior art date
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Pending
Application number
JP2180184A
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Japanese (ja)
Inventor
Ichiro Ohigata
大日方 一郎
Mitsuo Matsuyama
光男 松山
Tadakatsu Kimura
木村 忠勝
Yasunobu Inabe
井鍋 泰宣
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Ltd
Nippon Telegraph and Telephone Corp
Original Assignee
Hitachi Ltd
Nippon Telegraph and Telephone Corp
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Publication date
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Abstract

PURPOSE:To secure the actuation of a PNPN switch with high dv/dt tolerance and high sensitivity by using an element of PNPN structure to drive a short circuit protecting TR which gives a short circuit to a P-N junction at one side of the PNPN switch. CONSTITUTION:When the transient voltage having a sudden rise is applied between an anode A and a cathode K, the drive current of a short-circuiting TRQ1 is supplied from a place equivalent to a cathode gate through a PNPN element 2. Thus the TRQ1 is driven with the characteristics similar to the stored residual charge produced by the composite TR effect of a PNPTR and an NPNTR in a PNPN switch 1. Thus the dv/dt effect protecting capacity. While the element 2 is short-circuited by the P-N junction of the anode A and an anode gate GA to a DC action and turned off. Therefore the TRQ1 is not actuated either. Then the gate ignition sensitivity and the minimum holding current of the switch 1 are decided by a resistance R. The resistance of such a level that prevents the misignition due to the leakage current of the switch 1 is needed to the R. Therefore the high ignition sensitivity is obtained from the gate.

Description

【発明の詳細な説明】 〔発明の利用分野〕 本発明は、pNpN 4層構造の半導体スイッチの特性
改良に関するもので、特に4ν/11耐量が大きく、か
つ高感度で動作する半導体スイッチに関するものである
[Detailed Description of the Invention] [Field of Application of the Invention] The present invention relates to improving the characteristics of a pNpN four-layer structure semiconductor switch, and particularly relates to a semiconductor switch that has a large 4ν/11 withstand capability and operates with high sensitivity. be.

〔褪明の背景〕[Background of fading]

pNpN構造の半導体スイッチ(以下単にPNPNスイ
ッチという)には、アノードとカソード電極のみ取り出
したPNPNダイオード、カソードゲート制御端子また
はアノードゲート制御端子を取り出したる端子サイリス
タ、カソードゲート制御端子と7ノードゲート制御端子
の両方共取り出した4端子サイリスタ等があり、順逆と
もに高耐圧が得られ、かつ、自己保持機能を持りたスイ
ッチ素子として、種々の制御装置等に使用されている。
A semiconductor switch with a pNpN structure (hereinafter simply referred to as a PNPN switch) includes a PNPN diode with only the anode and cathode electrodes taken out, a terminal thyristor with the cathode gate control terminal or the anode gate control terminal taken out, a cathode gate control terminal and a 7-node gate control terminal. There are four-terminal thyristors, etc., which have both forward and reverse voltages, and are used in various control devices as switching elements that have a high withstand voltage in both forward and reverse directions and have a self-holding function.

しかし乍ら、これらPNPNスイッチは遮断中にアノー
ドとカソード間に急激な順方向電圧が加わると閉成して
しまうという欠点を持っている。この現象はdv/l 
を効果(あるいはレイト効果)と呼ばれるもので、これ
に対する対策法が種々提案されている。一般的には、P
NPNスイッチのカソードゲートGKとカソードに間に
抵抗を接続する方法が取られている。しかしこの方法で
高いdv/ct を耐量を得るためには低抵抗を接続す
る必要があり、ゲート点弧感度が悪くなるという欠点を
本質的に持っている。
However, these PNPN switches have the disadvantage that they will close if a sudden forward voltage is applied between the anode and cathode while the switch is turned off. This phenomenon is dv/l
This is called the effect (or late effect), and various countermeasures have been proposed for this effect. Generally, P
A method is used in which a resistor is connected between the cathode gate GK and the cathode of the NPN switch. However, in order to obtain a high dv/ct withstand capability with this method, it is necessary to connect a low resistance, which inherently has the drawback of poor gate firing sensitivity.

そこで“4を耐量が高くかつゲート点弧感度が良いPN
PNスイッチを得る手段として、第1図図示の如<PN
PNスイッチ1のカソードゲートGKとカソードに間に
トランジスタQ、を接続し過渡電圧が加わった時のみト
ランジスタQ1が動作して、カソードゲートGK、カソ
ードに間を短絡するようにpNpNスイッチ1のアノー
ドAとトランジスタQ1のベース間に容量性素子Cを接
続した回路が、米国特許第5.609,41&号明細書
に提示されている。この方法は容量性素子Cとしてコン
デンサを用いているため、半導体集積回路にはあまり適
さない。かつまた、かかる構成の回路を実際に半導体集
積化する場合には、種種の問題があり、構成に工夫を要
する。
Therefore, ``4'' is a PN with high tolerance and good gate firing sensitivity.
As a means of obtaining a PN switch, as shown in FIG.
A transistor Q is connected between the cathode gate GK and the cathode of the PN switch 1, and the transistor Q1 operates only when a transient voltage is applied, and the anode A of the pNpN switch 1 is connected to short-circuit between the cathode gate GK and the cathode. A circuit in which a capacitive element C is connected between the base of the transistor Q1 and the base of the transistor Q1 is presented in US Pat. No. 5,609,41&. Since this method uses a capacitor as the capacitive element C, it is not very suitable for semiconductor integrated circuits. Moreover, when a circuit having such a configuration is actually integrated into a semiconductor, there are various problems, and the configuration needs to be devised.

まずPNPNスイッチ1とdv7.、保護トランジスタ
Q1との動作の競争が行われ、特に”/l を保護トラ
ンジスタQ1の飽和からの回復が、PNPNスイッチ1
の蓄積電荷の削減より先になり、”/ltt保護効果が
なくなる問題を起こし易い。
First, PNPN switch 1 and dv7. , the operation competition with the protection transistor Q1 takes place, and in particular, recovery from the saturation of the protection transistor Q1 is caused by the PNPN switch 1
This is likely to occur before the reduction in the accumulated charge of ``/ltt'' and the protective effect of ``/ltt'' is lost.

また繰返し過渡電圧が加わる時に、容量性素子Cの放電
とPNPNスイッチ1の接合容量との放電に差が出て、
保護トランジスタもの駆動が十分に行われないことがあ
り、dv/d、耐量が低下する場合がある。また”/l
t を保護回路を付加したことにより、PNPNスイッ
チの本来持ってい・ 6 ・ る双方向高耐圧の特性を損ってはならないし、PNPN
スイッチが正規にオンした時にはdν/ct を保護回
路側はオフしないと発振の問題を引起こすので注意を要
する。
Furthermore, when a transient voltage is repeatedly applied, a difference appears between the discharge of the capacitive element C and the discharge of the junction capacitance of the PNPN switch 1,
The protection transistor may not be driven sufficiently, resulting in a decrease in dv/d and withstand capability. Also”/l
By adding a protection circuit to the PNPN switch, the bidirectional high voltage characteristics inherent to the PNPN switch must not be impaired, and the PNPN
If the protection circuit side does not turn off dv/ct when the switch is normally turned on, it will cause an oscillation problem, so care must be taken.

そこでこれらの問題を解決するために、当山願人は先に
第2図に示した回路を提示した。すなわち、PNPN)
ランジスタQ、のエミッタ・ベースにレベルシフト素子
を直列接続したものをPNPNスイッチ1のアノードと
アノードゲートの間に接続することで容量性素子として
保護トランジスタQ1を駆動し、かつ容量の放電路を形
成するために保護トランジスタQ、のベース・エミッタ
間にダイオードDを接続したものである。
In order to solve these problems, Ganto Toyama first proposed the circuit shown in Figure 2. i.e., PNPN)
A level shift element connected in series to the emitter and base of transistor Q is connected between the anode and anode gate of PNPN switch 1 to drive protection transistor Q1 as a capacitive element and form a capacitive discharge path. In order to do this, a diode D is connected between the base and emitter of the protection transistor Q.

かかる構成によれば、双方向高耐圧の特性を維持したま
ま、”/lt を耐量が大きく、かつ高感度で動作する
PNPNスイッチが得られる。但しかかる構成にJJい
ても、PNPNスイッチ1の特性とトランジスタQ=−
Qtで構成されるdv/lt を保護回路の特性との競
争の問題は残る。特にPNPNスイッチ1はPNP )
ランジスタとNpN )ランク・ 4 ・ スタとが一体化されており、単に個別のトランジスタを
外部で接続したものとは動作が異なるため、蓄積電荷の
削減特性に差が出て、”/lt を保護が十分性われな
い場合も出てくる可能性がある。
According to this configuration, it is possible to obtain a PNPN switch that has a large withstand capacity of "/lt" and operates with high sensitivity while maintaining the characteristics of bidirectional high withstand voltage. However, even if JJ is in this configuration, the characteristics of the PNPN switch 1 and transistor Q=-
The problem of competition between dv/lt formed by Qt and the characteristics of the protection circuit remains. Especially PNPN switch 1 is PNP)
Since the transistor and the NpN) rank 4 transistor are integrated, the operation is different from simply connecting individual transistors externally, so there is a difference in the reduction characteristics of accumulated charge, and it is difficult to protect "/lt". There may also be cases where the results are not sufficiently evaluated.

〔発明の目的〕[Purpose of the invention]

本発明の目的は、pNpNスイッチを高”/ct を耐
量でかつ高ゲート感度で動作させる半導体スイッチを提
供することにあり、特に、 (t) ”/lt を効果保護回路とPNPNスイッチ
の動作の競争に対して有利な回路構成を提供すること、 (2) アノ−トゲ−) GA 、カソードゲートGx
からの駆動に対しては、共に高ゲート感度で動作する回
路構成を提供すること、 (a) dv/ct を効果保護回路を接続したことに
よりpypyスイッチの双方向高耐圧特性が損われない
ような回路構成を提供すること、 (4)半導体集積回路化が容易な回路構成を提供するこ
と にある。
An object of the present invention is to provide a semiconductor switch that operates a pNpN switch with high ``/ct'' tolerance and high gate sensitivity. To provide a circuit configuration that is advantageous to competition; (2) Anode gate (GA), cathode gate Gx
(a) By connecting an effect protection circuit to dv/ct, the two-way high withstand voltage characteristics of the pypy switch should not be impaired. (4) To provide a circuit configuration that can be easily integrated into a semiconductor integrated circuit.

〔発明の概要〕[Summary of the invention]

上記目的を達成させるため、本発明は、 PNPNスイ
ッチの一方のPN接合を短絡する短絡用保護トランジス
タの駆動を、PNPN構造の素子を利用して行い、その
駆動回路は過渡的には容量性に加えてPNPNスイッチ
に類似の動作をし、直流的には容量性素子としてのみ動
作するように1本体PNPNスイッチの他端のPM接合
に並列に直接またはレベルシフト素子を介して接続し、
駆動用pNpN素子のゲート部を短絡用トランジスタの
ベースに接続した回路構成を特徴とするものである。
In order to achieve the above object, the present invention uses an element with a PNPN structure to drive a short-circuit protection transistor that shorts one PN junction of a PNPN switch, and the drive circuit is transiently capacitive. In addition, it operates similar to a PNPN switch, and is connected in parallel to the PM junction at the other end of the PNPN switch directly or via a level shift element so that it operates only as a capacitive element in terms of direct current.
This circuit is characterized by a circuit configuration in which the gate portion of the driving pNpN element is connected to the base of the shorting transistor.

〔発明の実施例〕[Embodiments of the invention]

以下図面を用いて本発明の一実施例を詳細に説明する。 An embodiment of the present invention will be described in detail below with reference to the drawings.

第3図は本発明による半導体スイッチの第1の実施例の
回路図で、1はPNPNスイッチで、Aはアノード、 
GAはアノードゲート、Gにはカソードゲート、Kはカ
ソードである。Q、はカソードゲートGx、カソードに
間のpN接合を短絡する短絡用保護トランジスタ、2は
短絡用トランジスタを駆動する駆動用PNPN素子、D
は放電用ダイオード、Rは抵抗である。
FIG. 3 is a circuit diagram of a first embodiment of a semiconductor switch according to the present invention, where 1 is a PNPN switch, A is an anode,
GA is an anode gate, G is a cathode gate, and K is a cathode. Q is a short-circuit protection transistor that short-circuits the pN junction between the cathode gate Gx and the cathode, 2 is a driving PNPN element that drives the short-circuit transistor, and D
is a discharge diode, and R is a resistance.

この回路構成によれば、アノードA、カソードに間に急
激な立上りの過渡電圧が加わった場合ニおけるIsM用
トランジスタQlの駆動電流はPMPM素子2を通して
そのカソードゲート相当のところから供給される。これ
によりpNpNスイッチ1の中のPNP )ランジスタ
とNPN )ランジスタの複金トランジスタ効果による
蓄積残留電荷と相似な特性をもって短絡用トランジスタ
Q、の駆動が行われ、′Lv/cLt効果保護能力が得
られる。PNPNスイッチ1をターンオンした時には、
駆動用pNpN素子2のNP接合にたまった電荷は、ダ
イオードDを通る放電路でpNpNスイッチ1の電荷と
同時に放電されるため、繰返し過渡電圧が加わっても十
分dν/11効果保護能力が得られる。
According to this circuit configuration, when a rapidly rising transient voltage is applied between the anode A and the cathode, the drive current of the IsM transistor Ql is supplied through the PMPM element 2 from a point corresponding to its cathode gate. As a result, the short-circuit transistor Q is driven with characteristics similar to the accumulated residual charge due to the double gold transistor effect of the PNP transistor and NPN transistor in the pNpN switch 1, and the 'Lv/cLt effect protection ability is obtained. . When PNPN switch 1 is turned on,
Since the charge accumulated in the NP junction of the driving pNpN element 2 is discharged simultaneously with the charge of the pNpN switch 1 in the discharge path passing through the diode D, sufficient dν/11 effect protection ability can be obtained even if repeated transient voltages are applied. .

次に直流的な動作に対しては、PNPN素子2・ 7 
・ はPNPNスイッチ1のアノードAとアノ−トゲ−) 
GAのpN接合で短絡されオフとなるため、短絡用トラ
ンジスタQ、も動作せず、pNpNスイッチ1のゲート
点弧感度および最小保持電流は抵抗Rにより決められる
ことになる。この抵抗Rは大きな□を効果保護を行う必
要がなく、PNPNスイッチ1のリーク電流による誤点
弧を防ぐ程度の高抵抗でよいため、ゲートからの点弧感
度は高いものが得られる。また双方向の高耐圧特性も容
易に得られる。
Next, for DC operation, PNPN elements 2 and 7
・ is the anode A and anode gate of PNPN switch 1)
Since the pN junction of GA is short-circuited and turned off, the short-circuiting transistor Q also does not operate, and the gate firing sensitivity and minimum holding current of the pNpN switch 1 are determined by the resistor R. This resistor R does not need to provide effective protection for a large □, and can be high enough to prevent erroneous firing due to leakage current of the PNPN switch 1, so that high firing sensitivity from the gate can be obtained. Also, bidirectional high voltage characteristics can be easily obtained.

第4図は本発明による半導体スイッチの第2の実施例を
示すものでおって、特にPMPMスイッチ1のON動作
時の”/l を保護回路の動作の切替を、より確実にす
る構成例を示すものである。
FIG. 4 shows a second embodiment of the semiconductor switch according to the present invention. In particular, a configuration example is shown in which the switching of the operation of the protection circuit is made more reliable during the ON operation of the PMPM switch 1. It shows.

すなわち3はレベルシフト素子を示すもので、n段のダ
イオードを直列接続したものでもよいし、ダイオードと
抵抗の直列回路でもよいし、場合によっては耐圧の低い
逆接合ダイオードでもよい。7ノードAとカソードに間
に過渡電圧が加わった時の動作は第3図の例と同様であ
り・ 8 ・ pypuスイッチ1をオン動作させた時は、PNPN素
子2がレベルシフト素子6゛を介して7ノード。
That is, numeral 3 indicates a level shift element, which may be a series connection of n stages of diodes, a series circuit of a diode and a resistor, or, depending on the case, a reverse junction diode with low breakdown voltage. 7. The operation when a transient voltage is applied between the node A and the cathode is the same as the example shown in Figure 3. 8. When the pypu switch 1 is turned on, the PNPN element 2 switches the level shift element 6. 7 nodes through.

アノードゲート接合で短絡されるため、より確実ニオフ
し、トランジスタQ、が動作することによる悪影響を除
くことができる。
Since it is short-circuited at the anode-gate junction, it can be turned off more reliably, and the adverse effects caused by the operation of the transistor Q can be eliminated.

第5図は本発明の第6の実施例を示すものでありて、特
にpNpNスイッチを逆並列接続して双方向スイッチと
して使用する場合に適した構成例を示すものである。1
′はアノードゲート領域の中にレベルシフト素子の機能
を持たせる第2P形領域を付加したpNpNスイッチ、
4は短絡用トランジスタQ、の駆動用としてのpNpN
素子を変形したNPNPN S層構造の素子で、構成例
を第7図に示す。
FIG. 5 shows a sixth embodiment of the present invention, and shows an example of a configuration particularly suitable for use as a bidirectional switch by connecting pNpN switches in antiparallel. 1
' is a pNpN switch in which a second P-type region is added in the anode gate region to have the function of a level shift element;
4 is a pNpN for driving the short-circuiting transistor Q.
FIG. 7 shows an example of the structure of an element having a modified NPNPNS layer structure.

かかる構成においても、端子T1#T!間に過渡電圧が
加わった場合には、逆側のダイオードDとNPNPN素
子4を経由して短絡用トランジスタQ1が駆動され、d
v/dt印加による誤動作を防止する。ターンオンした
時の放電路は、第6図。
Even in such a configuration, the terminal T1#T! When a transient voltage is applied between d and d, the shorting transistor Q1 is driven via the opposite diode D and the NPNPN element
Prevents malfunction due to v/dt application. Figure 6 shows the discharge path when turned on.

第4図等と同様、ダイオードDとNpNpN素子4とP
NPNスイッチ1′の中のレベルシフト用のP影領域を
経て形成される。また直流動作的には、NpNpN j
lc子4の中ノPNPN部とダイオードDとPNPNス
イッチ1′の中のP影領域によるPN接合との直列回路
を、アノードとアノードゲート接合で短絡することにな
り、”/l を効果保睦回路はオフされる。
Similarly to Fig. 4, diode D, NpNpN element 4 and P
It is formed via a P shadow area for level shifting in the NPN switch 1'. In terms of DC operation, NpNpN j
The series circuit between the middle PNPN part of the LC element 4 and the PN junction formed by the P shadow region in the diode D and the PNPN switch 1' is short-circuited between the anode and the anode gate junction, thereby preserving the effect of "/l". The circuit is turned off.

第6図は本発明の第4の実施例を示すもので逆並列接続
のPNPNスイッチ1#をアノードゲート領域間−島に
形成した場合の適用例を示すものである。4は第5図と
同様に短絡用トランジスタQ、を駆動するNPNPN 
S層構造の素子、3は第4図の例と同様のレベルシフト
素子である。
FIG. 6 shows a fourth embodiment of the present invention, in which an antiparallel-connected PNPN switch 1# is formed between the anode gate regions and an island. 4 is an NPNPN that drives the short-circuiting transistor Q as in FIG.
The S layer structure element 3 is a level shift element similar to the example shown in FIG.

回路動作は第5図と同様で、“/dt印加時の保賎、オ
ン時の電荷放電、PNPNスイッチオン直流動作時の保
験回路オフ動作を行う。
The circuit operation is similar to that shown in FIG. 5, and performs maintenance when /dt is applied, charge discharge when on, and test circuit off operation when the PNPN switch is on DC operation.

以上述べた実施例においては、アノードとアノードゲー
ト間のPN接合を短絡する回路例を示したが、これと相
補的にカソードとカソードゲート側を短絡する構成をと
ることも可能である。
In the embodiments described above, an example of a circuit was shown in which the PN junction between the anode and the anode gate was short-circuited, but it is also possible to adopt a configuration in which the cathode and the cathode-gate side are short-circuited in a complementary manner.

例えば第8図は第6図の構成と相補的な本発明による半
導体スイッチの第5の実施例を示すもので、短絡用トラ
ンジスタQ8はPNP )ランジスタで他の構成素子は
第6図と同様である。
For example, FIG. 8 shows a fifth embodiment of the semiconductor switch according to the present invention, which is complementary to the configuration shown in FIG. be.

〔発明の効果〕〔Effect of the invention〕

以上説明した如く、本発明によればpNpNスイッチの
v/ct を効果による誤点弧防止回路をPNPN構造
の素子を用いて、過渡電圧印加時にはpNpNスイッチ
と同様な能動素子として動作し、かつ直流的には誤点弧
防止回路をカットオフ状態とするように構成することに
より、製造バラツキ等によりPNPNスイッチの特性が
変動するような場合にも、有効に ht効果に対する保
護が行われ、ゲート駆動に対しては高ゲート点弧感度で
動作し、しかもこれによりpNpNスイッチの高耐圧特
性が損われないという特性上の利点を有し、かつ半導体
集積回路化が容易な回路構成を提供できる。
As explained above, according to the present invention, an error firing prevention circuit based on the effect of v/ct of a pNpN switch uses a PNPN structure element, operates as an active element similar to a pNpN switch when a transient voltage is applied, and operates as a DC Specifically, by configuring the false ignition prevention circuit to be in a cut-off state, even if the characteristics of the PNPN switch vary due to manufacturing variations, etc., protection against the HT effect is effectively achieved, and the gate drive It is possible to provide a circuit configuration that operates with high gate ignition sensitivity, which has the advantage of not impairing the high breakdown voltage characteristics of the pNpN switch, and which is easy to integrate into a semiconductor integrated circuit.

【図面の簡単な説明】[Brief explanation of drawings]

第1図及び、第2図は本発明に近い公知例の゛ 11 
。 回路図、第6図、第4図、第5図、第6図、第8図は各
々本発明による半導体スイッチの第1゜第2.第3.第
4.第5の実施例の回路図を示す。第7図は第5図及び
第6図の実施例に使用されるNPNPN@造の素子断面
図を示す。 1.1’、1’ : pNpNスイッチ2 : PNP
N$子 3ニレベルシフト素子 4 : NpNpN $子 Qs=Qm ; )ランジスタ D;ダイオード R;抵抗 A;アノード に;カソード GAニアノードゲート Gx;カソードゲート 代理人弁理士 高 橋 明 夫 °12゜ 殆1図 W82区 第3図 郁4 図 第5関 %6図 ヵ34.8、43 桶・K) ・□ ・ KL GKlp 34 GKI QQz 1q 第7図
Figures 1 and 2 show known examples close to the present invention.
. The circuit diagrams of FIGS. 6, 4, 5, 6, and 8 respectively show the first, second, and second circuit diagrams of a semiconductor switch according to the present invention. Third. 4th. A circuit diagram of a fifth embodiment is shown. FIG. 7 shows a cross-sectional view of an NPNPN@ structure element used in the embodiments of FIGS. 5 and 6. FIG. 1.1', 1': pNpN switch 2: PNP
N$3 two-level shift element 4: NpNpN $Qs=Qm; ) transistor D; diode R; resistor A; to anode; cathode GA near-node gate Gx; cathode gate patent attorney Akio Takahashi °12° Almost 1 Figure W82 Ward Figure 3 Iku 4 Figure 5 Seki %6 Figure Ka34.8, 43 Oke/K) ・□ ・ KL GKlp 34 GKI QQz 1q Figure 7

Claims (1)

【特許請求の範囲】 1 等測的にPNPN 4層構造を成す第1のPNPN
スイッチと、この第1のpNpNスイッチの一方のpN
接合を短絡する短絡用トランジスタと、この短絡用トラ
ンジスタを駆動する第2のPNPN構造の素子とをもっ
て構成され、上記第2のPNPN構造の素子を第1のp
NpNスイッチの他端のPN接合に並列に接続し、第2
のpNpN構造の素子の一方のゲートは短絡用トランジ
スタのベースに接続されたことを特徴とする半導体スイ
ッチ。 2 上記第2のPNPN構造の素子に直列にレベルシフ
ト素子を接続して上記第1のPNPNスイッチの他端の
PM接合に並列接続したことを特徴とする特許請求の範
囲第1項記載の半導体スイッチ。 五 逆並列接続したPNPNスイッチと、各々のPNP
Nスイッチの一方のpN接合を短絡するされ、該NPN
PN素子の両端のN領域はレベルシフト素子を介して前
記pNpNスイッチの7ノードゲートに各々接続され、
中間のP領域は各々短絡用トランジスタのベースに接続
されたことを特徴とする半導体スイッチ。
[Claims] 1. A first PNPN that isometrically forms a 4-layer PNPN structure.
switch and one pN of this first pNpN switch
It is composed of a shorting transistor that shorts the junction and a second PNPN structure element that drives the shorting transistor, and the second PNPN structure element is connected to the first pNPN structure element.
Connected in parallel to the PN junction at the other end of the NpN switch, and the second
A semiconductor switch characterized in that one gate of the pNpN structure element is connected to the base of a shorting transistor. 2. The semiconductor according to claim 1, wherein a level shift element is connected in series to the second PNPN structure element and connected in parallel to the PM junction at the other end of the first PNPN switch. switch. 5 PNPN switches connected in antiparallel and each PNP
One pN junction of the N switch is shorted, and the NPN
N regions at both ends of the PN element are each connected to the 7-node gate of the pNpN switch via a level shift element,
A semiconductor switch characterized in that the intermediate P regions are each connected to a base of a shorting transistor.
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0703664A3 (en) * 1994-09-20 1996-09-18 Hitachi Ltd Semiconductor circuit comprising means for malfunction prevention, and its use, particularly for inverters

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