JPS6012857A - Signal identifying circuit of network control device - Google Patents
Signal identifying circuit of network control deviceInfo
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- JPS6012857A JPS6012857A JP58120206A JP12020683A JPS6012857A JP S6012857 A JPS6012857 A JP S6012857A JP 58120206 A JP58120206 A JP 58120206A JP 12020683 A JP12020683 A JP 12020683A JP S6012857 A JPS6012857 A JP S6012857A
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Abstract
Description
【発明の詳細な説明】
辣1じ乞夏
本発明は、ファクシミリ等の網制御装置における直流お
よび交流受信信号の検出を行なう信号識別回路に関する
ものである。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a signal identification circuit for detecting DC and AC reception signals in a network control device such as a facsimile.
剋迷皿1
加入者線と電話機との間に接続され、ファクシミリ等の
端末装置と電話機との間で接続切換えを行なう網制御装
置は、電話機のフックがONであるかOFFであるかを
検出する機能と、呼出交流43号を検出する機能が必装
である。The network control device, which is connected between the subscriber line and the telephone and switches the connection between the telephone and a terminal device such as a facsimile machine, detects whether the hook of the telephone is ON or OFF. The function to detect the calling AC number 43 is essential.
これらの機能を有する従来の網制御装置の例を第1図に
示す。2はリレーまたはフォトカゾラよりなる直流ルー
プ検出回路、4は直流電流を阻止する直流電流阻止コン
デンサ、6は整流ブリッジ、8はリレーまたはフォトカ
プラよシなる交流受信信号検出回路10a、10bは、
中央局からの加入者線100を電話機側接続端子200
とファクシミリ端末装置50の間で切シ換えるリレー接
点、50はファクシミリ端末装置である。An example of a conventional network control device having these functions is shown in FIG. 2 is a DC loop detection circuit made of a relay or a photocoupler; 4 is a DC current blocking capacitor for blocking a DC current; 6 is a rectifier bridge; 8 is a relay or photocoupler.
Connect the subscriber line 100 from the central office to the telephone side connection terminal 200
and a facsimile terminal device 50; 50 is a facsimile terminal device;
電話機をオフフックすると、加入者線io。When you take the phone off-hook, the subscriber line io.
を流れる直流ループ電流によシ検出回路2でオフフック
が検出される。このとき検出回路8は、直流阻止コンデ
ンサ4により、直流ルーグミ流が阻止されて動作しない
。Off-hook is detected by the detection circuit 2 due to the DC loop current flowing through. At this time, the detection circuit 8 does not operate because the DC blocking capacitor 4 blocks the DC Rougemi flow.
次に網から加入者線iooを通して呼出交流信号が到来
すると、これは直流阻止コンデンサ4を通過する。そこ
で、整流ブリッジ6を通して検出回路8が動作し、この
検出回路8の出力するON信号は、接点I Q a *
i 0 bの切換えなど必要な各種制御に利用される
。Next, when a calling AC signal arrives from the network through the subscriber line ioo, it passes through the DC blocking capacitor 4. Therefore, the detection circuit 8 operates through the rectifier bridge 6, and the ON signal output from the detection circuit 8 is transmitted to the contact IQ a *
It is used for various necessary controls such as i 0 b switching.
このような従来方式では、受信信号の検出回路として2
回路必要となり、装置構成上、スペース的、コスト的に
不利であシ、また部品点数が多いなどの欠点があった。In such a conventional method, two
This method requires a circuit, which is disadvantageous in terms of device configuration, space, and cost, and it also has drawbacks such as a large number of parts.
また交流検出回路8は、自局の電話機で発生したダイヤ
ルパルスにも応動してしまい、誤動作する等の欠点があ
った。Furthermore, the AC detection circuit 8 also responds to dial pulses generated by the telephone at its own station, resulting in malfunctions.
この問題を解決するために、特開昭57−31256に
記載のNCU回路では、回線の直流ループ電流および呼
出交流信号のいずれにも応動する監視回路を使用してい
る。しかし、調整の微妙な多くの時定数回路を必要とす
るなど、なお複雑な構成となっている。To solve this problem, the NCU circuit described in Japanese Patent Laid-Open No. 57-31256 uses a monitoring circuit that responds to both the line's DC loop current and the calling AC signal. However, it still has a complicated configuration, requiring many time constant circuits with delicate adjustments.
W飾
本発明はこのような従来技術の欠点を解消し、簡略な構
成で誤動作をすることなく確実に各種の受信信号を識別
することのできる網制御装置の信号識別回路を提供する
ことを目的とする。An object of the present invention is to eliminate the drawbacks of the prior art and provide a signal identification circuit for a network control device that can reliably identify various received signals with a simple configuration and without malfunction. shall be.
1里
本発明の構成について以下、一実施例に基づいて説明す
る。The configuration of the present invention will be described below based on one embodiment.
本発明による網制御装置の信号識別回路の実施例では、
中央局から電話機(図示せず)に至る加入者線100の
一方、たとえばR線に1対のフォトカプラ20が挿入さ
れている。この実施例では、R線における接点10bの
ブレーク側から電話機のL2線に至る間に、1対のフォ
トダイオードDIおよびD2が図示のように互いに逆極
性に接続されている。7オトグイオー、ドDiおよびD
2の両端には、これらを逆耐圧から保護するだめのコン
デンサ22およびバリスタ24が接続されている。In an embodiment of the signal identification circuit of a network control device according to the present invention,
A pair of photocouplers 20 are inserted into one side, for example, the R line, of a subscriber line 100 extending from a central office to a telephone (not shown). In this embodiment, a pair of photodiodes DI and D2 are connected with opposite polarities to each other as shown, from the break side of the contact 10b on the R line to the L2 line of the telephone. 7 Otoguio, Do Di and D
A capacitor 22 and a varistor 24 are connected to both ends of the capacitor 2 to protect them from reverse breakdown voltage.
フォトカプラ対20の各フォトトランジスタQlおよび
Q2の各エミッタは接地されている。Each emitter of each phototransistor Ql and Q2 of photocoupler pair 20 is grounded.
また、そのコレクタは、一方では抵抗26を介して正の
直流電源V。Cに接続され、他方では2つのインバータ
28および30の各人力27および29に接続されてい
る。インバータ28および30は、各入力27または2
9が所定の閾値を超えると対応する出力31または33
が低レベルになる波形整形機能を有したシュミットトリ
ガ・インバータでよい。Moreover, its collector is connected to a positive DC power supply V via a resistor 26 on the one hand. C and, on the other hand, to two inverters 28 and 30, respectively, to human power 27 and 29. Inverters 28 and 30 each input 27 or 2
9 exceeds a predetermined threshold, the corresponding output 31 or 33
A Schmitt trigger inverter with a waveform shaping function that reduces the voltage to a low level may be used.
インバータ28の°出力31にはトーンディテクタ32
が接続されている。トーンディテクタ32は、後述する
ように呼出信号゛などの様々な信号音を検出する回路で
あり、その出力35には、検出した信号音の各・ぞルス
の継続期間を表わすデータが、たとえばディジタルデー
タの形で処理装置(CPU ) 48に出力される。ま
た、インバータ30の出力33は、高レベルでオフフッ
ク検出を表わす信号としてCPU 48に供給される。A tone detector 32 is connected to the output 31 of the inverter 28.
is connected. The tone detector 32 is a circuit that detects various signal tones such as a ringing signal, as will be described later, and its output 35 contains data representing the duration of each detected signal tone, for example, as a digital signal. The data is output to a processing unit (CPU) 48 in the form of data. The output 33 of inverter 30 is also provided to CPU 48 as a high level signal indicating off-hook detection.
CPU A 8は、本網制御装置全体、あるいはファク
シミリ端末装置50をも含めたシステム全体を制御する
ディジタル処理装置であり、本発明の理解に必要な部分
のみが図示されている。The CPU A 8 is a digital processing device that controls the entire network control device or the entire system including the facsimile terminal device 50, and only the parts necessary for understanding the present invention are shown.
CPU 48は接続線37でトーンディテクタ32を制
御し、矢印49で象徴的に示される制御線49で切換接
点10aおよび10゛bを制御する。The CPU 48 controls the tone detector 32 via a connecting line 37 and the switching contacts 10a and 10'b via a control line 49, symbolized by an arrow 49.
まず電話機がオンフックの状態にあシ、また呼出交流信
号が中央局から到来しない遊休状態での動作を説明する
。この状態では加入者ル−グが閉成せず、2つの7オト
カグラ20は、ダイオードDIおよびD2に電流が流れ
ないためトランジスタQ1およびQ2がOFFとなって
いる。したがってトランジスタQ1およびQ2のコレク
タは正電源V。Cの電圧でHレベルとなり、インバータ
28.30の出力はLレベルとなっている。First, we will explain the operation when the telephone is on-hook and in an idle state where no calling AC signal is received from the central office. In this state, the subscriber loop is not closed, and no current flows through the diodes DI and D2 in the two 7-channel telephone circuits 20, so that the transistors Q1 and Q2 are turned off. Therefore, the collectors of transistors Q1 and Q2 are connected to the positive power supply V. The voltage of C becomes H level, and the output of inverter 28.30 becomes L level.
次に電話機がオンフック状態で第4図(4)に示す呼出
交流信号が中央局から加入者線100に到来すると、呼
出信号の半波毎に7オトカグラ20の発光ダイオードD
1およびD2に交互に電流が流れ、トランジスタQ1お
よびQ2のコレクタ出力は交互にON 、 OFFとな
る。2つのトランジスタQlおよびQ2のコレクタは、
いわゆる共通接続コレクタによるワイヤ208回路を構
成しているので、たとえば通常の!6Hzの呼出交流信
号は2倍の36 Hzにてい倍された形でインバータ2
8に入力される。よってインバータ28の出力31には
第4図(B)に示す如く36 HzのH,Lレベルのく
り返しノfルスとして出力されることになる。インバー
タ28の出力31は、トーンディテクタ32に接続され
ており、と、のような整形された36Hzの/ぞルスが
トーンディテクタ32に入力され、パルス幅が計数され
、CPU 48で呼出信号として検出される。Next, when the telephone is on-hook and a calling AC signal shown in FIG. 4 (4) arrives from the central office to the subscriber line 100, seven light emitting diodes D
Current flows alternately through transistors Q1 and D2, and the collector outputs of transistors Q1 and Q2 are alternately turned on and off. The collectors of the two transistors Ql and Q2 are
Since the wire 208 circuit is configured by a so-called common connection collector, for example, a normal! The 6Hz calling AC signal is doubled to 36Hz and sent to the inverter 2.
8 is input. Therefore, as shown in FIG. 4(B), the output 31 of the inverter 28 is a 36 Hz H/L level repeating pulse. The output 31 of the inverter 28 is connected to a tone detector 32, and a shaped 36Hz signal such as be done.
ところで、遊休状態において時刻tl(第4図(C))
で電話機をオフフック状態にした場合、加入者ループが
形成され、一方の方向に直流電流が流れる。これによシ
ベアフォトカゾラ20のいずれかのダイオードDIまた
はD2が定常的にONの状態となシ、よって導通した一
方のトランジスタQ1またはQ2のコレクタは低レベル
となり、インバータ30の出力33ではHレベルのオフ
フック検出信号が出力される。By the way, in the idle state, the time tl (Fig. 4(C))
When the telephone is taken off-hook, a subscriber loop is formed and direct current flows in one direction. As a result, one of the diodes DI or D2 of the Shibea photocazolla 20 is not in a steady ON state, so the collector of one of the transistors Q1 or Q2 that has been turned on becomes a low level, and the output 33 of the inverter 30 is turned on. An off-hook detection signal at H level is output.
次に電話機がオフフック状態において、ダイヤルを操作
した場合、導通している一方のフォトダイオードD1ま
たはD2はダイヤルパルスに応じて断続する。たとえば
10ppsのダイヤルパルス(第4図CD) )の場合
、これまでオフフックによシ定常的に導通していた一方
のフォトカプラ20のフォトダイオード、たとえばDl
が1/1o秒の周期でON 、 OFFを繰り返し、他
方、たとえばD2は継続的に非導通状態をとる。そこで
一方のトランジスタQ1の出力はワイヤドOR結合を介
して同じ10 ppsのノjルスをインバータ28に出
力する。同様にして20 ppsのダイヤルパルスのと
きは20 ppsのi9ルス出力がフォトカプラ20の
出力側に現われる。Next, when the dial is operated while the telephone is off-hook, one of the photodiodes D1 or D2, which is conducting, is turned on and off in response to the dial pulse. For example, in the case of a 10 pps dial pulse (Fig. 4 CD), the photodiode of one photocoupler 20, for example Dl
is repeatedly turned ON and OFF at a period of 1/1o second, while, for example, D2 is continuously in a non-conducting state. Therefore, the output of one transistor Q1 outputs the same 10 pps Norj to the inverter 28 via a wired OR combination. Similarly, when the dial pulse is 20 pps, an i9 pulse output of 20 pps appears on the output side of the photocoupler 20.
各ダイヤルパルスの検出i9ルスはインバータ28で整
形、反転され、トーンディテクタ32に入力、容易に前
述の呼出信号と区別される。The detected i9 pulse of each dial pulse is shaped and inverted by an inverter 28, and inputted to a tone detector 32, where it can be easily distinguished from the above-mentioned calling signal.
すなわち、ダイヤルミ4ルスによる検出パルスは10
Hzまたは20 Hzであるに対し、呼出交流信号によ
る検出パルスは16Hzを2倍にてい倍した32I(z
としてトーンディテクタ32に入力される。このように
呼出信号の検出信号の周波数をダイヤルパルス検出信号
の周波数から離れるようにシフトさせることにより、C
PU48では周波数の相違が容易に識別され、これらの
信号が区別される。In other words, the number of pulses detected by DialMi4rus is 10.
Hz or 20 Hz, whereas the detection pulse from the calling AC signal is 32I (z
The signal is input to the tone detector 32 as a signal. By shifting the frequency of the ringing signal detection signal away from the frequency of the dial pulse detection signal in this way, C
In the PU 48, the difference in frequency is easily identified and these signals are differentiated.
次にトーンディテクタ32にづいて説明を行なう。トー
ンディテクタ32は第3図に示す如く、制御信号発生回
路40、アンドゲート42、基準クロック発生回路44
、切換スイッチ50および計数回路46よシ成りている
。基準クロック発生回路44は、出力端子45aに比較
的低い周波数のクロックを出力し、出力端子45bには
比較的高い周波数のタロツクを出力する。Next, the tone detector 32 will be explained. As shown in FIG. 3, the tone detector 32 includes a control signal generation circuit 40, an AND gate 42, and a reference clock generation circuit 44.
, a changeover switch 50, and a counting circuit 46. The reference clock generation circuit 44 outputs a relatively low frequency clock to an output terminal 45a, and outputs a relatively high frequency tarokk to an output terminal 45b.
このようにすることによって、計数回路46は同じ計数
段数で長短いずれの周期の)4ルス幅をも言−1数する
ことができる。By doing so, the counting circuit 46 can multiply the width of 4 pulses (of either long or short periods) by 1 with the same number of counting stages.
第2図のインバータ28から入力信号が制御信号発生回
路40に入ると、入力信号のHレベルの期間だけり−ド
41を付勢してアンドダートを開き、これによってその
Hレベルの期間中だけ基準クロック発生回路44から計
数回路46に計数クロックが供給される。たとえば呼出
信号やダイヤル・ぐルスの識別動作の場合、CPU 4
8は制御線37により接点50を出力45&に接続し、
低い周波数のクロックを計数回路46に入力させる。こ
のようにして計数回路46は、インバータ28の出力3
1がHレベルにある期間の長さを計数し、出力35から
この計数値をCPU 48に出力する。インバータ28
からの入力信号31がLレベルになると、制御信号発生
回路40はリード43によって計数回路46をリセット
し、次のパルス幅の計数に備える。When the input signal from the inverter 28 in FIG. 2 enters the control signal generation circuit 40, the gate 41 is energized and the AND/DART is opened only during the period when the input signal is at the H level. A counting clock is supplied from the reference clock generation circuit 44 to the counting circuit 46. For example, in the case of calling signals and dial/guru identification operations, the CPU 4
8 connects the contact 50 to the output 45& by the control line 37,
A low frequency clock is input to the counting circuit 46. In this way, the counting circuit 46 outputs the output 3 of the inverter 28.
1 is at the H level, and outputs this counted value from the output 35 to the CPU 48. Inverter 28
When the input signal 31 from the control signal generation circuit 40 becomes L level, the control signal generation circuit 40 resets the counting circuit 46 through the lead 43 and prepares for counting the next pulse width.
このような計数回路46からの出力データ35、および
インバータ30の出力33にもとすいてCPU 48は
、呼出信号をダイヤルiEルスとは明確に区別して識別
し、また、オフフックを識別する。呼出信号を検出する
と、CPo 48はリード49により接点10aおよび
lObをファクシミIJ端末装置50911に切り換え
、装置制御が行なわれる。Based on the output data 35 from the counting circuit 46 and the output 33 from the inverter 30, the CPU 48 clearly distinguishes the calling signal from the dial iE call and identifies off-hook. When a ringing signal is detected, the CPo 48 switches the contacts 10a and 1Ob to the facsimile IJ terminal device 50911 through the lead 49, thereby controlling the device.
亙至
本発明によれば、このように、オフフックの検出回路と
呼出信号の検出回路を共通化することにより網制御装置
の構成を簡素化することができる。また、呼出信号の周
波数をてい倍して識別しているので、従来方式の欠点で
6りた自局の電話機によるダイヤル・ぞルスを呼出信号
として誤検出して誤動作することを防ぐことができる。According to the present invention, the configuration of the network control device can be simplified by making the off-hook detection circuit and the paging signal detection circuit common. In addition, since the frequency of the ringing signal is multiplied for identification, it is possible to prevent malfunctions caused by erroneously detecting dials and dials from your own telephone as a ringing signal, which is a drawback of the conventional method. .
さらに、使用する電話機の種数や、呼出信号の偏差にも
誤動作することがない。Furthermore, there is no malfunction due to the number of types of telephones used or deviations in ringing signals.
第1図は従来の網制御装置の信号識別回路のνりを示す
回路図、
第2図は本発明による網制御装置の信号識別回路の実施
例を示す回路図、
第3図は第2図の実施例に使用するトーンディテクタの
ブロック図、
第4図は第2図に示す回路の各部に現われる信号波形を
示す波形図である。
主要部分の符号の説明
2・・・ループ検出回路
4・−・直流阻止用コンデンサ
6・・・整流ブリッジ
8・・・交流検出回路
10a、10b・・・リレー接点
20・・・フォトカブラ
24・・・保護用バリスタ
28.30・・・インバータ
32・・・トーンディテクタ
40・・・制御信号発生回路
42・・・アンドゲート
44・・・基準クロック発生回路
46・・・計数回路
48・・・CPU
50・・・ファク7ミリ端末装置
100・・・加入者線
200・・・電話機端子
特許出願人 株式会社リコー
手続ネ山j−1三j−Iり
昭和58年10J1−2P日
特許庁長官 若杉和夫 殿
工、事件の表示
昭和58年特許願第120206号
2、発明の名称
網制御装置の信号識別回路
3、補正をする者
本件との関係 特許出願人
住 所 東京都大田区中馬込1丁目3番6号名 称 (
874) 株式会社 リ コ −4、代理人
住所〒105
東京都港区虎ノ門1−13−4
虎ノ門宝寿会館7#
5、補正の対象
(1)明細書の「発明の詳細な説明」の欄(2)明細書
の「図面の簡単な説明」の欄6、補正の内容
(1)明細書第6頁第5行の
「継続JIJI IIJI Jを
r周期」に訂正する。
(2)同第7頁第17行の
r 36HzJを
r 32HzJに訂tEする。
(3)同頁S2θ行の
r 38)1zJを
132HzJに訂正する。
(4)同第8頁第3行の
r38HzJを
r32HzJに訂正する。
(5)同頁第4行の
「パルス幅」を
「パルスの周期に相当するパルス数」に訂正する。
(6)同第1O頁第1θ行の
r周期のパルス幅」を
「周期に相当するパルス数」に訂正する。
(7)同頁第13行〜第14行の
「Hレベル」を
「1周期」に訂正する。
(8)同頁第15行の
「Hレベル」を
「1周期」に訂正する。
(9)同第11頁第2行〜第3行の
「がHレベルにある」を
「の出力パルスの1周期の」に訂正する。
(lO)同頁第5行の
「がLレベルになる」を
「の1周期が終了する」に訂正する。
(11)同頁第7行の
「パルス幅」を
「パルス周期」に訂正する。
(12)同頁第16行と第17行の間に下記の文章を挿
入する。
「 第5図は本発明の他の実施例を示し、第2図の回路
におけgコンデンサ22の代りに、抵抗10Gおよび1
02が設けられ、LlおよびL2線が抵抗104および
コンデンサ10Bで結合されている他は第2甲の回路と
同様である。」(13)同第12頁第15行の
r波形図」を
「波形図、第5図は本発明の他の実施例を示す回路図」
に訂正する。
(14)図面の第5図を別紙のとおり追加する。
7、添付書類の目録
(1)追加図面(第5図) 1通FIG. 1 is a circuit diagram showing the signal identification circuit of a conventional network control device; FIG. 2 is a circuit diagram showing an embodiment of the signal identification circuit of a network control device according to the present invention; FIG. FIG. 4 is a waveform diagram showing signal waveforms appearing in each part of the circuit shown in FIG. 2. Explanation of symbols of main parts 2... Loop detection circuit 4... DC blocking capacitor 6... Rectifier bridge 8... AC detection circuit 10a, 10b... Relay contact 20... Photo coupler 24... ...Protective varistor 28,30...Inverter 32...Tone detector 40...Control signal generation circuit 42...AND gate 44...Reference clock generation circuit 46...Counter circuit 48... CPU 50...Fax 7mm terminal device 100...Subscriber line 200...Telephone terminal Patent applicant: Ricoh Co., Ltd., Japan J-13J-I, Director General of the Japan Patent Office, 1981, 10J1-2P Kazuo Wakasugi, Engineer, Indication of the case, 1982 Patent Application No. 120206 2, Name of the invention, Signal identification circuit for network control equipment 3, Person making the amendment Relationship to the case Patent applicant Address: 1 Nakamagome, Ota-ku, Tokyo Chome 3-6 Name (
874) Riko Co., Ltd. -4, Agent address: Toranomon Hoju Kaikan 7#5, 1-13-4 Toranomon, Minato-ku, Tokyo 105, Subject of amendment (1) "Detailed description of the invention" column of the specification (2) Contents of amendment in column 6 of "Brief Description of Drawings" of the specification (1) Correct the statement "Continuation JIJI IIJI J to r period" in line 5 of page 6 of the specification. (2) Revise r 36HzJ on page 7, line 17 to r 32HzJ. (3) Correct r38) 1zJ to 132HzJ in line S2θ on the same page. (4) Correct r38HzJ in the third line of page 8 to r32HzJ. (5) Correct "pulse width" in the fourth line of the same page to "number of pulses corresponding to the pulse period". (6) Correct "pulse width of r period" in the 1st θ line of page 1 O to "number of pulses corresponding to the period". (7) Correct "H level" in lines 13 to 14 of the same page to "1 cycle." (8) Correct "H level" in line 15 of the same page to "1 cycle". (9) In the second and third lines of page 11, "is at H level" is corrected to "is in one period of the output pulse of". (lO) In the fifth line of the same page, correct "becomes L level" to "ends one cycle of." (11) Correct "pulse width" in line 7 of the same page to "pulse period". (12) Insert the following text between lines 16 and 17 of the same page. 5 shows another embodiment of the invention, in which the g capacitor 22 in the circuit of FIG. 2 is replaced by a resistor 10G and a
02 is provided, and the Ll and L2 lines are coupled through a resistor 104 and a capacitor 10B, but this circuit is the same as the circuit in the second A. (13) "r waveform diagram on page 12, line 15" is replaced with "waveform diagram," and FIG. 5 is a circuit diagram showing another embodiment of the present invention.
Correct. (14) Figure 5 of the drawings is added as attached. 7. List of attached documents (1) Additional drawings (Fig. 5) 1 copy
Claims (1)
入者線から到来しだ呼出信号を検出すると、該加入者線
を電話機から端末装置に切シ換える網制御装置の信号識
別回路において、該信号識別回路は、 前記加入者線における一方の方向の電流に応動して論理
出力を出力する第1の方向性検出手段と、 第1の方向性検出手段とは逆極性に接続され、該加入者
線における他方の方向の電流に応動して論理出力を出力
する第2の方向性検出手段と、第1および第2の方向性
検出手段の論理出力の論理和ととる合成回路と、 該合成回路の出力する信号の周波数および継続期間を識
別する信号識別手段とを含み、該信号識別手段は、前記
合成回路の論理出力が継続したとき株前記電話機による
オフフックと識別し、 該合成回路の論理出力が断続したときは1、その断続の
周波数および継続期間から呼出信号を識別することを特
徴とする網制御装置の信号識別回路。[Scope of Claims] A network control device that is located between a telephone set, a terminal device, and a subscriber line, and that switches the subscriber line from the telephone set to the terminal device when a ringing signal arriving from the subscriber line is detected. The signal identification circuit includes: first directionality detection means for outputting a logic output in response to a current in one direction in the subscriber line; and a first directionality detection means having a polarity opposite to that of the first directionality detection means. a second directionality detection means that is connected to the subscriber line and outputs a logic output in response to a current in the other direction in the subscriber line; and a logical sum of the logic outputs of the first and second directionality detection means. a synthesis circuit; and signal identification means for identifying the frequency and duration of a signal output by the synthesis circuit, the signal identification means identifying an off-hook by the telephone when the logic output of the synthesis circuit continues. A signal identification circuit for a network control device, characterized in that when the logical output of the combining circuit is intermittent, the signal is 1, and a paging signal is identified from the frequency and duration of the intermittent occurrence.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58120206A JPS6012857A (en) | 1983-07-04 | 1983-07-04 | Signal identifying circuit of network control device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58120206A JPS6012857A (en) | 1983-07-04 | 1983-07-04 | Signal identifying circuit of network control device |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6012857A true JPS6012857A (en) | 1985-01-23 |
Family
ID=14780525
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP58120206A Pending JPS6012857A (en) | 1983-07-04 | 1983-07-04 | Signal identifying circuit of network control device |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6012857A (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS62237857A (en) * | 1986-04-09 | 1987-10-17 | Sanyo Electric Co Ltd | Facsimile equipment |
-
1983
- 1983-07-04 JP JP58120206A patent/JPS6012857A/en active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS62237857A (en) * | 1986-04-09 | 1987-10-17 | Sanyo Electric Co Ltd | Facsimile equipment |
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