JPS6012144Y2 - dot matrix display device - Google Patents

dot matrix display device

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Publication number
JPS6012144Y2
JPS6012144Y2 JP8433680U JP8433680U JPS6012144Y2 JP S6012144 Y2 JPS6012144 Y2 JP S6012144Y2 JP 8433680 U JP8433680 U JP 8433680U JP 8433680 U JP8433680 U JP 8433680U JP S6012144 Y2 JPS6012144 Y2 JP S6012144Y2
Authority
JP
Japan
Prior art keywords
dot matrix
column electrodes
column
display device
electrodes
Prior art date
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Expired
Application number
JP8433680U
Other languages
Japanese (ja)
Other versions
JPS579978U (en
Inventor
和正 安田
武弘 石川
Original Assignee
セイコーインスツルメンツ株式会社
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Filing date
Publication date
Application filed by セイコーインスツルメンツ株式会社 filed Critical セイコーインスツルメンツ株式会社
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Publication of JPS579978U publication Critical patent/JPS579978U/ja
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Expired legal-status Critical Current

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  • Digital Computer Display Output (AREA)
  • Control Of Indicators Other Than Cathode Ray Tubes (AREA)
  • Devices For Indicating Variable Information By Combining Individual Elements (AREA)

Description

【考案の詳細な説明】 本考案はいわゆるドツトマトリックスにより構成された
数字又は文字の小文字を得る手段に関するものである。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a means for obtaining lowercase numbers or letters constructed by a so-called dot matrix.

最近、生活の多様化に供ない、日常生活に身近に必要と
する情報が多様化して来たために、腕時計あるいは小型
計算機等の携帯機器に多数の情報を組みこむことが考え
られている。
2. Description of the Related Art Recently, with the diversification of lifestyles, the information that is needed in everyday life has become more diverse, and it is now being considered to incorporate a large amount of information into portable devices such as wristwatches and small computers.

集積回路技術の向上により、情報自体の小型化が可能に
なり、さらに、それを表示する手段として、数字、英文
字、記号等がより自由に表現できるドツトマトリックス
表示機が上記小型携帯情報機器にも採用されるようにな
って来た。
Improvements in integrated circuit technology have made it possible to miniaturize the information itself, and as a means of displaying it, dot matrix displays, which can more freely express numbers, letters, symbols, etc., have been used in the above-mentioned small portable information devices. has also started to be adopted.

第1図が、5行、7列のドツトマトリック表示を時計に
応用した場合の例であるが、時分秒の大きさがすべて同
じであるため見にくく、特に秒と分の区別がはっきりし
ないという欠点を有していた。
Figure 1 shows an example of a 5-row, 7-column dot-matrix display applied to a clock, but it is difficult to read because the hours, minutes, and seconds are all the same size, and it is especially difficult to distinguish between seconds and minutes. It had drawbacks.

これを解消するために、一番必要度の高い1時J′分ヨ
は大きくし、1秒、の表示を小さくしたのが第2図であ
る。
In order to solve this problem, the display of 1:00 J' minutes, which is most necessary, is made larger, and the display of 1 second is made smaller, as shown in Fig. 2.

一方、秒表示を5行6列のドツト構成を用いて小文字に
したのが第3図である。
On the other hand, FIG. 3 shows seconds displayed in lowercase letters using a dot configuration of 5 rows and 6 columns.

また、表示装置として、液晶表示装置を用いた場合の電
極構造は、第1図の場合が第4図で、第2図の場合が第
5図である。
Further, when a liquid crystal display device is used as a display device, the electrode structure in the case of FIG. 1 is shown in FIG. 4, and in the case of FIG. 2 is shown in FIG. 5.

しかし、第2図のようになした場合は、第5図からも判
かるように、電極間すきまが電極間抵抗の問題のために
、小さく出来ないため、結果的に小文字のドツトが非常
に小さくなってしまうという欠点があった。
However, when it is done as shown in Figure 2, as can be seen from Figure 5, the gap between the electrodes cannot be made smaller due to the problem of inter-electrode resistance, and as a result, the lowercase dots become very large. The drawback was that it was small.

一方、第3図のようになす場合は、従来は、集積回路内
に大文字用と小文字用それぞれ別のデコーダを備え、そ
の表示内容によって回路内で識別し、デコーダを切換え
て表示装置へ出力するようにしていた。
On the other hand, in the case of doing as shown in Fig. 3, conventionally, separate decoders for uppercase letters and lowercase letters are provided in the integrated circuit, and the display contents are identified in the circuit, and the decoder is switched to output to the display device. That's what I was doing.

しかし、その場合は、デコーダが大文字用、小文字用で
2倍の量になり、さらにその識別と切換の回路をも備え
なければならなかった。
However, in that case, the number of decoders for uppercase letters and lowercase letters would be twice as large, and circuits for identification and switching would also have to be provided.

本考案は上記の欠点を除去し、回路上は何ら手を加える
ことなく、デコーダは大文字用の1種類のみで良く、さ
らに識別回路や切換回路を備える必要もなく、非常に安
易な手段で小文字を得ることを目的としたものである。
The present invention eliminates the above drawbacks, requires no modification to the circuit, requires only one type of decoder for uppercase letters, and also eliminates the need for identification circuits or switching circuits. The purpose is to obtain.

以下、図面に従って本考案を詳細に明する。Hereinafter, the present invention will be explained in detail according to the drawings.

第6図は本考案の一実施例の電極構造を示している。FIG. 6 shows the electrode structure of one embodiment of the present invention.

この図において、101〜107は列電極、111〜1
60は行電極を示す。
In this figure, 101-107 are column electrodes, 111-1
60 indicates a row electrode.

この複数の行電極と列電極は互いに直行して配置され、
前記列電極101〜107を共通して複数のデジットの
マトリックスを構成している。
The plurality of row electrodes and column electrodes are arranged perpendicularly to each other,
The column electrodes 101 to 107 commonly constitute a matrix of a plurality of digits.

そして、前記列電極は所定数のデジット領域においては
全列電極101〜107が設けられて大文字表示領域が
形成され、残余の所定数のデジット領域においては、全
列電極の両端の電極101と107を含み、全電極数よ
り少ない数の所定の列電極が等間隔に設けられて小文字
領域を形成している。
In a predetermined number of digit areas, all the column electrodes 101 to 107 are provided to form a capital letter display area, and in the remaining predetermined number of digit areas, electrodes 101 and 107 at both ends of all the column electrodes are provided. , and a predetermined number of column electrodes smaller than the total number of electrodes are provided at regular intervals to form a lower case region.

この実施例の場合、小文字領域には列電極105が配置
されていない状態である。
In this embodiment, no column electrodes 105 are arranged in the lowercase letter area.

このように構成したドツトマトリックス構成において、
第7図が本考案の実施例の回路ブロックダイヤグラムで
ある。
In the dot matrix configuration constructed in this way,
FIG. 7 is a circuit block diagram of an embodiment of the present invention.

1が発振回路、2が分周回路、3〜8が各表示桁に対応
したカウンタ、9〜14は、カウンタの内容をデコーダ
16に供給するための切換をする電気的スイッチ群、1
5はラッチ回路群18〜23にタイミングパルスを供給
するタイミングパルス発生回路、16はアンド項デコー
ダ、17はオア項デコーダ、24はラッチ回路、25は
マトリックス表示体100を駆動するための行(セグメ
ント)ドライバー、26は同じく列(コモン)ドライバ
ーである。
1 is an oscillation circuit, 2 is a frequency dividing circuit, 3 to 8 are counters corresponding to each display digit, 9 to 14 are a group of electrical switches for switching to supply the contents of the counter to the decoder 16;
5 is a timing pulse generation circuit that supplies timing pulses to the latch circuit groups 18 to 23; 16 is an AND term decoder; 17 is an OR term decoder; 24 is a latch circuit; 25 is a row (segment) for driving the matrix display 100; ) driver, and 26 is a column (common) driver.

なお、動作については既に公知のため、詳細な説明は省
略する。
Note that since the operation is already known, detailed explanation will be omitted.

デコーダ16,17は集積回路チップ内では約173と
いう非常に大きな面積を占める部分である。
The decoders 16 and 17 occupy a very large area of about 173 in an integrated circuit chip.

従来例のごとく、デコーダを大文字用、小文字州別々に
備える場合には、このデコーダがさらに2倍になってし
まう。
If separate decoders are provided for uppercase letters and lowercase letters as in the conventional example, the number of decoders will further double.

本実施例は説明の簡易化のために単に数字のみの時刻表
示を用いたが、前述のごとく、情報の多様化により、数
字だけでなく、アルファベット等も必要になってくる。
In this embodiment, a time display using only numbers is used to simplify the explanation, but as described above, with the diversification of information, not only numbers but also alphabets and the like are required.

この場合には、数字の0〜9の10文字分に加えて、ア
ルファベットのA〜2の2蚊字を備え、さらにそれぞれ
の大文字、小文字用で別々にデコーダを用意するとなる
と、デコーダ部分のみで集積回路チップのほとんどの面
積を占めてしまうことになる。
In this case, in addition to the 10 characters of numbers 0 to 9, the two letters of the alphabet A to 2 are provided, and if separate decoders are prepared for each uppercase and lowercase letter, only the decoder part is required. This occupies most of the area of the integrated circuit chip.

そこで本考案は、第6図に示すごとく、小文字表示部分
には、第5番目の列(コモン)電極105を設けない構
成にし、さらにデコーダを第7図に示すように組むこと
によって、デコーダからの出力は1種類であるが、表示
体には、第8図に示す大文字と第9図に示す小文字の両
方を表示することが出来るようにしたものである。
Therefore, in the present invention, as shown in FIG. 6, the fifth column (common) electrode 105 is not provided in the lowercase letter display area, and the decoder is assembled as shown in FIG. Although there is only one type of output, the display is capable of displaying both uppercase letters shown in FIG. 8 and lowercase letters shown in FIG. 9.

つまり小文字表示部には第5列電極がないために、デコ
ーダから第5図に示すようなデータが出力されても、第
5列電極に対応するドツトを抜いた文字、つまり第9図
のような小文字として表示されることになる。
In other words, since there is no fifth column electrode in the lowercase character display section, even if the decoder outputs data as shown in Figure 5, it will display a character with the dot corresponding to the fifth column electrode removed, that is, as in Figure 9. will be displayed as lowercase letters.

以上述べて来たように、本考案によれば、集積回路チッ
プの大きな面積を占めているデコーダ部分を増やすこと
なく、非常に安易に大文字と小文字を表示することが出
来るという大きな効果を有する。
As described above, the present invention has the great effect of being able to display uppercase and lowercase letters very easily without increasing the decoder section, which occupies a large area of the integrated circuit chip.

さらに、その面積によってほぼコストが決まってしまう
集積回路チップを大きくする必要がないのでコスト低減
に役立ち、また、チップサイズが小さいということは、
腕時計のように、少ない面積内に実装する場合にも非常
に有利である。
Furthermore, there is no need to increase the size of the integrated circuit chip, whose cost is almost determined by its area, which helps reduce costs.
It is also very advantageous when mounting within a small area, such as in a wristwatch.

なお、本実施例は9デイジツトの時計を例として用いた
が、数字、アルファベット、記号等を用いるすべてのド
ツトマトリックス表示装置に適用できることは言うまで
もない。
Although this embodiment uses a 9-digit clock as an example, it goes without saying that it can be applied to any dot matrix display device that uses numbers, alphabets, symbols, etc.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図、第2図は従来例の表示状態を示す表示部平面図
、第3図が本考案を時計に応用した場合の一実施例の表
示状態を示す表示部平面図、第4図、第5図が従来例の
電極構造、第6図が本考案の一実施例の電極構造図で、
第3図に対応している。 第7図が回路ブロックダイヤグラム、第8図a、bが本
考案による大文字の実施例で、第9図a、 bが同じく
小文字の実施例である。 101〜107・・・・・・列電極、111〜160・
・・・・・行電極、1・・・・・・発振回路、2・・・
・・・分周回路、3〜8・・・・・・カウンタ、9〜1
4・・・・・・スイッチ、15・・・・・・タイミング
パルス発生回路、16・・・・・・アンド項デコーダ、
17・・・・・・オア項デコーダ、25・・・・・・ド
ライバー。
1 and 2 are plan views of the display section showing the display state of a conventional example, FIG. 3 is a plan view of the display section showing the display state of an embodiment when the present invention is applied to a watch, and FIG. Fig. 5 shows the electrode structure of a conventional example, and Fig. 6 shows an electrode structure of an embodiment of the present invention.
This corresponds to Figure 3. FIG. 7 is a circuit block diagram, FIGS. 8a and 8b are uppercase letters according to the present invention, and FIGS. 9a and 9b are lowercase letters. 101-107... Column electrodes, 111-160.
... Row electrode, 1 ... Oscillation circuit, 2 ...
...Frequency divider circuit, 3 to 8...Counter, 9 to 1
4... Switch, 15... Timing pulse generation circuit, 16... AND term decoder,
17...OR term decoder, 25...Driver.

Claims (1)

【実用新案登録請求の範囲】[Scope of utility model registration request] 互いに直交する複数の行電極と列電極により列電極を共
通とする、複数ディジットのドツトマトリックスを構成
してなる表示装置において、上記列電極は、所定数のデ
ィジット領域においては全列電極が設けられて大文字表
示領域を形成し、残余の所定数のディジット領域におい
ては、少なくとも全列電極両端の列電極を含み全列電極
数より少ない数の所定の列電極が等間隔に設けられて小
文字領域を形成したことを特徴とするドツトマトリック
ス表示装置。
In a display device constituted by a multi-digit dot matrix in which a column electrode is shared by a plurality of row electrodes and column electrodes that are orthogonal to each other, the column electrode is arranged such that all column electrodes are provided in a predetermined number of digit regions. In the remaining predetermined number of digit areas, a number of predetermined column electrodes smaller than the total number of column electrodes, including at least the column electrodes at both ends of all column electrodes, are provided at equal intervals to form a lowercase letter area. A dot matrix display device characterized by forming a dot matrix.
JP8433680U 1980-06-17 1980-06-17 dot matrix display device Expired JPS6012144Y2 (en)

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JPS579978U JPS579978U (en) 1982-01-19
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