JPS60108931A - Information processing system - Google Patents
Information processing systemInfo
- Publication number
- JPS60108931A JPS60108931A JP58215021A JP21502183A JPS60108931A JP S60108931 A JPS60108931 A JP S60108931A JP 58215021 A JP58215021 A JP 58215021A JP 21502183 A JP21502183 A JP 21502183A JP S60108931 A JPS60108931 A JP S60108931A
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- JP
- Japan
- Prior art keywords
- signal
- display
- keyboard
- processing device
- transmission
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Input From Keyboards Or The Like (AREA)
- Digital Computer Display Output (AREA)
Abstract
Description
【発明の詳細な説明】
技術分野
本発明は情報処理システム、よシ具体的には、キーボー
ドとCRTディスグレイ装置とからなる入出力装置を備
えた情報処理システムに関するものである。TECHNICAL FIELD The present invention relates to an information processing system, and more specifically to an information processing system equipped with an input/output device consisting of a keyboard and a CRT display device.
従来技術
キーボード付CRTディスプレイ装置からなる入出力装
置を有するノクーソナルコンピュータ等の情報処理シス
テムにおいソ、所定のデータに基づいてビデオ信号及び
同期信号を作成するCRT制御部が処理装置体に収容さ
れている場合、処理装置本体とCRTディスプレイ装置
とを接続する表示信号伝送用ケーブルは普通ビデオ信号
線と同期信号線のみとなシ、このためキーデートで入力
したデータを処理装置本体へ送出するだめのキーボード
データ伝送用のケーブルが別個に必要となる。従って、
従来は入出力装置と処理装置本体とを接続する接続線が
2組設けられていた。このため、多芯ケーブルや2本の
ケーブルを用いておシ、接続線が太く重くなシ、装置の
組立作業が面倒で、取扱いも不便となり、又、コスト高
となっていた。BACKGROUND OF THE INVENTION In an information processing system such as a novel computer having an input/output device consisting of a CRT display device with a keyboard, a CRT control section for creating a video signal and a synchronization signal based on predetermined data is housed in a processing device body. In this case, the display signal transmission cable that connects the processing device main body and the CRT display device usually has only a video signal line and a synchronization signal line, so it is not possible to send the data input by key date to the processing device main body. A separate cable for keyboard data transmission is required. Therefore,
Conventionally, two sets of connection lines were provided to connect the input/output device and the main body of the processing device. For this reason, when a multi-core cable or two cables are used, the connection wire is thick and heavy, the assembly work of the device is troublesome, the handling is inconvenient, and the cost is high.
目 的
本発明は、このような従来技術の欠点を解消し、入出力
装置と処理装置本体とを接続する信号線数を多く必要と
しない情報処理システムを提供することを目的とする〇
構成
本発明の構成について以下、一実施例に基づいて説明す
る。Purpose The present invention aims to solve the drawbacks of the prior art and provide an information processing system that does not require a large number of signal lines to connect input/output devices and a processing device main body. The configuration of the invention will be described below based on one embodiment.
第1図は、本発明による情報処理システムを示す外観斜
視図であり、処理装置本体10と、キーボード12を併
設したCRTディスプレイ装置14とが接続ケーブル1
6によって接続されティる。第1図の実施例では、キー
ボード12とCRTディスプレイ装置14との間は、所
望によシ、キーボード12を適宜の位置に移動すること
ができるようにするため別体に構成され伸縮性を持つコ
イルケーブル18に−よって接続されているが、一体化
するようにしてもよい。処理装置本体工0は、キーボー
ド12によって入力されたデータに基づいて所定の処理
動作を行ない、処理結果を出力するための出力信号を作
成する機能を有している。この出力信号が接続ケーブル
16を介してCRTディスプレイ装置14に送られ画面
14Aに映像として表示される。FIG. 1 is an external perspective view showing an information processing system according to the present invention, in which a processing device main body 10 and a CRT display device 14 equipped with a keyboard 12 are connected by a connecting cable 1.
Connected by 6 and teed. In the embodiment of FIG. 1, the space between the keyboard 12 and the CRT display device 14 is constructed separately and has elasticity so that the keyboard 12 can be moved to an appropriate position as desired. Although they are connected by a coil cable 18, they may be integrated. The processing device main unit 0 has a function of performing a predetermined processing operation based on data input through the keyboard 12 and creating an output signal for outputting the processing result. This output signal is sent to the CRT display device 14 via the connection cable 16 and displayed as an image on the screen 14A.
一方、キーボード12は、オペレータによシあるキー2
0が押下さ′れるとキー20の定義に対応するコードデ
ータを発生する機能を有しており、このコードデータが
コイルケーブル18のデータ送出線18Aを介してCR
Tディスプレイ装置14に送られ、前記表示信号伝送用
の接続ケーブル16を共用して処理装置本体10に入力
されるように成っている。On the other hand, the keyboard 12 has a key 2 that is accessible to the operator.
It has a function of generating code data corresponding to the definition of the key 20 when 0 is pressed, and this code data is sent to the CR via the data sending line 18A of the coil cable 18.
The signal is sent to the T display device 14 and is input to the processing device main body 10 by sharing the connection cable 16 for transmitting the display signal.
第2図に、処理装置本体10、CRTディスゾレイ装置
14及びキーボード12のブロック構成を示す。処理装
置本体10には、CPU等で構成された処理部(図示せ
ず)の他、処理データに基づいて表示信号を作成するだ
めのCRT制御部の一部をなすビデオ信号発生回路22
及び同期信号発生回路24が装備されている。ビデオ信
号発生回路22は、−性分の文字パターン等に対応する
所定のドツトデータをラスタ走査のビデオ信号(第3図
参照)として1ラスタ分ずつ直列に出力し、又、同期信
号発生回路24は、CRTディスプレイ装置14側で同
期をとるための水平・垂直同期信号(第3図参照)を出
力するようになっている。これらのビデオ信号及び水平
・垂直同期信号は接続ケーブル16に設けられた各信号
線16−A〜16Cを介してCRTディスプレイ装置1
4に送出される。FIG. 2 shows a block configuration of the processing device main body 10, the CRT display device 14, and the keyboard 12. The processing device main body 10 includes a processing section (not shown) including a CPU and the like, as well as a video signal generation circuit 22 that forms part of a CRT control section that creates display signals based on processed data.
and a synchronization signal generation circuit 24. The video signal generation circuit 22 serially outputs predetermined dot data corresponding to a character pattern, etc. of the negative character, one raster at a time, as a raster scanning video signal (see FIG. 3), and the synchronization signal generation circuit 24 outputs horizontal and vertical synchronizing signals (see FIG. 3) for synchronizing on the CRT display device 14 side. These video signals and horizontal/vertical synchronizing signals are transmitted to the CRT display device 1 via signal lines 16-A to 16C provided in the connection cable 16.
Sent on 4th.
CRTディスプレイ装置14は、ビデオ信号を入力しド
ツトデータを輝度変調する輝度信号発生回路26と、水
平・垂直同期信号を入力してX、Yす曲の塔d1信妥を
登生す入嬉引位会益津回路28が装備されており、これ
らの輝度信号及び掃引信号が陰極線管30に印加される
ことによシ画面14Aに所定の文字情報等が表示される
ようになっている。The CRT display device 14 includes a luminance signal generation circuit 26 that inputs a video signal and modulates the luminance of dot data, and an input circuit that inputs horizontal and vertical synchronizing signals and generates an X, Y curve tower d1 signal. The camera is equipped with a brightness signal and a sweep signal, and by applying these brightness signals and sweep signals to the cathode ray tube 30, predetermined character information and the like are displayed on the screen 14A.
キーボード12は、キー20の押下でX、Y方向のキー
信号を発生する′キーマトリクス3−2と、キー信号を
所定のコードデータに変換するエンコーダ34、及びこ
のエンコーダ34で変換した並列なコードデータを直列
データに変換し一時的に記憶する並−直列変換器36と
を備えており、この並−直列変換器36出力データ18
Aが外部から入力される送信レディ信号18Bに付勢さ
れてコイルケーブル18を介してCRTディスプレイ装
置14側に送出されるようになっている。The keyboard 12 includes a key matrix 3-2 that generates key signals in the X and Y directions when a key 20 is pressed, an encoder 34 that converts the key signals into predetermined code data, and parallel codes converted by the encoder 34. The parallel-to-serial converter 36 converts data into serial data and temporarily stores the data, and the parallel-to-serial converter 36 outputs data 18.
A is energized by a transmission ready signal 18B input from the outside and is sent to the CRT display device 14 side via the coil cable 18.
キーボード12からコードデータを入力するCRTディ
スプレイ装置14及び処理装置本体10には、各′々ビ
デオ信号/キーデートデータ線16Aの送受方向を切換
える切換制御回路38゜40が設けられておシ、ビデオ
信号のプランキング期間中にキーボード12から送られ
たコードデータがビデオ信号/キーボードデータ線16
Aを介して処理装置本体10側に送出されるようになっ
ている。即ち、処理装置本体lO内のビデオ信号/キー
ボードデータ線16Aには、伝送方向を切換えるための
バッファアンプ42.44が逆向きに並列に設けられて
おシ、出力方向のバッファアンプ42の入力側にビデオ
信号発生回路22の出力側が接続されている。The CRT display device 14 to which code data is input from the keyboard 12 and the processing device main body 10 are each provided with switching control circuits 38 and 40 for switching the transmission/reception direction of the video signal/key date data line 16A. The code data sent from the keyboard 12 during the signal blanking period is transferred to the video signal/keyboard data line 16.
The data is sent to the processing device main body 10 side via A. That is, the video signal/keyboard data line 16A in the processing device main body 1O is provided with buffer amplifiers 42 and 44 in opposite directions in parallel for switching the transmission direction, and the input side of the buffer amplifier 42 in the output direction The output side of the video signal generation circuit 22 is connected to.
入力方向のバッファアンプ44の出力側には、直−並列
変換器46が接続されている。切換制御回路40は、同
゛期信号発生回路24が出力する水平同期信号に付勢さ
れて、水平同期信号の立上シタイミングで、バッファア
ンプ42の駆動電圧を零に落としバッファアン742部
分をオープンにし、同時にバッファアンプ44に所定の
駆動電圧を印加してスルーとしビデオ信号/キーボード
データ線16Aを直−並列変換器46と接続する。逆に
、水平同期信号の立下りタイミングで、バッファアンプ
42をスルーとし、44をオープンとする。A serial-to-parallel converter 46 is connected to the output side of the buffer amplifier 44 in the input direction. The switching control circuit 40 is energized by the horizontal synchronization signal output from the synchronization signal generation circuit 24, and drops the drive voltage of the buffer amplifier 42 to zero at the rising timing of the horizontal synchronization signal, and controls the buffer amplifier 742 portion. At the same time, a predetermined drive voltage is applied to the buffer amplifier 44 to connect the video signal/keyboard data line 16A to the serial-to-parallel converter 46. Conversely, at the falling timing of the horizontal synchronization signal, the buffer amplifier 42 is turned on and the buffer amplifier 44 is opened.
CRTディスプレイ装置14側も同様にしてビデオ信号
/キーボードデータ線16Aに伝送方向を切換えるため
のバッファアンプ48.50が逆向きに並列に設けられ
ている。出方方向アンプ48の出力側には輝度信号発生
回路26が接続されておシ、入力方向アンプ5oの入力
側にキーボード12の並−直列変換器36の出方側が接
続されている。そして切換制御回路38は、水平同期信
号の立上りタイミングでアンプ48をオープンとし、ア
ンプ5oをスルーとし、同時にコイルケーブル18に設
けられたコマンド信号線18Bを介して送信レディ信号
を並−直列変換’t’j 36へ出方する。この並−直
列変換器36は、送信レディ信号を受信した時点でコー
ドデータが蓄積されている場合、データ送出線18Aを
介してそのコードデータを1ビツトずつ直列にCRTデ
ィスプレイ装置14へ送出fる(第3図のキーボード大
刀データ参照)。このコードデータはビデオ信号線16
Aを介して処理装置本体10側に入力され、直−並列変
換器46によってもとの並列コードデータに変換され処
理部へ送られる。送信レディ信号を受信した時点で並−
直列変換器36内にデータがないときは、当該水平ブラ
ンキング期間中のデータ伝送は行なわれない。Similarly, on the CRT display device 14 side, buffer amplifiers 48 and 50 for switching the transmission direction to the video signal/keyboard data line 16A are provided in parallel in opposite directions. The luminance signal generation circuit 26 is connected to the output side of the output direction amplifier 48, and the output side of the parallel-to-serial converter 36 of the keyboard 12 is connected to the input side of the input direction amplifier 5o. Then, the switching control circuit 38 opens the amplifier 48 and the amplifier 5o at the rising timing of the horizontal synchronization signal, and simultaneously converts the transmission ready signal from parallel to serial via the command signal line 18B provided in the coil cable 18. Exit to t'j 36. If code data has been accumulated at the time of receiving the transmission ready signal, this parallel-to-serial converter 36 serially sends the code data bit by bit to the CRT display device 14 via the data sending line 18A. (Refer to the keyboard large sword data in Figure 3). This code data is the video signal line 16
A, the data is input to the processing device main body 10 side, converted into the original parallel code data by the serial-parallel converter 46, and sent to the processing section. When the transmission ready signal is received, the
When there is no data in serializer 36, no data transmission occurs during the horizontal blanking period.
続いて、水平同期信号の立下シタイミングで切換制御回
路38はバッファアンプ48をスルー、50をオプーン
とする。Subsequently, at the falling edge timing of the horizontal synchronization signal, the switching control circuit 38 passes through the buffer amplifier 48 and opens the buffer amplifier 50.
水平同期信号が「高」レベルとなる水平ブランキング期
間中は、第3図に示すようにビデオ信号が「低」レベル
となっており、このため、ビデオ信号線16Aを介して
キーボード12で入力したコードデータを処理装置本体
lo側に伝送することが可能となる。この際、切換制御
回路38.40による水平同期信号に同期した送受方向
の切換え動作によシ、ビデオ信号とコードデータがビデ
オ信号線上で同時にドライブされることはなく、水平ブ
ランキング期間が終了すれば、再び処理装置本体lOか
らCRTディスプレイ装置14ヘビデオ信号が送出され
るので、画面14Aに表示される映像の品質等が低下す
ることもない。During the horizontal blanking period when the horizontal synchronization signal is at the "high" level, the video signal is at the "low" level as shown in FIG. It becomes possible to transmit the code data to the processing device main body lo side. At this time, due to the switching operation of the transmission/reception direction synchronized with the horizontal synchronizing signal by the switching control circuits 38 and 40, the video signal and code data are not driven simultaneously on the video signal line, and the horizontal blanking period ends. For example, since the video signal is again sent from the processing device body 10 to the CRT display device 14, the quality of the video displayed on the screen 14A does not deteriorate.
なお、垂直ブランキング期間を利用して、コードデータ
の伝送を行なうようにしてもよい。Note that the code data may be transmitted using the vertical blanking period.
効果
本発明によればこのように、処理装置からCRTディス
プレイ装置に表示信号を送出する信号線をキーボードか
ら処理装置へデータを送出する場合にも共通に使用する
ことができるので、信号線数を減らすことができ、信号
線本数の少ない単一のグープルを使用することができる
。Effects According to the present invention, the signal line for sending display signals from the processing device to the CRT display device can also be used in common when sending data from the keyboard to the processing device, so the number of signal lines can be reduced. A single group with fewer signal lines can be used.
第1図は本発明の一実施例に係る情報処理システムを示
す外観斜視図、
第2図は第1図に示した情報処理システム各部の電気的
構成を示すブロック図、
第3図は第2図中の接続ケーブルを伝送される各信号を
示すタイミングチャートである。
主要部分の符号の説明
10・・・処理装置本体
12・・・キービード
14・・・CRTディスプレイ装置
16・・・接続ケーブル
16A・・・ビデオ信号/キー?−ドデータ線22・・
・ビデオ信号発生回路
24・・・同期信号発生回路
38.40・・・切換制御回路
特許出願人 株式会社リ コーFIG. 1 is an external perspective view showing an information processing system according to an embodiment of the present invention, FIG. 2 is a block diagram showing the electrical configuration of each part of the information processing system shown in FIG. 1, and FIG. 3 is a timing chart showing each signal transmitted through the connection cable in the figure. Explanation of symbols of main parts 10...Processing device body 12...Key bead 14...CRT display device 16...Connection cable 16A...Video signal/key? - data line 22...
・Video signal generation circuit 24...Synchronization signal generation circuit 38.40...Switching control circuit Patent applicant Ricoh Co., Ltd.
Claims (1)
号を出力する表示制御手段を備えた処理装置と、 該処理装置から伝送路を通して送られる表示信号に基づ
き画面に映像を表示する表示手段と、該表示手段に接続
され情報を入力するキーボードとを備えた情報処理シス
テムにおいて、前記表示手段は、前記表示同期信号のブ
ランキング期間中に前記キーボードからの入力情報を前
記伝送路を通して前記処理装置に送出し、他の期間は該
処理装置から表示信号を受信するように前記伝送路を切
シ換える第1の送受切換え手段を有し、 前記処理装置は、前記表示同期信号のブランキング期間
中に前記キーボードからの入力・画報を前記伝送路を通
して前記表示手段から受信し、他の期間は該表示手段へ
表示信号を送出するように前記伝送路を切シ換える第2
の送受切換え手段を有することを特徴とする情報処理シ
ステム0[Scope of Claims] A processing device including a display control means for outputting a display signal consisting of a Rusk scan video signal and a display synchronization signal, and displaying an image on a screen based on a display signal sent from the processing device through a transmission line. and a keyboard connected to the display means for inputting information, wherein the display means transmits information input from the keyboard to the transmission path during a blanking period of the display synchronization signal. a first transmitting/receiving switching means for switching the transmission path so as to transmit the display signal to the processing device through the processing device and receive the display signal from the processing device during other periods; A second method for switching the transmission path so that input from the keyboard and pictures are received from the display means through the transmission path during the blanking period, and display signals are sent to the display means during other periods.
An information processing system 0 characterized in that it has a transmission/reception switching means.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58215021A JPS60108931A (en) | 1983-11-17 | 1983-11-17 | Information processing system |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58215021A JPS60108931A (en) | 1983-11-17 | 1983-11-17 | Information processing system |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS60108931A true JPS60108931A (en) | 1985-06-14 |
Family
ID=16665418
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP58215021A Pending JPS60108931A (en) | 1983-11-17 | 1983-11-17 | Information processing system |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS60108931A (en) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0468420A (en) * | 1990-07-09 | 1992-03-04 | Alps Electric Co Ltd | Personal computer |
JPH0468418A (en) * | 1990-07-09 | 1992-03-04 | Alps Electric Co Ltd | Computer |
JPH0484310A (en) * | 1990-07-27 | 1992-03-17 | Alps Electric Co Ltd | Personal computer |
-
1983
- 1983-11-17 JP JP58215021A patent/JPS60108931A/en active Pending
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0468420A (en) * | 1990-07-09 | 1992-03-04 | Alps Electric Co Ltd | Personal computer |
JPH0468418A (en) * | 1990-07-09 | 1992-03-04 | Alps Electric Co Ltd | Computer |
JPH0484310A (en) * | 1990-07-27 | 1992-03-17 | Alps Electric Co Ltd | Personal computer |
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