JPS60108070U - サグ打消し回路 - Google Patents

サグ打消し回路

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Publication number
JPS60108070U
JPS60108070U JP19797983U JP19797983U JPS60108070U JP S60108070 U JPS60108070 U JP S60108070U JP 19797983 U JP19797983 U JP 19797983U JP 19797983 U JP19797983 U JP 19797983U JP S60108070 U JPS60108070 U JP S60108070U
Authority
JP
Japan
Prior art keywords
sag
cancellation circuit
integrating
input signal
video input
Prior art date
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Pending
Application number
JP19797983U
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English (en)
Inventor
木村　裕行
Original Assignee
パイオニア株式会社
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Publication date
Application filed by パイオニア株式会社 filed Critical パイオニア株式会社
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Publication of JPS60108070U publication Critical patent/JPS60108070U/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図ａは従来のサグ打消し回路を示す図、第１図すは
第１図ａの時定数対出力振幅の特性を示す図、第２図ａ
は一般的な伝送系の特性を示す図、第２図すは第１図ａ
の周波数特性を示す図、第２図Ｃは第１図ａの回路を通
したときの特性を示す図、第３図は本考案の一実施例に
よるサグ打消し回路を示す図、第４図ａは一般的な伝送
系の特性を示す図、第４図すは第３図の積分器の特性を
示す図、第４図Ｃはこの積分器を通したときの特性を示
す図、第４図ｄは第３図の出力特性を示す図である。 １．３・・・増幅器または減衰器、２・・・積分器、４
・・・加算器。

Claims (1)

    【実用新案登録請求の範囲】
  1. 映像入力信号を積分する積分手段と、前記積分手段の出
    力と映像入力信号とを所定の比率で加算する加算手段と
    を備え、低域周波数特性を補正して、サグを打消すよう
    にしたことを特性とするサグ折消し回路。
JP19797983U 1983-12-22 1983-12-22 サグ打消し回路 Pending JPS60108070U (ja)

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JP19797983U JPS60108070U (ja) 1983-12-22 1983-12-22 サグ打消し回路

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JPS60108070U true JPS60108070U (ja) 1985-07-23

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ID=30756582

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JP19797983U Pending JPS60108070U (ja) 1983-12-22 1983-12-22 サグ打消し回路

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