JPS5999546U - ミユ−テイング回路 - Google Patents

ミユ−テイング回路

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JPS5999546U
JPS5999546U JP19918382U JP19918382U JPS5999546U JP S5999546 U JPS5999546 U JP S5999546U JP 19918382 U JP19918382 U JP 19918382U JP 19918382 U JP19918382 U JP 19918382U JP S5999546 U JPS5999546 U JP S5999546U
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JP
Japan
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muting
transistor
muting circuit
drive circuit
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Pending
Application number
JP19918382U
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English (en)
Inventor
茂 斉藤
Original Assignee
パイオニア株式会社
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は本考案の一実施例を示す回路構成図、第２図は
別の実施例の回路構成図である。 １・・・ＦＭ検波回路、２・・・電圧計、３・・・信号
ライン、４・・・遅延駆動回路、Ｑｌ、　Ｑ２・・・ト
ランジスタ、ＤＬよ・・・ＬＥＤ、　Ｚｌ・・・ツェナ
ーダイオード、Ｄｌ・・・ダイオード、Ｒ工〜Ｒ３・・
・抵抗、Ｃ１・・・コンデンサ。

Claims (1)

    【実用新案登録請求の範囲】
  1. 定常状態でオフ状態のチューニングインジケータ駆動用
    トランジスタの（＋）電位側において充電されるコンデ
    ンサを含む遅延駆動回路を設け、上記遅延駆動回路は、
    上記トランジスタがオフ状態において、信号ラインをミ
    ューティング状態にするようにミューティング用トラン
    ジスタをオン状態にするように構成されていることを特
    徴とするミューティング回路。
JP19918382U 1982-12-22 1982-12-22 ミユ−テイング回路 Pending JPS5999546U (ja)

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