JPS5978987U - マルチビツトチエツカ− - Google Patents

マルチビツトチエツカ−

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Publication number
JPS5978987U
JPS5978987U JP17358982U JP17358982U JPS5978987U JP S5978987 U JPS5978987 U JP S5978987U JP 17358982 U JP17358982 U JP 17358982U JP 17358982 U JP17358982 U JP 17358982U JP S5978987 U JPS5978987 U JP S5978987U
Authority
JP
Japan
Prior art keywords
bit checker
socket
bit
checker
arrange
Prior art date
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Pending
Application number
JP17358982U
Other languages
English (en)
Inventor
猪飼　均
Original Assignee
日本電信電話株式会社
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Filing date
Publication date
Application filed by 日本電信電話株式会社 filed Critical 日本電信電話株式会社
Priority to JP17358982U priority Critical patent/JPS5978987U/ja
Publication of JPS5978987U publication Critical patent/JPS5978987U/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は本考案の一実施例を示す斜視図、第２図は上記
実施例の本体の内部回路を示す回路図、第３図ａ、　　
ｂはそれぞれ異なるアダプタを使用した測定例を示す斜
視図である。 図において、１・・・端子、４・・・デジタルＩＣ，５
・・・発光ダイオード、Ａ・・・ソケット、Ｂ、Ｃ，Ｄ
・・・アダプタ、Ｅ・・・本体、Ｆ・・・引出し装置、
Ｄｌ、Ｄ２・・・ダイオード、Ｒ□〜Ｒ２・・・抵抗、
ＳＷ・・・スイッチ。

Claims (1)

    【実用新案登録請求の範囲】
  1. 多数の入力端子を配列し各種のアダプタを交換接続でき
    るソケットと、該ソケットとケーブルによって接続され
    、゛それぞれの前記入力端子の論理レベルに苅応して表
    示灯を点灯または消灯する手段と、該手段により点滅す
    る複数の表示灯とを備えたことを特徴とするマルチビッ
    トチェッカー。
JP17358982U 1982-11-18 1982-11-18 マルチビツトチエツカ− Pending JPS5978987U (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP17358982U JPS5978987U (ja) 1982-11-18 1982-11-18 マルチビツトチエツカ−

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP17358982U JPS5978987U (ja) 1982-11-18 1982-11-18 マルチビツトチエツカ−

Publications (1)

Publication Number Publication Date
JPS5978987U true JPS5978987U (ja) 1984-05-28

Family

ID=30378120

Family Applications (1)

Application Number Title Priority Date Filing Date
JP17358982U Pending JPS5978987U (ja) 1982-11-18 1982-11-18 マルチビツトチエツカ−

Country Status (1)

Country Link
JP (1) JPS5978987U (ja)

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5146062B2 (ja) * 1971-08-09 1976-12-07
US3999126A (en) * 1975-04-17 1976-12-21 A & P Products Incorporated Test device for simultaneously displaying the level of logic signals in a plurality of circuits

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5146062B2 (ja) * 1971-08-09 1976-12-07
US3999126A (en) * 1975-04-17 1976-12-21 A & P Products Incorporated Test device for simultaneously displaying the level of logic signals in a plurality of circuits

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