JPS5977771A - Picture signal processor - Google Patents

Picture signal processor

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JPS5977771A
JPS5977771A JP57188395A JP18839582A JPS5977771A JP S5977771 A JPS5977771 A JP S5977771A JP 57188395 A JP57188395 A JP 57188395A JP 18839582 A JP18839582 A JP 18839582A JP S5977771 A JPS5977771 A JP S5977771A
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JP
Japan
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reading
signal
data
sampling data
image
Prior art date
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Pending
Application number
JP57188395A
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Japanese (ja)
Inventor
Hirotaka Otsuka
大塚 博隆
Katsuo Nakazato
中里 克雄
Kunio Sannomiya
三宮 邦夫
Hidehiko Kawakami
秀彦 川上
Hiroyoshi Tsuchiya
博義 土屋
Hideo Uchida
内田 日出夫
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic System Solutions Japan Co Ltd
Panasonic Holdings Corp
Original Assignee
Matsushita Graphic Communication Systems Inc
Matsushita Electric Industrial Co Ltd
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Publication date
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Abstract

PURPOSE:To obtain a sharp picture signal by a simple optical system by quantizing and storing a read picture in a line memory, and reading and delaying the picture specifically and then performing contour emphasizing operation. CONSTITUTION:An original 15 set around a drum 16 is irradiated with light from a light source 22 and its reflected light is converged to form an image on the surface of an aperture 25. Light passed through the aperture 25 is converted by a photoelectric converter 26 into an electric signal, which is amplified 27 and then applied to an A/D converter 28. A sampling pulse generator 29, on the other hand, is initialized by a phase signal (g) on every turn of the drum 16 to generate sampling pulses (h) of frequency corresponding to scanning density. The converter 28 converts the input signal from analog to digital by the pulses (h) to supply an output signal to a memory part 30. The contents of the memory part 30 are read out in specific order and applied to an arithmetic part 31. The arithmetic part 31 delays the picture signal specifically and then processes the signal by using a contour emphasis constant (n) set on a constant setting panel 32 as a parameter to generate output data O and an output clock P.

Description

【発明の詳細な説明】 産業上の利用分野 本発明はファクシミリ装置やスキャナ等、中間調を有す
る原稿を走査処理する際、ポケた画像を輪郭強調したり
、画像の鮮鋭度を高めたりする画像信号処理装置に関す
る。
DETAILED DESCRIPTION OF THE INVENTION Field of Industrial Application The present invention is applied to facsimile machines, scanners, etc. when scanning originals with halftones, enhancing the outline of blurred images, and increasing the sharpness of images. The present invention relates to a signal processing device.

従来例の構成とその問題点 中間調を有する原稿を処理できるファクシミリやスキャ
ナは、従来からアナログ方式が多く、第1図にその一例
を示す。これはボケマスクによる方法であり、輪郭強調
の手段として良く用いられている。回転するドラム1上
に貼られた原稿2には光源3及びレンズ4によって光が
照射されてお9、その反射光は、レンズ5によって集光
され、ハーフミラ−6により分割されて、アパチャ7及
びアパチャ8画上に像を結ぶ。アパチャ了は走査密度に
対応したアパチャサイズを有し、アパチャ8は、通常の
アパチャ7の2〜4倍のアパチャサイズを有する。アパ
チャ7を通過した反射光は、光電変換器9で電気信号と
なり、アンプ10により増幅されてシャープ信号aとな
る。またアパチャ8f:通過した反射光は、光電変換器
11で電気信号となり、アンプ12により増幅及びレベ
ル合わせをされてアンシャープ信号すとなる。シャープ
信号a及びアンシャープ信号すは、定数設定パネル13
により設定された輪郭強調定数Gと共に演算器14に加
えられ、所定の演算がされて出力信号dとなる。演算器
14で施される演算は、シャープ信号色の値を人、アン
シャープ信号すの値をB、輪郭強調定数Cの値iK、出
力信号dの値をOUTとすると、 0UT=A+Kx(A−B) なる演算である。この演算により、第2図に示すように
、輪郭強調を施さなかった時、すなわち、K=00時の
画像信号値eが、輪郭強調を施すと画像信号値fとなり
、画像の輪郭が強調される。
Conventional Structures and Problems Many facsimile machines and scanners that can process originals with halftones have conventionally been analog systems, one example of which is shown in FIG. This is a method using a blur mask, and is often used as a means of edge enhancement. A document 2 pasted on a rotating drum 1 is irradiated with light 9 by a light source 3 and a lens 4, and the reflected light is collected by a lens 5, divided by a half mirror 6, and sent to an aperture 7 and Focus the image on the aperture 8 image. The aperture has an aperture size corresponding to the scanning density, and the aperture 8 has an aperture size 2 to 4 times that of the normal aperture 7. The reflected light that has passed through the aperture 7 is turned into an electrical signal by a photoelectric converter 9, and is amplified by an amplifier 10 to become a sharp signal a. Further, the reflected light that has passed through the aperture 8f becomes an electric signal at a photoelectric converter 11, and is amplified and level-adjusted by an amplifier 12 to become an unsharp signal. Sharp signal a and unsharp signal S are constant setting panel 13
The signal is added to the arithmetic unit 14 together with the contour enhancement constant G set by , and a predetermined calculation is performed to obtain the output signal d. The calculation performed by the calculator 14 is as follows: 0UT=A+Kx(A -B) is the calculation. Through this calculation, as shown in Fig. 2, the image signal value e when no contour enhancement is applied, that is, at K=00, becomes the image signal value f when contour enhancement is applied, and the contours of the image are emphasized. Ru.

しかしながら、このような従来の方法では、ノへ−7ミ
ラーが必要であり、アパチャ、光電交換器及びアンプが
それぞれ2組必要である。従って光学系が複雑になり、
高価な装置となる。また、走査密度に可変にするには、
アパチャサイズを可変にしなければならず、2つのアパ
チャを可変にすると、レベルも変動するため、2つのア
ンプ出力を合わせるために、レベルの補正も必要であり
、安定度を保つ上でも問題があった。
However, such a conventional method requires a No. 7 mirror, and requires two sets each of an aperture, a photoelectric exchanger, and an amplifier. Therefore, the optical system becomes complicated,
This is an expensive device. Also, to make the scanning density variable,
The aperture size must be made variable, and if the two apertures are made variable, the level will also fluctuate, so it is necessary to correct the level in order to match the two amplifier outputs, which poses a problem in maintaining stability. Ta.

発明の目的 本発明はへ従来例による複雑な光学系に変えて単純な光
学系により得た画像信号を、デジタル信号処理し、鮮鋭
な画像信号を得る画像信号処理装置を提供する事を目的
とする。
OBJECTS OF THE INVENTION It is an object of the present invention to provide an image signal processing device that digitally processes an image signal obtained by a simple optical system instead of the conventional complicated optical system and obtains a sharp image signal. do.

発明の構成 本発明は単一の読み取り光学系で画像を読み取り、ム/
D変換器で量子化し、さらに走査に同期して選択された
ラインメモリに記憶し、所定の順序で読み出し、所定の
遅延を施した画像信号を輪郭強調演算する構成により、
複雑な光学系を簡略化できるものである。
Structure of the Invention The present invention reads an image with a single reading optical system, and
With a configuration in which the image signal is quantized by a D converter, stored in a selected line memory in synchronization with scanning, read out in a predetermined order, and subjected to a predetermined delay, the image signal is subjected to contour enhancement calculations.
This allows a complicated optical system to be simplified.

実施例の説明 以下に本発明の実施例を図面を用いて説明する。Description of examples Embodiments of the present invention will be described below with reference to the drawings.

第3図は本発明の画像信号処理装置の一実施例を示す概
略構成図であり、第4図は同実施例の主要部の信号のタ
イミングチャートである。原稿16が貼付されているド
ラム16は駆動モータ17により回転する。ドラム16
と同軸に、位相信号発生用のきざみの入った円板18が
設けられ、位相信号発生器190間を回転しており、ド
ラム16の一回転につき一つの位相信号g(第4図参照
)を発生している。一方、走査光学系を乗せた副走査移
動台2oは副走査駆動部21により、ドラム16に沿っ
て軸方向に走査密度に応じた速度で移動する。副走査移
動台20の上には、光源22、レンズ23、レンズ24
、アパチャ25、光電変換器26及びアンプ27等の走
査光学系が乗せられている。ドラム16に貼付された原
稿16には光源22及びレンズ23により光が照射され
、反射光はレンズ24により集光されて、アパチャ25
の面上に結像する。アパチャ25は走査密度に対応した
アパチャサイズを有し、アパチャ25を通過した光は光
電変換器26で電気信号となり、アンプ27により増幅
されて、人/D変換器2日に加えられる。サンプリング
パルス発生器29は位相信号gによりドラム16の一回
転ごとに初期化され、走査密度に対応した周波数のサン
プリングパルスhを発生する。A / D変換器28は
サンプリングパルスhによりアンプ27がらの出力信号
iA/D変換し、サンプリングデータlとデータクロッ
クjを出力する。メモリ部3oは複数の主走査のライン
メモリ構成となっており、N−aデータに−Nデータノ
ーN+8データmを出力し、演算部31に加えられる。
FIG. 3 is a schematic configuration diagram showing an embodiment of the image signal processing device of the present invention, and FIG. 4 is a timing chart of signals of the main parts of the embodiment. The drum 16 to which the original 16 is attached is rotated by a drive motor 17 . drum 16
Coaxially with the drum 16, a notched disc 18 for generating a phase signal is provided, which rotates between the phase signal generators 190 and generates one phase signal g (see FIG. 4) per rotation of the drum 16. It has occurred. On the other hand, the sub-scanning movable table 2o carrying the scanning optical system is moved by the sub-scanning drive section 21 in the axial direction along the drum 16 at a speed corresponding to the scanning density. On the sub-scanning movable table 20, a light source 22, a lens 23, a lens 24 are arranged.
, an aperture 25, a photoelectric converter 26, an amplifier 27, and other scanning optical systems are mounted thereon. The document 16 attached to the drum 16 is irradiated with light by a light source 22 and a lens 23, and the reflected light is collected by a lens 24 and sent to an aperture 25.
The image is formed on the surface of The aperture 25 has an aperture size corresponding to the scanning density, and the light passing through the aperture 25 becomes an electrical signal in a photoelectric converter 26, is amplified by an amplifier 27, and is applied to the human/D converter 2. The sampling pulse generator 29 is initialized every rotation of the drum 16 by the phase signal g, and generates a sampling pulse h of a frequency corresponding to the scanning density. The A/D converter 28 A/D converts the output signal i from the amplifier 27 using the sampling pulse h, and outputs sampling data l and data clock j. The memory section 3o has a plurality of main scanning line memory configurations, and outputs -N data no N+8 data m to Na data, and is added to the calculation section 31.

演算部31は定数設定パネル32により設定された輪郭
強調定数% f ハラメータとし、データクロックコに
より、N−sデータに−Nデータ!、N−sデータmを
処理して出力データO及び出力クロックPを発生する。
The calculation unit 31 uses the contour enhancement constant % f harammeter set by the constant setting panel 32, and converts the N-s data to -N data! by the data clock controller. , N-s data m to generate output data O and output clock P.

なお、メモリ部30及び演算部31の詳細は以下に図面
と共に説明する。
Note that details of the memory section 30 and the calculation section 31 will be explained below with reference to the drawings.

第6図はメモリ部3oの詳細な構成図である。FIG. 6 is a detailed configuration diagram of the memory section 3o.

ラインメモリ33は、17主走査ライン分の容量を持っ
ており、入力データ、出力データ、リードライン制御お
よびアドレス制御の各端子を持っている。アドレスカウ
ンタ34は位相信号gにより、各主走査ラインごとに初
期化され、データクロックコによりカウントアツプされ
る。アドレスカウンタ34の出力はラインメモリ33の
アドレス制御端子に加えられ、主走査方向の画素位置を
指定する。サンプリングデータiはラインメモリ33の
入力データ端子に加えられると共に、データクロックj
によりラッチ35にラッチされてN+8デ一タmとして
出力される。ライトセレクタ36ij、データクロック
jをラインメモリ33の17主走査ラインのいずれか一
つのリードライト制御端子に加え、その主走査ラインの
メモI) を書き込み状態とする。その他の主走査ライ
ンメモリは読み出し状態である。N−sセレクタ37及
びNセレクタ38は、ラインメモリ33の17主走査ラ
インのいずれか一つの出力データ端子を選択して、それ
ぞれN−8データk及びNデータノとして出力する。ラ
イトセレクタ36、N−sセレクタ37及びNセレクタ
38は位相信号gにより制御されるセレクタコントロー
ラ39により、第1表で示すように、Mを整数とした時
の主走査ライン番号に対し、各セレクタの記号で示され
るラインメモリ33内の主走査ラインを選択する。
The line memory 33 has a capacity for 17 main scanning lines, and has input data, output data, read line control, and address control terminals. The address counter 34 is initialized for each main scanning line by the phase signal g, and is counted up by the data clock. The output of the address counter 34 is applied to an address control terminal of the line memory 33 to designate a pixel position in the main scanning direction. The sampling data i is applied to the input data terminal of the line memory 33, and the data clock j
The data is latched by the latch 35 and output as N+8 data m. The write selector 36ij and the data clock j are applied to the read/write control terminal of any one of the 17 main scanning lines of the line memory 33, and the memo I) of that main scanning line is placed in a writing state. The other main scanning line memories are in a read state. The N-s selector 37 and the N-selector 38 select any one output data terminal of the 17 main scanning lines of the line memory 33 and output it as N-8 data k and N data, respectively. The write selector 36, N-s selector 37, and N selector 38 are controlled by a selector controller 39 controlled by a phase signal g. The main scanning line in the line memory 33 indicated by the symbol is selected.

第1表 第6図は演算部31の詳細な構成図である。Table 1 FIG. 6 is a detailed configuration diagram of the calculation section 31.

ラッチ40及び画素シフトレジスタ41.42は縦列に
接続されて17画素のシフトレジスタとなっており、そ
れぞれにデータクロックjが加えられ、一画素ごとシフ
トする。また位相信号gにより、主走査ラインごとに初
期化される。ラッチ43と8画素シフトレジスタ44,
45及びラッチ46と8画素シフトレジスタ47+ ’
8f’j、ラッチ40と8画素シフトレジスタ41.4
2と全く同じで、それぞれ17画素シフトレジスタ全構
成し、データクロックj及び位相信号gK接続されてい
る。メモリ部3oの出カN−f3データにはラッチ40
に、データノはラッチ43に、N+8デ一タmはラッテ
46にそれぞれ接続され、各17画素シフトレジスタの
入力となる。ラッチ40゜43.46及び8画素シフト
レジスタ41,42゜44.45,47.48のそれぞ
れの出刃は、加算器49に入力され加算される。加算結
果は3ビツトシフタ60にょ91/8倍されアンシャー
プデータqとなる。8画素シフトレジスタ44の出力は
シャープデータγとして減算器61に入力されアンシャ
ープデータqの値が減算される。減算器51の出力は輪
郭強調定数nと共に掛算器52に入力さ扛、演算され、
その出力は加算器63により、シャープデータγと加算
される。遅延回路54はデータクロックjを演算回路6
1の処理時間だけ遅延して、ラッチ65に加え、加算器
5oの出力を一画素ごとにラッチして出力データOk設
定する。なお、遅延回路54の出力は、出力クロックP
としても出力される。ラッチ55は他の回路と同様に位
相信号gで主走査ラインごとに初期化されている。
The latch 40 and pixel shift registers 41 and 42 are connected in columns to form a 17-pixel shift register, and a data clock j is applied to each to shift each pixel. Further, each main scanning line is initialized by the phase signal g. latch 43 and 8 pixel shift register 44,
45, latch 46 and 8 pixel shift register 47+'
8f'j, latch 40 and 8 pixel shift register 41.4
2, each has a complete configuration of 17 pixel shift registers, and is connected to a data clock j and a phase signal gK. A latch 40 is attached to the output N-f3 data of the memory section 3o.
The data no. is connected to the latch 43, and the N+8 data m is connected to the latch 46, respectively, and serve as inputs to each of the 17-pixel shift registers. The respective outputs of the latch 40°43.46 and the 8-pixel shift registers 41, 42°44.45, 47.48 are input to an adder 49 and added. The addition result is multiplied by 91/8 by a 3-bit shifter 60 and becomes unsharp data q. The output of the 8-pixel shift register 44 is input to a subtracter 61 as sharp data γ, and the value of unsharp data q is subtracted therefrom. The output of the subtracter 51 is input to the multiplier 52 together with the contour enhancement constant n, and is calculated.
The output is added to sharp data γ by an adder 63. The delay circuit 54 transfers the data clock j to the arithmetic circuit 6.
After a delay of 1 processing time, the output of the adder 5o is latched pixel by pixel in addition to the latch 65, and the output data is set to Ok. Note that the output of the delay circuit 54 is the output clock P.
It is also output as Like other circuits, the latch 55 is initialized for each main scanning line using the phase signal g.

第7図は第6図で説明した演算部31の処理を別の表現
で説明したものである。
FIG. 7 illustrates the processing of the arithmetic unit 31 explained in FIG. 6 using another expression.

矢印66は主走査方向を示し、矢印57は副走査方向を
示す。各マス目は一画素全示している。
Arrow 66 indicates the main scanning direction, and arrow 57 indicates the sub-scanning direction. Each square shows one full pixel.

従って−67は主走査方向17画素、副走査方向17画
素の走査窓を示している。第6図と第7図全対応させる
と一ラッチ40,43.46の出力は画素68,61.
64に、8画素シフトレジスタ41.42,44,45
,47.48の出力は画素59,60,62,63,6
5.66にそれぞれ対応する。すなわち本実施例は原稿
15を一走査窓67で主走査方向に一画素ずつ、移動し
ながら走査し、−主走査ラインが終了すると、副走査方
向に一画素移動して、主走査方向に同様に走査を繰返す
処理である。
Therefore, -67 indicates a scanning window of 17 pixels in the main scanning direction and 17 pixels in the sub-scanning direction. 6 and 7, the output of one latch 40, 43, 46 is the pixel 68, 61, .
64, 8 pixel shift registers 41, 42, 44, 45
, 47.48 outputs pixels 59, 60, 62, 63, 6
5.66 respectively. That is, in this embodiment, the document 15 is scanned while moving pixel by pixel in the main scanning direction in one scanning window 67, and when the main scanning line ends, it is moved by one pixel in the sub-scanning direction, and then the document 15 is scanned in the same manner in the main scanning direction. This is a process in which scanning is repeated over and over again.

また画素58 、59.60.61 、62.63.6
4.65゜66のそれぞれの値をDI 、D2.Da、
D4゜Ds、Da、D’y、DB、D9とし、シャープ
データγの値をA、アンシャープデータqの値tB、輪
郭強調定数nの値をk、出方データ0の値全OUTとす
ると、 B  = 178X(DI+D2+D3+D4+D6+
D7+DB+D9)ム=ns OUT=人十Kx(ム−B) なる演算を施す事になる。
Also pixels 58, 59.60.61, 62.63.6
The respective values of 4.65°66 are DI, D2. Da,
D4゜Ds, Da, D'y, DB, D9, the value of sharp data γ is A, the value of unsharp data q is tB, the value of edge enhancement constant n is k, and the value of appearance data 0 is all OUT. , B = 178X (DI+D2+D3+D4+D6+
D7+DB+D9)mu=ns OUT=person ten Kx(mu-B) The following calculation will be performed.

なお一本実施例では、17画素×17画素の走査窓を説
明したが、別の一実施例として、走査窓のサイズを任意
とするために、第6図に示すラインメモリ33を走査窓
の副走査方向の画素の個数に等しいライン数だけ準備し
、ライトセレクタ36゜N−8セレクタ37、Nセレク
タ38もライン数が選択できる構成とし、セレクタコン
トローラ39は第1表で示される選択表を任意に書換え
可能な構成とし、第6図においては、8画素シフトレジ
スタ41.42,44,45,47.48を走査窓の主
走査方向の画素の個数の段数シフト可能で任意の段から
出力が取り出せるシフトレジスタとすれば、任意のサイ
ズの走査窓が構成できる。この方法によれば、構成が複
雑になるが、上記実施例の様に走査窓サイズが限定され
る事なく、画像処理方式に応じた任意のサイズの走査窓
を選択できる。
In this embodiment, a scanning window of 17 pixels x 17 pixels has been described. However, in another embodiment, in order to make the size of the scanning window arbitrary, the line memory 33 shown in FIG. The number of lines equal to the number of pixels in the sub-scanning direction is prepared, and the write selector 36° N-8 selector 37 and N selector 38 are also configured to allow selection of the number of lines, and the selector controller 39 uses the selection table shown in Table 1. It has a configuration that can be arbitrarily rewritten, and in FIG. 6, the 8-pixel shift registers 41, 42, 44, 45, 47, and 48 can be shifted by the number of stages of pixels in the main scanning direction of the scanning window, and output from any stage. A scanning window of any size can be constructed by using a shift register that can take out . According to this method, although the configuration becomes complicated, the scanning window size is not limited as in the above embodiment, and a scanning window of any size can be selected according to the image processing method.

また別の実施例として、第3図におけるメモリ部30の
詳細な構成を第5図とは異なる構成で実施した例を以下
に第8図と共に説明する。
As another embodiment, an example in which the detailed configuration of the memory section 30 in FIG. 3 is different from that in FIG. 5 will be described below with reference to FIG. 8.

ラインメモリ68は、18主走査ライン分の容量を持っ
ており、入力データ、出力データ、リードライン制御お
よびアドレス制御の各端子を持つている。アドレスカウ
ンタ69は位相信号gにより、各主走査ラインごとに初
期化され−データクロックjによりカウントアツプされ
る。アドレスカウンタ69の出力はラインメモリ68の
アドレス制御端子に加えられ、主走査方向の画像位置を
設定する。
The line memory 68 has a capacity for 18 main scanning lines, and has input data, output data, read line control, and address control terminals. The address counter 69 is initialized for each main scanning line by the phase signal g and counted up by the data clock j. The output of the address counter 69 is applied to the address control terminal of the line memory 68 to set the image position in the main scanning direction.

サンプリングデータiはラインメモリ68の入力データ
端子に加えられている。ライトセレクタ70は、データ
クロックjをラインメモリ68の18主走査ラインのい
ずれか一つのリードライト制御端子に加え−その主走査
ラインのメモリヲ書き込み状態とする。その他の主走査
ラインメモリは読み出し状態である。N−8セレクタ7
1及びNセレクタ72及びN+8セレクタ73(d、ラ
インメモリ68の18主走査ラインのいずれか一つの出
力データ端子を選択して、N−8データk及びNデータ
ノ及びN+8デ一タmとして出力する。
Sampling data i is applied to the input data terminal of line memory 68. The write selector 70 applies the data clock j to the read/write control terminal of any one of the 18 main scanning lines of the line memory 68 and puts the memory of that main scanning line into a write state. The other main scanning line memories are in a read state. N-8 selector 7
1 and N selector 72 and N+8 selector 73 (d) selects any one output data terminal of the 18 main scanning lines of line memory 68 and outputs it as N-8 data k, N data no, and N+8 data m .

ライトセレクタ70及びN−sセレクタ71及びNセレ
クタ72及びN+8セレクタ73は位相信号gにより制
御されるセレクタコントローラ74により−第2表で示
すように、Mを整数とした時の主走査ライン番号に対し
、各セレクタの記号で示されるラインメモリ68内のそ
れぞれの主走査ライン全選択する。
The write selector 70, the N-s selector 71, the N selector 72, and the N+8 selector 73 are controlled by a selector controller 74 controlled by a phase signal g. On the other hand, all main scanning lines in the line memory 68 indicated by the symbol of each selector are selected.

この実施例によれば、全てのデータがラインメモリ68
を経由しており、同一形式のセレクタにより3つのデー
タの出力制御ができるので、メモリ部3oの構成が整然
となる。
According to this embodiment, all data is stored in the line memory 68.
Since the output of the three data can be controlled by the same type of selector, the configuration of the memory section 3o becomes orderly.

発明の詳細 な説明したように本発明は、単一の読み取り光学系で画
像音読み取り+ A/D変換器で量子化し−さらに走査
に同期して選択されたラインメモリに記憶し、所定の順
序で読み出し、所定の遅延を施した画像信号を輪郭強調
演算する構成により複雑な光学系の簡略化及び安定で鮮
鋭な画像信号を得る事ができ、安価な画像信号処理装置
を実現する事ができる。
DETAILED DESCRIPTION OF THE INVENTION As described above, the present invention reads image sound using a single reading optical system, quantizes it using an A/D converter, stores it in a selected line memory in synchronization with scanning, and stores it in a predetermined order. By using a configuration that performs contour enhancement calculations on the image signal read out with a predetermined delay, it is possible to simplify the complicated optical system, obtain a stable and sharp image signal, and realize an inexpensive image signal processing device. .

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は従来の画像信号処理装置の概略構成図、第2図
は従来の画像信号処理装置の出力信号の波形図、第3図
は本発明の一実施例を示す画像信号処理装置の概略構成
図、第4図は同実施例の主な信号のタイミングチャート
、第5図はメモリ部の詳細構成図、第6図は演算部の詳
細構成図、第7図は走査窓の構成図、第8図は本発明の
他の実施例におけるメモリの詳細を示す図である。 1.16・・・・・・ドラム、2,16・・・・・・原
稿、3.32°゛°゛°光源−4,5,23,24・・
・・・ル′ンズ、6・・・・・・ハーフミラ−17,8
,25°゛°°°アパチヤ、9.11.26・・・・・
・光電変換器、10,12.27・・・・・・アンプ、
14・・・・・・演算器−13,32・・・・・・定数
設定パネル、17・・・・・・駆動モータ、18・・・
・・・きざみの入った円板、19・・・・・・位相信号
発生器、2o・・・・・・副走査移動台、21・・・・
・・副走査駆動部、28・・・・・・A/D変換器、 
29・・・・・・サンプリングパルス発生器、30・・
・・・・メモリ部、31・・・・・・演算部、33.6
8・・・・・・ラインメモリ、34,69°°°゛°。 アドレスカウンタ35.40.43.46.55・・・
・°・ラッチ、36.70・・・・・・ライトセレクタ
、37.71・・・・・・N+8セレクタ、38.72
・・・・・・Hセレクタ、39.74°°・・・・セレ
クタコントローラ、41 、42゜44、45.47.
48・・・・・・8画素シフトレジスター49.53・
・・・・・加算器、60・・・・・・3ビツトシフタ。 61・・・・・・減算器、52・・・・・・掛算器、5
4・・・・・・遅延回路、56・・・・・・主走査方向
、67・・・・・・副走査方向、5B、59,60,6
1.62,63,64.6666・・・・・・画素、6
7・・・・・・走査窓、73・・・・・・N+8セレク
タ。 第2図 敏   −゛〜、−X ′″′ − ト ぶン ミノ(=
FIG. 1 is a schematic configuration diagram of a conventional image signal processing device, FIG. 2 is a waveform diagram of an output signal of the conventional image signal processing device, and FIG. 3 is a schematic diagram of an image signal processing device showing an embodiment of the present invention. 4 is a timing chart of the main signals of the same embodiment, FIG. 5 is a detailed configuration diagram of the memory section, FIG. 6 is a detailed configuration diagram of the calculation section, FIG. 7 is a configuration diagram of the scanning window, FIG. 8 is a diagram showing details of a memory in another embodiment of the present invention. 1.16...Drum, 2,16...Manuscript, 3.32°゛°゛°Light source -4, 5, 23, 24...
... Runes, 6 ... Half mirror - 17, 8
, 25°゛°°° Apatya, 9.11.26...
・Photoelectric converter, 10, 12.27...Amplifier,
14... Arithmetic unit-13, 32... Constant setting panel, 17... Drive motor, 18...
...Knurled disc, 19...Phase signal generator, 2o...Sub-scanning moving table, 21...
... Sub-scanning drive unit, 28... A/D converter,
29... Sampling pulse generator, 30...
...Memory section, 31...Arithmetic section, 33.6
8...Line memory, 34,69°°°゛°. Address counter 35.40.43.46.55...
・°・Latch, 36.70...Write selector, 37.71...N+8 selector, 38.72
...H selector, 39.74°...Selector controller, 41, 42°44, 45.47.
48...8 pixel shift register 49.53.
...Adder, 60...3 bit shifter. 61... Subtractor, 52... Multiplier, 5
4... Delay circuit, 56... Main scanning direction, 67... Sub-scanning direction, 5B, 59, 60, 6
1.62,63,64.6666...pixels, 6
7...Scanning window, 73...N+8 selector. Figure 2 Min −゛~, −X ′″′ − Tobun Mino (=

Claims (3)

【特許請求の範囲】[Claims] (1)中間調を含む画像を光学的に走査して各走査ごと
に電気信号を発生する第1の手段と、前記走査と同期し
て読み取り周波数を有するサンプリングパルスを発生す
る第2の手段と、前記サンプリングパルスに同期して前
記電気信号を量子化し、サンプリングデータに変換する
第3の手段と複数のライン番号を有するラインメモリに
所定の順序で前記サンプリングデータを記憶する第4の
手段と、前記ラインメモリから所定のライン番号順に前
記サンプリングデータを読み出す第5の手段と、前記サ
ンプリングデータを前記第5の手段と同期して出力する
第6の手段と、前記第5の手段及び前記第6の手段より
得られた複数の画像信号を所定のクロック周期だけ遅延
させる第7の手段と、所定の輪郭強調定数を設定する第
8の手段と、前記第7の手段により遅延された複数の画
像信号と前記第8の手段により設定された輪郭強調定数
とにより輪郭強調演算をする第9の手段と、前記第9の
手段の演算結果を出力する第10の手段とを具備した事
を特徴とする画像信号処理装置。
(1) A first means for optically scanning an image including halftones and generating an electrical signal for each scan, and a second means for generating a sampling pulse having a reading frequency in synchronization with the scanning. , a third means for quantizing the electrical signal in synchronization with the sampling pulse and converting it into sampling data; and a fourth means for storing the sampling data in a predetermined order in a line memory having a plurality of line numbers; a fifth means for reading the sampling data from the line memory in the order of predetermined line numbers; a sixth means for outputting the sampling data in synchronization with the fifth means; the fifth means and the sixth means; a seventh means for delaying the plurality of image signals obtained by the means by a predetermined clock cycle; an eighth means for setting a predetermined contour enhancement constant; and a plurality of images delayed by the seventh means. It is characterized by comprising a ninth means for performing an edge enhancement calculation using the signal and the edge enhancement constant set by the eighth means, and a tenth means for outputting the calculation result of the ninth means. image signal processing device.
(2)  ラインメモリが1から17のライン番号を有
し、第4の手段はライン番号1.2.3.4.5.6゜
7、8.9.10.11.12.13.14.15.1
6.17の順に繰返してサンプリングデータを記憶し、
第5の手段は第1及び第2の読み出し手段を有し、前記
第1の読み出し手段は前記ラインメモリからライン番号
2.3.4.5.6.7.8.9.10゜11.12,
13,14,15,16,17.1の順に繰返して読み
出し、前記第2の読み出し手段は前記ラインメモリから
ライン番号10,11,12,13゜14.15,16
,17,1,2,3,4,5,6,7,8,9゜の順に
繰返して読み出し、第7の手段は、前記第6の手段と第
6の手段により得られた3種の各画像信号を前記サンプ
リングデータと同期したデータクロックの1周期及び9
周期及び17周期だけ遅延させるものであり、前記第1
の読み出し手段及び前記第7の手段による遅延を施した
画像信号の値をそれぞれDl及びD2及びD3とし、前
記第2の読み出し手段及び前記第7の手段による遅延を
施した画像信号の値をそれぞれD4及びD5及びD6と
し、前記第6の手段及び前記第7の手段による遅延を施
した画像信号の値をそれぞれD7及びD8及びD9とし
、輪郭強調定数の値をKとした時、第9の手段は、D 
5 +K x (D 5 1/8X(DI+D2+’D
3D4+D6+D了十D8+D9)) なる演算をする
ものである事を特徴とする特許請求の範囲第1項記載の
画像信号処理装置。
(2) The line memory has line numbers from 1 to 17, and the fourth means has line numbers 1.2.3.4.5.6°7, 8.9.10.11.12.13.14 .15.1
6.Repeat the order of 17 to store the sampling data,
The fifth means has first and second reading means, and the first reading means reads line numbers 2.3.4.5.6.7.8.9.10°11. 12,
13, 14, 15, 16, 17.1, and the second reading means reads line numbers 10, 11, 12, 13, 14, 15, 16 from the line memory.
, 17, 1, 2, 3, 4, 5, 6, 7, 8, 9 degrees, and the seventh means reads out the three types obtained by the sixth means and the sixth means. One cycle and nine cycles of a data clock synchronizing each image signal with the sampling data.
and 17 periods, and the first
The values of the image signals delayed by the reading means and the seventh means are respectively Dl, D2 and D3, and the values of the image signals delayed by the second reading means and the seventh means are respectively D4, D5, and D6, the values of the image signals delayed by the sixth means and the seventh means are D7, D8, and D9, respectively, and the value of the edge enhancement constant is K, then the ninth The means is D
5 +K x (D 5 1/8X(DI+D2+'D
The image signal processing device according to claim 1, characterized in that the image signal processing device performs the following calculation.
(3)中間調を含む画像全光学的に走査して各走査ごと
に電気信号を発生する第1の手段と、前記走査と同期し
て読み取り周波数を有するサンプリングパルスを発生す
る第2の手段と、前記サンプリングパルスに同期して前
記電気信号を量子化し、サンプリングデータに変換する
第3の手段と、複数のライン番号を有するラインメモリ
に所定の順序で前記サンプリングデータを記憶する第4
の手段と、前記ラインメモリから所定のライン番号順に
前記サンプリングデータを読み出す第5の手段と、前記
第6の手段により得られた複数の画像信号をそれぞれ所
定のクロック周期だけ遅延させる第6の手段と、所定の
輪郭強調定数を設定する第7の手段と、前記第6の手段
により遅延された複数の画像信号と前記第7の手段によ
り設定された前記輪郭強調定数とにより輪郭強調演算を
する第8の手段と、前記第8の手段の演算結果を出力す
る第9の手段とを具備した事を特徴とする画像信号処理
装置。
(3) a first means for fully optically scanning an image including halftones and generating an electrical signal for each scan; and a second means for generating a sampling pulse having a reading frequency in synchronization with the scanning. , a third means for quantizing the electrical signal in synchronization with the sampling pulse and converting it into sampling data; and a fourth means for storing the sampling data in a predetermined order in a line memory having a plurality of line numbers.
a fifth means for reading the sampling data from the line memory in the order of a predetermined line number; and a sixth means for delaying each of the plurality of image signals obtained by the sixth means by a predetermined clock period. and seventh means for setting a predetermined contour enhancement constant, and performing contour enhancement calculation using the plurality of image signals delayed by the sixth means and the contour enhancement constant set by the seventh means. An image signal processing device comprising: an eighth means; and a ninth means for outputting a calculation result of the eighth means.
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GB08322128A GB2127646B (en) 1982-08-18 1983-08-17 Image processor
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JPS59141871A (en) * 1983-02-02 1984-08-14 Dainippon Screen Mfg Co Ltd Sharpness emphasizing method in picture scanning and recording mode
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