JPS5972036U - 多重化デイジタル入力回路 - Google Patents

多重化デイジタル入力回路

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Publication number
JPS5972036U
JPS5972036U JP16628482U JP16628482U JPS5972036U JP S5972036 U JPS5972036 U JP S5972036U JP 16628482 U JP16628482 U JP 16628482U JP 16628482 U JP16628482 U JP 16628482U JP S5972036 U JPS5972036 U JP S5972036U
Authority
JP
Japan
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photocouplers
digital input
series
circuit
input circuit
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Pending
Application number
JP16628482U
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English (en)
Inventor
猪狩 邦之
橋本 忠彦
長山 哲也
Original Assignee
株式会社日立製作所
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第1図は従来の多重化ディジタル入力回路図、第2図、
第3図はそれぞれ本考案の多重化ディジタル入力回路の
異なる実施例の回路図である。 R・・・抵抗器、PC・・・フォトカップラ、BUF・
・・バッファ、A・・・定電流回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. プロセスからのディジタル入力信号を処理装置や制御装
    置に取り込むために、フォトカップラを用いてレベル変
    換を行なうディジタル入力回路において、複数個のフォ
    トカップラの発光ダイオード側を直列に接続し、該フォ
    トカップラ各々の発光ダイオードのアノード・カソード
    間に並列に抵抗を設け、該フォトカップラ受光トランジ
    スタ側を並列に接続して多重化を構成し、さらに複数個
    直列接続したフォトカップラの電流供給源として定電流
    回路を直列に接続する事により、1個又は数個のフォト
    カップラが故障しても直列に接続されている他のフォト
    カップラは影響を受けず、正常動作する事を特徴とする
    多重化ディジタル入力 ・回路。
JP16628482U 1982-11-04 1982-11-04 多重化デイジタル入力回路 Pending JPS5972036U (ja)

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JPS5972036U true JPS5972036U (ja) 1984-05-16

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ID=30364074

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