JPS5960794U - カウンタリセツト回路 - Google Patents

カウンタリセツト回路

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Publication number
JPS5960794U
JPS5960794U JP15507282U JP15507282U JPS5960794U JP S5960794 U JPS5960794 U JP S5960794U JP 15507282 U JP15507282 U JP 15507282U JP 15507282 U JP15507282 U JP 15507282U JP S5960794 U JPS5960794 U JP S5960794U
Authority
JP
Japan
Prior art keywords
counter
recording
control signal
microprocessor
timer
Prior art date
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Pending
Application number
JP15507282U
Other languages
English (en)
Inventor
洋司 三上
Original Assignee
株式会社日立製作所
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Filing date
Publication date
Application filed by 株式会社日立製作所 filed Critical 株式会社日立製作所
Priority to JP15507282U priority Critical patent/JPS5960794U/ja
Publication of JPS5960794U publication Critical patent/JPS5960794U/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来のカウンタリセット回路の一例を示すブロ
ック図、第２図は本考案のカウンタリセット回路の一実
施例を示す回路図である。 １・・・タイマ制御用マイクロプロセッサ、２・・・カ
ウンタ制御用マイクロプロセッサ、３・・・メモリスト
ップスイッチ、４・・・コンデンサ、５−・・抵抗、６
．７・・・ダイオード、８・・・システム制御用マイク
ロプロセッサ。

Claims (1)

    【実用新案登録請求の範囲】
  1. タイマ録画期間中録画制御信号を出力するタイマ制御用
    マイクロプロセッサと、前記録画制御信゛　　　号を取
    込み、この録画制御信号入力期間中タイマ録画を行なう
    様に動作するシステム制御用マイクロプロセッサと、少
    なくともパルス信号によりカウンタがリセットされ、か
    つ前記システム制御用マイクロプロセッサからのカウン
    タ制御信号を受けて前記タイマ録画期間中ビデオテープ
    走行量をカウントする前記カウンタを有するカウンタ制
    御用マイクロプロセッサと、゛前記タイマ制御用マイク
    ロプロセッサからの録画制御信号を入力し、この録画制
    御信号の前端でパルス信号を発生して、これを前記カウ
    ンタ制御用マイクロプロセッサに供給することにより、
    前記カウンタをリセットする回路手段とを具備したこと
    を特徴とするカウンタリセット回路。
JP15507282U 1982-10-15 1982-10-15 カウンタリセツト回路 Pending JPS5960794U (ja)

Priority Applications (1)

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JP15507282U JPS5960794U (ja) 1982-10-15 1982-10-15 カウンタリセツト回路

Applications Claiming Priority (1)

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JP15507282U JPS5960794U (ja) 1982-10-15 1982-10-15 カウンタリセツト回路

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Publication Number Publication Date
JPS5960794U true JPS5960794U (ja) 1984-04-20

Family

ID=30342589

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Application Number Title Priority Date Filing Date
JP15507282U Pending JPS5960794U (ja) 1982-10-15 1982-10-15 カウンタリセツト回路

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JP (1) JPS5960794U (ja)

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