JPS5953890A - Tone display system for el display - Google Patents

Tone display system for el display

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Publication number
JPS5953890A
JPS5953890A JP16546082A JP16546082A JPS5953890A JP S5953890 A JPS5953890 A JP S5953890A JP 16546082 A JP16546082 A JP 16546082A JP 16546082 A JP16546082 A JP 16546082A JP S5953890 A JPS5953890 A JP S5953890A
Authority
JP
Japan
Prior art keywords
display
capacitor
data
transistor
signal
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP16546082A
Other languages
Japanese (ja)
Inventor
権藤 浩之
高原 和博
沖 賢一
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Filing date
Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
Priority to JP16546082A priority Critical patent/JPS5953890A/en
Publication of JPS5953890A publication Critical patent/JPS5953890A/en
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.

Description

【発明の詳細な説明】 (a)  発明の分野 この発明はEL、(エレクトロ・ルミネッセンス)型の
表示素子をマ) IJクス状に配列してなる表示装置に
おける階調表示方式f関する。
DETAILED DESCRIPTION OF THE INVENTION (a) Field of the Invention The present invention relates to a gradation display method f in a display device in which EL (electroluminescence) type display elements are arranged in a matrix.

(L))技術の庁景と従来技術 +bL表示素子をマトリクス状に配列し、かつ各素子を
順次走査し、その走査と同期して表示すべき情報を与え
る表示方式では、EL表示素子自体に充分な記憶能力が
ないために情報を貯えるための何らかの工夫を施さなけ
ればならない。そのため従来より所1112Tr−IC
回路方式が提案されている。この方式は情報をコンデン
サの電圧として貯えるものであり、各画素対応に素子駆
動用のトランジスタとアドレス選択用のトランジスタお
よびデータ蓄積用のコンデンサを設けたものである。
(L)) Technical background and prior art+bL In a display system in which display elements are arranged in a matrix, each element is sequentially scanned, and information to be displayed is provided in synchronization with the scanning, the EL display elements themselves Because they do not have sufficient memory capacity, they must find some way to store information. Therefore, conventionally 1112Tr-IC
A circuit scheme has been proposed. This method stores information as a voltage on a capacitor, and each pixel is provided with a transistor for driving an element, a transistor for selecting an address, and a capacitor for storing data.

第1図にこの2Tr=IC回路方式のEL表示装置を示
す。第1図において複数個の画素は縦方向にm個、横方
向にn個マトリクヌ状に配列されている。各画素はEL
表示素子ELljを有し、それを表示制御するための2
個のヌイツチングトランジスタA、Qij、DΔ−jお
よびデータ蓄積用コンデンサCijを備えている。すな
わち、例えば1行1列目の画素は表示素子ELIl、素
子駆動用のトヲンジヌタDll、データ選択用のトラン
ジスタAQ 11 *データ蓄積用のコンテ゛ンサC1
lよりなる。
FIG. 1 shows this 2Tr=IC circuit type EL display device. In FIG. 1, a plurality of pixels are arranged in a matrix of m pixels in the vertical direction and n pixels in the horizontal direction. Each pixel is EL
2 for controlling the display of the display element ELlj.
It is provided with a number of biting transistors A, Qij, DΔ-j and a data storage capacitor Cij. That is, for example, the pixel in the first row and first column is a display element ELIl, a transistor Dll for driving the element, a transistor AQ11 for data selection, and a capacitor C1 for data storage.
Consists of l.

各々データ選択用トランジスタAQ、ijのゲート端子
はその行に対応するアドレス選択用の1−ランジスタQ
1〜Qmのエミッタ端子に共通に接続され、一方、その
ドレイン端子はその列に対応するデーpfL り線])l−E’nのそれぞれに共通に接続さfする。
The gate terminals of the data selection transistors AQ and ij are connected to the 1-transistor Q for address selection corresponding to that row.
It is commonly connected to the emitter terminals of 1 to Qm, while its drain terminal is commonly connected to each of the data lines corresponding to that column.

アドレス選択用のトランジスタQi’−Qmの各ペース
には走査制御回路SCNの出力線であるスキャン端子S
01〜SCm が接続されている。走査制御回路SON
はシフトレジスタより構成すれ、シフト)5vスSFT
が1個入力するたびに、スキャン端並列にデータを出力
する。
Each pace of the transistors Qi'-Qm for address selection has a scan terminal S, which is an output line of the scan control circuit SCN.
01 to SCm are connected. Scan control circuit SON
is composed of a shift register (shift) 5vs SFT
Each time one is input, data is output in parallel at the scan end.

次に、表示動作を簡単に説明する。Next, the display operation will be briefly explained.

シフトパルスSFTに同期して走査制御回路SONの各
スキャン端子S01〜SCmがらは順次スキャンハフレ
スが出力さ九る。今、スキャン端子SC1からヌキャン
パルヌが出力された時点を考えるに、7FL/ス選択用
のトランジスタQ、II″iオンとなり、第1行のデー
タ選択用のトランジスタAQ+1−AQ、tnのゲート
端子はゞH′となる。このヌーキャンパルスと同期して
ストローブ信号STBが入力し、各データ線D】〜Dn
よりデータを出力する。データ線D1〜Dnの出力が1
′にセットされたデータ選択用のトランジスタA(Il
l、ljのみが、アドレス選択用のトランジスタQ、1
.データ選択用のトランジスタAQ1jを介して対応す
るコンデンサC1j?、47充電する。この充電電位は
駆動用トランジスタI)ljのスレシホールドレベルよ
りも高く設定され、その放電時定数は走査周期lフレヘ
ムよシも長く設定される。コンデンサC1jの充電によ
り駆動用トランジスタDijがオンとなり、表示素子E
L1jを駆動する。尚、各表示素子ELi jの一方の
端子はパルス発振器に接続され、この発振器±100〜
200(V)のパlレス信号が印加されている。以上の
ようにしてスキャン端子SCiが11′となった画素の
うちデータ線DI−Dnが′″l′とされた画素に対応
するコンデンサCijが充電され、対応する表示素子E
LL jが点灯する。
In synchronization with the shift pulse SFT, each scan terminal S01 to SCm of the scan control circuit SON sequentially outputs a scan signal. Now, considering the point in time when the null signal is output from the scan terminal SC1, the transistor Q, II''i for selecting 7FL/s is turned on, and the gate terminal of the transistor AQ+1-AQ, tn for selecting data in the first row is The strobe signal STB is input in synchronization with this Nucan pulse, and each data line D] to Dn
Output more data. The output of data lines D1 to Dn is 1
' The data selection transistor A (Il
Only l and lj are transistors Q and 1 for address selection.
.. The corresponding capacitor C1j? via the data selection transistor AQ1j? , 47 charges. This charging potential is set higher than the threshold level of the driving transistor I)lj, and its discharge time constant is set longer than the scanning period l frame. Charging of the capacitor C1j turns on the driving transistor Dij, and the display element E
Drive L1j. Note that one terminal of each display element ELi j is connected to a pulse oscillator, and this oscillator has a ±100 to
A pulse pulse signal of 200 (V) is applied. As described above, among the pixels whose scan terminal SCi is set to 11', the capacitor Cij corresponding to the pixel whose data line DI-Dn is set to ``1'' is charged, and the corresponding display element E is charged.
LL j lights up.

さて、このような表示装置における各表示素子の状態を
見ると、データ蓄積用のコンデンサが充電されその充w
L電位がスレシホールドレベルを越えると素子は点灯す
る。そしてコンデンサが徐々に放電しその電位が前記レ
ベルより降下すると素子は非点灯となる。すなわち、素
子は点灯と非点灯の2状態であり、かつ点灯状態におけ
る素子の発光輝度は一定であるから、画像を階調表示す
ることはできなかった。
Now, if we look at the state of each display element in such a display device, we can see that the capacitor for data storage is charged and its charge w.
When the L potential exceeds the threshold level, the element lights up. Then, when the capacitor gradually discharges and its potential drops below the above-mentioned level, the element becomes non-lit. That is, since the element has two states, lit and non-lit, and the luminance of the element in the lit state is constant, it was not possible to display images in gradations.

(C)発明の目的と構成 この発明はFiL型表示装置において、画像の階調表示
を可能にすることを目的としたものである。
(C) Object and Structure of the Invention The object of the invention is to enable gradation display of images in an FiL type display device.

階調制御には単位時間内における表示素子の発光時間と
非発光時間の割合を輝度情報に応じて変化するもの1表
示素子の発光輝度を輝度情報によって変化するものが考
えらjするが、本発明は前者の制御方式をベースとして
いる。すなわち、本発明はEL型表示装置が表示素子に
対応するようにデータ蓄積用のコンデンサを有している
点に注目し、このコンデンサに充電される電位を輝度情
報によって変化させることによって、単位時間に対する
点灯時間と非点灯時間の割合を変え、もって画像を階調
表示可能としたものである。
Gradation control may include changing the ratio of light emitting time and non-light emitting time of a display element within a unit time according to brightness information.1 Changing the light emitting brightness of a display element depending on brightness information, but this method The invention is based on the former control method. That is, the present invention focuses on the fact that an EL display device has a data storage capacitor corresponding to the display element, and by changing the potential charged in this capacitor based on luminance information, By changing the ratio of lighting time to non-lighting time, images can be displayed in gradations.

(2))発明の実施例 以下図面に沿って本発明による階調表示方式を詳細に説
明する、 第2図は表示装置’を構成する1つの画素に対応する制
御回路を示し、第3図はこの回路の主要部における信号
波形を示す。トランジスタ’rrl 、 T172デー
タ蓄積用のコンデンサCs、表示素子EL、々どの接続
状態は従来のそれと変わらないが、トランジスタl1l
r1の前段に輝得セレクト回路SELが設けられている
。この輝度セレクト回路SELの入力は画像に対応した
輝度情報J) Bでありその出力はデータ信号DAであ
りトランジスタTrlのドレイン端子に接続されている
。この輝度セレクト回路SELは以下の機能を果たす。
(2)) Embodiments of the Invention The gradation display method according to the present invention will be explained in detail below with reference to the drawings. shows the signal waveform in the main part of this circuit. The connection status of the transistor 'rrl, T172 data storage capacitor Cs, display element EL, etc. is the same as that of the conventional one, but the transistor l1l
A gain select circuit SEL is provided before r1. The input of this brightness select circuit SEL is brightness information J)B corresponding to the image, and its output is a data signal DA, which is connected to the drain terminal of the transistor Trl. This brightness select circuit SEL performs the following functions.

すなわち、輝度情報DBの値を判定し、その鎖に応じた
電圧値をもったデータ信号DAを送出する機能を有する
That is, it has a function of determining the value of the brightness information DB and sending out a data signal DA having a voltage value corresponding to the chain.

例えば輝度情報DBが2ビツト構成とすると第8図(b
)、 ((!1. ((1)に示すようなデータ信号D
A1〜DA3をその値に応じて出力する。データ信号D
Al〜DA3 17)i正値” 1〜V 3ハV 1 
< ’V 2 (V 3 )関fK設定されている。
For example, if the luminance information DB has a 2-bit configuration, FIG.
), ((!1. (Data signal D as shown in (1)
A1 to DA3 are output according to their values. data signal D
Al~DA3 17) i positive value” 1~V 3haV 1
<'V 2 (V 3 ) function fK is set.

トヲンジスタ1′r】のゲート端子には走査信′号Se
 A N (第3図(8,) i 参照)が所定の周期
で印加される。この走査信号SCΔNが到来するたびに
トクンジスクTr1は導通となり、コンデンサORは光
重;されるが(た光し、走査信号5CANが到来しても
データ信号DAがない場@−はコンデンサC8の充電は
行々わilないことは勿論である)、このコンデンサC
6に充電される電位はデータ信号りへの電圧値によって
変化する。具体的にはデータ信号DAがDAIすなわち
電圧端が■】の場合に(は充電電位はElとなり、DA
2の場合には充電電位はF;2(E2>El)となり、
DA3の場合には躬3(E3>E2)となる(第8図(
’El) 、(f) 、’F)然照)、コンデンサCG
の放電にともなう、コンデンサC3の電位とトフンジヌ
タqTr2のスレシホールド電圧との関係を見ると、当
然のことではあるがいずれの場合にも放電時定数は同じ
であるから、コンデンサC8の電位がスレシホーlレド
電圧に到達する時間は異なる。すなわち、充電電位がE
lの場合はtl、E2の場合はj 2 + E 3の場
合はtsとなる。(tx<tg<t a ) コt7J
FRjnfJ tt 、tg、 tsの間トランジスタ
Tr2は導通状態となるため、表示素子ELには第3図
(ロ)、 (i)、 (j)の如き電圧波形がその両端
に印加され表示素子ELは発光を行なう。よって、デー
タ信号DAがDAIの場合は走査信号5CAN1周期の
うちtlのみ発光状態とされ、DAzの場合にはtgの
み発光状態とされ、そしてDA2の場合にはtsのみ発
光状態とされる。このように画像に対応した輝度情報に
応じて所定の時間内における点灯時間と非点灯時間との
比を制御し、もって画像の階調表示が可能をなる。
A scanning signal Se is applied to the gate terminal of the transistor 1'r.
A N (see FIG. 3 (8,) i) is applied at a predetermined period. Every time this scanning signal SCΔN arrives, the control circuit Tr1 becomes conductive, and the capacitor OR is light-loaded. Of course, this capacitor C
The potential charged to 6 changes depending on the voltage value applied to the data signal. Specifically, when the data signal DA is DAI, that is, the voltage terminal is
In the case of 2, the charging potential becomes F;2 (E2>El),
In the case of DA3, it becomes 3 (E3>E2) (Figure 8 (
'El) , (f) , 'F)Zanzhou), capacitor CG
When we look at the relationship between the potential of capacitor C3 and the threshold voltage of qTr2 as it discharges, we see that since the discharge time constant is the same in both cases, the potential of capacitor C8 becomes the threshold voltage. The time to reach the lred voltage is different. That is, the charging potential is E
In the case of l, it becomes tl, and in the case of E2, it becomes ts in the case of j 2 + E 3. (tx<tg<t a ) Kot7J
Since the transistor Tr2 is in a conductive state during FRjnfJ tt, tg, and ts, voltage waveforms as shown in FIG. Emits light. Therefore, when the data signal DA is DAI, only tl of one period of the scanning signal 5CAN is in the light emitting state, in the case of DAz, only tg is in the light emitting state, and in the case of DA2, only ts is in the light emitting state. In this way, the ratio between the lighting time and the non-lighting time within a predetermined time is controlled according to the brightness information corresponding to the image, thereby making it possible to display the image in gradations.

尚、上記実施例はデータ信号DA(7)電圧mを輝度情
報によって変化し、結果としてデータ蓄積用ノコンデン
サの充電電位を制御する例について述べたが、データ信
号の電圧値は一定として、その時間幅を輝度情報によっ
て変化してもよい。また、データ信号DAを変化するこ
となく、走査信号5CAHの電圧値あるいは時間幅を輝
度情報によって変化してもよい。ただし、各信号の時間
幅によって充電電位を制御する場合には互いに相手とな
る信号の時間幅を考慮する必要がある。
In the above embodiment, the voltage m of the data signal DA(7) is changed depending on the luminance information, and as a result, the charging potential of the data storage capacitor is controlled. However, assuming that the voltage value of the data signal is constant, The time width may be changed depending on the luminance information. Furthermore, the voltage value or time width of the scanning signal 5CAH may be changed depending on the luminance information without changing the data signal DA. However, when controlling the charging potential based on the time width of each signal, it is necessary to consider the time widths of the opposing signals.

(e)  発明の詳細 な説明したように本発明によJlば本来ト:■」表示装
置に必要とされるデータ蓄積用のコンデンサを利用し、
その充電電位を輝度情報に応じて変化したものであるか
ら、i?1′;成1瀘1[にすることなくF:L種表示
装置においても階調表示を行なうことが可能となる。
(e) As described in detail, the present invention utilizes a data storage capacitor required for a display device;
Since the charging potential is changed according to the luminance information, i? It becomes possible to perform gradation display even in the F:L type display device without using 1';

【図面の簡単な説明】[Brief explanation of drawings]

第1図は従来のEL表示装置を示す回路図、第2図、第
3図は本発明に係り、第2図は1つの画素を構成する制
御回路、第3図は第2図における主要部の波形を示すフ
ローチャートである。 図中、DBは輝度情報、SELは輝度セレクト回路、D
A、 DAl、 DA2. D113はデータ信号、5
CANは走査信号、ELは表示素子、esはデータ蓄積
用のコンデンサを示す。
FIG. 1 is a circuit diagram showing a conventional EL display device, FIGS. 2 and 3 are related to the present invention, FIG. 2 is a control circuit constituting one pixel, and FIG. 3 is a main part in FIG. 2. 2 is a flowchart showing waveforms of FIG. In the figure, DB is brightness information, SEL is brightness select circuit, D
A, DAl, DA2. D113 is a data signal, 5
CAN is a scanning signal, EL is a display element, and es is a data storage capacitor.

Claims (1)

【特許請求の範囲】[Claims] マ) IJクヌ状に配列さiまたY12L型表示累子の
そhぞれに対応するようにデータ蓄積用のコンデンサを
有する表示装置において、表示すべき画像に対応する輝
度情報によって前記データ蓄積用のコンデンサにおける
充電電位を変化したことを特徴とするEL型表示装置に
おける階調表示方式。
M) In a display device having capacitors for data storage arranged in an IJ-shaped configuration and corresponding to each of Y12L type display elements, the data storage is A gradation display method in an EL display device characterized by changing the charging potential of a capacitor.
JP16546082A 1982-09-21 1982-09-21 Tone display system for el display Pending JPS5953890A (en)

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH04161984A (en) * 1990-10-26 1992-06-05 Opt Tec Corp Large-sized picture display board system having multiple gray level
JP2006301450A (en) * 2005-04-22 2006-11-02 Sharp Corp Light emission device and display device

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