JPS5953402U - 一次遅れ演算回路 - Google Patents
一次遅れ演算回路Info
- Publication number
- JPS5953402U JPS5953402U JP14824182U JP14824182U JPS5953402U JP S5953402 U JPS5953402 U JP S5953402U JP 14824182 U JP14824182 U JP 14824182U JP 14824182 U JP14824182 U JP 14824182U JP S5953402 U JPS5953402 U JP S5953402U
- Authority
- JP
- Japan
- Prior art keywords
- input terminal
- signal
- input
- external setting
- order delay
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Landscapes
- Feedback Control In General (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第1図はボイラの給水制御系を示す図、第2図は第1図
に示またボイラ給水制御系の制御回路の構成を示すブロ
ック図、第3図a、 bは第2図に示した制御回路に
よる第1図のボイラ給水制御系のポンプスピード特性、
及び弁差圧特性を示す図、第4図は他の制御回路の一部
の構成を示すブロック図、第5図a、 bは第4図に
示す制御回路による第1図のボイラ給水制御系のポンプ
スピード特性、及び弁差圧特性を示す図、第6図はこの
考案を説明するのに参考的に示す他の一次遅れ演算回路
のブロック図、第7図はこの考案に使用される初期値外
部設定形積分器を示す図、第8図a、 bはこの考案
の一実施例を示す一次遅れ演算回路の接続図、及び−次
遅れ動作時のブロック線図、第9図a、 bは第8図
aの回路を第2図の制御回路に使用した場合のボイラ給
水制御系のポンプスピード特性及び弁差圧特性を示す図
である。 12:初期値外部設定形積分器、El・E2:入力信号
、Ext、外部設定入力信号、SE:クィック動作/−
次遅れ動作モード切換信号、X:制御入力信号、y:出
力信号。 M2図 第4図 第5図
に示またボイラ給水制御系の制御回路の構成を示すブロ
ック図、第3図a、 bは第2図に示した制御回路に
よる第1図のボイラ給水制御系のポンプスピード特性、
及び弁差圧特性を示す図、第4図は他の制御回路の一部
の構成を示すブロック図、第5図a、 bは第4図に
示す制御回路による第1図のボイラ給水制御系のポンプ
スピード特性、及び弁差圧特性を示す図、第6図はこの
考案を説明するのに参考的に示す他の一次遅れ演算回路
のブロック図、第7図はこの考案に使用される初期値外
部設定形積分器を示す図、第8図a、 bはこの考案
の一実施例を示す一次遅れ演算回路の接続図、及び−次
遅れ動作時のブロック線図、第9図a、 bは第8図
aの回路を第2図の制御回路に使用した場合のボイラ給
水制御系のポンプスピード特性及び弁差圧特性を示す図
である。 12:初期値外部設定形積分器、El・E2:入力信号
、Ext、外部設定入力信号、SE:クィック動作/−
次遅れ動作モード切換信号、X:制御入力信号、y:出
力信号。 M2図 第4図 第5図
Claims (1)
- 2入力端と、外部設定入力端と、動作モード切換信号入
力端と、出力端とを持ち、前記動作モード切換信号入力
端に第1の信号が加えられると前記外部設定入力端に加
えられる信号を初期値とし、前記2入力端に加えられる
信号の偏差を積分して出力し、前記動作モード切換信号
入力端に第2の信号が加えられると前記外部設定入力端
に加えられる信号を出力する積分器を備え、前記2入力
端の一方に制御信号を入力し、この制御入力信号を加え
る入力端と前記外部設定入力端を接続するとともに、前
記積分器の出力端を前記2入力端の他方の入力端に接続
してなることを特徴とする一次遅れ演算回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP14824182U JPS5953402U (ja) | 1982-09-29 | 1982-09-29 | 一次遅れ演算回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP14824182U JPS5953402U (ja) | 1982-09-29 | 1982-09-29 | 一次遅れ演算回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS5953402U true JPS5953402U (ja) | 1984-04-07 |
Family
ID=30329417
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP14824182U Pending JPS5953402U (ja) | 1982-09-29 | 1982-09-29 | 一次遅れ演算回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5953402U (ja) |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS50142984A (ja) * | 1974-05-02 | 1975-11-18 |
-
1982
- 1982-09-29 JP JP14824182U patent/JPS5953402U/ja active Pending
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS50142984A (ja) * | 1974-05-02 | 1975-11-18 |
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