JPS5942879B2 - automatic accompaniment device - Google Patents
automatic accompaniment deviceInfo
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- JPS5942879B2 JPS5942879B2 JP52023493A JP2349377A JPS5942879B2 JP S5942879 B2 JPS5942879 B2 JP S5942879B2 JP 52023493 A JP52023493 A JP 52023493A JP 2349377 A JP2349377 A JP 2349377A JP S5942879 B2 JPS5942879 B2 JP S5942879B2
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- Japan
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- circuit
- signal
- accompaniment
- gate
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Description
【発明の詳細な説明】
本発明は伴奏鍵盤を1鍵押しただけで所定の複数の伴奏
音が得られる自動伴奏装置に関するものである。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to an automatic accompaniment device that can produce a plurality of predetermined accompaniment tones by pressing just one key on an accompaniment keyboard.
従来、伴奏を行なう時メジヤコードならば1度、3度、
5度、セブンスならば1度、3度、5度、短7度のよう
に3鍵あるいは4鍵を押鍵しなければ完全な伴奏音が得
られなかつた。Traditionally, when playing accompaniment, major chords are 1st, 3rd,
For fifths and sevenths, complete accompaniment notes could not be obtained unless three or four keys were pressed, such as the first, third, fifth, and minor seventh.
また1鍵で伴奏可能な機種もあるが回路構成上通常2種
類のコードたとえばメジヤ、マイナを指定するのが精々
であつた。There are also models that allow accompaniment with one key, but due to the circuit configuration, it is usually best to specify two types of chords, such as major and minor.
さらに従来の自動伴奏装置では個別部品、配線数が多い
ため、大規模集積回路(LSI)化には不都合であつた
のでこれに適合した回路構成が望まれる。Furthermore, conventional automatic accompaniment devices have a large number of individual parts and wiring, which is inconvenient for large-scale integrated circuits (LSI), so a circuit configuration suitable for this is desired.
本発明の目的は伴奏鍵盤を1鍵押しただけで所定の複数
の伴奏音が得られるLSI化容易な回路構成の自動伴奏
装置を提供することである。SUMMARY OF THE INVENTION An object of the present invention is to provide an automatic accompaniment device having a circuit configuration that can be easily integrated into an LSI and which can produce a plurality of predetermined accompaniment tones by pressing only one key on an accompaniment keyboard.
前記目的を達成するため、本発明の自動伴奏装置は伴奏
鍵盤を1鍵押すことにより根音信号を出力する根音検出
回路、クロック発生器よりのクロックにより動作するカ
ウンタ、該カウンタの出力信号を設定された和音信号に
応じて選択導出する一致ゲート、該一致ゲートの出力を
別に設けたコード指定手段よりの信号により選択する選
択回路、該選択回路の出力が設定された和音と一致した
とき前記カウンタの出力を読み込み記憶する記憶回路、
前記根音検出回路の出力と前記記憶回路の出力を加算す
る加算器、および該加算器の出力を楽音信号に変換する
楽音信号変換回路を具えたことを特徴とするものである
。以下本発明を実施例につき詳述する。In order to achieve the above object, the automatic accompaniment device of the present invention includes a root note detection circuit that outputs a root note signal when one key is pressed on an accompaniment keyboard, a counter that operates with a clock from a clock generator, and an output signal of the counter. A matching gate that selects and derives the output according to a set chord signal, a selection circuit that selects the output of the matching gate based on a signal from a separately provided chord specifying means, and when the output of the selection circuit matches the set chord, A memory circuit that reads and stores the output of the counter;
The present invention is characterized by comprising an adder that adds the output of the root note detection circuit and the output of the storage circuit, and a musical tone signal conversion circuit that converts the output of the adder into a musical tone signal. The present invention will be described in detail below with reference to examples.
第1図は本発明の伴奏装置の実施例の構成を示す全体説
明図である。FIG. 1 is an overall explanatory diagram showing the configuration of an embodiment of the accompaniment device of the present invention.
同図では下鍵盤を伴奏鍵盤として用い本発明の要部であ
るコード発生回路を含んでいる。すなわち、通常の下鍵
盤の伴奏では、下鍵盤キースイッチ4のオンオフにより
開閉回路2を動作させ、音源1からの音を通過させ、ゲ
ート3、フィルタ9、増幅器10を通して出力する。次
に自動伴奏をする場合は、下鍵盤キースイッチ4の1鍵
の押鍵によつて、根音検出回路5で根音信号を検出し、
その信号を一方は自動ベース伴奏回路11に送りベース
音を発生させ、他方は本発明に係るコード発生回路に送
る。コード発生回路6では根音信号と外部からコードの
種類を指定するコード指定信号により和音信号をつくり
、その和音信号に対応した音を音源1から導く。コード
発生回路6から出力した楽音信号はリズムパルス発生器
8からのパルスによつて制御されるゲート7を通して出
力される。第2図は第1図のコード発生回路6とその関
連部分の詳細説明図である。In the figure, the lower keyboard is used as an accompaniment keyboard and includes a chord generation circuit, which is the main part of the present invention. That is, for normal accompaniment on the lower keyboard, the opening/closing circuit 2 is operated by turning the lower keyboard key switch 4 on and off, allowing the sound from the sound source 1 to pass through and output through the gate 3, filter 9, and amplifier 10. Next, when performing automatic accompaniment, the root note detection circuit 5 detects the root note signal by pressing one key of the lower keyboard key switch 4,
One of the signals is sent to the automatic bass accompaniment circuit 11 to generate a bass sound, and the other is sent to the chord generation circuit according to the present invention. The chord generation circuit 6 generates a chord signal using the root note signal and an external chord designation signal that specifies the type of chord, and a sound corresponding to the chord signal is guided from the sound source 1. The musical tone signal outputted from the chord generation circuit 6 is outputted through a gate 7 controlled by pulses from a rhythm pulse generator 8. FIG. 2 is a detailed explanatory diagram of the code generation circuit 6 of FIG. 1 and its related parts.
同図において、伴奏鍵盤として下鍵盤を用いキースイツ
チ回路21(第1図の4に相当)の1鍵の押鍵によつて
根音検出回路22(第1図の5に相当)で根音信号を検
出し、根音信号は加算器23に送られる。In the figure, the lower keyboard is used as an accompaniment keyboard, and when one key of the key switch circuit 21 (corresponding to 4 in Figure 1) is pressed, the root note detection circuit 22 (corresponding to 5 in Figure 1) generates a root note signal. is detected, and the root tone signal is sent to the adder 23.
一方クロツクにより16進カウンタ26を動作させ、こ
の16進カウンタ26の出力が一致ゲート27内の1度
、短3度、3度、4度、5度、短6度、6度、短7度用
の各ANDゲートに対応する入力条件に一致した時出力
し、これらを組合せたメジヤ(Maj)、マイナ(Mi
n),セブンス(7th)、デイミニツシユ(Dim)
,オーギユメント(Aug)用の0Rゲートのそれぞれ
の出力パルスはラインA,B,C,D,Eを通してマル
チプレタサ28に入れ、外部からのコードの種類すなわ
ち、メジヤ、マイナ、セブンス、デイミニツシユ、オー
ギユメント等のコード指定信号によつて選択される。マ
ルチプレクサ28の出力パルスはANDゲート29を介
しクロツクタイミングでラツチ回路25に送られ、その
パルスによりカウンタ26の内容が一時記憶される。次
に前述の根音検出回路22の根音信号とラツチ回路25
の内容を加算器23で加算し、この加算器23の出力を
16進−12進変換回路24、すなわちANDゲートと
0Rゲートの回路で桁上げ制御された加算回路を通して
4ビツト12進数に変換し、デコーダ30で復号化して
ラツチ回路31に記憶させる。このラツチ回路31の出
力で音名(C,C≠,・・・・・・B)のゲート32を
制御して音源から伴奏音が出力され、第1図のゲート7
に送られる。第3図aはラツチ回路31とゲート32の
1例を示し、前者はダイオードとCR時定数回路より成
り、後者はラツチ回路31の出力と各音源を入力とする
AND回路より成る。同図bはデコーダ30の復号化波
形1に対するラツチ回路31の点Aの波形2、ゲート3
2の入力音源C−B3、出力C−B4を示す動作波形図
である。以上は構成の概要を述べたが、さらに詳細な動
作を説明する。On the other hand, the hexadecimal counter 26 is operated by the clock, and the output of the hexadecimal counter 26 is the 1st, minor third, third, fourth, fifth, minor sixth, sixth, minor seventh in the coincidence gate 27. When the input conditions corresponding to each AND gate for
n), 7th, Dim
, the respective output pulses of the 0R gates for augmentation (Aug) are input to the multiplexer 28 through lines A, B, C, D, and E. Selected by code designation signal. The output pulse of multiplexer 28 is sent to latch circuit 25 via AND gate 29 at clock timing, and the content of counter 26 is temporarily stored by the pulse. Next, the root note signal of the root note detection circuit 22 and the latch circuit 25
The contents of the adder 23 are added, and the output of the adder 23 is converted into a 4-bit decimal number through a hexadecimal-decimal conversion circuit 24, that is, an addition circuit whose carry is controlled by an AND gate and an 0R gate circuit. , decoded by the decoder 30 and stored in the latch circuit 31. The output of this latch circuit 31 controls the gate 32 of the pitch name (C, C≠, . . . B) to output an accompaniment sound from the sound source, and the gate 7 of FIG.
sent to. FIG. 3a shows an example of the latch circuit 31 and gate 32, the former consisting of a diode and a CR time constant circuit, and the latter consisting of an AND circuit having the output of the latch circuit 31 and each sound source as inputs. Figure b shows the waveform 2 and gate 3 at point A of the latch circuit 31 for the decoded waveform 1 of the decoder 30.
FIG. 2 is an operation waveform diagram showing input sound source C-B3 and output C-B4 of No. 2; The outline of the configuration has been described above, and the operation will be explained in more detail.
クロツクで16進カウンタ26をカウントしその出力が
一致ゲート27の入力条件と一致した時、たとえばカウ
ンタ26の出力が「0000]の時は1え(ROOt)
のANDゲート,[0111]の時は5(のANDゲー
トの入力条件と一致した時パルスを出力してその組合せ
によりコードを示すメジヤ(Maj)、マイナ(Min
)等の0Rゲートのそれぞれの出力パルスをラインA−
Eを介してマルチプレクサ28に入れ、コード指定信号
により、ラインを選択し、この選択されたラインのパル
スはラツチ回路25に送られ、そのパルスによつてその
時のカウンタ26の出力状態がラツチ回路25に記憶さ
れる。When the hexadecimal counter 26 is counted by the clock and its output matches the input condition of the coincidence gate 27, for example, when the output of the counter 26 is "0000", it is 1 (ROOt).
AND gate, [0111] outputs a pulse when it matches the input condition of the AND gate of 5 (Maj), minor (Min), which indicates the code by the combination.
) etc., each output pulse of the 0R gate is connected to the line A-
A code designation signal is input to the multiplexer 28 via E to select a line, and the pulse of the selected line is sent to the latch circuit 25, which changes the output state of the counter 26 at that time. is memorized.
このラツチ回路25の内容は第2表に示すように度数1
度〜短7度までを4ビツト符号化したものである。これ
に対し根音検出回路22から出力される根音信号は第1
表に示すように根音C,c尋,・・・・・・Bを4ビツ
ト符号化したものである。これら第1表の根音信号と第
2表のラツチ回路25の内容を加算器23で加算され1
6進のデジタル出力が得られ、これが16進−12進変
換回路25の入力として12進のデジタル出力に変換さ
れる。第3表はこの16進一12進変換回路25の音名
による入出力表を例示したものである。以下上述の動作
を例を挙げて説明する。The contents of this latch circuit 25 are as shown in Table 2.
This is a 4-bit encoded version of degrees to minor sevenths. On the other hand, the root sound signal output from the root sound detection circuit 22 is the first root sound signal.
As shown in the table, the root sounds C, c,...B are encoded in 4 bits. These root tone signals in Table 1 and the contents of the latch circuit 25 in Table 2 are added by an adder 23 and
A hexadecimal digital output is obtained, which is input to a hexadecimal-decimal conversion circuit 25 and converted into a decimal digital output. Table 3 is an example of an input/output table of the hexadecimal to decimal conversion circuit 25 based on pitch names. The above-mentioned operation will be explained below using an example.
たとえば下鍵盤において、Fマイナ(Fmln)が押さ
れると第1表によれば根音として加算器23に「010
1」が入力する。マイナであるから、マルチプレクサ2
8ではラインBを選択しているが、そのラインBには1
度、短3度、5度の3つのANI)ゲート出力が接続さ
れているから、カウンタ26の出力が「0000j,「
0011」および「0111」の時にパルスがラツチ回
路25に与えられ、その各各のカウンタ出力「0000
」,「0011],「0111」を順にラツチ回路25
に記憶する。これらの信号が根音信号[0101」と加
算され、加算器出力「0101L「10001,「11
00」となり、これは16進数であるから12進数に変
換して「0101」,「1000」,「0000」の順
に出力することになる。この信号はすなわちF,GCの
3音(Fマイナ)にほかならない。この信号はデコーダ
30で復号化されラツチ回路31に記憶されてその出力
は各音各ゲート32を制御する。このような構成と動作
において、伴奏を行なうには伴奏鍵盤においては1鍵の
押鍵によつて根音を指定すると同時にコード指定信号は
外部から与えて前述のように複数の伴奏音が一挙に得ら
れるものである。For example, when F minor (Fmln) is pressed on the lower keyboard, according to Table 1, the root note is sent to the adder 23 as "010
1” is input. Since it is minor, multiplexer 2
8, line B is selected, but line B has 1
Since the three (ANI) gate outputs of degrees, minor thirds, and fifths are connected, the output of the counter 26 is "0000j,"
0011" and "0111", a pulse is given to the latch circuit 25, and the respective counter outputs "0000"
”, “0011], and “0111” in the latch circuit 25.
to be memorized. These signals are added to the root signal [0101], and the adder outputs "0101L"10001, "11
Since this is a hexadecimal number, it is converted to a decimal number and output in the order of "0101", "1000", and "0000". This signal is nothing but the three tones of F and GC (F minor). This signal is decoded by a decoder 30 and stored in a latch circuit 31, whose output controls each gate 32 for each tone. With this configuration and operation, to perform accompaniment, the root note is specified by pressing one key on the accompaniment keyboard, and at the same time, a chord specification signal is applied externally, so that multiple accompaniment notes are played at once as described above. That's what you get.
従来の1鍵伴奏では通常2種類のコードを指定するのが
精々であつたが、本発明では簡単な構成にもかかわらず
、メジヤ、マイナ、セブンス、デイミニツシユ、オーギ
ユメントのように多くのコードが得られ効果的な伴奏音
が得られ、操作が著しく容易となることは明らかである
。さらに回路は第2図に示すように通常の論理回路より
成り、配線の数が少なく素子数も少ないので大規模集積
回路(LSl)化にも適した小形安価な伴奏装置が実現
される。In conventional single-key accompaniments, it was usually best to specify two types of chords, but with the present invention, despite the simple structure, many chords such as major, minor, seventh, diminutive, and augment can be obtained. It is clear that an effective accompaniment sound can be obtained and the operation is significantly easier. Furthermore, as shown in FIG. 2, the circuit is comprised of a normal logic circuit, with fewer wires and fewer elements, making it possible to realize a compact and inexpensive accompaniment device suitable for large-scale integrated circuits (LSI).
第1図は本発明の伴奏装置の実施例の構成を示す説明図
、第2図は本発明の実施例の要部の詳細説明図、第3図
A,bは第2図の要部の具体回路例と動作波形図であり
、図中、1は音源、2は開閉回路、3,7はゲート、4
,21は下鍵盤キースイツチ回路、5,22は根音検出
回路、6はコード発生回路、8はリズムパルス発生器、
9はフイルタ、10は増幅器、11は自動ベース伴奏回
路、23は加算器、24は16進−12進変換回路、2
5はラツチ回路、26はカウンタ、27は一致ゲート、
28はマルチプレクサ、29はANDゲート、30はデ
コーダ、31はラツチ回路、32は音名ゲートを示す。Fig. 1 is an explanatory diagram showing the configuration of an embodiment of the accompaniment device of the present invention, Fig. 2 is a detailed explanatory diagram of the main part of the embodiment of the invention, and Figs. 3A and b are the main parts of Fig. 2. These are concrete circuit examples and operation waveform diagrams. In the figure, 1 is a sound source, 2 is an opening/closing circuit, 3 and 7 are gates, and 4
, 21 is a lower keyboard key switch circuit, 5 and 22 are root note detection circuits, 6 is a chord generation circuit, 8 is a rhythm pulse generator,
9 is a filter, 10 is an amplifier, 11 is an automatic bass accompaniment circuit, 23 is an adder, 24 is a hexadecimal-decimal conversion circuit, 2
5 is a latch circuit, 26 is a counter, 27 is a coincidence gate,
28 is a multiplexer, 29 is an AND gate, 30 is a decoder, 31 is a latch circuit, and 32 is a pitch name gate.
Claims (1)
根音検出回路、クロック発生器よりのクロックにより動
作するカウンタ、該カウンタの出力を設定された和音に
応じて選択導出する一致ゲート、該一致ゲートの出力を
別に設けたコード指定手段よりの信号により選択する選
択回路、該選択回路の出力信号が設定された和音信号と
一致したとき前記カウンタの出力を読み込み記憶する記
憶回路、前記根音検出回路の出力と前記記憶回路の出力
を加算する加算器、および該加算器の出力を楽音信号に
変換する楽音信号変換回路を具えたことを特徴とする自
動伴奏装置。1. A root note detection circuit that outputs a root note signal by pressing one key on an accompaniment keyboard, a counter operated by a clock from a clock generator, a coincidence gate that selects and derives the output of the counter according to a set chord, and a selection circuit that selects the output of the coincidence gate based on a signal from a separately provided chord designation means; a storage circuit that reads and stores the output of the counter when the output signal of the selection circuit matches a set chord signal; and the root note. An automatic accompaniment device comprising: an adder that adds the output of the detection circuit and the output of the storage circuit; and a musical tone signal conversion circuit that converts the output of the adder into a musical tone signal.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP52023493A JPS5942879B2 (en) | 1977-03-04 | 1977-03-04 | automatic accompaniment device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP52023493A JPS5942879B2 (en) | 1977-03-04 | 1977-03-04 | automatic accompaniment device |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS53108415A JPS53108415A (en) | 1978-09-21 |
JPS5942879B2 true JPS5942879B2 (en) | 1984-10-18 |
Family
ID=12112022
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP52023493A Expired JPS5942879B2 (en) | 1977-03-04 | 1977-03-04 | automatic accompaniment device |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5942879B2 (en) |
-
1977
- 1977-03-04 JP JP52023493A patent/JPS5942879B2/en not_active Expired
Also Published As
Publication number | Publication date |
---|---|
JPS53108415A (en) | 1978-09-21 |
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