JPS594098U - 入力信号の積算表示装置 - Google Patents

入力信号の積算表示装置

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JPS594098U
JPS594098U JP9511182U JP9511182U JPS594098U JP S594098 U JPS594098 U JP S594098U JP 9511182 U JP9511182 U JP 9511182U JP 9511182 U JP9511182 U JP 9511182U JP S594098 U JPS594098 U JP S594098U
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JP
Japan
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section
input signal
display device
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timer
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Pending
Application number
JP9511182U
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English (en)
Inventor
戸田　高道
Original Assignee
富士電機株式会社
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Publication date
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Priority to JP9511182U priority Critical patent/JPS594098U/ja
Publication of JPS594098U publication Critical patent/JPS594098U/ja
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  • Arrangements For Transmission Of Measured Signals (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来方式の演算表示装置のブロック線図、第２
図は本考案の一実施例である積算表示装置のブロック線
図、第３図は本考案の他の実施例である積算表示装置の
ブロック線図、第４図は本考案の別の実施例である積算
表示装置のブロック線図である。 １・・・積算部、２．　５．　９・・・表示部、３・・
・累積加算部、４・・・記憶部、６・・・タイマ。

Claims (1)

    【実用新案登録請求の範囲】
  1. 所定時限ごとに信号を送出するタイマと、このタイマか
    らの信号に基づいて入力信号の積算値をリセットし再び
    入力信号の積算を開始する積算部と、前記タイマからの
    信号に基づいて積算部の積算値を累積加算する累積加算
    部と、この累積加算部よりの累積加算値を記憶する記憶
    部と、前記積算部および記憶部の出力を表示する表示部
    とからなる入力信号の積算表示装置。
JP9511182U 1982-06-24 1982-06-24 入力信号の積算表示装置 Pending JPS594098U (ja)

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JP9511182U JPS594098U (ja) 1982-06-24 1982-06-24 入力信号の積算表示装置

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JPS594098U true JPS594098U (ja) 1984-01-11

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